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Frenos ABS (Anti Block System) en un automvil: Evita una posible perdida del control de la direccin de un automvil cuando se frena.
Actuador de freno
Control de frenada
Sensor de velocidad
Adems de determinismo lgico, las acciones de un STR deben realizarse en el momento adecuado, es decir, deben tener correccin temporal. Determinismo temporal.
Ejemplo (ABS): Evento externo El usuario pisa el pedal de freno. Respuesta del sistema Activar el actuador del freno. Correccin lgica y temporal: siempre se debe frenar antes de un tiempo determinado.
Un sistema de tiempo real es aquel en el que el tiempo de respuesta a estmulos externos es vital para el sistema [Kris 97]. Las restricciones temporales son una parte significativa de los requisitos del sistema. La influencia de los requisitos temporales puede variar mucho dependiendo de la naturaleza de la aplicacin:
Lmite
Utilidad
T. de respuesta mximo (TRmax) Funcin de utilidad (value function) del sistema cuando una respuesta retrasada invalida los resultados: Sistema ABS. 5
En algunas aplicaciones, se pueden dar resultados vlidos aunque no se cumplan las especificaciones temporales: Tienen funciones de utilidad con el siguiente aspecto:
Lmite
Utilidad
Son aplicaciones en las que el computador acta sobre un proceso un proceso fsico externo para mantenerlo en un estado deseado.
Velocidad deseada
Operador
Bucle tpico de control digital en lazo cerrado para controlar el estado de un proceso:
Referencia r(t)
Sensor y(t)
Velocidades bajas.
Una actuacin incorrecta (lgica o temporalmente) puede ser peligrosa. Sistemas de E/S orientados a la adquisicin de datos de algn proceso fsico. Las medidas tienen un tiempo de validez. Las mediciones pueden estar dirigidas por tiempo o por eventos. Suelen ser necesarios procesos (SW o HW) de acondicionado de las mediciones y validacin. Los procesos de control pueden ser continuos (cclicos) o discretos (eventos).
Necesitan supervisin de la integridad de sistemas (datos adquiridos, actuaciones, ). En muchos casos es necesario tener mecanismos de control alternativos por si algn sensor, actuador o proceso falla.
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A/D Transmisor
Canal
Alg. de descompresin
D/A
Receptor
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Manejan gran cantidad de datos. Siempre son intensivos en datos. A veces tambin son intensivos en computacin.
No se producen actuaciones sobre el medio fsico. Una actuacin incorrecta (lgica o temporalmente) no suele ser peligrosa.
En muchos casos si se pierde alguna imagen y se substituye por la anterior no ocurre nada (si esto se hace una prporcin pequea de veces).
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Una gran parte de sistemas de tiempo real incorporal computadores empotrados (embedded):
Estn integrados en la estructura fsica de la maquinaria que controlan: Vehculos: Coches, autobuses, trenes, aviones, barcos, gras, Maquinaria industrial: Robots, clulas de fabricacin, maquinas/herramienta, Sistemas de comunicacin: Telfonos mviles, repetidores, rotures, radio, Electrodomsticos: Elec. lnea blanca, televisores, videos, cmaras fotos, alarmas, Ocio: Consolas videojuego, juguetes, salas de cine, sistemas de sonido, iluminacin,
Unidad de control para un SCORBOT ER-VII: Brazo robot (5 ejes) Unidad de control
Entorno
Caractersticas Hardware (ER-IX B): CPU: 68020-68881. 512 KB. ROM, 512 KB RAM E/S: Tarjetas de control de motores (6-12 ejes). 2-10 RS232. 16 entradas, 16 salidas digitales (12-24 voltios) 14
Arquitectura orientada al sistema que controla. Sobre todo los sistemas de E/S.
Poca o ninguna intervencin de operadores humanos. Ciclo de vida y evolucin tecnolgica muy condicionados por el mecanismo que controla.
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Tarea: Actividades que se ejecutan en un computador en respuesta a un evento. Dos tipos de tareas: Peridicas o cclicas. Responden a eventos que se producen peridicamente. Espordicas. Responden a eventos que se producen irregularmente.
Cada vez que se ejecuta una tarea, debe terminar antes de su plazo de ejecucin (deadline) asociado.
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Activacin
Lmite (D)
Siguiente activacin
Plazo de ejecucin
Arranque Terminacin
Ejecucin de la tarea
Tiempo de respuesta
Periodo ( T )
En las tareas espordicas, el periodo se sustituye por la separacin o tiempo mnimo entre activaciones consecutivas.
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Un STR tendr correccin temporal si todas sus tareas se ejecutan siempre antes de su plazo de ejecucin. Esto condiciona el diseo y el anlisis del sistema: Diseo: La arquitectura del STR debe asegurar el determinismo de las actividades. Anlisis: Se deben disponer de tcnicas que permitan comprobar la correccin del sistema en cualquier condicin operativa.
Las consecuencias de que una tarea no cumpla sus plazos dependen de la naturaleza de la tarea/aplicacin: Tareas esenciales o no esenciales: presentan o no restricciones temporales. Una tarea esencial puede ser: Crtica: Debe completarse siempre dentro de su plazo. Acrtica: puede completarse fuera de plazo sin producir efectos inadmisibles en el sistema.
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Sistemas de tiempo real duro: tienen al menos una tarea crtica. Sistemas de tiempo real blando: todas sus tareas son acrticas. Las dificultades para asegurar el determinismo aumentan conforme aumenta la complejidad de la arquitectura. Esto es fcil de ver con un ejemplo sencillo: control de un motor en lazo cerrado:
Velocidad deseada
Operador
Sensor de giro
La seguridad mide las consecuencias de una avera. Tipos de averas: malignas y benignas. Averas malignas: su coste es muy superior a la utilidad del sistema.
Sistemas crticos: son ultrafiables con respecto a averas malignas. Otras medidas de seguridad:
Tipos de plazos de ejecucin, en funcin de la gravedad de su incumplimiento: Duro o crtico (Hard Deadline). Resultados puede ser catastrfico. Firme (Firm Deadline). Resultados sin sentido o intiles. Blando o no crtico (Soft Deadline). Deteriora la utilidad o el sentido de los resultados, aunque no los invalida totalmente. El tipo de plazo de ejecucin de una tarea depende de las caractersticas de la aplicacin. Aunque a veces puede verse influenciado por el proceso de diseo.
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Las caractersticas de un STR duro tienden a hacerlo lo ms resistente posible a fallos: En condiciones operativas normales: Plazos de respuesta crticos --> comportamiento predecible en sobrecargas. Deben ser ultrafiables respecto a averas malignas. Comportamiento temporal garantizado analticamente (sistemas con respuesta garantizada: guarantee response systems). Deben disponer de mecanismos que reduzcan el coste de una avera: Mecanismos de tolerancia a fallos --> sistema con degradacin aceptable.
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Las caractersticas de un STR blando: No existen plazos de respuesta crticos. El sistema hace lo que puede comportamiento degradado en sobrecargas. No existen averas malignas. No se hace caracterizacin precisa de carga y fallos. No tienen comportamiento temporal garantizado analticamente (sistemas que hacen lo que pueden: best-effort systems). Los mecanismo de tolerancia a fallos pueden ser justificables econmicamente.
Caractersticas Tiempo real firme (sistemas peridicos): Hay que cumplir estrictamente los plazos en un alto % de las ocasiones. En los dems casos se usa como salida la correspondiente al periodo anterior. El ej. Tipico es el procesado de audio o vdeo.
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El determinismo es fcil de asegurar si se usan arquitectura muy sencillas (pero de prestaciones limitadas). Muchas de las mejoras en la arquitectura hard/soft suelen estar orientadas al aumento del rendimiento medio basandose en mejorar los casos ms comunes, por lo que afectan al determinismo: Pipelines: Prediccin de saltos, ejecucin especulativa. Superescalares. Caches. Memoria virtual. Gestin de multitarea. Gestin de E/S. Sistemas de comunicacin. Mejoras en la velocidad de ejecucin no implican mejoras en el determinismo de la ejecucin. Puede haber grandes diferencias entre distintas ejecuciones de una misma tarea.
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