SISTEMAS DIGITALES SECUENCIALES

SISTEMAS DIGITALES SECUENCIALES

TRABAJO COLABORATIVO 2
PARTICIPACION

Grupo colaborativo:
90178

Presentado Por

Presentado A
Ing. Carlos Emel Ruiz

UNIVERSIDAD NACIONAL ABIERTA Y A DISTANCIA- UNAD

TRABAJO COLABORATIVO

Actividad 10

SISTEMAS DIGITALES SECUENCIALES

INTRODUCCION

Este trabajo tiene como principal objetivo lograr la evidencia en la adquisicin del
conocimiento para la creacin de circuitos digitales secuenciales a partir del anlisis de
tablas de verdad, diagramas de tiempo y la creacin de circuitos a partir de lograr
simplificar largos procesos y analisis de formulas mediante la utilizacin de mapas de
Karnaught. Tambin pretende lograr que interactuemos investigando y desarrollando
soluciones a un problema planteado, todo esto para lograr un trabajo en equipo.

TRABAJO COLABORATIVO

Actividad 10

SISTEMAS DIGITALES SECUENCIALES

PLANTEAMIENTO DEL PROBLEMA

Una vez estudiados los contenidos de la unidad II y apoyados en los
documentos de las referencias bibliogrficas, el equipo de trabajo debe disear un
circuito secuencial que permita en un display de siete segmentos la secuencia de
diez nmeros de manera cclica.
1 3 5 7 9 0 8 6 4 2.
Anlisis del problema y listado de materiales.
Para el desarrollo de este trabajo colaborativo se pretende
realizar:
Un circuito contador con una serie establecida de acuerdo a la descripcin realizada en
el planteamiento del problema, se requiere un pulso de reloj que alimente los Flip-Flops
y ser generado por un multivibrador 555 en modo astable.
Para dar solucin de la necesidad necesitamos lo
siguiente:
Una Bateria de 9 volt, para alimentar el circuito secuencial.
1 Temporizador 555 en modo astable.
1 Resistencia de 22 k, una resistencia de 5,6 k y resistencias
de 220 diodos led y del display de 7 segmentos.

para proteccin de
los

1 integrado 74LS90P.
1 integrado 74LS47N
1 Condensador de 10F y 1 Dipswitch
1 Display de 7 segmentos.
Protoboard.
Simulador ( Proteus).
Computador.
DIAGRAMA DE BLOQUES
ETAPA DE TEMPORIZACION

TRABAJO COLABORATIVO

ETAPA DE PROCESAMIENTO (CIRCUITO SECUENCIAL)

Actividad 10

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ETAPA DE EDICION (DISPLAY 7 SEGMENTOS)

TEORIA PARA
SOLUCION

TRABAJO COLABORATIVO

Actividad 10

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APLICACIN DE LOS FLIP-FLOP

Un biestable (flip-flop o LATCH en ingls), es un multivibrador capaz de permanecer en
uno de dos estados posibles durante un tiempo indefinido en ausencia de
1
Perturbaciones. Esta caracterstica es ampliamente utilizada en electrnica digital para
memorizar informacin. El paso de un estado a otro se realiza variando sus entradas.
Dependiendo del tipo de dichas entradas los biestables se dividen en:
Asncronos: slo tienen entradas de control. El ms empleado es el biestable RS.
Sncronos: adems de las entradas de control posee una entrada de sincronismo
o de reloj. Si las entradas de control dependen de la de sincronismo se
denominan sncronas y en caso contrario asncronas. Por lo general, las entradas
de control asncronas prevalecen sobre las sncronas.
La entrada de sincronismo puede ser activada por nivel (alto o bajo) o por flanco (de
subida o de bajada). Dentro de los biestables sncronos activados por nivel estn los
tipos RS y D, y dentro de los activos por flancos los tipos JK, T y D.
Los biestables sncronos activos por flanco (flip-flop) se crearon para eliminar las
deficiencias de los latches (biestables asncronos o sincronizados por nivel).
Para nuestro caso utilizaremos dos flip-flop para el manejo de las salidas hacia el
integrado que maneja el display de 7 segmentos (LS7447).
Descripcin de las terminales del Temporizador 555

Terminales del 555.

GND (normalmente la 1): es el polo negativo de la alimentacin, generalmente
tierra.
Disparo (normalmente la 2): Es en esta patilla, donde se establece el inicio del
tiempo de retardo, si el 555 es configurado como monostable. Este proceso de
disparo ocurre cuando este pin va por debajo del nivel de 1/3 del voltaje de
alimentacin. Este pulso debe ser de corta duracin, pues si se mantiene bajo por
mucho tiempo la salida se quedar en alto hasta que la entrada de disparo pase a
alto otra vez.

TRABAJO COLABORATIVO

Actividad 10

Salida (normalmente la 3): Aqu veremos el resultado de la operacin del

temporizador, ya sea que est conectado como monostable, astable u otro.
Cuando la salida es alta, el voltaje ser el voltaje de alimentacin (Vcc) menos 1.7
Voltios. Esta salida se puede obligar a estar en casi 0 voltios con la ayuda de la
patilla de reset (normalmente la 4).
Reset (normalmente la 4): Si se pone a un nivel por debajo de 0.7 Voltios, pone la
patilla de salida a nivel bajo. Si por algn motivo esta patilla no se utiliza hay que
conectarla a Vcc para evitar que el 555 se "resetee".
Control de voltaje (normalmente la 5): Cuando el temporizador se utiliza en el
modo de controlador de voltaje, el voltaje en esta patilla puede variar casi desde
Vcc (en la prctica como Vcc -1 voltio) hasta casi 0 V (aprox. 2 Voltios). As es
posible modificar los tiempos en que la salida est en alto o en bajo independiente
del diseo (establecido por los resistores y condensadores conectados
externamente al 555). El voltaje aplicado a la patilla de control de voltaje puede
variar entre un 45 y un 90 % de Vcc en la configuracin monostable. Cuando se
utiliza la configuracin astable, el voltaje puede variar desde 1.7 voltios hasta Vcc.
Modificando el voltaje en esta patilla en la configuracin astable causar la
frecuencia original del astable sea modulada en frecuencia (FM). Si esta patilla no
se utiliza, se recomienda ponerle un condensador de 0.01F para evitar las
interferencias.
Umbral (normalmente la 6): Es una entrada a un comparador interno que tiene el
555 y se utiliza para poner la salida a nivel bajo.
Descarga (normalmente la 7): Utilizado para descargar con efectividad el
condensador externo utilizado por el temporizador para su funcionamiento.
V+ (normalmente la 8): Tambin llamado Vcc, alimentacin, es el pin donde se
conecta el voltaje de alimentacin que va de 4.5 voltios hasta 18 voltios (mximo).
Hay versiones militares de este integrado que llegan hasta 18 Voltios.
Multivibrador monoestable

En el diagrama de bloques hablamos de una etapa de temporizacin, a continuacin

la grafica del instrumento que nos hara el trabajo de temporizar.

Este tipo de funcionamiento se caracteriza por una salida con forma de onda
cuadrada (o rectangular) continua de ancho predefinido por el diseador del circuito.
El esquema de conexin es el que se muestra. La seal de salida tiene un nivel alto
por un tiempo t1 y un nivel bajo por un tiempo t2. La duracin de estos tiempos
dependen de los valores de R1, R2 y C, segn las frmulas siguientes:
Seg

Seg

La frecuencia con que la seal de salida oscila est dada por la frmula:

el perodo es simplemente:
Tambin decir que si lo que queremos es un generador con frecuencia variable,
debemos variar la capacidad de condensador, ya que si el cambio lo hacemos mediante
los resistores R1 y/o R2, tambin cambia el ciclo de trabajo o ancho de pulso (D) de la
seal de salida segn la siguiente expresin:

Hay que recordar que el perodo es el tiempo que dura la seal hasta que sta se vuelve
a repetir (Tb - Ta).
Si se requiere una seal cuadrada donde el ciclo de trabajo D sea del 50%, es decir que

el tiempo t1 sea igual al tiempo t2, es necesario aadir un diodo en paralelo con R2

segn se muestra en la figura. Ya que, segn las frmulas, para hacer

sera necesario que R1 fuera cero, lo cual en la prctica no funcionara.
Para realizar un ciclo de trabajo igual al 50% se necesita colocar el resistor R1 entre la
fuente de alimentacin y la terminal 7; desde la terminal 7 hacia el condensador se
coloca un diodo con el nodo apuntando hacia el condensador, despus de esto se
coloca un diodo con el ctodo del lado del condensador seguido del resistor R2 y este
conjunto de diodo y resistor en paralelo con el primer diodo, adems de esto los valores
de los resistores R1 y R2 tienen que ser de la misma magnitud.
ESPECIFICACIONES

DE

MATERIALES

PARA EL DESARROLLO

DE

LA

SOLUCION.
DECODIFICADOR: Como su nombre lo indica, es un dispositivo que "decodifica" un
cdigo de entrada en otro. Es decir, transforma una combinacin de unos y cero, en
otra. 74LS47, en particular transforma el cdigo binario en el cdigo de 7 segmentos.

El decodificador recibe en su entrada el nmero que ser visualizado en el display.

Posee 7 salidas, una para cada segmento (led). Para un valor de entrada, existe igual
un valor de salida. (on/off)
La entrada consiste en 4 terminales en donde el integrado recibe en cdigo binario.
Para ingresar un "0" en un terminal, conectaremos el mismo al terminal negativo de la
fuente. Para ingresar un "1", vamos a conectarlo al terminal positivo.
Para el 74LS47N El dispositivo viene en un encapsulado DIP16. A continuacin la
descripcin de sus terminales (funciones)
Entradas: 4 terminales de entrada para ingresar el dgito a mostrar en binario.
Salidas: 7 terminales de salida, uno para cada segmento.
Alimentacin (suministro de voltaje para trabajar): 2 terminales para alimentacin
de voltaje, fuente (+) y fuente (-).

En la entrada del 74LS47 hay que ingresar un cdigo binario

El valor binario es una combinacin de unos y cero, siendo, "0" lgico = 0v; "1"
lgico = 5v.
En la salida aparece la combinacin de siete segmentos correspondiente.
Cada pin de salida corresponde a un segmento.
Las salidas son activo baja, es decir, "0" lgico = encendido; "1" lgico = apagado.
A continuacin la forma en como debemos conectar el integrado y el display de
7 segmentos (leds).

Analicemos el circuito por partes. En primer lugar, veamos el dgito de 7

segmentos. Cada segmento est conectado al pin correspondiente, mediante una
resistencia de limitacin de corriente. Los nodos de todos los segmentos (es
decir, el terminal nodo Comn CA) se conectan a la fuente positiva de +5v. Es lo
mismo que habamos visto antes con un solo LED.

Display 7 Segmentos.

Sabiendo esto es muy fcil mostrar el nmero que queramos en el display.

Conectado cada segmento a un PIN del puerto B del PIC slo tendramos que
seguir la siguiente secuencia para encender cada dgito.

A continuacin la forma en que debemos conectar el 74LS47 al display.

SISTEMAS
DIGITALES SECUENCIALES

DISEO DE LA SOLUCION
A continuacin se encuentra la tabla de Flip-Flops que permiti la generacin
de los mapas de Karnaught y las ecuaciones finales para el circuito.
ESTADO ACTUAL

ESTADO FUTURO

FLIP-FLOP A

FLIP-FLOP B

FLIP-FLOP C

FLIP-FLOP D

Q3

Q2

Q1

Q0

Q3

Q2

Q1

Q0

J3

K3

J2

K2

J1

K1

J0

K0

Abajo las tablas finales para el desarrollo del circuito.

J0 = Q0 + Q1Q3 + Q2Q3 + Q1Q2'

K0 = Q3 + Q0
J1 = Q1 + Q2 + Q0Q3' + Q0'Q3
K1 = 1
J2 = Q2 + Q1Q3 + Q1Q0 + Q0'Q3
K2 = Q3 + Q2' + Q0'Q1' + Q0Q1
J3 = Q3 + Q0'Q1'Q2' + Q0Q1Q2
K3 = 1

Trabajo Colaborativo N1
Actividad 6

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A continuacin tabas de estados.

ESTADO INICIAL
SECUENCIA

ESTADO FINAL

Q3 Q2 Q1 Q0 Q3 Q2 Q1 Q0

SECUENCIA

Circuito en Proteus

REGISTRO FOTOGRAFICO DEL CIRCUITO EN FISICO

TRABAJO COLABORATIVO

Actividad 10

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TRABAJO COLABORATIVO

Actividad 10

SISTEMAS DIGITALES SECUENCIALES

CONCLUSIONES

De este trabajo podemos concluir claramente lo siguiente:

En el diseo del circuito es bsico tener en cuenta y hacer los clculos

correctos para la etapa de temporizacin.
Bsicamente las tablas de verdad, las tablas de estados y los mapas de
Karnaught nos permiten desarrollar este tipo de circuitos y son una
herramienta muy poderosa.
Es indispensable tener en cuenta si el display es de nodo comn o de
ctodo comn a la hora de conectarle.
En el transcurso de la unidad hemos visto la importancia y la versatilidad
que tienen los flip flops para este tipo de necesidades.

TRABAJO COLABORATIVO

Actividad 10

SISTEMAS DIGITALES SECUENCIALES

REFERENCIA BIBLIOGRAFICA

Modulo de Sistemas digitales Secuenciales

ACEVEDO GONZALEZ --

Autor: Lic. GEORFFREY

Medelln -- Universidad Nacional

Abierta y a Distancia UNAD -- Escuela de Ciencias Bsicas Tecnologa

e Ingeniera .
Gua de Actividad -- Trabajo colaborativo 2
http://www.ladelec.com/teoria/electronica-digital/195-flip-flop-jk
http://www.youtube.com/watch?v=OB_5DxXYxOA
http://es.wikipedia.org/wiki/Circuito_integrado_555
http://www.unicrom.com/dig_FF_JK.asp
ltimo acceso: 10 de Mayo de 2013.

TRABAJO COLABORATIVO

Actividad 10