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ELETR NICA DIGITAL

Alcantaro Corra Presidente da FIESC Srgio Roberto Arruda Diretor Regional do SENAI/SC Antnio Jos Carradore Diretor de Educao e Tecnologia do SENAI/SC Marco Antnio Dociatti Diretor de Desenvolvimento Organizacional do SENAI/SC

ELETR NICA DIGITAL

Florian polis 2004

autorizada reproduo total ou parcial deste material por qualquer meio ou sistema desde que a fonte seja citada

Equipe T cnica:
Autor:
Joo Roberto Lorenzett

Projeto Gr fico:
Rafael Viana Silva

Capa:

Rafael Viana Silva Samay Milet Freitas

Servio Nacional de Aprendizagem Industrial Departamento Regional de Santa Catarina www.sc.senai.br Rodovia Admar Gonzaga, 2765 Itacorubi. CEP 88034-001 - Florianpolis - SC Fone: (048) 231-4221 Fax: (048) 231-4331 Este material faz parte do Programa SENAI SC de Recursos Didticos www.sc.senai.br/recursosdidaticos

S RIE RECURSOS DID TICOS

LISTA DE FIGURAS
1 No es Bsicas....................................................................11
1.1 Sinais analgicos..................................................................................11 1.2 Sinais digitais.......................................................................................11 1.3 Converso de nmeros decimais em nmeros binrios.............................13 1.4 Converso de nmeros decimais em nmeros binrios.............................13

2 Variveis e Fun es L gicas.................................................17


2.1 Funo inverso (NOT)/Porta lgica NOT................................................19 2.2 Funo AND/Porta lgica AND..............................................................19 2.3 Funo OR/Porta lgica OR..................................................................19 2.4 Outras portas lgicas............................................................................19 2.5 Limitador Schmitt (Schmitt Trigger)..........................................................20 2.6 Sa da em coletor aberto.......................................................................22 2.7 Sa da tri-state......................................................................................22 2.8 Exemplo genrico de circuito que implementa a soma padro de produto...24 2.9 Exemplo genrico de circuito que implementa o produto padro de somas.25 2.10 Figura representariva de mapas de karnaugh.........................................26 2.11 Primeira etapa para soluo do circuito, utilizando mapas de Karnaugh.....27 2.12 Segunda e terceira etapas para soluo do circuito..................................28

3 Circuitos Combinacionais.....................................................29
3.1 Decodificador com 2 bits de entrada e 4 sa da...........................................29 3.2 Circuito integrado 74138......................................................................30 3.3 Codificador com 4 entradas e 4 bits de sa da............................................30 3.4 Diagrama para conversor de cdigo......................................................31 3.5 Representao de multiplexador (MUX)..................................................32 3.6 Implementao de circuito MUX com portas NOT, AND e OR...................32 3.7 CI multiplexador 74151........................................................................33 3.8 Circuito multiplexador com coletor aberto..............................................34 3.9 Implementao de demultiplexador de 4 linhas.......................................34 3.10 Diagrama de blocos mostrando circuitos MUX e DEMUX no compartilhamento de linhas de transmisso.................................................35

4 Latchs e Flip-Flops.............................................................36
4.1 Latch com duas portas inversoras............................................................36 4.2 Latch SR (representao e tabela-verdade).............................................37 4.3 Representao latch SR........................................................................37 4.4 Circuito anti-trepidao........................................................................38 4.5 Latch controlado (com entrada enable/clock)...........................................38 4.6 Diagrama de tempo do latch da figura 4.5...............................................39 4.7 Flip-flop mestre-escravo.......................................................................40 4.8 Circuito flip-flop tipo JK e sua tabela-verdade........................................41 4.9 Diagrama de tempos mostrando ru do detectado por flip-flop tipo JK ou SR......................................................................................................41 4.10 Diagrama de tempos comparativos entre flip-flops metre-escravo com e sem data-lock-out..........................................................................42 4.11 Flip-flop mestre-escravo modificado (Flip-flop tipo D)............................42
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4.12 Modos de habilitao de flip-flops......................................................43 4.13 Tempo de set-up...............................................................................43 4.14 Tempo de manuteno.......................................................................43

5 Registradores e Contadores.................................................44
5.1 Registrador simples para palavra de 4 bits..................................................44 5.2 Registrador de deslocamento 4 bits, com flip-flops tipo JK.......................44 5.3 Contador s ncrono, com configurao em anel e mdulo 4......................46 5.4 Contador binrio de 4 bits, s ncrono........................................................46 5.5 Contador por pulsao..........................................................................47

6 Circuitos Aritmticos...........................................................49
6.1 Circuito para soma e carry....................................................................49 6.2 Circuito para subtrao e carry (meio subtrator).......................................50 6.3 Circuito somador paralelo......................................................................51 6.4 Somador srie.....................................................................................52 6.5 Circuito subtrador somador...................................................................53

7 Mem rias............................................................................54
7.1 Diagrama de uma memria hipottica de 8 palavras de 6 bits.....................54 7.2 Ligao de memrias em paralelo para aumentar nmero de bits por palavra..56 7.3 Ligao de memrias em paralelo para aumentar nmero de palavras..........56

8 Conversores D/A e A/D........................................................58


8.1 Conversor D/A....................................................................................58 8.2 Conversor D/A tipo somador................................................................58 8.3 Conversor D/A tipo R-2R.....................................................................59 8.4 Conversor A/D simultneo ou conversor flash.........................................60 8.5 Conversor A/D de contagem crescente.................................................60 8.6 Sinal analgico e sua representao digital em um conversor A/D de contagem crescente..................................................................................61 8.7 Circuito conversor A/D de rastreamento e sinal analgico e sua representao digital em um conversor deste tipo..........................................61 8.8 Exemplo da utilizao de conversor A/D e D/A em um sistema de controle de temperatura............................................................................62 8.9 Circuito de amostra e reteno (sample-and-hold)..................................62

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LISTA DE TABELAS
1 No es Bsicas....................................................................11
1.1 Sistemas de Numerao........................................................................14 1.2 Cdigo Gray........................................................................................15

2 Variveis e Fun es L gicas.................................................17


2.1 Tabelas-Verdade da Funo Lgica..........................................................17 2.2 Funo de Duas Variveis Lgicas............................................................18 2.3 Vantagens e Desvantagens das Fam lias Lgicas........................................21 2.4 Caracter sticas das Fam lias CMOS e TTL.................................................21 2.5 Operao OR......................................................................................23 2.6 Operao AND (E)...............................................................................23 2.7 Operao Complemento (NOT ou N O)...............................................23 2.8 Teoremas de Uma Varivel....................................................................23 2.9 Teoremas de Duas e Trs Variveis..........................................................24 2.10 Obteno de Soma Padro de Produto a partir de Tabela-Verdade...............25 2.11 Obteno de Produto Padro de Somas a partir de Tabela-Verdade............26 2.12 Tabela-Verdade para Circuito Hipottico.................................................27

3 Circuitos Combinacionais.....................................................29
3.1 Sa da EO e GS do Circuito Integrado 74148..............................................31

4 Latchs e Flip-Flops.............................................................36
4.1 Tabela-Verdade Latch SR com Portas NAND..............................................37

5 Registradores e Contadores.................................................44
5.1 Direo de Contagem Conforme Ligao e Tipo de Chaveamento em um Contador por Pulsao..........................................................................47 5.2 Entradas e Sa das do CI Contador 7490....................................................47

6 Circuitos Aritmticos...........................................................48
6.1 Tabela-Verdade para Meio Somador.........................................................48 6.2 Tabela-Verdade para Meio Subtrator.........................................................50 6.3 Tabela-Verdade para Soma de 3 Bits..........................................................50 6.4 Tabela-Verdade para Subtrao de 3 Bits....................................................51 6.5 Cojunto de Funes da ULA 74181........................................................53

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SUM RIO
1 No es Bsicas....................................................................11
1.1 Eletrnica Analgica e Digital.....................................................11 1.2 Sistemas de Numerao..............................................................12
1.2.1 Sistema Decimal......................................................................12 1.2.2 Sistema Binrio........................................................................12 1.2.3 Transformao de sistemas de numerao binrio em decimal e vice-versa....................................................................................12 1.2.4 Sistema Octal.........................................................................14 1.2.5 Sistema Hexadecimal...............................................................14 1.3.1 Cdigo BCD...........................................................................15 1.3.2 Cdigo Gray...........................................................................15 1.3.3Cdigo Alfanumrico ASCII......................................................16

1.3 Codificao..................................................................................15

2 Variveis e Fun es L gicas.................................................17


2.1 Variveis Lgicas..........................................................................17 2.2 Funes Lgicas...........................................................................17
2.2.1 Funes de uma Varivel Lgica................................................17 2.2.2 Funes de duas Variveis Lgicas..............................................18 2.3.1 Funo Inverso (NOT) / Porta Lgica NOT.................................18 2.3.2 Funo AND / Porta Lgica AND...............................................19 2.3.3 Funo OR / Porta Lgica OR...................................................19 2.3.4 Outras Portas Lgicas...............................................................19 2.3.5 Limitador Schmitt....................................................................19

2.3 Implementao de Sistemas Lgicos.........................................18

2.4 Fam lias Lgicas...........................................................................20 2.5 Algebra de Boole.........................................................................22 2.6 Formas Padro de Funes Lgicas............................................24 2.7 Mapas de Karnaugh....................................................................26

2.5.1 Postulados Bsicos...................................................................23 2.5.2 Teoremas...............................................................................23 2.6.1 Soma Padro de Produtos.........................................................24 2.6.2 Produto Padro de Somas..........................................................25

3 Cicuitos Combinacionais......................................................29
3.1Decodificadores.......................................................................29 3.2 Codificadores...............................................................................30 3.3 Conversores de Cdigos.............................................................31
3.3.1 Decodificadores / Drives..........................................................32 3.2.1 Codificador com Prioridade......................................................31

3.4 Multiplexadores (MUX)..............................................................32

3.5 Demultiplexadores (DEMUX).....................................................34

3.4.1 Multiplexadores como Gerador de Funo..................................33 3.4.2 Multiplexao com Coletor Aberto............................................33 3.4.3 Multiplexao com Sa da Tri-State..............................................34 3.5.1 Mux e Demux em Comunicao...............................................35

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3.6 Comparadores Digitais................................................................35 3.7 Gerao e Verificao de Bit de Paridade...................................35

4 Latchs e Flip-Flops............................................................36
4.1 Latchs..................................................................................36
4.1.1 Latch SR..........................................................................................36 4.1.2 Chave sem Trepidao.............................................................37 4.1.3 Latchs Controlados................................................................38 4.1.4 Sincronismo (Clocking)............................................................39

4.2 Flip-Flops...................................................................................39

4.2.1 Flip-Flop Mestre-Escravo..........................................................39 4.2.2 Entradas Diretas......................................................................40 4.2.3 Flip-Flop JK............................................................................40 4.2.4 Flip-Flop Tipo T.......................................................................41 4.2.5 Flip-Flop JK Gatilhado pela Borda................................................41 4.2.6 Flip-Flops Mestre-Escravo com Data-Lock-Out..........................42 4.2.7 Flip-Flop Tipo D......................................................................42 4.2.8 Parmetros dos Flip-Flops........................................................43

5 Registradores e Contadores.................................................44
5.1 Registradores................................................................................44 5.2 Contadores...................................................................................45
5.1.1 Registradores de Deslocamento (Shift Registers)........................44 5.1.2 Formato Srie e Paralelo...........................................................45

5.2.1 Contadores S ncronos..............................................................45 5.2.1.1 Contador em Anel......................................................45 5.2.1.2 Contador em Anel Torcido...........................................46 5.2.1.3 Contador S ncrono em Cdigo Binrio............................46 5.2.1.4 Contador S ncrono de Mdulo Arbitrrio........................46 5.2.2 Contadores Ass ncronos...........................................................47 5.2.2.1 Contadores por Pulsao (Ripple Counters)....................47 5.2.3 Circuitos Integrados Contadores................................................47

6 Circuitos Aritmticos...........................................................49
6.1 Meio Somador..............................................................................49 6.2 Meio Subtrador.............................................................................49 6.3 Somador Inteiro...........................................................................50 6.4 Subtrador Inteiro..........................................................................51 6.5 Somador Paralelo.........................................................................51 6.6 Somador Srie..............................................................................51 6.7 Representao em Complemento de Dois................................52 6.8 Circuito Subtrador Somador.......................................................52 6.9 ULA (Unidade Lgica e Aritmtica)............................................53

7 Mem rias............................................................................54
7.1 Memria RAM (Memria de Acesso Aleatrio).......................54 7.2 Memrias ROM...........................................................................55
7.2.1 Memrias ROM Programveis (Proms).....................................55

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7.3 Ligao de Memrias em Paralelo..............................................56 7.4 Memrias Srie............................................................................57

7.2.2 Memrias ROM Programveis e Apagveis (Eproms)...................55

8 Conversores D/A e A/D........................................................58


8.1 Conversores Digitais/Analgicos (D/A)....................................58 8.2 Conversores Anlogicos/Digitais (A/D)....................................59
8.2.1 Conversor A/D Simultneo ou Conversor Flash............................59 8.2.2 Conversores de Contagem Crescente........................................60 8.2.3 Conversores de Rastreamento..................................................61 8.2.4 Circuito de Amostra e Reteno (Sample-and-Hold)....................62 8.1.1 Conversor D/A do Tipo Somador...............................................58 8.1.2 Conversor D/A Tipo R-2R........................................................59

Referncias Bibliogrficas.......................................................63

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CAPTULO NO ES B SICAS
1.1 Eletr nica Anal gica e Digital

A diferena entre eletrnica analgica e digital devida ao tipo de sinal processado. O sinal analgico tem como principal caracter stica a de que ele no tem descontinuidades no seu valor, ou seja, no varia bruscamente no tempo. Normalmente um circuito analgico responde a mltiplos n veis de tenso. A figura abaixo apresenta um sinal analgico variando continuamente no tempo (corrente alternada) e um sinal sem variao no tempo (corrente cont nua).

FIGURA 1.1: Sinais Anal gicos

J o sinal digital apresenta variaes descont nuas no tempo, ou seja, normalmente o sinal varia bruscamente entre n veis definidos e conhecidos. Os circuitos digitais baseiam-se na representao de nmeros (d gitos) binrios; Portanto, normalmente respondem a apenas dois n veis de tenso, representativos destes nmeros. Os grficos abaixo demonstram dois sinais digitais: O primeiro varia entre 0 e 5 V e o segundo entre -5 e +5 V. Observe que o sinal no mantm-se entre os dois n veis por tempos que sejam considerveis.

FIGURA 1.2: Sinais Digitais

Os circuitos analgicos e os digitais tem a mesma finalidade, qual seja: processar os sinais de entrada e fornecer sinais de sa da. O que varia de um para outro a filosofia de funcionamento. Cada tipo tem suas vantagens e desvantagens. Atualmente, os circuitos digitais tem avanado em reas antes dominadas por dispositivos analgicos (como udio e v deo, por ex.), avanELETR NICA DIGITAL 11

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o este proporcionado pelo aumento do poder de processamento do circuitos integrados.

1.2 Sistemas de Numera o


1.2.1 Sistema Decimal
Entre os sistemas numricos existentes, o sistema decimal o mais utilizado. Os s mbolos ou d gitos empregados so os algarismos 0, 1, 2, 3, 4, 5, 6, 7, 8, 9. Embora o sistema decimal possua somente dez s mbolos, qualquer nmero acima disso pode ser expresso usando o sistema de peso por posicionamento, conforme o exemplo abaixo: O decimal 3546, pode tambm ser escrito da seguinte forma: 3 x 10 + 5 x 10 + 4 x 10 + 6 x 10 3000 + 500 + 40 + 6 = 3546 O decimal 798, pode tambm ser escrito da seguinte forma : 7 x 10 + 9 x 10 + 8 x 10 700 + 90 + 8 = 798 Dependendo do seu posicionamento, o d gito ter um peso. Quanto mais prximo da extrema esquerda do nmero estiver o d gito maior ser a potncia de dez que estar multiplicando o mesmo, ou seja, mais significativo ser o d gito.

1.2.2 Sistema Bin rio


o sistema de numerao mais utilizado em processamento de dados digitais, pois utiliza apenas dois algarismos (0 e 1), sendo portanto mais fcil de ser representado por circuitos eletrnicos ( Os d gitos binrios podem ser representados pela presena ou no de tenso). O sistema de numerao binrio utiliza a base 2. Cada posio de cada algarismo de um n mero binrio corresponde uma potncia de 2, analogamente ao sistema decimal, onde cada posio corresponde a uma potncia de dez. Exemplos de nmeros em binrio: 11001011001 1001100 Os d gitos binrios chamam-se bits, proveniente da contrao do ingls Binary Digit. Assim como no sistema decimal, dependendo do posicionamento, o algarismo ou bit ter um peso. O da extrema esquerda ser o bit mais significativo (Most Significant Bit -MSB) e o da extrema direita o bit menos significativo (Least Significante Bit - LSB) . Um conjunto de 8 bits denominado byte. Um conjunto de 4 bits denominado nybble.

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1.2.3 Transforma o de sistemas de numera o bin rio em decimal e vice-versa


poss vel converter um nmero decimal em binrio, dividindo-se o nmero decimal por 2 sucessivamente at obter-se o quociente 0. Toma-se a seqncia dos restos da diviso em ordem inversa e obtm-se o resultado em binrio. Exemplos: Para converter o decimal 345 em binrio, realiza-se a operao indicada abaixo:

FIGURA 1.3: Converso de Numeros Decimais em Numeros Binrios

O correspondente binrio do decimal 345 , portanto, 101011001. Para converter o decimal 47 em binrio, realiza-se a operao indicada abaixo:

FIGURA 1.4: Converso de Numeros Decimais em Numeros Binrios

Correspondente binrio do decimal 47 , portanto, 101111. O processo inverso, ou seja a converso de um nmero binrio em decimal, tambm poss vel, multiplicando-se cada d gito binrio por seu peso correspondente na base dois. A soma destes produtos resulta no equivalente decimal, conforme ilustram os exemplos abaixo: Para transformar o nmero binrio 1101 em decimal devemos proceder da seguinte forma: 1 x 2 + 1 x 2 + 0 x 2 + 1 x 2 8 + 4 + 0 + 1 = 13 O correspondente decimal do binrio 1101 , portanto, 13.

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Para transformar o nmero binrio 10111 em decimal devemos proceder da seguinte forma: 1 x 24 + 0 x 2 + 1 x 2 + 1 x 2 + 1 x 2 16 + 0 + 4 + 2 + 1 = 23 O correspondente decimal do binrio 10111 , portanto, 23

1.2.4 Sistema Octal


O sistema octal (base 8) formado por oito s mbolos ou d gitos : 0, 1, 2, 3, 4, 5, 6, 7 . Para representao de qualquer d gito em octal, necessitamos de trs d gitos binrios. Os nmeros octais tm, portanto, um tero do comprimento de um nmero binrio e fornecem a mesma informao. O sistema octal foi criado com o propsito de minimizar a representao de um nmero binrio e facilitar a manipulao humana dos nmeros.

1.2.5 Sistema Hexadecimal


O sistema hexadecimal (base 16) foi criado com o mesmo propsito do sistema octal (Minimizar a representao de um nmero binrio). Se considerarmos quatro d gitos binrios, ou seja, quatro bits, o maior nmero que se pode expressar com esses quatro d gitos 1111 que , em decimal, 15. Como 15 o maior algarismo do sistema hexadecimal, com um nico d gito hexadecimal podemos representar um conjunto de 4 bits. O sistema hexadecimal, como o nome mesmo diz, possui 16 s mbolos, de 0 a 15. Como no existem s mbolos dentro do sistema arbico, que possam representar os nmeros decimais entre 10 e 15 sem repetir os s mbolos anteriores, foram usados s mbolos literais: A, B, C, D, E e F, portanto, o sistema hexadecimal ser formado por 16 s mbolos alfanumricos 0, 1, 2, 3, 4, 5, 6, 7, 8, 9, A, B, C, D, E, F . A tabela a seguir mostra um quadro resumo dos sistemas de numerao mais utilizados:

TABELA 1.1: Sistemas de Numerao ELETR NICA DIGITAL 14

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1.3 Codifica o
Codificar significa representar uma determinada informao por um cojunto de simbolos (cdigos). Neste texto, codificar significa especificamente converter um dado ou uma informao numrica decimal ou alfabtica em binrio, pois os equipamentos digitais e os computadores processam a informao em binrio, ao passo que as entradas e sa das desse sistema so acessadas pelo homem. Existem diversas maneiras de realizar esta codificao (Existem diversos cdigos em binrio). Os principais sero vistos neste cap tulo.

1.3.1 C digo BCD


O cdigo BCD (Binary Coded Decimal = Decimal Codificado em Binrio) muito utilizado em displays, contadores, etc. Ele representa cada d gito decimal de 0 a 9 por quatro bits binrios. Exemplo: O nmero 360 em decimal representado em BCD como: 3 6 0 0011 0110 0000 A vantagem do cdigo BCD que, na converso de decimal para BCD gito de cada vez e na converso de BCD precisamos examinar apenas um d para decimal examinamos apenas quatro d gitos binrios (4 bits). No entanto, necessita mais d gitos do que o cdigo binrio puro.

1.3.2 C digo Gray


O cdigo Gray se caracteriza por variar apenas um bit na mudana de um nmero consecutivo para outro. O cdigo Gray s vezes referido como cdigo 8421.

TABELA1.2: C digo Gray

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1.3.3 C digo Alfanum rico ASCII


Neste cdigo cada carter alfanumrico corresponde a um nmero binrio. conhecido internacionalmente pelo nome de American Standard Code for Information Interchange. O cdigo utilizado principalmente na troca de informaes ou dados entre computadores e seus sistemas perifricos, ou seja o meio de comunicao entre os diversos sistemas. O cdigo veis e apresentado em sete bits, portanto temos 128 combinaes poss podemos comunicar com isso at 128 caracteres, letras, nmeros ou s mbolos especiais ou de controle. Junto aos sete bits de cdigo, acrescentado um oitavo bit, como bit de paridade ou verificao e atravs dele se verifica se o que foi transmitido est correto ou no. O valor deste bit definido pelo tipo de paridade.

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CAPTULO VARI VEIS E FUN ES L GICAS


2.1 Vari veis L gicas
Uma varivel lgica uma varivel que atende os seguintes quesitos: S pode assumir um de dois estados poss veis (Por exemplo: aceso/ apagado, alto/baixo, ligado/desligado, etc.) Os dois valores poss veis devem ser tais que, baseados na lgica, sejam mutuamente exclusivos. (Se um circuito est ligado, no pode estar desligado). O sistema binrio bastante adequado para a manipulao de variveis lgicas, visto que s possui dois d gitos: 0 e 1.

2.2 Fun es L gicas


2.2.1 Fun es de uma Vari vel L gica
Supondo que A e B sejam variveis lgicas e B dependa de A obedecendo a uma determinada regra chamada funo lgica. Representa-se isto escrevendo B = f (A). Todas as maneiras poss veis de B variar com A esto representadas nas tabelas abaixo. Estas tabelas so chamadas tabelas-verdade da funo lgica. Consideramos os dois valores poss veis para as variveis lgicas como sendo 0 e 1.

TABELA 2.1: Tabelas-Verdade da Funo L gica

Na primeira tabela temos a representao da funo B=A Na segunda tabela temos a representao da funo B=contrrio de A Na terceira tabela temos a representao da funo B=0 Na quarta tabela temos a representao da funo B=1 Podemos representar a funo B=contrrio de A como B=A
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Tabela verdade uma tabela que representa todos os poss veis estados lgicos a que podem ser submetidas s entradas e sa das de um circuito digital.

2.2.2 Fun es de Duas Vari veis L gicas


Como existem 4 combinaes de duas variveis binrias, gerando quatro resultados; E estes quatro resultados podem combinar-se de 16 maneiras diferentes, temos ento 16 funes poss veis para duas variveis lgicas. A tabela abaixo apresenta as usualmente empregadas diretamente na prtica:

TABELA 2.2: Fun es de Duas Variveis L gicas

2.3 Implementa o de Sistemas L gicos


A implementao de sistemas lgicos em circuitos eletrnicos digitais pode ser feita considerando-se os dois estados poss veis para uma varivel lgica como sendo a presena ou no de tenso em um determinado ponto veis de tenso determinados. Por do circuito, ou ainda como sendo dois n exemplo: em um determinado circuito digital os dois estados poss veis para cada ponto do circuito podem ser 0V ou 5V. Normalmente denominamos os n veis lgicos em um circuito digital de 0 e 1, ou Low e High, no importando quais os n veis de tenso que os representaro . Os dispositivos digitais so constitu dos de circuitos eletrnicos que, a partir dos n veis lgicos das entradas, fornecem as sa das de acordo com sua construo, obedecendo a uma determinada funo. Estes dispositivos so denominados portas lgicas. Porta lgica , portanto, um circuito digital (dois estados) com uma ou mais entradas e uma sa da.

2.3.1 Fun o Invers o (NOT) / Porta L gica NOT


O Inversor uma porta lgica que tem uma nica entrada e cuja sa da o complemento da entrada. A notao da funo e o s mbolo lgico esto representados no desenho da pgina seguinte:

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FIGURA 2.1: Funo Inverso (NOT)/Porta L gica NOT

2.3.2 Fun o AND / Porta L gica AND


Na funo AND, a sa da tem n vel lgico 1 somente quando as duas vel lgico 1, conforme a tabela-verdade abaixo: entradas tem n

FIGURA 2.2: Funo AND/Porta L gica AND

2.3.3 Fun o OR / Porta L gica OR


Na funo OR, a sa da C s ter n vel lgico 1 se a entrada A for 1 ou a entrada B for 1 ou ambas as entradas forem 1, conforme a tabela-verdade abaixo:

FIGURA 2.3: Funo OR/Porta L gica OR

2.3.4 Outras Portas L gicas

FIGURA 2.4: Outras Portas L gicas

2.3.5 Limitador Schmitt


Um limitador Schmitt, tambm chamado de Schmitt Trigger um circuito eletrnico utilizado para detectar se uma tenso ultrapassou um dado n vel de referncia. Ele tem dois estados estveis e utilizado como dispositivo de condicionamento de sinal: Se a tenso de entrada ultrapassar um determinado valor, a sa da vai para n vel alto. Se a tenso de entrada ficar abaixo de determinado valor, a sa da vai para n vel baixo.
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O s mbolo e um grfico explicativo do funcionamento do schmitt trigger esto a seguir:

FIGURA 2.5: Limitador Schmitt (Schmitt Trigger)

2.4 Famlias L gicas


As portas lgicas bsicas dependendo da poca em que foram desenvolvidas, do fabricante e da tcnica, so constru das a partir de componentes discretos ou circuitos integrados. Possuem vrios tipos de construes ou montagens (implementao) tendo, portanto, vantagens ou desvantagens entre elas. Cada tipo de construo, embora possam representar a mesma funo lgica, diferem quanto a fatores como: velocidade de operao, componentes empregados, potncia consumida, etc. Assim, dependendo desses fatores, faz-se a opo por esta ou aquela fam lia, segundo necessidade e interesse. Um circuito integrado possui um tipo de integrao que depende da poca em que foi desenvolvido e do tamanho do circuito que estar contido nele. Assim, temos por conveno a integrao em pequena escala - SSI (Small Scale Integration), que possui at 12 componentes em uma nica pastilha de sil cio; a integrao em mdia escala - MSI (Medium Scale Integration), com at 99 componentes; a integrao em larga escala LSI (Large Scale Integration), com at 1.000 componentes em uma nica pastilha; e a integrao em larga escala VLSI (Very Large Scale Integration), at 100.000 componentes em uma nica pastilha. As fam lias lgicas so constitu das de circuitos integrados constru dos sob uma determinada tcnica. As mais comuns so: fam lia RTL (Resistor transistor logic); fam lia DTL (Diode transistor logic); fam lia TTL (Transistor transistor logic); fam lia ECL (Emmiter Coupled logic); fam lia IIL ou IL (Integrated injection logic); fam lia MOS ou MOS FET (Metal oxid semiconductor, Field effect transistor); fam lia CMOS (MOS complementar).
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Na tabela a seguir esto resumidas as vantagens e desvantagens de cada fam lia:

TABELA 2.3: Vantagens e Desvantagens das Fam lias L gicas

As fam lias mais utilizadas na prtica so a CMOS e a TTL. As principais caracter sticas destas duas fam lias esto detalhadas na tabela na pgina seguinte:

TABELA 2.4: Caracter sticas das Fam lias CMOS e TTL

Obs.: Atraso propagao (delay) o tempo requerido para a sa da da porta mudar de estado aps as entradas terem mudado.
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FIGURA 2.6: Sa da em Coletor Aberto

Sa das em coletor aberto: A figura abaixo representa a sa da de uma porta com coletor aberto. Observe que, para que o circuito funcione a contento, devemos utilizar um resistor externo ligado ao positivo da fonte de alimentao (chamado de resistor pull-up). Alguns circuitos integrados possuem sa das em coletor aberto e devem, portanto ser supridos de resistores nestas sa das. Sa da tri-state: Uma sa da em tri-state est representada na figura abaixo. Este tipo de diminui o atraso provocado por capacitncias parasitas nas portas. Observe que quando a chave S1 est fechada, a sa da est em n vel lgico zero; quando a chve S2 est fechada, a sa da est em n vel lgico um. Se nenhuma chave estiver fechada, a sa da assume um terceiro estado denominado alta impedncia (Hi-Z). como se a sa da ficasse desligada do resto do circuito. Quem diz se a porta est ou no em um estado de Hi-Z um sinal de enable. Este tipo de configurao de sa da muito til quando dois ou mais circuitos necessitam compartilhar o mesmo meio de transmisso.

FIGURA 2.7: Sa da Tri-State

2.5 Algebra de Boole


A lgebra criada por George Boole (1815 - 1864), facilita o entendimento operacional dos circuitos eltricos digitais. Partindo de premissas prestabelecidas, esta parte da matemtica muito importante para a determinao de circuitos lgicos, facilitando no s o entendimento operacional de tais circuitos, como tambm a sua simplificao e minimizao.
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2.5.1 Postulados B sicos


Operao (+) tambm chamada de unio, ou OR (OU).

TABELA 2.5: Operao OR

Operao (.) tambm chamada de interseo, ou AND (E).

TABELA 2.6: Operao AND (E)

(N O)

Operao Complemento, tambm chamada de inverso, ou NOT

TABELA 2.7: Operao Complemento (NOT ou N O)

2.5.2 Teoremas
Existem diversos teoremas envolvendo operaes AND, OR e NOT que servem para simplificao de expresses contendo variveis lgicas (provendo uma economia nos circuitos), e tambm para alterao da expresso, visando a utilizao de dispositivos prticos diferentes. Usa-se os s mbolos de adio para representar a funo OR, o s mbolo de multiplicao para representar a funo AND e o sinal de barra sobre a varivel para representar a funo NOT. Os dois estados poss veis para as variveis so 0 e 1. Temos a seguir alguns teoremas de uma varivel, teis para simplificao de funes lgicas:

TABELA 2.8: Teorema de uma Varivel

Temos a seguir alguns teoremas de duas e trs variveis, teis para simplificao de funes lgicas:

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TABELA 2.9: Teorema de Duas e Trs Variveis

Teorema de Morgan

Lei comutativa : A + B = B + A Lei associativa : A . B = B . A Lei distributiva : A + ( B + C ) = ( A + B ) + C

2.6 Formas Padr o de Fun es L gicas


2.6.1 Soma Padr o de Produtos
Soma padro de produtos uma estrutura de portas lgicas de dois n veis na qual as entradas do circuito so ligadas a portas AND, e as sa das destas portas AND so ligadas s entradas de uma porta OR. Qualquer funo lgica pode ser expressa na forma de soma padro de produtos. O desenho a seguir mostra um exemplo genrico.

FIGURA 2.8: Exemplo Genrico de Circuito que Implementa a Soma Padro de Produtos

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Para expressar uma funo como soma padro de produtos, devemos modifica-la, se necessrio, tendo em vista os teoremas e as propriedades de funes lgicas. Para obter a soma padro de produtos a partir de uma tabela-verdade, devemos selecionar as linhas da tabela que tiverem sa da igual a um, conforme o exemplo abaixo:

TABELA 2.10: Obteno de Soma Padro do Produto a partir de Tabela-Verdade

2.6.2 Produto Padr o de Somas


Produto padro de somas uma estrutura de portas lgicas de dois n veis na qual as entradas do circuito so ligadas a portas OR, e as sa das destas portas OR so ligadas s entradas de uma porta AND. Qualquer funo lgica pode ser expressa na forma de produto padro de somas.

FIGURA 2.9: Exemplo Genrico de Circuito que Implementa o Produto Padro de Somas

Para expressar uma funo como produto padro de somas, devemos modifica-la, se necessrio, tendo em vista os teoremas e as propriedades de funes lgicas. Para obter o produto padro de somas a partir de uma tabela-verdade, devemos selecionar as linhas da tabela que tiverem sa da igual a zero, invertendo as entradas, conforme o exemplo na pgina seguinte:

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TABELA 2.11: Obteno de Produto Padro do Somas a partir de Tabela-Verdade

2.7 Mapas de Karnaugh


Os mapas de Karnaugh so dispositivos teis para simplificao e minimizao de funes algbricas booleanas. Um mapa Karnaugh uma figura geomtrica como a mostrada abaixo:

FIGURA 2.10: Figuras Representativas de Mapas de Karnaugh

A primeira figura mostra um mapa K para 3 variveis (A,B e C) e a segunda mostra um mapa K para 4 variveis (A,B,C e D). As vantagens do uso dos mapas K na simplificao de funes tornam-se mais evidentes nas funes com mais de 3 variveis. poss vel desenhar mapas K para qualquer nmero de variveis. No exemplo abaixo demonstramos um mtodo simplificado de uso de um mapa K para 4 variveis lgicas. Vamos projetar um circuito que tenha quatro entradas (A,B,C e D) e uma sa da (O). Nosso circuito deve comportar-se conforme a tabela-verdade na pgina seguinte:

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TABELA 2.12: Tabela-Verdade para Circuitos Hipotticos

Soluo: 1) Desenhamos um mapa K de 4 variveis de entrada e escrevemos o nmero 1 em cada quadr culo correspondente linha da tabela verdade que tiver sa da 1:

FIGURA 2.11: Primeira Etapa para Soluo do Circuito, Utilizando Mapas de Karnaugh

2) Assinalamos os quadr culos com um que no estejam prximos a nenhum outro (so considerados prximos os quadr culos que estiverem se tocando diretamente pelas arestas ou aqueles que estiverem em posies anlogas em linhas ou colunas nas extremidades opostas). 3) Assinalamos os grupos de quadr culos com um que estejam prximos. Os grupos de quadr culos devem ser os maiores poss veis. Cada quadr culo deve estar assinalado pelo menos uma vez. Observe a sequncia dos desenhos na pgina seguinte:

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FIGURA 2.12: Segunda e Terceira Etapas para a Soluo do Circuito

4) Obtemos a funo simplificada que representa a tabela - verdade proposta, a partir da ltima verso do mapa K. Compare a expresso obtida abaixo com o ltimo desenho da srie mostrada acima

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CAPTULO CIRCUITOS COMBINACIONAIS


Circuitos combinacionais so aqueles nos quais a sa da determinada pelas condies da entrada, ou seja, em um determinado momento a sa da do circuito depende unicamente do estado da entrada do circuito naquele momento. Todos os circuitos digitais vistos at este ponto do curso so considerados combinacionais. Existem alguns circuitos combinacionais clssicos, muito utilizados na prtica, e que merecem ser estudados separadamente. So eles: decodificadores; codificadores; multiplexadores (MUX); demultiplexadores (DEMUX); comparadores.

3.1 Decodificadores
Um circuito decodificador, usualmente, considerado aquele que, a partir de uma entrada fornecida em um cdigo qualquer, produz uma sa da em cdigo decimal. A figura a seguir mostra um decodificador com uma entrada em binrio com dois bits e uma sa da em decimal de 4 d gitos, bem como a tabela verdade do circuito:

FIGURA 3.1: Decodificador com 2 bits de entrada e 4 sa das

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Uma caracter stica importante de um decodificador que , para cada entrada A1,A0 existe uma e apenas uma sa da habilitada (ativa), permanecendo as demais desabilitadas. Um exemplo de CI decodificador o 74138, que possui quatro entradas para cdigo binrio (endereo), e 8 vias de sa da para cdigo decimal. O 74138 possui ainda uma entrada de enable ativada por trs entradas (duas em n vel baixo e uma em n vel alto).

FIGURA 3.2: Circuito Integrado 74138 (Decodificador)

3.2 Codificadores
Um codificador executa a oprao inversa do decodificador: Para cada linha escolhida (ativada) , uma palavra de cdigo aparecer nas linhas de sa da. A palavra de cdigo da sa da geralmente nica para cada linha selecionada na entrada, mas no precisa ser necessariamente assim. Abaixo temos um exemplo de um poss vel decodificador com quatro linhas de entrada e quatro linhas de sa da em um cdigo arbitrrio

FIGURA 3.3: Codificador com 4 Entradas e 4 bits de Sa da

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3.2.1 Codificador com Prioridade


Sistemas digitais freqentemente possuem sensores que indicam quando alguma ao necessria. Por exemplo: Um sensor de passagem pode indicar que uma pessoa passou por uma porta, gerando um sinal digital ( a passagem do n vel lgico 0 para n vel lgico 1 em um condutor, por ex.). Este sinal a indicao de que algo deve ser feito (incrementar um contador, ligar um circuito, etc.), ou seja uma solicitao de atendimento . Normalmente um codificador utilizado para aceitar as linhas de solicitao de atendimento e apresentar o cdigo que corresponde ao endereo do componente do sistema que faria o atendimento solicitao. Se duas solicitaes de atendimento forem feitas ao mesmo tempo, temos que ter um esquema de prioridades, ou seja, ser atendida a solicitao que tiver prioridade mais alta. Um circuito integrado comercial que implementa um codificador com prioridade o 74148. Este possui todas as entradas e linhas de controle ativas quando baixas. O CI aceita 8 entradas (I7 a I0) e prov trs sa das (A2 a A0), que podem gerar 2 = 8 endereos. Possui ainda uma entrada de habilitao (EI) e duas sa das : EO e GS. As sa das EO e GS servem para indicar quando h uma solicitao de atendimento ou no, conforme a tabela abaixo:

TABELA 3.1: Sa das EO e GS do Circuito Integrado 74148

3.3 Conversores de C digo


Conversor de cdigo o circuito lgico que faz a traduo de uma informao codificada de uma determinada maneira para um cdigo diferente. Um conversor de cdigo pode ser constru do ligando um decodificador e um codificador em cascata, conforme a figura abaixo:

FIGURA 3.4: Diagrama para a Criao de C digo

Existem conversores de cdigo implementados em circuitos integrados dispon veis comercialmente. Um exemplo t pico o conversor de cdigo BCD para display de 7 segmentos, no qual podemos entrar com um cdigo BCD de 4 bits e teremos na sa da um cdigo de 7 bits adequado para acionar um display de 7 segmentos que mostre o nmero da entrada em forma decimal ou hexa. s vezes os conversores de cdigo so denominados pelos fabricantes de integrados de decodificadores.

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3.3.1 Decodificadores / Drivers


Existem alguns integrados que possuem sa das de coletor aberto com capacidades relativamente elevadas de dissipao de potncia, como por exemplo os integrados 7406 (Buffers/Drivers inversores) e 7407 (Buffers/ Drivers no-inversores), sendo adequados para alimentao direta de pequenas cargas como lmpadas (da ordem de algumas dezenas de mA, em at 30 V). Existem tambm CIs decodificadores da fam lia 74 com drivers incorporados, que so chamados decodificadores / drivers. Um exemplo o CI 74141 que um decodificador de BCD para decimal.

3.4 Multiplexadores (MUX)


Um multiplexador um circuito lgico digital que possui um determinado nmero de entradas e apenas uma sa da. O circuito, atravs de uma determinao externa, conecta uma nica entrada sa da. Um multiplexador, portanto, faz o papel de uma chave digital mltipla, como a que est representada abaixo:

FIGURA 3.5: Representao de um Multiplexador (MUX)

Uma implementao prtica de um circuito MUX demonstrada na figura abaixo. No caso, as entradas S0 e S1 determinam, atravs de um cdigo binrio, qual das entradas (I0 a I3) estar conectada com a sa da (O). Um circuito MUX tem sua aplicao mais bvia no compartilhamento de uma nica via de transmisso de dados por mais que um circuito, dividindo o tempo.

FIGURA 3.6: Implementao de Circuito MUX com Portas NOT, AND e OR

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3.4.1 Multiplexador como Gerador de Fun es


Um circuito MUX pode ser utilizado para gerar uma funo lgica arbitrria das variveis selecionadoras. Para isto, devemos escrever a funo arbitrria na forma de soma de produtos das variveis de seleo e ativamos as entradas correspondentes a cada parcela da soma. Por exemplo: se desejarmos criar, atravs de um multiplexador, um circuito que apresente na sa da a funo:
O = S1 + S1 S0

Escrevemos a funo como soma de produtos das duas variveis de seleo ( S1 e S2):
O = S1(S0 + S0) + S1 S0 O = S1 S0 + S1 S0 + S1 S0

A primeira parcela da soma, no circuito de portas da pgina anterior, ser gerado fazendo I1 = 1. A segunda parcela ser gerada fazendo I0 = 1. A terceira parcela ser gerada com I2 = 1. Um exemplo de CI multiplexador o 74151, que possui trs entradas de seleo e 8 vias de entrada. O 74151 possui ainda uma entrada de enable ativada por n vel baixo e duas sa das complementares.

FIGURA 3.7: CI Multiplexador 74151

3.4.2 Multiplexa o com Coletor Aberto


Se tivermos diversos chips com sa das de coletor aberto, e necessitamos multiplexar estas sa das, no necessrio usar um CI multiplexador adicional, pois se ligarmos todas as sa das a um ponto comum , com um resistor de pull-up (resistor ligado ao positivo da fonte de alimentao), o circuito ir funcionar perfeitamente bem, desde que apenas um integrado esteja habilitado de cada vez.

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FIGURA 3.8: Circuito Multiplexador com Coletor Aberto

3.4.3 Multiplexa o com Sada Tri-State


Circuitos integrados com sa das em tri-state tambm podem ser multiplexados sem o aux lio de um circuito especial, visto que as sa das esto desligadas (em alta impedncia - HiZ) se o circuito correspondente estiver desabilitado. Basta, portanto, ligar todas as sa das a um ponto comum e habilitar um circuito de cada vez. A linha de dados compartilhada por mais de um circuito chamada BUS ou Barramento.

3.5 Demultiplexadores (DEMUX)


Na prtica, normalmente utilizamos um BUS para muitas fontes de sinal diferentes, recorrendo multiplexao. O Demultiplexador um circuito que recebe um sinal do BUS e o dirige para o receptor adequado. Um demultiplexador pode ser considerado um decodificador no qual, em cada porta AND foi acrescentada uma entrada adicional que ligada ao BUS. Um demultiplexador de uma linha para quatro linhas mostrado na figura abaixo:

FIGURA 3.9: Implementao de Demultiplexadores de 4 Linhas

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3.5.1 Mux e Demux em Comunica o


Circuitos multiplexadores e Demultiplexadores podem ser utilizados para tornal poss vel o compartilhamento de uma nica linha de transmisso para vrios emissores e receptores. Neste caso, os usurios compartilham a linha no tempo, conforme representado no desenho abaixo. O bloco denominado contador e o clock do sistema sero estudados em detalhes mais frente.

FIGURA 3.10: Diagrama de Blocos Mostrando Circuitos MUX e DEMUX no compartilhamento de linha de transmisso

3.6 Comparadores Digitais


Uma grande parte dos circuitos lgicos digitais, normalmente, utilizam circuitos especializados em comaparar dois nmeros binrios e determinar se estes so iguais ou diferentes, e qual dos dois maior. Para o caso em que os nmeros possuem apenas um bit, o circuito simples e requer apenas algumas portas simples. Para nmeros maiores o circuito torna-se mais complexo, e existem CIs dedicados para este fim. O CI 7485 um circuito de comparao de magnitude que possui duas entradas de quatro bits (A e B) e trs sa das (A>B, A<B , A=B). Possui ainda trs entradas de cascateamento para possibilitar a comparao entre nmeros com mais que 4 bits.

3.7 Gera o e Verifica o de Bit de Paridade


O bit de paridade um bit que se adiciona a uma palavra binria, para diminuir o risco de perda de integridade de dados em uma transmisso, por exemplo. Existem dois tipos de paridade: Par e mpar. Na paridade par, o bit adicionado palavra deve ser tal que o total de bits 1 seja par. Na paridade mpar, o bit adicionado palavra deve ser tal que o total de bits 1 seja mpar. Na recepo da palavra, existe um circuito para verificao da paridade. Se alguma falha na transmisso ocorreu, provavelmente ser detectada. O CI 74180 um gerador e verificador de paridade, e pode verificar uma palavra de 9 bits, gerando o 10 bit de paridade. O 74180 possui 8 entradas para a palavra a ser verificada (A a H), 2 entradas (ODD e EVEN) para o 9 bit ou para ligao em cascata, e 2 sa das ( odd e even) e que indicam a paridade das entradas.
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CAPTULO LATCHS AND FLIP-FLOPS


4.1 Latchs

Um latch um circuito lgico que, sem interveno externa, permanece indefinidamente em um determinado estado (High ou low, 1 ou 0). Ao contrrio dos circuitos combinacionais, o latch no depende unicamente das suas entradas para determinar suas sa das, visto que na ausncia de entradas ele ainda mantm um n vel lgico definido. No desenho abaixo est representado um latch constru do com duas portas inversoras:

FIGURA 4.1: Latch com Duas Portas Inversoras

Um latch pode ser usado para armazenar , ou seja registrar ou ainda memorizar um valor 0 ou 1 (chamado bit). Um conjunto de 8 latchs pode ser considerado um registrador de palavras de 8 bits onde escrevemos um valor ou dado. Os dois estados poss veis de um latch so chamados de set (quando Q=1) e reset (quando Q=0). O estado reset chamado s vezes de clear, ou seja, limpo. Para levar o latch da figura acima para o estado setado ou resetado, basta forar a entrada Q para o n vel lgico 1 ou 0, respectivamente.

41.1 Latch SR
Podemos construir um latch utilizando portas NOR, conforme desenho a seguir, obtendo assim duas entradas chamadas entradas de controle.O comportamento do circuito est resumido na tabela verdade a seguir:

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FIGURA 4.2: Latch SR (Representao e Tabela-Verdade)

O mesmo circuito que est representado acima, se for implementado com portas NAND, obedecer a tabela abaixo:

TABELA 4.1: Tabela-Verdade Latch SR com Portas NAND

O s mbolo do latch SR est representado no desenho abaixo:

FIGURA 4.3: Representao Latch SR

O circuito integrado 74279 possui quatro latchs SR implementados com portas NAND, sendo que dois deles tem as entradas S e R normais e dois deles tem trs entradas : S1, S2 e R (para serem setados necessitam de sinais em duas entradas).

4.1.2 Chave sem Trepida o


Uma caracter stica das chaves mecnicas de liga/desliga que o contato trepida (bouces) diversas vezes antes de repousar em um estado determinado. Isto pode causar problemas em um circuito digital, j que a abertura

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ou fechamento de uma chave no ir causar a simples alterao de n vel lgico 1 para 0 ou vice-versa, e sim ir gerar um trem de pulsos geralmente indesejvel. Um circuito como o representado no desenho abaixo elimina o efeito da trepidao da chave, j que, se a chave trepidar, as entradas do latch permanecero em n vel lgico 0, mantendo as sa das com seu valor inalterado.

FIGURA 4.4: Circuito Anti-Trepidao

4.1.3 Latchs Controlados


Um latch controlado ou dinmico nada mais do que um latch que possui uma entrada adicional de habilita (Enable), que recebe um sinal de controle (strobe) habilitando o latch a registrar o dado presente em suas entradas (R e S). Um exemplo de latch deste tipo est representado no desenho abaixo.

FIGURA 4.5: Latch Controlado (com Entrada Enable/Clock)

Diz-se que este tipo de latch tem a caracter stica de ser transparente, j que a sa da segue a entrada sempre que o latch estiver habilitado. Um latch que possui apenas uma entrada de dados denominado latch tipo D. A seguir temos um diagrama de tempos representando o funcionamento do latch da figura acima.
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FIGURA 4.6: Diagrama de Tempos do Latch da Figura 4.5

O circuito integrado 74373 possui oito latchs transparentes tipo D, com sa das tri-state controladas por um pino de Enable e entradas controladas por um pino de Enable tambm.

4.1.4 Sincronismo (Clocking)


Um sistema s ncrono aquele em que aplicamos sua entrada Enable um sinal (Clock) que executa transies entre os n veis alto e baixo, habilitando e desabilitando o circuito nos momentos apropriados. A cada ciclo alto-baixo, o processamento do circuito avana um passo. A velocidade do processamento depende da frequncia destes ciclos. O tempo destinado ao ciclo do clock depende dos atrasos de propagao dos dispositivos f sicos empregados.

4.2 Flip-Flops
Os latchs controlados apresentam deficincias em sistemas s ncronos, pois tem suas sa das inteiramente, ou em parte, ligadas entradas de outros latchs. Neste caso encontramos problemas quando desejamos ler e escrever um dado em um latch no mesmo per odo do relgio (clock). Circuitos que superam estas deficincias so chamados de Flip-Flops.

4.2.1 Flip-Flop Mestre-Escravo


O flip-flop mestre-escravo um circuito lgico armazenador no-transparente, no qual acoplamos dois latchs em sequncia, com um mesmo sinal de habilitao (clock) para os dois, sendo que no segundo latch (escravo) o sinal invertido, conforme desenho a seguir:

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FIGURA 4.7: Flip-Flop Mestre-Escravo

No flip-flop mestre-escravo, ocorre o seguinte: Quando o pino de clock passa de 0 para 1, o valor lido na entrada armazenado no latch mestre. Quando o pino de clock passa de 1 para 0, o valor armazenado no latch mestre passa para a sa da do latch escravo. Este modo de funcionamento permite a construo de dispositivos chamados registradores de deslocamento ou shift-registers , bastante utilizados na prtica.

4.2.2 Entradas Diretas


Entradas diretas so entradas que podem setar(preset) ou resetar(clear) o flip-flop sem depender do sinal do clock. Estas entradas so s vezes chancronas. As entradas diretas prevalecem totalmente madas de entradas ass sobre as entradas s ncronas.

4.2.3 Flip-Flop JK
O flip-flop JK um flip-flop modificado para que, na condio R=1 e S=1, a sa da inverta-se (altere o seu estado) . A representao de um circuito de flip-flop tipo JK, bem como a sua tabela-verdade est no desenho a seguir:

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FIGURA 4.8: Circuito Flip-Flop tipo JK e sua Tabela-Verdade

4.2.4 Flip-Flop Tipo T


Um flip-flop tipo T um flip-flop que chaveia a sa da quando a entrada de controle for ativa e no altera-se quando a entrada for inativa. O flip-flop tipo T pode ser constru do ligando-se juntas as entradas J e K de um flip-flop JK.

4.2.5 Flip-Flop JK Gatilhado pela Borda


O flip-flop mestre-escravo (Tanto no modo SR como JK), tem a seguinte desvantagem: Se alguma alterao rpida (ru do) ocorrer durante um pulso ativo do clock, esta alterao pode ser detectada e registrada, conforme mostra o diagrama de tempos representado a seguir: O flip-flop gatilhado pela borda resolve o problema apresentado ante-

FIGURA 4.9: Diagrama de Tempos Mostrando Ru do Detectado por Flip-Flop tipo JK ou SR

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riormente, j que a sa da a resposta entrada, mas somente aos dados imediatamente anteriores transio de gatilho do sinal de relgio.

4.2.6 Flip-Flops Mestre-Escravo com Data-Lock-Out


Existem flip-flops do tipo mestre-escravo nos quais os dados so guardados no mestre durante a borda positiva do clock, e so trasnferidos para a sa da durante a borda negativa do pulso do clock. Estes so denominados flip-flops mestre-escravo com Data-Lock-Out. Neste flip-flop, pode haver mudana na entrada durante o n vel positivo do clock, pois a informao da entrada j foi armazenada no mestre na borda positiva do clock. Abaixo temos o diagrama de tempos que compara as formas de onda para um flip-flop mestre-escravo normal e um com datalock-out

FIGURA 4.10: Diagrama de Tempos Comparativos entre Flip-Flops Mestre-Escravo com e sem Data-Lock-Out

4.2.7 Flip-Flop Tipo D


Um flip-flop tipo D um flip-flop tipo mestre-escravo, modificado da forma indicada no desenho abaixo. Em um flip-flop tipo D, o dado presente na entrada aparece na sa da Q, em resposta uma transio negativa do relgio. Existe um circuito alternativo dispon vel mais econmico que o flipflop mestre-escravo modificado, que tem gatilhamento na borda positiva da transio do relgio.

FIGURA 4.11: Flip-Flop Mestre-Escravo Modificado (Flip-Flop tipo D)

Utilizando outros circuitos no mostrados aqui, os flip-flops podem ser habilitados, na prtica, de quatro maneiras diferentes:
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FIGURA 4.12: Modos de Habilitao de Flip-Flops

a) habilitado quando o clock est em n vel 1; b) habilitado quando o clock est em n vel 0; c) habilitado na transio de 0 para 1 do clock; d) habilitado na transio de 1 para 0 do clock.

4.2.8 Par metros dos Flip-Flops


a) Tempo de Set-Up - tSet-Up o tempo m nimo que o sinal deve permanecer nas entradas antes da ocorrncia do pulso de gatilhamento

FIGURA 4.13: Tempo de Set-Up

b) Tempo de Manuteno - thold o tempo que o sinal deve permanecer nas entradas aps a ocorrncia do pulso de gatilhamento.

FIGURA 4.14: Tempo de Manuteno

c) Freqncia mxima - fmax a maior freqncia de pulsos de clock que pode ser aplicado ao dispositivo, mantendo chaveamento confivel.
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CAPTULO REGISTRADORES E CONTADORES


5.1 Registradores
Registradores so um grupo de elementos (flip-flops, por ex.) capazes de guardar uma informao, e que funcionam juntos em uma unidade. Os registradores mais simples armazenam uma palavra binria que pode ter n bits. Existem tambm registradores mais complexos como os de deslocamento (shift registers) e contadores que, alm de armazenar a palavra, podem executar uma determinada operao sobre esta palavra. O desenho abaixo representa um registrador simples para palavra de quatro bits. Os registradores normalmente so mais complexos que o mostrado abaixo, tendo sinais de controle que habilitam sua leitura ou escrita.

FIGURA 5.1: Registrador Simples para Palavra de 4 Bits

5.1.1 Registradores de Deslocamento (Shift Registers)


Uma caracter stica bastante til em um registrador a possibilidade de efetuar um deslocamento , isto , a possibilidade de um dado registrado em um bit deslocar-se atravs das unidades de armazenamento (flip-flops). Um registrador de deslocamento um dispositivo s ncrono que pode ser utilizado para armazenar n bits com apenas um pino de entrada. O desenho a seguir representa um registrador de deslocamento de 4 bits, utilizando flip-flops do tipo JK.

FIGURA 5.2: Registrador de Deslocamento de 4 Bits, com Flip-Flops tipo JK

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Existem registradores de deslocamento com circuitos lgicos prprios para a inverso de ligao entre os flip-flops, de forma que possamos inverter o sentido do deslocamento. Se ligarmos a sa da do ltimo flip-flop entrada do primeiro, obtemos um registrador de deslocamento que no perde o ltimo bit, mas sim transfere o seu valor para o primeiro. Este tipo de circuito denominado registrador com rotao. O CI 74194 um registrador de deslocamento universal bidirecional de quatro bits. O CI 74 164 um registrador de deslocamento de 8 bits.

5.1.2 Formato S rie e Paralelo


Os dados digitais so apresentados e transmitidos de duas formas : Srie e paralelo. No formato srie, os dados so conduzidos (transmitidos) por um nico fio. No formato paralelo, necessitamos de tantos fios quantos forem os bits a serem transmitidos. O formato srie mais econmico, mas menos rpido. Frequentemente, necessitamos fazer a converso da apresentao de dados em srie para paralelo e vice-versa. O circuito registrador de deslocamento adequado para este fim.

5.2 Contadores
Um contador um arranjo de flip-flops que avana de um estado para outro em resposta a um evento. Este evento pode ser a passagem de uma pea por uma esteira na linha de produo, a passagem de uma pessoa por uma roleta, etc. , e geralmente traduzido na forma de um pulso de clock. Observe que um relgio digital nada mais do que um contador em que o odo de tempo. evento a ser contado um per Existem dois tipos de contadores: Os contadores s ncronos, nos quais o sinal de clock aplicado a todos os flip-flops componentes do conjunto ao mesmo tempo e os contadores ass ncronos , nos quais o sinal aplicado ao clock de cada flip-flop pode diferir.

5.2.1 Contadores Sncronos


5.2.1.1 Contador em Anel

O contador em anel um registrador de deslocamento ligado em configurao de rotao, no qual carregamos previamente o valor 1 em apenas um dos flip-flops. Este tipo de contador tem, portanto, uma sa da em decimal. No desenho na pgina seguinte est representado um contador em anel com mdulo 4:

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FIGURA 5.3: Contador S ncrono, com Configurao em Anel e M dulo 4

5.2.1.2 Contador em Anel Torcido O contador em anel torcido, ou contador Johnson, idntico ao da figura anterior, com excesso que para fechar o anel, ligamos a sa da Q\ do ltimo flip-flop entrada D do primeiro. Com este arranjo, obtemos 8 combinaes poss veis para quatro flip-flops, ao contrrio do circuito da Figura 5.3, que s tinha mdulo 4. Este tipo de circuito, no entanto, necessitar de da aceitvel. uma lgica adicional (um decodificador) para obter uma sa 5.2.1.3 Contador Sncrono em C digo Binrio Um circuito utilizando flip-flops tipo T , montados como mostra a figura abaixo um contador em binrio de 4 bits, ou seja, pode contar at 16. Lembre que os flip-flops tipo JK com as entradas J e K ligadas juntas um flip-flop tipo T . Este tipo de contador mais lento que o contador em anel, visto que , dependendo da situao, o sinal deve se propagar atravs de uma cascata de portas AND.

FIGURA 5.4: Contador Binrio de 4 Bits, S ncrono

5.2.1.4 Contadores S ncronos de M dulo Arbitrrio Para construir um contador de mdulo arbitrrio, comeamos com um nmero de flip-flops suficiente para prover um nmero de estados igual ou maior que o mdulo. Em seguida devemos decidir quais estados entre os poss veis devem ser eliminados. Devemos ento decidir a ordem pela qual o contador deve passar pelos estados no eliminados. Finalmente devemos projetar uma lgica combinacional de forma que o contador passe de estado para estado conforme desejamos. Os mtodos espec ficos para o projeto de um gerador de mdulo arbitrrio fogem do escopo deste documento.
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5.2.2 Contadores Assncronos


5.2.2.1 Contadores por Pulsao (Ripple Counters) Tambm chamado contador Srie. Este tipo de contador constru do ligando-se flip-flops tipo T ligados em cascata conforme o desenho abaixo. A entrada T do flip-flop deve ser mantida em n vel 1 para que o flip-flop opere em modo de chaveamento. O relgio externo (clock) s ligado no primeiro flip-flop. Para que o efeito do clock possa ser sentido em um determinado flip-flop, este deve se propagar atravs de todos os flip-flops anteriores.

FIGURA 5.5: Contador por Pulsao

Um contador por pulsao pode usar flip-flops que chaveiam na borda positiva ou na borda negativa do sinal aplicado na entrada de clock. Podese ainda ligar a entrada de clock de cada flip-flop sa da Q ou Q\ do flip-flop anterior. Dependendo do tipo de arranjo, o contador contar para cima ou para baixo.

TABELA 5.1: Direo de Contagem Conforme Ligao e Tipo de Chaveamento em um Contador por Pulsao

5.2.3 Circuitos Integrados Contadores


Existe um grande nmero de circuitos integrados contadores , sendo que alguns possuem circuitos bastante complexos. Todos baseiam o funcionamento em flip-flops. Na fam lia TTL 74, os mais simples so o 7490, 7492 e 7493. O 7490 um contador de dcadas (mdulo 10). Internamente temos um conjunto de 3 flip-flops que compe um contador mdulo 5 e mais um flip-flop que um contador mdulo 2. Se ligarmos externamente a sa da QA (pino 12) entrada B ( pino 1), obtemos um contador de dcadas. Neste caso o sinal de entrada conectado entrada A ( pino 14). O 7490 possui 4 entradas de reset que determinam as sa das, conforme a tabela a seguir:

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TABELA 5.2: Entradas e Sa das do CI Contador 7490

O 7492 possui 4 flip-flops (A,B,C e D) interligados de maneira que possam ser usados das seguintes maneiras: flip-flop A pode ser usado separadamente como contador mdulo 2; os flip-flops B, C e D podem ser usados como contador mdulo 6; os quatro flip-flops podem ser usados como contador mdulo 12. O 7493 um contador de pulsao com quatro flip-flops, sendo que o primeiro isolado dos demais, formando assim trs possibilidades de uso : 1 contador mdulo 2; 1 contador de pulsao mdulo 8; 1 contador de pulsao mdulo 16, interligando externamente o primeiro flip-flop aos demais. Pode-se interligar dois circuitos 7493, como qualquer outro circuito integrado contador, para formar um contador de pulsao maior. Existem integrados que possuem uma sa da de carry que facilitam esta interligao.

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CAPTULO CIRCUITOS ARITM TICOS

Na maioria dos circuitos digitais existem circuitos denominados aritmticos que executam as operaes de adio, subtrao, multiplicao e diviso de nmeros binrios. Existem tambm dispositivos flex veis tais como as Unidades Aritmticas e Lgicas (ULAs), que so fornecidas em forma de CIs e podem executar diversas operaes, dependendo de como forem programadas (conforme o estado de determinadas entradas que determinam a funo a executar).

6.1 Meio Somador


O meio somador um circuito destinado a somar dois bits. A soma de dois bits obedece as regras da tabela verdade a seguir:

TABELA 6.1: Tabela-Verdade para Meio Somador

A partir da ltima tabela , pode-se chegar ao circuito que calcula a soma e o carry:

FIGURA 6.1: Circuito para Soma e Carry (Meio Somador)

6.2 Meio Subtrator


um circuito bsico destinado a subtrair dois bits. A subtrao de dois bits obedece as regras da tabela a seguir:
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TABELA 6.2: Tabela-Verdade para Meio Subtrator

A partir da tabela acima, pode-se chegar ao circuito que calcula a subtrao e o carry:

FIGURA 6.2: Circuito para Subtrao e Carry (Meio Subtrador)

6.3 Meio Inteiro


O somador descrito neste item utilizado para soma de dois nmeros binrios, cada qual contendo mais que um bit. Nestes casos, quase sempre h necessidade de somar-se trs bits (os dois nmeros mais um eventual vai um). A tabela verdade que rege a soma de trs bits a que est representada seguir:

TABELA 6.3: Tabela-Verdade para Soma de 3 Bits

A partir da tabela anterior, chega-se expresso que calcula a soma de trs bits:

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6.4 Subtrator Inteiro


Da mesma forma que o somador, quando se deseja subtrair dois nmeros binrios com mais de um bit cada, quase sempre h necessidade de efetuar uma operao envolvendo 3 bits. Neste caso, a tabela-verdade que rege a subtrao a mostrada abaixo. O carry o pede emprestado, no caso.

TABELA 6.4: Tabela-Verdade para Subtrao de 3 Bits

A partir da tabela acima, chega-se expresso que calcula a subtrao de trs bits:

6.5 Somador Paralelo


O somador paralelo soma todos os bits das parcelas a serem somados simultaneamente, conforme mostra a figura abaixo. Isto aumenta a velocidade da soma, mas requer mais hardware.

FIGURA 6.3: Circuito Somador Paralelo

6.6 Somador S rie


O circuito somador srie mais lento que o somador paralelo, mas gasta menos hardware. O circuito est representado no desenho abaixo e funciona da seguinte forma: As parcelas da soma so carregadas em dois registradores de deslocamentos de n bits. Temos disposio um registrador de deslocamento de N+1 bits para registrar o resultado. Temos um clock comum a todo o conjunto. A cada pulso de clock, o resultado da soma de dois bits guardado e dois bits mais significativos so apresentados ao circuito somador inteiro.

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Um flip-flop tipo D atrasa o bit de carry resultante da soma de forma que este seja apresentado no prximo ciclo.

FIGURA 6.4: Somador Srie

O 7483 um circuito integrado somador de 4 bits que aceita dois nmeros de quatro bits como entradas e fornece na sa da a soma de quatro bits e um bit de carry.

6.7 Representa o em Complemento de Dois


Boa parte dos circuitos digitais utiliza apenas um circuito para soma e subtrao. Neste processo, no caso de efetuarmos uma subtrao, representa-se o subtraendo como um nmero negativo e efetua-se uma soma comum. A maneira mais usual de representao de nmeros negativos em binrio denominada complemento de dois. Para achar o complemento de dois de um determinado nmero binrio basta inverter este nmero e somar 1 ao resultado. Da mesma forma, se um resultado tiver 1 no bit mais significativo, isto significa que este um nmero negativo, e devemos calcular o seu complemento de dois. Exemplo: 30 - 25 = 5 30 = 11110 25 = 11001 25 em comp. de dois = 00111 11110 + 00111 = 00101 = 5

6.8 Circuito Subtrator Somador


Na figura 6.5 temos representado um circuito somador subtrator paralelo de 4 bits que utiliza o processo de complemento de dois. Quando a entrada de seleo estiver em 0, a operao realizada pelos blocos somadores inteiros A+B. Quando a entrada de seleo estiver em 1, a operao reaELETR NICA DIGITAL 52

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lizada A+B+1 como B+1 o complemento de dois de B, na verdade estamos realizando a subtrao de A e B.

FIGURA 6.5: Circuito Subtrador Somador

6.9 ULA (Unidade L gica e Aritm tica)


Uma ULA um dispositivo lgico combinacional que aceita duas enda F que est relacionada s entradas tradas A e B e gera uma funo na sa por uma operao lgica ou aritmtica. A maneira pela qual as sa das esto relacionadas com as entradas depende do bits seletores de funo S0, S1, etc. O circuito Integrado 74181 uma ULA bsica de linha 74. Possui duas entradas para palavras de quatro bits (A e B), uma sa da de quatro bits (F) para o resultado da operao, uma entrada de quatro bits para seleo de operao (S), um bit para seleo de modo (m), uma entrada para o carry-in (o carry-in no afeta as operaes lgicas), uma sa da para o carry-out, e uma sa da indicativa de igualdade (A=B). A tabela abaixo resume as funes da ULA 74181

TABELA 6.5: Conjunto de Fun es da ULA 74181 ELETR NICA DIGITAL 53

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CAPTULO MEM RIAS

J vimos que atravs de dispositivos eletrnicos como registradores, podemos armazenar uma palavra de n bits. Memrias so dispositivos utilizados para armazenar palavra binrias na ordem de centenas de milhares. Podese utilizar flip-flops para o armazenamento em memrias ou outro dispositivo qualquer que sirva para este fim. Os circuitos de memria normalmente tem as seguintes entradas e sa das: algumas vias de entrada de dados para gravao e algumas sa das para leitura (que fisicamente podem ser as mesmas); algumas vias para endereo , que selecionar qual registrador ser lido / escrito, de acordo com um cdigo (endereo de memria); um pino que habilita o circuito (Chip Select - CS). Se o circuito no estiver habilitado, as sa das permanecem em alta impedncia; um pino de leitura / escrita, que habilita uma destas duas operaes ou apenas leitura, dependendo do tipo de memria.

FIGURA 7.1: Diagrama de uma Mem ria Hipottica de 8 Palavras de 6 Bits

7.1 Mem ria RAM (Mem ria de Acesso Aleat rio)


Memria RAM uma memria de leitura e escrita, isto , que pode ser gravada com um determinado valor e este valor pode ser posteriormente lido. Alm disso, podemos acessar qualquer registrador desejado aleatoriamente para ler ou escrever uma palavra. A memria RAM comum necessita de alimentao eltrica para manter a integridade de seus dados. por este motivo, pertencente ao grupo de memrias volteis. Quanto sua construo, as memrias RAM podem ser de dois tipos bsicos: RAM esttica e RAM dinmica. Na memria RAM esttica, os bits so armazenados em flip-flops individuais e permanecem armazenados indefinidamente enquanto o circuito for alimentado.
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A memria RAM dinmica armazena os bits atravs de carga em diminutos capacitores. Como um capacitor deste tipo ocupa muito menos espao que um flip-flop em um CI, a memria dinmica resulta bem mais compacta que a esttica. Em compensao, o bit em um capacitor permenece ntegro por apenas uma frao de tempo (aprox. 2 ms), devido s fugas. Para contornar este problema este tipo de memria deve ter um circuito auxiliar que verifique temporariamente os capacitores e os recaregue, se for necessrio. Esta operao denominada refresh. A maioria das memrias tem sa das em coletor aberto ou tri-state para permitir a ligao em paralelo e consequentemente melhorar a capacidade de manuseio de dados. Assim, quando o Chip Select no estiver ativo, o componente ficar em estado de alta impedncia, e no se pode nem escrever na memria nem ler os seus contedos. Isto significa que a memria estar desconectada de seus componentes externos. A operao de gravao ou escrita feita colocando-se os dados nas linhas de entrada, habilitando-se o chip , colocando-se os sinais de endereo na posio desejada e habilitando a escrita da memria. Deste modo os dados das linhas de entrada sero escritos na posio selecionada. Do mesmo modo, a operao de leitura feita habilitando-se o chip , colocando-se os sinais de endereo na posio desejada e habilitando a leitura da memria. Deste modo os dados da posio de memria selecionada ficaro dispon veis na sa da, para leitura.

7.2 Mem rias ROM


Uma memria ROM (Read Only Memory) um tipo de memria no qual podemos ler, mas no escrever. Os contedos so fixos e inalterados, sendo estabelecidos na hora da fabricao. Em uma ROM, os contedos no precisam ser alterados. Portanto no necessitamos de flip-flops ou dispositivos semelhantes. Uma ROM na verdade nada mais do que um conversor de cdigo e pode ser constru do a partir de dispositivos mais simples e baratos que as portas normalmente utilizadas.

7.2.1 Mem rias ROM Program veis (Proms)


Existem circuitos de ROM que permitem que o usurio estabelea as informaes que sero armazenadas, ao invs do fabricante. Estas memrias so chamadas de memrias PROM (Memrias de leitura programveis). A gravao s pode ser feita uma nica vez e no mais alterada. Normalmente a gravao feita atravs da queima de elos fus veis que determinam se a posio de memria conter um ou zero.

7.2.2 Mem rias ROM Program veis e Apag veis (Eproms)


Na EPROM, os dados so armazenados em dispositivos baseados em MOSFETs. Estes dispositivos fazem ou no a conexo (guardam bit um ou
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zero) conforme haja ou no carga eltrica na porta do trans stor. A programao feita atravs de um programador de EPROMs. Uma caracter stica importante a de que a exposio luz ultravioleta forte (por aproximadamente 30 min.) permite a fuga das cargas, apagando a memria. O apagamento possibilita uma nova programao (gravao).

7.3 Liga o de Mem rias em Paralelo


A ligao de memrias em paralelo utilizada quando o nmero de palavras e/ou o nmero de bits por palavra dispon vel em um determinado CI no adequado. Abaixo est representado a uma ligao em paralelo para aumentar o nmero de bits por palavra:

FIGURA 7.2: Ligao de Mem rias em Paralelo para Aumentar N mero de Bits por Palavra

O prximo desenho mostra uma ligao em paralelo para aumentar o nmero de palavras do conjunto:

FIGURA 7.3: Ligao de Mem rias em Paralelo para Aumentar N mero de Palavras

Para possibilitar flexibilidade no nmero de bits por palavra, os fabricantes oferecem circuitos de memria com um s bit por palavra. Aps selecionar um circuito com o nmero adequado de palavras, constru mos uma memria com n bits/palavra atravs da ligao em paralelo de n circuitos.

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7.4 Mem rias S rie


As memrias vistas at agora so todas de acesso aleatrio, isto , qualquer posio de memria pode ser acessada gastando aproximadamente o mesmo tempo, colocando o cdigo adequado nos pinos de endereo. Existe outro tipo de memria denominado memrias-srie, em que os dados so guardados seqencialmente em uma ordem pr-determinada. Isto significa que o tempo de acesso memria-srie depende do nmero de endereos interpostos entre o endereo desejado e o endereo presente. As memrias srie so mais econmicas que as de acesso aleatrio, mas em compensao so mais lentas. Existem dois tipos principais de memrias-srie: Aquelas nas quais as palavras aparecem na sa da na mesma ordem em que foram escritas. Elas so implementadas utilizando shift-registers ligados em anel. Por isso, o dispositivo s vezes chamado de first-in-first-out (FIFO); Aquelas nas quais as palavras aparecem na sa da na ordem inversa em que foram escritas. Elas so implementadas utilizando shift-registers bidirecionais. Por isso, o dispositivo s vezes chamado de last-in-first-out (LIFO).

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CAPTULO CONVERSORES D/A e A/D

comum acontecerem situaes em que se precisa trabalhar com sinal digital ao invs do analgico e vice-versa. Para resolver estas situaes foram criados dispositivos denominados conversores Analgico/Digital (A/ D), que convertem um sinal analgico em digital e conversores (D/A), que fazem a operao inversa. Nos conversores A/D e D/A, a importncia maior dada a amplitude do sinal, de entrada e de sa da respectivamente, de maneira que exista uma exata correspondncia entre o sinal analgico e o quantificado em digital e vice-versa.

8.1 Conversores Digitais/Anal gicos (D/A)


O conversor D/A converte n bits de sinal, presente em sua entrada, em um correspondente sinal analgico de sa da e no tempo, de modo que, a cada valor binrio colocado rm sua entrada, fornecer somente um n vel analgico de tenso na sa da:

FIGURA 8.1: Conversor D/A

8.1.1 Conversor D/A do Tipo Somador


Este conversor soma os n veis lgicos correspondentes a cada bit, sendo que o bit mais significativo corresponde com um n vel de tenso maior ou proporcional na soma, se comparado aos bits menos significativos.

FIGURA 8.2: Conversor D/A Tipo Somador ELETR NICA DIGITAL 58

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Quanto menos significativo o bit, maior a resistncia, que dobra a cada bit. Consequentemente, maior a queda de tenso sobre a mesma e menor a tenso com que contribui na sa da, uma vez que os n veis de tenso de cada bit digital de A1 a An, so iguais. O amplificador operacional na sa da permite um ajuste de ganho do circuito. Como exemplo, temos abaixo a equao que expressa o valor da tenso de sa da Vs a partir da tenso de entrada Vi para 3 bits de entrada:

8.1.2 Conversor D/A Tipo R-2R


O conversor somador apresenta o inconveniente utilizar resistores de valores mltiplos uns dos outros . J os do tipo R-2R s utiliza resistores de dois valores, formando uma malha, conforme mostrado na figura abaixo.

FIGURA 8.3: Conversor D/A Tipo R-2R

A expresso geral para qualquer nmero de bits i de entrada mostrada abaixo:

8.2 Conversores Anal gicos/Digitais (A/D)


O processo de converso do sinal analgico em digital bem mais complexo que o inverso. Existem diversos mtodos desenvolvidos para tal, sendo que os principais descreveremos a seguir. importante ressaltar que, para aplicaes que exijam confiabilidade e/ou preciso maiores, existem circuitos integrados dedicados para a converso A/D no mercado.

8.2.1 Conversor A/D Simult neo ou Conversor Flash


Este mtodo de converso baseia-se no uso de uma srie de comparadores ligados ao sinal analgico de entrada. Cada comparador tem sua segunda entrada ligada a uma tenso de referncia diferente, fazendo que a sa da dos comparadores seja ativada conforme o valor da tenso de entrada. Ligando-se as sa das dos comparadores a um conversor de cdigo, teremos um nmero binrio que corresponde ao sinal de entrada.
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FIGURA 8.4: Conversor A/D Simultneo ou Conversor Flash

O conversor A/D simultneo utilizado somente at 3 ou 4 bits de resoluo de sa da e tem uma velocidade de converso bastante elevada.

8.2.2 Conversores de Contagem Crescente


Observe o desenho abaixo:

FIGURA 8.5: Conversor A/D de Contagem Crescente

O funcionamento do circuito o seguinte: Um pulso de clear reseta o contador fazendo com que a sa da do conversor D/A v para zero. Se a entrada analgica apresentar uma determinada tenso, aparecer um sinal na sa da do comparador, que habilita o clock e faz com que o contador aumente at estabilizar no nmero binrio que representa a entrada. Periodicamente, deve-se fazer a leitura do contador e reset-lo para reiniciar o processo. Logicamente o conversor apenas tem o nmero binrio correto nas suas sa das em determinados per odos de tempo, o que limita sua utilizao. Na pgina seguinte temos a representao do funcionamento de um conversor A/D de quatro bits do tipo contagem crescente:

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FIGURA 8.6: Sinal Anal gico e sua Representao Digital em um Circuito Conversor de A/D de Contagem Crescente

8.2.3 Conversores de Rastreamento


Neste tipo de conversor, acrescentamos um contador bidirecional (updown) ao circuito. A sa da do comparador ligada ao controle up-down do contador. Se o sinal de entrada for maior que o d gito binrio na sa da, o da siga (rastreie) a contador conta para cima e vice-versa. Isto faz com que a sa entrada. O circuito e o grfico representativo esto na figura abaixo:

FIGURA 8.7: Circuito Conversor A/D de Rastramento / Sinal Anal gico e sua Representao digital em um conversor deste tipo

Os conversores A/D e D/A so muito utilizados em aplicaes como armazenamento (gravao) e transmisso de udio e v deo, visto que os sinais digitais so menos pass veis de introduo de ru dos e podem ter verificao de integridade e processamento mais fceis. Alm disso em qualquer circuito de interface entre variveis do mundo real (como movimento, velocidade, temperatura, massa, presso, umidade, posio, etc), e um circuito
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digital, os circuitos conversores mostram-se teis, conforme mostra o circuito de controle de temperatura sugerido abaixo:

FIGURA 8.8: Exemplo da Utilizao de Conversores A/D e D/A em um Sistema de Controle de Temperatura

8.2.4 Circuito de Amostra e Reten o (Sample-andHold)


Um conversor A/D requer uma certa quantidade de tempo, chamada tempo de converso, para transformar um sinal analgico em um sinal digital correspondente. Se o sinal analgico muda durante o tempo de converso, a sa da do conversor pode apresentar erro. Para impedir isso, um circuito de amostra e reteno utilizado para ler o sinal no in cio da converso e armazen-lo em um capacitor durante o tempo de converso restante. A figura 8.9 mostra um circuito deste tipo. A1 e A2 so buffers. S uma chave normalmente representada por um circuito a trans stor.

FIGURA 8.7: Circuito de Amostra e Reteno (Sample-and-Hold)

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REFER NCIAS BIBLIOGR FICAS


DATAPOOL ELETR NICA. M dulo 8810 : teoria e prtica. Itajub, [199-], 1 v. MALVINO, Albert Paul. Microcomputadores e microprocessadores. So Paulo : Makron Books. 1985. 578 p. MALVINO, Albert Paul. Eletr nica digital : princ pios e aplica es. So Paulo, Makron Books do Brasil, 1987. 2 v. NATALE, Ferdinando. Tecnologia digital. So Paulo : Atlas, 1992. 376 p. TAUB, Herbert. Circuitos digitais e microprocessadores. So Paulo, Makron Books, 1984. 510 p.

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