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Sistemas Digitales II
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DISEO DE UN SISTEMA DIGITAL MULTIPLICADOR
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Bosquejo del Procesador de Datos.
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Diagrama ASM del Controlador
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Diagrama de tiempo del circuito MULTIPLICADOR
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Cdigo VHDL para el registro de desplazamiento_d_i
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Cdigo VHDL para el registro de desplazamiento_i_d
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Cdigo VHDL para el registro de sostenimiento
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Cdigo VHDL para un BUS MUX 2 a 1
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Creacin del paquete COMPONENTES
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Creacin del paquete COMPONENTES
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Cdigo VHDL del circuito total Multiplicador de dos palabras de n bits.
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El numero de bits de los datos DataA y DataB es establecido por el parmetro genrico n.
Ya que los registros A y P deben ser de 2n bits se define un segundo parmetro genrico
nn para representar el tamao 2 x n.
Cambiando los valores de los parmetros genricos se puede usar el mismo cdigo VHDL
para nmeros de cualquier tamao.
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Los procesos MSS_transiciones y MSS_salidas definen las transiciones de
estados y generacin de salidas del circuito Controlador.
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El Procesador de Datos esta descrito por el siguiente cdigo VHDL:
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INTERFASES
Interfas de Entrada INTERFASES
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Diagrama ASM
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Interfaz de Salida
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