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PlayStation 2

Marcelo Schiavon Porto msporto@inf.ufrgs.br

CMP237 - Arquitetura e Organizao de Processadores

Introduo

Exemplo de sistema embarcado; Mantm compatibilidade com PS1; Suporta jogos on-line; Revolucionou a industria de jogos em 2001; Possui um processador mais poderoso do que qualquer console de jogos anterior;

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Arquitetura do PS2

Emotion Engine (EE Processador principal); Grafic Synthesizer (GS); Dynamic Sound Processor (SPU2); DVD/CD Room system;

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Arquitetura do PS2
RAM Emotion Engine (EE) I/O Procesor (IOP) Grafic Synthesizer (GS) Sound Processor (SPU2) Sada de vdeo

Dispositivos Externos

RAM

Sada de udio

ROM

CD/DVD

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Especificaes da EE

CPU core de 128 bits; Clock de 300MHz; Largura de banda do barramento de 3,2GB/s; 6,2 GFLOPS; 3D Geometry Performance de 66 milhes de polgonos por segundo; Unidade de processamento de imagens MPEG2;

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Arquitetura da EE
Controle e sntese de comportamento FPU
COP1

Processamento Geomtrico VU1


EFU

CPU Core

VUO
COP2

GIF

Timer

Barramento principal de Instrues de 64 bits, superscalar de 2 vias;128 bits Instrues multimdia de 128 bits; SIF DMAC IPU DRAMC Processador MIPS III R5900; Clock de 300MHz; Possui extenses do MIPS IV e de operaes multimdia; DRAM IOP

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Arquitetura da CPU Core


Duas ULAs inteiras de 64 bits; Unidade de Load/Store de 128 bits; Unidade de Execuo de Branch; FPU Co-processor (COP1); Vector Co-processor, VU0 (COP2); Os dois pipelines podem operar em conjunto e executar instrues inteiras de 128 bits;

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Estgios do Pipeline
1. 2. 3. 4. 5. 6.

Seleo do PC Fetch de instrues Decodificao das instrues e leitura de registradores; Execuo; Acesso a cache Writeback

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VU0 e VU1
FPU
COP1

CPU Core

VUO
COP2

VU1
EFU

GIF Barramento principal de 128 bits

Usadas para operaes matemticas; Arquiteturalmente idnticas; realizam adies e multiplicaes; Timer FMACs DMAC IPU DRAMC SIF FDIV para divises e clculo de raiz quadrada; Memria interna para microprogramas; DRAM IOP
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VU0
Arquitetura SIMD/VLIW de 128 bits; Co-processador (COP2) da CPU para macro-intrues (128 bits); 8k de memria de dados e intrues; Utilizada para operaes complexas, como clculos fsicos;

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VU1
Pr processador geometrico para o Grafic Synthesizer (GS); No possui um caminho direto para a CPU core, mas possui para o GIF (Grafic Interface Unit) 16k de cache de dados e de intrues; Mais usada transformaes; para

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Controlador DMA (DMAC)


FPU
COP1

CPU Core

VUO
COP2

VU1
EFU

GIF Barramento principal de 128 bits

Timer

DMAC

IPU

DRAMC

SIF

Controla o acesso de memria dos dispositivos; Essencial para o desempenho da EE; DRAM
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IOP
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Image Processing Unit (IPU)


FPU
COP1

VUO VU1 CPU Processador de descompresso de imagem; GIF Core COP2 EFU Decodifica vdeos MPEG2; Barramento Quantizao de vetores; principal de 128 bits Controle de transparncias; DMAC IPU DRAMC SIF

Timer

DRAM
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IOP
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Memrias no PS2
Cache L1 de duas vias, 16k instrues e 8k dados; SPRAM de 16k; VU0 4k instrues e dados; VU1 16k instues e dados; Memria de vdeo de 4MB (GS); Memria principal de 32MB;

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Grafic Synthesizer (GS)


Emotion Engine (EE) Grafic Synthesizer Syntesizer (GS) Sada de vdeo

RAM

Dispositivos Externos

RAM

Frequncia de clock de 150MHz; Sada de Sound I/O udio Procesor Largura de banda deProcessor memria 1,2Gb/s; (SPU2) (IOP) Taxa de processamento 2,4GPixel/s; Memria de 8K para frame e texturas; ROM CD/DVD

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Concluses

O PS2 possui uma poderosa arquitetura para processamento grfico; Arquitetura baseada em pequenas caches e em grande movimentao de dados; Barramento com diversos canais de comunicao direta com a memria garantem performance do processador;

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Referncias

http://www.technology.scee.net/ http://arstechnica.com/articles/paedia/cpu/ps2vspc.ars/1 http://arstechnica.com/reviews/hardware/ee.ars/1 http://en.wikipedia.org/wiki/PlayStation_2

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