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PDH

Plesiochronous Digital Hierarchy

Profs: Paulo J. da Costa Cunha e Selmar Tarcsio Mendes

Sistemas Telefnicos e de Comunicao

Plesicronos-Quase Sncronos
Plesios (Quase) Kronos (Tempo)
Desenvolvida nas dcadas de 60 e 70 Objetivo: Necessidade de aumentar o nmero de canais
transmitidos nos cabos com transmisso PCM.

Multiplexao Plesicrona: Multiplexao no tempo de


sinais com a mesma frequncia nominal mas com relgios (clocks) independentes. A multiplexao realizada por bit exceto os 2Mbps que por byte.

Bits de Justificao: Como a taxa de bits podem ser


ligeiramente diferentes para se agrupar vrios canais as taxas devem ser uniformizadas.

Sistemas Telefnicos e de Comunicao

Caractersticas
Padronizao Parcial (altas taxas e interfaces de linha no padronizadas)
Projetada para aplicaes Ponto-a-Ponto

Dificuldade para Insero e Derivao de tributrios


Pouca capacidade para gerncia de rede Existncia de 03 Hierarquias: Europia, Americana e Japonesa Multiplexao a partir de E1 realizada por bits e no mais por bytes

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PDH - Multiplex
O PCM-30 com 30 canais a base da multiplexao digital
A Multiplexao de 30 canais de voz mais 2 canais de sinalizao e controle transmitida em um canal de 2Mbps chamado E1. Para multiplexao de mais de 30 canais necessria a utilizao de taxas superiores da PDH A hierarquia de multiplexao da PDH comea no E1 e as taxas vo subindo passando pelo E2 (2xE1), E3(4xE2) e E4(4xE3).

Sistemas Telefnicos e de Comunicao

PDH - Multiplex
Em um sistema sncrono as bordas de subida e descida do clock so coincidentes em todos os equipamentos Na multiplexao PDH as bordas de subida e descida do clock no so coincidentes.
A multiplexao de vrios tributrios pode ser conseguida multiplexando-se bit por bit ou byte por byte. Byte interleaving Multiplexao E1 Bit interleaving. Demais taxas

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BIT INTERLEAVING

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BYTE INTERLEAVING

MULTIPLEXAO Byte por Byte

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As trs hierarquias
PDH (Plesiochronous Digital Hierarchy)
Japo USA Europa

J1 J2 J3 J4

1,5 Mbit/s 6 Mbit/s 32 Mbit/s 98 Mbit/s

T1 T2 T3 T4

1,5 Mbit/s 6 Mbit/s 45 Mbit/s 140 Mbit/s

E1 E2 E3 E4

2 Mbit/s 8 Mbit/s 34 Mbit/s 140 Mbit/s

Sistemas Telefnicos e de Comunicao

Hierarquia Digital Americana


1 64kbit/s

PCM de 1a ordem

1544kbit/s
2 3 4

PCM de 2a ordem

6312kbit/s 2 3 4 5 6 7 44736kbit/s

24

PCM de 3a ordem

2 3 4 5 6

PCM de 4a ordem

274176kbit/s

Designao DS0 DS1 DS2 DS3 DS-4

Denominao 64 kbit/s (T1) 1,5 Mbit/s (T2) 6,3 Mbit/s (T3) 44 Mbit/s (T4) 274 Mbit/s

Taxa exata de bits 64 kbit/s 1,544 Mbit/s 6,312 Mbit/s 44,736 Mbit/s 274,176 Mbit/s

Quant. de Tributrios 24 4 7 6

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Hierarquia Digital Europia (adotada no Brasil)


1 64kbit/s

PCM de 1a ordem

2048kbit/s 2 3 4

PCM de 2a ordem

8448kbit/s 2 3 4

30

PCM de 3a ordem

34368kbit/s 2 3 4

PCM de 4a ordem

139264kbit/s

Designao Ordem 0 Primeira Ordem Segunda Ordem Terceira Ordem Quarta Ordem Sem designao

Taxa exata de bits 64 kbit/s 64 kbit/s (E1) 2 Mbit/s 2,048 Mbit/s (E2) 8 Mbit/s 8,448 Mbit/s (E3) 34 Mbit/s 34,368 Mbit/s (E4) 140 Mbit/s 139,264 Mbit/s 565 Mbit/s 564,992

Denominao

Quant. de Tributrios 32 4 4 4 4

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Comparativo das Hierarquias Digitais

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Caractersticas do PDH - Brasil


Utiliza estrutura padronizada europia at o 4o nvel o quinto nvel no padronizado (565Mbit/s)
As interfaces eltricas so padronizadas tambm at o 4o nvel

As interfaces pticas no so padronizadas em qualquer nvel


So destinados poucos bits para a gerncia nos nveis padronizados

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EQUIPAMENTOS DA PDH
30canais
64 30 1 PCM 1a Ordem 2048 2048 16 1 Duplo Salto 34368

120canais
2048

1
4 PCM 2a Ordem

8448
2048

64 34368

Triplo Salto

139264

480canais
8448

1 PCM 3a Ordem
PCM 4a Ordem Taxas em kbit/s

4 1

1
Tributrios 139264 n Agregado

1920canais
34368 4

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EQUIPAMENTOS DA PDH
TRIBUTRIOS AGREGADO

TM

TM = TERMINAL MULTIPLEXADOR

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INTERFACES PADRONIZADAS
2M 8M 34M 140M 565M SIM SIM SIM SIM NO

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INTERFACES DE LINHA PADRONIZADAS


2M 8M NO NO

34M 140M 565M

NO NO NO

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INTERFACES DE LINHA NO PADRONIZADAS


Interface Padronizada Interface Padronizada

TM

ETL

ETL

TM

Interface Proprietria

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DIFICULDADE DE DERIVAO E INSERO DE TRIBUTRIOS


MULTIPLEXAO
A
B C D

TM

SADA

1 byte ou 1 bit

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DIFICULDADE DE DERIVAO E INSERO DE TRIBUTRIOS


ENTRADAS COM PEQUENAS VARIAES DE FREQUNCIA EM RELAO NOMINAL

A
B

ENTRADAS

C D

TM

SADA

NECESSIDADE DE MECANISMOS DE SINCRONIZAO

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Necessidade de Justificao
Central A
2,047950 Mbps

Central 2,047898 Mbps B


2,048 Mbps

TDM 8,442Mbps 2 ordem

50ppm
=102,4bps

Central C
2,048102 Mbps

Central D

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Necessidade de Justificao
Ordem 1a 2a 3a 4a Velocidade nominal de transmisso (kbit/s) 64 2048 8448 34368 139264 Tolerncia Mxima ppm Hz 100 6,4 50 102,4 30 253,4 20 687,4 15 2088,9

Como ocorrem diferenas entre os diversos relgios (Clocks) dos sinais a serem multiplexados necessrio sincroniz-los uma vez que a multiplexagem realizada por bit.

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Necessidade de Justificao
A
1 2 3 4

SADA

Na PDH as entradas correspondem aos tributrios. Na SDH as entradas correspondem aos VCs.

ERROS

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Justificao
A SINCRONIZADOR

SINC_A
M U X SADA

B A B SINC_A SINC_B I I I

SINCRONIZADOR

SINC_B

I I I I

I I OJ OJ I I I

I I I I

I I OJ OJ I I I

I I I I

I I OJ OJ I I I

I I I I

I I OJ OJ I I I

SADA
I - INFORMAO OJ - OPORTUNIDADE DE JUSTIFICAO

Sistemas Telefnicos e de Comunicao

Justificao
Bits de Justificao so ento inseridos durante a multiplexao a fim de sincronizar os sinais de entrada

Os bits de justificao, que no possuem informao (bit stuffing), so identificados e retirados durante o processo de demultiplexao.
Devido a insero destes bits de justificao impossvel identificar em nveis superiores as informaes relacionadas aos canais elementares dos nveis inferiores.

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DIFICULDADE DE DERIVAO E INSERO DE TRIBUTRIOS


Estrutura de Quadro no Facilita a Insero e Derivao de Tributrios

PDH Adequada para Aplicaes Ponto-aPonto


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Insero e Derivao de Tributrios


Para se derivar um tributrio de 2Mbit/s a partir de um sinal de 140Mbit/s necessrio percorrer todos os nveis inferiores a 140Mbit/s at chegar ao 2M desejado

140Mbit/s

140

ELO

140
34 34 8 8 2 2 8 34

140Mbit/s

34

ELO

Cliente 2Mbit/s

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2,048Mbps 1

8,448Mbps 1

Rede PDH
34,368Mbps

2,048Mbps 8,448Mbps 1 1

34,368Mbps

4 1 2 4 1 3 4 1 4 4 3 139,264Mbps 1 ELO 139,264Mbps ELO 1 2

4
1

Aplicaes
Ponto a Ponto

4
4

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ESTRUTURA DE QUADRO 8.448 kbit/s


A B
2.048bit/s C D

TM

8.448kbit/s

OH
212 bits

CJ

I
212 bits

CJ T

I
212 bits

CJ

OJ
212 bits

OH =

1 1 1 1 0 1 0 0 0 0 H1 H2
CJA CJB CJC CJD
Gerenciamento

CJ =

Durao do Quadro T = (1/8.448) x (4 x 212) T = 100,38 s


Bits I por Quadro = 200 + 208 + 208 + 204 = 820

OJ = OJA OJB OJC OJD I=

IA IB IC ID

.... IA IB IC ID

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ESTRUTURA DE MULTIPLEXAO NA PDH

140M x4

34M x4

8M x4

2M

Justificao (Mapeamento) Multiplexao

Alinhamento (Overhead)

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ESTRUTURA DE MULTIPLEXAO NA PDH

Justificao (Mapeamento) Processo de sincronismo dos tributrios acrscimo de bits de OJ e CJ

Multiplexao
Entrelaamento de bits podem ocorrer erros se no houver justificao Alinhamento (Overhead)

Bits de alinhamento determinam o incio do quadro

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Gerenciamento
Pouca Capacidade para Gerncia de Rede. Cerca de 0,5% utilizado para Gerncia de Rede (Alarme remoto). Dificuldade para monitorar o desempenho da rede.

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Porque voc precisa da SDH?

Sistemas Telefnicos e de Comunicao

SUA REDE DEVER RECEBER VRIOS TIPOS DE DADOS DE


ENTRADA? (PDH, ANALGICO, ATM, FRAME RELAY, VDEO ....)

SUA REDE DEVER COMPORTAR VRIAS FREQNCIA DE


ENTRADA (FAIXA LARGA)?

SUA REDE OFERECER SERVIOS COM CONFIABILIDADE? SUA REDE OFERECER FLEXIBILIDADE DE ARQUITETURA? SUA REDE TER QUE CONVIVER COM OUTRAS REDES DE ALTA
VELOCIDADE? NA MESMA FIBRA? NO MESMO CABO?

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A SDH Synchronous Digital Hierarchy a soluo!

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EXERCCIOS
1) Quais as taxas dos sinais agregados dos equipamentos multiplexadores da PDH?
2) Considerando uma cadeia de equipamentos PCM de 1a, 2a, 3a e 4a ordem, quantos canais de voz (64 kbit/s) podem ser transmitidos pelo sinal de 140 Mbit/s? 3) Quais as interfaces de linha padronizadas para a PDH? 4) Como se denomina a tcnica utilizada para sincronizar sinais tributrios em equipamentos multiplexadores da PDH? 5) Porque o bit de enchimento pode no possuir dado til? 6) Qual a diferena entre os bis CJ e OJ

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