Ing.

Amador Humberto Vivar Recarte

GUA N04
DIAGRAMA DE ESTADO Y TABLA DE ESTADO
OBJETIVO

reforzar los conocimientos adquiridos por el estudiante en el diseo de

circuitos digitales secuenciales sincrnicos partiendo de su diagrama de
estados.

MATERIAL
Esta prctica se realizar en equipos de 3 alumnos por equipo. Cada equipo
de trabajo requiere el siguiente material:

1 CI SN 7404
1 CI SN 7408
1 CI SN 7432
1 CI SN 7476
1 CI 7483
1 CI 74193
1 CI 74165
2 CI 74112
1 Microswitch de 8P8T
3 LEDs
4 Resistores de 220

EQUIPO
Osciloscopio HAMEG HMO 1522
1 Protoboard
1 Probador Lgico
1 Fuente de alimentacin de 5 VDC.
1 Generador de Funciones.
Equipo de cmputo
Quartus II v 9.1
MARCO TERICO
El diseo de un circuito secuencial sincrnico comienza a partir de un conjunto
de especificaciones y culmina en un diagrama lgico de un circuito o una lista
de funciones de Boole a partir de las cuales se puede obtener el diagrama
lgico.
El primer paso en el diseo consiste en describir en palabras el
comportamiento deseado del circuito. Frecuentemente el paso siguiente
consiste en construir el diagrama de estados a partir de la descripcin en
palabras del funcionamiento deseado, para poder, a partir del diagrama de
estados elaborado, obtener el diagrama lgico del circuito digital.

PROCEDIMIENTO
A continuacin se muestra el diagrama de estados de cierto sistema digital, el
cual se mantiene en el estado T0 hasta que una seal de entrada externa qm le
indique a la unidad de control (circuito secuencial) que debe comenzar una
operacin. Cuando el sistema digital termina de realizar la operacin, la seal
Pz = 1 le indica a la unidad de control que la operacin est terminada,
regresando al estado inicial T0.

Las actividades que debe realizar el sistema digital en cada uno de los estados
son las siguientes:
T0 : nada, la ocurrencia de este estado indica que la operacin est completa
T1 : A #0, P#3
T2 : P P-1
T3: A A+B
A es un registro de 4 bits y B es un nmero de 4 bits generado por uno de los
teclados.
P es un contador binario de cuatro bits y Pz ser una seal que indique cuando
P = 0, por lo que Pz debe ser obtenida a la salida de una NOR de los cuatro
bits del contador P. Por tanto, si Pz = 0 P 0, de lo contrario, si Pz = 1

P=0.

1. Utilice flip-flops JK convertidos en tipo D para implementar la unidad de

control (el circuito secuencial), por el mtodo de 1 flip-flop/estado.
2. Utilice el pulsador para la seal qm, y el generador con el divisor para
obtener la seal de los pulsos de reloj del sistema con una frecuencia de
1Hz.
3. Disee completamente su sistema digital especificando muy claramente
todas las conexiones que efectuar, incluyendo las conexiones de la
unidad de control (circuito secuencial) al procesador de datos (registro A,
contador P, etc.). Utilice un mnimo de compuertas lgicas.
4. Con las entradas asincrnicas de los flip-flops, coloque el estado inicial T 0
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5. Aplique los pulsos de reloj con una frecuencia de 1 Hz.

6. Presione el pulsador para sacar al sistema del estado T0. Tan pronto salga
de este estado, suelte el pulsador.
7. Verifique que el sistema digital termina con el resultado esperado.

8. Observe que en el estado T3, el modo del registro A = 11, por

tanto la salida del sumador se cargar en este registro con el
flanco positivo del pulso de reloj en este estado, etc.

ACTIVIDADES COMPLEMENTARIAS
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1. Obtenga el diagrama de estados y tabla de estados de cada uno de los

circuitos incluidos en sta gua.
2. Investigue sobre mquinas de estado finito: mquinas de Mealy y mquinas
de Moore.
3. Qu operacin realiza este sistema digital?
4. Si B = 2, esto es, si usted coloca el #2 en el teclado cuya salida es el
nmero B
a. cul ser el nmero contenido en el registro A al final del estado T 3
siendo P =2?
b. cul ser el nmero contenido en el registro A al final del estado T 3
siendo P =1?
c. cul ser el contenido del registro A una vez terminada la operacin?
d. Este sistema digital corresponde a un modelo de Moore o de Mealy?
5. Observaciones y conclusiones

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