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Laboratrio 04 Contadores
CONTADOR COM DECODIFICADOR E DISPLAYS DE 7 SEGMENTOS
A capacidade de contar uma operao fundamental em eletrnica digital.
Um contador fornece
uma sada binria igual ao nmero de impulsos binrios ocorridos na sua entrada. Os contadores podem ser
construdos com flip flop's sendo o seu limite de contagem de 2 n-1 em que n o nmero de flip flop's
colocados em cascata.
Nesta aula prtica de laboratrio, utilizaremos alguns CI que j realizam a funo de contagem. Na
primeira parte da aula utilizaremos um contador BCD para realizar a contagem de 0 a 9, um decodificador
BCD para 7 segmentos e um display de 7 segmentos para observar a contagem.
J na segunda parte do
trabalho usaremos outro contador em cascata com o primeiro para podermos efetuar contagens de 0 at 99 e
um segundo conjunto descodificador/display para observarmos a contagem. Usaremos ainda alguma lgica
adicional para limitarmos a contagem de 0 a 59.
Logo, so objetivos dessa aula prtica a familiarizao com os CI contadores, descodificadores e
displays, bem como a sua interligao e funcionamento.
circuitos adicionais, tais como foto-transistors para detectar objetos e realizar uma implementao prtica de
contagem.
1 EQUIPAMENTOS
Contadores, Decodificadores e Displays de 7 Segmentos.
Datapool
aconselha-se uma consulta ao datasheet destes CI's. O CI 74LS90 (Figura 4.1a) um contador assncrono,
BCD que efetua, portanto, contagem crescente em binrio e pode ser utilizado tambm como divisores de
frequncia por 2 e por 5 (conforme diagrama da Figura 4.1b). Os pinos A e B so as entradas de clock para
os dois divisores.
alternativa.
Neste caso, as sadas denominadas Q0, Q1, Q2 e Q3, corresponderiam, respectivamente, QA,
(a)
(b)
Figura 5.1 (a) Diagrama de pinos contador 74LS90 e (b) Diagrama de pinos divisor por 2 e 5.
A sada do flip-flop da esquerda da Figura 4.2 (QA) executa a diviso por 2, ou seja, um sinal de
frequncia f1 na entrada A (pino 14) d origem a um sinal f1 / 2 no pino 12 (Q A). J os trs flip-flops da
mesma figura, executam a diviso por 5, ou seja, um sinal de frequncia f2 na entrada B (pino 1) d origem a
um sinal f2 / 5 no pino 11 (QD).
A porta lgica 1 controla as entradas set dos flip-flops extremos.
entradas reset dos quatro flip-flops.
contador resseta se ambas as entradas R0(1) e R0(2) assumem nvel 1 e pelo menos uma das entradas R9s
estiver em 0. Qualquer uma das combinaes nas linhas 4, 5, 6 e 7 habilita o contador para contagem.
Se dos divisores da Figura 4.1b forem interligados, ou seja, a sada QA (pino 12) for ligada
externamente entrada B (pino 1), obtemos um circuito divisor por dez. A frequncia na sada QD (pino 11)
ser igual frequncia na linha clock do pino 14 dividida por 10.
A cada 10
inicial 0000 (0 em decimal), aps 10 transies negativas na linha de clock o estado ser novamente 0000.
Tabela 4.2 Tabela de combinaes no modo BCD.
A Figura 4.3a a seguir apresenta uma ligao tpica envolvendo as entradas reset. Quando S vai
para 1, o contador resseta, caso contrrio, fica liberado para contagem. J a Figura 4.3b ilustra o diagrama
de pinos do decodificador 9368 e a Figura 4.3c o diagrama de pinos do display para 7 segmentos (ctodo
comum).
(a)
(b)
(c)
Figura 5.3 (a) Diagrama de pinos do contador 74LS90, (b) Diagrama de pinos do decodificador 9368 e
(c) Diagrama de pinos do display de 7 segmentos ctodo comum.
O CI 9368 fornece corrente correspondente 20mA nos seus pinos de sada, suficiente para uma boa
luminosidade.
O valor de corrente nunca poder ser superior 40mA para no danificar o display.
As
entradas do decodificador 9368 A, B, C e D devero ser ligadas s sadas QA, QB, QC e QD do contador
74LS90. As Figuras 4.4a e b ilustram as disposies de acionamento dos displays nodo comum e ctodo
comum.
Tambm importante informar que, no decodificador 9368, o pino EL utilizado como controle para
isolar a informao do display de 7 segmentos: Se EL estiver em 0, a informao em DCBA passa para o
display, caso contrrio, se estiver em 1, a informao isolada.
J a entrada RB0 utilizada para apagamento (blank) de zeros nos cantos de uma configurao, por
exemplo, quando polarizado convenientemente (Figura 4.5), os zeros esquerda e direita em um instrumento
digital so apagados (ex. o nmero 060,040 ficaria 60,04).
Figura 4.5 Diagrama de ligao dos pinos RB0 e RBI para o apagamento dos zeros direita e esquerda.
Entretanto, para montar um contador BCD simples (um digito), basta fazer a ligao conforme Figura
4.6 abaixo. O pino EL (pino 3) dever ser 0 para permitir a passagem da informao de DCBA (se for 1 o
display fica parado) e o clock dever ser ligado a uma frequncia de 1Hz (um pulso por segundo).
Caso no tenha os componentes acima citados, pode-se utilizar de outros modelos de contadores e
decodificadores, como o caso do decodificador 4511 e do contador 4518.
internamente dois contadores assncronos, independentes, ou seja, podem ser utilizados separadamente.
Uma outra
Pinos de alimentao 16 (VDD 3 a 18V) e 08 (VSS - GND). Pinos de clock 01 (contador A) e 09 (contador
B).
Pinos de reset 07 (contador A) e 15 (contador B), sendo que se colocados em 0 permitem a contagem e se
colocados em 1 zeram a contagem. Pinos de enable 02 (contador A) e 10 (contador B), sendo que se colocados em 0
param a contagem e se colocados em 1 habilitam a contagem. A seguir apresentado a pinagem dos decodificadores
4511 e 74LS48 (catodo comum) e do 74LS47 (anodo comum).
A seguir apresentado uma soluo para contagem de 00 a 99 com o contador 4518 e decodificadores 4511.
PARTE II CONTAGEM DE 0 AT 99
3 MONTAGEM
Na Figura 5.7 temos um circuito obtido do cascateamento de duas dcadas contadoras 74LS90, com
sadas para o decodificador 9368. De acordo com o cascateamento, vemos que aps 10 pulsos de entrada
clock, ocorre uma transio negativa em QD (no caso da Figura 5.7 seria o QD1). Essa transio negativa
poder, ento, ser utilizada como gatilho para a segunda dcada levando o conjunto a variar de 00 a 99,
passando por 100 estgios diferentes.
Figura 5.8 Contador BCD com dois dgitos com parada de contagem (chave SW).