ELT413 ELETRNICA ANALGICA II

ENGENHARIA ELTRICA
O
LABORATRIO N 3: AMPLIFICADOR EC E CC EM CASCATA, RIN, ROUT

OBJETIVOS RS Vo1 ... sem R S

R in =
1. Medir Resistncia de Entrada e Resistncia de Vo1 Vo2 ... com R S
- 1
Sada de um amplificador. Vo2
2. Melhorar estas resistncias atravs de amplifi-
cadores em cascata. a) Amplificadores com polarizao por divisor de
tenso:
I - RESISTNCIA DE ENTRADA

Para medir indiretamente a resistncia de entra-

(
R in = R B1 // R B2 // R e + re, )
da do circuito devemos inserir um resistor RS em VCC =+15V
srie com o gerador de sinais e medir a queda de
tenso neste resistor. R in (1)
R B1 RC
ATENO: No utilize ohmmetro para executar 2k
R dc =3k 30k
este ensaio. Utilize osciloscpio.
Canal 1: CH1=Ei RS VC
Canal 2: CH2=Vi ou Vo 10k
Ei Vi
+
ATENO: O amplificador no deve apresentar
distoro na tenso de sada. Monitore o sinal de Ci= 10 F VE
sada atravs do osciloscpio. Diminua a amplitude
do sinal de entrada se necessrio. R B2 RE
O valor de RS deve ser um valor prximo da re- 10k 1k
sistncia de entrada do circuito.

Ei RS
Vi
Figura 2 - Circuito para medio da resistncia de en-
trada.
Rin=?

Tabela 1 Amplificadores EC e CC (a)

EC CC

Figura 1 Circuito equivalente para determinao da Rin 1 2 3 4

resistncia de entrada
RS
R in =
Ei
-1
Vi
Este procedimento vivel para resistncia de
entrada menor que 100k. Considerando resistn-
cia de entrada do osciloscpio como 1M teremos
um erro de insero de aproximadamente 10%.
Para resistncia de entrada superior 100k
devemos adotar outro procedimento para estimar
esta resistncia de entrada. Devemos verificar o e-
feito de RS sobre o sinal de sada. O procedimento
manter Ei fixo e medir a tenso de sada sem e
com Rs, respectivamente VO1 e VO2. Observe que
nenhum canal do osciloscpio mantido em parale-
lo com a entrada do amplificador.
Terico
Medido
A carga altera o valor da resistncia de entrada
do circuito. Pouco no amplificador emissor comum
(circuitos 1, 2 e 3) e muito no amplificador coletor
comum (circuito 4).
No circuito Rin(3) a resistncia de entrada dimi-
nuiu porque o resistor RE foi desviado para corrente
alternada, foi cuto-circuitado pelo capacitor de des-
vio CE.
ATENO: No desmonte o circuito anterior.
Complete o circuito adicionando o capacitor Co e o
resistor RL.

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VCC = +15V
R in (2) R in (5)
R dc =3k RC = 2k
RC
R ac =2k CO = 10F
+ RF 2k
Vo Co
200k
Ei Vi 10F
+ Ci
+
RS 1F
10k RE RL + RL
1k 2k RE 2k
100

R in (3) Figura 4 Amplificador Emissor comum com polari-

R dc =3k zao por tenso do coletor

R ac =1k Vo Tabela 2 Amplificador Emissor Comum (b)

+
Av max
CO = 10F Rin 5 6
Ei Vi
+
Terico
RS
10k RL Medido
+
2k
CE
Para evitar a degradao do ganho de tenso e
100F da resistncia de entrada do circuito devido ao e-
feito Miller podemos evitar a realimentao ac uti-
lizando um capacitor de desvio no circuito de reali-
R in (4) mentao. A realimentao negativa DC, que ga-
rante a estabilidade do ponto de operao Q,
Coletor Comum
mantida uma vez que o capacitor se comporta co-
mo circuito aberto para corrente contnua..
R e =R E //R L
(
R in = R F1 // R e + re, )
Ei Vi R c = R C // R L // R F2
+ CO = 10F
RS + VCC = +15V
Vo
10k R in (6)
RE RL
RC
1k 2k
RF1 RF2 2k
Co
100k 100k
10F
Figura 3 Influncia da carga sobre Rin Ci
+
1F
b) Amplificadores com polarizao pela realiman-
tao da tenso do coletor: + RL
2k
R in = R i(Miller) // R e + ( re, ) RE
100
RF V
=
A+1
// R e + re, ( ) onde A = c
Vb ac Figura 5 Amplificador Emissor comum com polari-
A zao por tenso do coletor - realimentao AC de-
R c = R C // R L // R F sacoplada.
1+A

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II - RESISTNCIA DE SADA VCC = +15V

R out (1)
Para medir indiretamente a resistncia de sa-
RC
da devemos utilizar dois valores de RL, no mnimo RF
uma relao 2x1, ou ento uma medio na tenso 200k
2k Co
de sada sem carga (RL=) e outra medio com 10F
carga RL. Ci
+
1F

EO Rout=? +
VO
RL
RE 2k
RL 1k

R out = R C // (1/h oe ) // R F [A/(1+A)]

VO RC
EO Figura 7 Amplificador Emissor comum com polari-
zao por tenso do coletor
VO2
Para o amplificador Coletor Comum (Seguidor
VO1
de Emissor ou Emissor Seguidor uma vez que o
Emissor segue a Base) a resistncia de sada
muito baixa, entre dezena e centena de Ohm. As
resistncias ligadas em srie com a base, ou seja,
IO2 IO1 IO ligadas em srie entre o gerador de sinais Ei (ou Vs)
Figura 6 Circuito equivalente para determinao da
e a Base, influenciam no valor de Rout.
resistncia de sada.
VCC = +15V
VO V -V R out (2)
R out = = O2 O1
IO VO1 VO1 RC
- RF
R L1 R L1 2k
200k
E Ci
= R L O - 1
VO 1F
Co
E o = Vo para R L = + 10F

+
RL 2 k 1 k RE RL
VO Vpp 1k 2k
IO=VO / RL 0 mApp

Tabela 3 - Rout R b-serie

R out = R e // (re, + )
EC CC
Figura 8 Amplificador Coletor comum com polari-
Rout 1 2 4 5 zao por tenso do coletor

Terico
AMPLIFICADORES EM CASCATA
Medido
Para obter um amplificador que tenha ganho de
tenso (maior que 1) e baixa resistncia de sada
Para o amplificador Emissor Comum a resistn- devemos associar dois amplificadores em cascata,
cia de sada ligeiramente menor que a resistncia um emissor comum, responsvel pelo ganho de
do coletor RC tenso, seguido de um coletor comum, responsvel
pela baixa resistncia de sada.

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R out (3) RC VCC = +15V VCC = +15V

RC R E2
RF 2k
R out (5) RF Co
20k 2k
200k 2M 10F
Ci Co
Ci
1F 10F
1F

R E2 RL RL
R E1
2k 2k R E1 2k
100
1k

Figura 9 Amplificador Emissor comum em cascata Figura 11 Amplificador Emissor Comum em cascata
com amplificador Coletor comum com polarizao com amplificador Coletor Comum com polarizao
por tenso do coletor e acoplamento direto NPN- por tenso do coletor e acoplamento direto NPN-
NPN. PNP
Lembrando ainda que a resistncia de entrada
Uma vez que o circuito do coletor de Q1 o cir-
pode ser aumentada dividindo RF em duas partes e
cuito da base de Q2, podemos aumentar a resis-
instalando o capacitor de desvio como no circuito
tncia deste circuito em 10 vezes em relao ao
da Figura 5.
circuito do coletor (emissor) de Q2. A Figura 10
mostra esta soluo utilizando transistor PNP. Utilizando apenas BJT possvel obter, a muito
custo, resistncia de entrada de at 1M, portanto,
Em relao ao circuito da Figura 9, esta soluo
proporciona um aumento considervel na resistn- acima de 100k recomendamos a utilizao de
cia de entrada e um pequeno aumento na resistn- FET para o primeiro estgio.
cia de sada do circuito. O aumento da resistncia
de sada de Q2 se deve ao aumento da resistncia III - ESCOLHA DO VALOR DE RE2
srie na base de Q2 que o resistor do coletor de
Q1. Nesta configurao em cascata com acoplamen-
to direto a determinao do ponto Q timo mais
R complicado devido a interao DC entre os dois es-
R out(Q2) = C + re, (Q2) // R E2 tgios.
Q2
A tenso pico a pico sem ceifamento disponvel
R c(Q1) = R C // Q2 (R E2 // R L ) no coletor de Q1 aproximadamente
R c Q1
Vc(Q1) p-p max = V
R out (4) RC R E2 VCC = +15V R c Q1 +R e Q1 CC
20k 2k
RF Vo Para uma carga extremamente leve, ou seja, pa-
2M ra RacRdc
Ci Co
1F 10F Av
Vcppmax = VCC
A v +1
RL
R E1 2k Verificamos que quanto menor for o ganho de
1k tenso menor ser a amplitude mxima disponvel
em Q1.
Tabela 1- RL=RE2
Figura 10 Amplificador Emissor Comum em cascata
com amplificador Coletor Comum com polarizao Av Vcpp max Vcc Vo pp max Vcc
por tenso do coletor e acoplamento direto NPN-
PNP. 1 0,50 0,4
2 0,66 0,5
Uma soluo muito empregada fazer a reali-
mentao negativa a partir do segundo estgio 5 0,83 0,587
como mostra a Figura 11. Isto possvel porque o 10 0,91 0,625
seguidor de emissor (Q2) no inverte a fase.

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Analisando apenas o estgio seguidor de emis- IC

sor, o ponto Q timo determinado pela relao

entre Rac e Rdc.
R ac
VCEQot = Vcc
R ac + R dc
R dc =R E2
R ac =R E2 //R L
O ganho de tenso determinado pela relao
entre as resistncias AC do coletor e do emissor de
Q1
R R C //[h FE-Q2 (R E2 //R L )] R C
A v = c1 =
R e1 R E1 R E1
A Figura 12 mostra que obtemos maior amplitu-

L
de sem ceifamento (maior compliance) se o ponto
de operao do transistor estiver no ponto Q ti- VCE

mo. Figura 13 Reta de carga DC e retas de carga

AC no ponto timo. RDC constante e RL varivel.
Se o ponto de operao estiver prximo ao cor-
te, o ceifamento devido ao corte ocorrer primeiro.
Durante o projeto geralmente a carga pr-
O sinal de sada ser mais distorcido devido influ-
definida. O objetivo ser, ento, determinar qual o
ncia maior de re. A nica vantagem ser o menor
valor de RC mais adequado. A Figura 14 mostra que
consumo de energia para polarizao do transistor.
quanto menor a resistncia RE2 maior ser a ampli-
tude disponvel em RL, porm ao custo de um maior
consumo de energia e conseqente reduo da efi-
cincia. Se no existir nenhuma outra restrio, um
bom critrio para escolha de RC adotar RCRL.
IC
L
L

E2

Figura 12 Reta de carga DC e retas de carga AC.

RDC e RL constante

A Figura 13 mostra que quanto maior for o valor

da resistncia RL (carga leve) maior a amplitude do VCE
sinal de sada. Nos trs casos o ponto Q timo. Figura 14 Reta de carga DC e retas de carga AC no
Observe que o ponto de operao Q est no meio ponto timo. RDC varivel e RL constante.
da reta de carga AC.

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IV - OSCILAES DE ALTA FREQUNCIA V - OSCILAES DE BAIXA FREQUNCIA

Em amplificadores transistorizados com ganho Em amplificadores com trs ou mais estgios

de tenso acima de 20 (26 dB) muito comum o- pode ocorrer oscilaes da baixa frequncia tipo
correr oscilaes indesejadas de alta frequncia put put , ou motor de popa, devido uma uma ins-
provocadas pela fonte de alimentao, Lay- Out da tabilidade tpica de uma realimentao positiva
montagem, etc. provocada principalmente pela impedncia de sada
da fonte de alimentao e de um lay-out mal feito.
Estas oscilaes podem ser evitadas adicionan-
do-se um pequeno capacitor (entre 10pF e 100pF)
entre o coletor e a base do transistor responsvel
pelo ganho de tenso.

Vcc

RC
2k
RF
200k
Figura 16 Oscilao de baixa freqncia
10uF
15V
+ Uma filtragem na fonte de alimentao tambm
1uF 100pF
Vc uma boa pratica. Um capacitor eletroltico (10 a
+ RL 100F) em paralelo com um capacitor de polister
Ve 2k metalizado (10 a 330nF).
RE
10 No circuito apresentado na Figura 17 um filtro
adicional ou um regulador de tenso entre o 2o e o
3o estgio pode resolver este problema de instabili-
Figura 15 Amplificador Emissor Comum Av
60 e dade
capacitncia Miller.

Figura 17 Amplificadores em cascata instvel

Itajuba, MG, julho de 2016

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