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ELETRÔNICA DIGITAL

Universidade Federal de Itajubá

Verilog HDL – Descrição por fluxo de dados

Prof. Fadul Ferrari Rodor


Verilog | Fluxo de dados
Descrição por Fluxo de Dados

𝑋0 𝑍0
𝑋1 𝑍1
Circuito
⋮ ⋮
Digital
𝑋𝑚−1 𝑍𝑛−1

𝑍𝑖 = 𝑓𝑖 (𝑋0 , 𝑋1 , … , 𝑋𝑚−1 )
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Verilog | Fluxo de dados
Descrição por Fluxo de Dados

descrição da relação

assign ;

equação envolvendo
sinal a receber outros sinais
a atribuição
sinal função

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Verilog | Fluxo de dados
Porta E

module exemplo (A,B,C);


input A,B; //entradas
output C; //saídas

assign C=A & B;

endmodule

O que o circuito faz e/ou


sua estrutura interna
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Verilog | Fluxo de dados
Porta E - RTL

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Verilog | Elementos
Operadores lógicos de bits

• Instruções assign em módulos são consideradas como


blocos lógicos;
• Sua posição no código do módulo é irrelevante;
• Use os seguintes operadores para suas expressões:
• Para um E use: &
• Para um OU use: |
• Para um NÃO use: ~
• Para um OU-EXCLUSIVO: ^
• Use parênteses para forçar prioridades.

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Verilog | Elementos
Porta S

module exemplo (A,B,C,D);


input A,B; //entradas
output C; //saídas

wire S; //sinal interno

//operações
assign S=A & B;
assign D=S & C;

endmodule

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Verilog | Elementos
Porta S - RTL

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Verilog | Elementos
Porta S – RTL (forçar a manutenção de
um wire)

wire S/*synthesis keep*/;

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Verilog | Elementos
Exercícios

1. Implementar um MUX 2x1

2. Implementar um meio somador

3. Implementar um somador completo

4. Um circuito cuja saída é 1 se abcd for divisível por 3 ou 4

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Verilog | Bibliografia

• TOCCI, Ronald J.; WIDMER, Neal S.; MOSS, Gregory L.


Sistemas Digitais: princípios e aplicações. Pearson
Prentice Hall, 10ª ou 11ª Edição, 2011, ISBN:
9788576059226.

• WAKERLY, J. F.; Digital Design, Editora Pearson, 4ª


Edição, 2006, ISBN: 9780131733497.

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Verilog | Fim

Obrigado

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