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Isra Cero
Universidad Politécnica de Puebla
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= 0≤ ≤2
una arquitectura analógica dejando la implementación digital
para la parte II.
Ec.2
Palabras Clave- Atraso-Adelanto, Control, FPAA, Fraccional. El valor de se obtiene con la ecuación Ec.3.
#
" 2 + '() + / 0 12 − 32 < 0
% * ,- *
! & .,- *,
En el presente trabajo se implementa un control de
2 = ; ∙ ∙A
@*
de prueba y error, pero con los trabajos desarrollados por *=>? @
Wang [1] and Tavazoei [2] permiten contar con ecuaciones Ec.4
que permiten el diseño de los controladores de adelanto y
1=
atraso de fase. Por lo que tomando como referencia a los =>?@*
∙
BCA@
autores anteriormente mencionados inicia el desarrollo de este Ec.5
; = 10
D
DESARROLLO % Ec.6
=
; = 10 = 10.JJ = 1.5417
.I
Ec.1 % Ec.7
=
PP
1= = = 0.6470 Ec.9
=>?@* .OPI∙=>?%P.*
∙
BCA@ .OPI∙
BCA%P.
Ec.17
Sustituyendo los valores para 2 y 1 que se observan en En este punto es posible implementar el sistema de
las ecuaciones Ec.8 y Ec.9 para conocer el valor del control de adelanto de fase de orden fraccional con
12 − 32 =
0.647023R2500 − 14402.380493T
= −600.379006 Ec.10
De acuerdo con el valor indicado por Ec.10 y Figura. 1. Diagrama a bloques del compensador de adelanto de fase
considerando los rangos de la ecuación Ec.3, se calcula . de orden fraccional Ec.16 y la planta Ec.17.
2 2 − 3
=2+ '()* U V
En este punto se tiene la función de transferencia de un
12 − 32
control de adelanto de fase de orden fraccional y una planta a
2 2500 − 1440
= 2 + '()* U V
ser controlada, existen dos maneras de implementar el
−600.379006
sistema y son mediante técnicas de electrónica analógica o
= 1.3280
mediante un sistema de electrónica digital.
Ec.11
En este documento se presenta la implementación con un
La ecuación Ec.11 indica el orden fraccional del
FPAA es decir un arreglo analógico programable en campo
valores de W y X mediante las ecuaciones Ec.12 y Ec.13.
compensador de adelanto de fase, ahora se calculan los
(Field Programmable Analog Array).
[
,.∙YZC+ /*
W=
Se utiliza el AN231E04 de Analog Devices [4].
\
[
.∙YZC+ /*
Ec.12
\
Para realizar la programación del FPAA las ecuaciones
Ec.16 y Ec.17 deben escribirse en forma de funciones de
X = ] _1 ∙ `)N + % / − cos + % /b
a& a& transferencia correspondientes a filtros analógicos, la
^
Ec.13 ecuación Ec.17 se puede escribir como la ecuación Ec.18.
= + / +
/ +
/
P
Ec.18
De manera que sustituyendo los valores ya conocidos
resultan las ecuaciones Ec.14 y Ec.15
Cada uno de los términos de la ecuación Ec.18 se
21 ∙ '() + 2 / − 1
aproxima a un integrador y dos filtros como se observa en las
W=
1 ∙ '() + / − 1
ecuaciones Ec.19 a Ec.21.
2
+ / = k
Bl. ∙
1.3820 ∙ P .%
2.380492 ∙ 0.647023 ∙ tan + /−1
= 2
Ec.19
1.3820 ∙
0.647023 ∙ tan + 2 /−1
36 363000
= 1.736209 U V=m n
+ 36 + 363000
Ec.14
,p = = 17.223ℎr
J
%&
Ec.20
1 100 1003000
X= _1 ∙ `)N + / − cos + /b U V=m n
a 2 2 + 100 + 1003000
1 1.3820 ∙ 1.3820 ∙ ,p =
= 47.73ℎr
= _0.647023 ∙ `)N + / − cos + /b
39.J% %&
Ec.21
2 2
= 8.140092* Ec.15
factor de desnormalización en frecuencia Ω = 3000.
Se menciona que las ecuaciones Ec.19 a Ec.21 utilizan un
Con todos los datos calculados se tiene el control de
adelanto de fase de orden fraccional indicado por la ecuación
Ec.16.
La ecuación Ec.16 requiere de una aproximación del Las características de la señal de entrada se aprecian en la
término fraccional y se puede implementar con un filtro Figura 3.
bicuadratico de la forma Ec.22.
t
\ u
]u\
p = W vu
tw
\
]w
\
Ec.22
vw
En donde:
x =
√
Ec.23
@ =
√
Ec.24
zx =
√{
Ec.25
z@ =
√{
Ec.26
= %*a
a Figura. 3. Características de la señal de entrada del sistema con
Ec.27 compensador de orden fraccional implementado en el FPAA AN231E04.
≈ 1.736209
\
%.
IJf
%%.JPJI
Ec.28
\
.PI
I.IO
J
O
Continuara ...
CONCLUSIONES
REFERENCIAS
[1] - Wang FY (2003) The exact and unique solution for phase-lead and
phase-lag compensation. IEEE Transactions on Education 46(2):258–262.,
DOI 10.1109/TE.2002.808279.