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Electrónica Digital
Orientado a profesores
de enseñanza Técnico Profesional
en el módulo de Electrónica Digital.
Duración: 20 horas
Objetivos generales
Metodología
Objetivos:
- Profundizar en conceptos y aplicaciones de las distintas ramas de la electrónica digital.
- Desarrollar criterios técnicos para trabajar con circuitos digitales a partir del estudio de las
características eléctricas de las compuertas lógicas.
Si bien el estudio de los sistemas digitales debe comenzar necesariamente por el análisis funcional de las
compuertas lógicas, no debe nunca perderse de vista que éstas son a su vez circuitos electrónicos
construidos con componentes discretos (diodos, transistores, resistencias, etc.).
Incluir el estudio de las características eléctricas de las compuertas lógicas permite:
- Profundizar conceptos de electrónica analógica como el funcionamiento de diodos y transistores.
- Profundizar conceptos de análisis de circuitos con transistores, particularmente el
funcionamiento del transistor trabajando en corte y saturación.
- Ejercitar el uso de instrumentos electrónicos (multitester , osciloscopio) y la interpretación de
magnitudes eléctricas.
- Comprender las características de las compuertas lógicas y la necesidad de interfaces de
acoplamiento con circuitos de electrónica analógica.
A continuación se introducen los principales parámetros eléctricos asociados a las compuertas lógicas,
centrando su estudio en el análisis comparativo entre las compuertas de las familias TTL y CMOS a partir
de las características constructivas de cada una.
La familia de compuertas lógicas TTL (Transistor Transistor Logic) se construye mediante tecnología de
transistores bipolares. Trabaja a tensión nominal de 5V, tiene gran extensión en el ámbito de los circuitos
integrados digitales y es habitualmente la primera con la que el estudiante tiene contacto. En la figura se
muestra un circuito TTL estándar para un inversor. Q1 es el transistor de acoplamiento de entrada y D1
es el diodo de fijación de nivel de entrada (diodo clamp). El transistor Q2 es el divisor de fase y la
combinación Q3 y Q4 forma el circuito de salida, a menudo denominado como disposición totem-pole.
Compuerta NOT con salida Totem-Pole construida con tecnología TTL estándar
La puerta NAND TTL es equivalente al inversor, con la excepción de que el transistor Q1 se convierte en
un transistor con dos emisores (transistor multiemisor)
La mayoría de las pastillas de la familia TTL tiene salidas del tipo totem-pole, que permiten inyectar o
drenar corrientes pequeñas a una carga conectada a la salida (que puede ser otra compuerta lógica u
otro dispositivo). Cuando se requiere manejar cargas un poco mayores, la familia TTL dispone de otro
tipo de salida, denominada en colector abierto, open-collector. En la siguiente figura se muestra un
inversor TTL estándar con salida en colector abierto.
Compuerta NOT con salida Open-Collector construida con tecnología TTL estándar
Notemos que la salida es el colector del transistor Q3 sin nada conectado, de ahí el nombre de colector
abierto. Para obtener los niveles lógicos alto y bajo a la salida del circuito se conecta una resistencia de
pull-up a la tensión de alimentación Vcc desde el colector de Q3. Cuando Q3 no conduce, la salida es
llevada a Vcc a través de la resistencia externa. Cuando Q3 se satura, la salida se lleva a un potencial
próximo a tierra a través del transistor saturado.
Los transistores de efecto de campo son los elementos activos de conmutación de los circuitos CMOS.
Los símbolos para los MOSFET de canal-n t de canal-p se indican en la figura.
Cuando la tensión de puerta de un MOSFET canal-n es más positiva que la de fuente, el transistor
conduce (ON) y la resistencia drenador-fuente es pequeña. Cuando la tensión entre puerta y fuente es
cero, el transistor no conduce y la resistencia es muy grande. Los MOSFET de canal-p funcionan con
polaridades de tensión opuestas. Idealmente las resistencias, tanto en conducción como en corte se
pueden despreciar por lo que podemos considerar a estos transistores como un interruptor cerrado
cuando conduce y abierto cuando no lo hace.
Para la configuración de puertas lógicas interesan aquellos tipos de transistores de efecto de campo en
que la tensión de puerta es del mismo signo que la de drenaje (referidas ambas a la fuente): los
transistores MOS de acumulación canal-n, los cuales, además, presentan la ventaja de ofrecer mayores
velocidades de respuesta.
En los siguientes esquemas presentamos algunas puertas lógicas básicas con tecnología MOS:
Estas puertas presentan una muy alta impedancia de entrada (intensidad de entrada nula), por lo que
disminuye considerablemente su consumo en régimen de operación estático.
Por el contrario el efecto capacitivo puerta-canal limita su velocidad de trabajo y los valores altos de
impedancias repercuten frente al ruido. Otro problema lo encontramos en la manipulación de estos
circuitos: la delgada capa de óxido de las entradas se pueden perforar con facilidad, incluso con la propia
carga estática acumulada en el cuerpo del operador.
La reducción del área de integración se consigue, en buena medida, sustituyendo la resistencia que
limita la intensidad por otro transistor MOS polarizado en conducción, lo que permite ahorrar la gran
cantidad de área que necesita una resistencia integrada en un circuito, sobre todo si su impedancia es
alta.
El consumo reducido permite acumular gran cantidad de transistores sobre un mismo sustrato sin los
problemas de disipación de potencia: en un primer momento se pasó de las 20 puertas/mm2 que
permitía la tecnología bipolar a más de 100 puertas/mm2. En la actualidad se integran varios miles de
puertas/mm2.
Otra ventaja de esta tecnología frente a la bipolar es el menor número de pasos o etapas en el proceso
de fabricación (del orden de la mitad).
La familia CMOS utiliza la lógica MOS complementaria, esto es, la combinación de MOSFET de canal-n y
de canal-p. Esta configuración es de una gran simetría estructural y reduce el consumo estático a valores
prácticamente nulos; en cambio se produce un consumo no despreciable cuando la puerta conmuta
debido a los procesos de carga y de descarga de las capacidades puerta-canal; además, durante un
instante conducen los dos transistores a la vez.
Compuertas lógicas construidas con tecnología CMOS
Para proteger las entradas respecto de sobreoscilaciones y cargas electrostáticas se integran un filtro de
tipo RC (una resistencia en serie con un diodo, que actúa como diodo rectificador de tensiones negativas
y como un pequeño condensador de filtrado de frecuencias muy altas).
Por este motivo la entrada no conectada equivale a un valor lógico bajo, pero de nuevo nos encontramos
con los efectos nocivos de la radiación electromagnética, amplificada por las altas impedancias de
entrada de estas puertas. Con un diseño adecuado se consigue que la función de transferencia sea
simétrica, con la conmutación entre los estados muy próxima a Vcc/2. No obstante los fabricantes no
aseguran un comportamiento adecuado de la puerta en un intervalo comprendido entre el 30% y el 70%
de la tensión de alimentación.
Parámetros eléctricos para las compuertas lógicas
Para comparar las características de cada compuerta los fabricantes entregan abundante información
técnica en sus catálogos. A continuación se resumen las características más importantes.
Niveles lógicos
Las compuertas lógicas trabajan con niveles de tensión denominados Alto (H) y Bajo (L). Los niveles de
tensión características para los niveles H y L tanto para tensión de entrada (Vi) como para tensión de
salida (Vo) se muestran en la siguiente tabla:
Según las diferentes familias encontramos grandes diferencias de consumo. La disipación en un circuito
TTL es esencialmente constante dentro de su rango de operación. Sin embargo, la disipación de potencia
en CMOS depende de la frecuencia. En condiciones estáticas es extremadamente baja y aumenta al
aumentar la frecuencia.
Retardo de propagación
Cuando una señal se propaga a través de un circuito lógico, siempre experimenta un retardo de tiempo.
Un cambio del nivel de salida siempre se produce un cierto tiempo más tarde después de que se ha
realizado un cambio de nivel en la entrada, lo que se denomina tiempo de retardo de propagación, el
cual suele un valor para la transición de nivel bajo a nivel alto tPLH y otro valor en la transición de nivel
alto a nivel bajo tPHL.
El retardo de propagación de una puerta limita la frecuencia a la que puede trabajar. Cuanto mayor es el
retardo de propagación, menor es la frecuencia máxima.
Producto Velocidad-Potencia
Cuando en una aplicación son importantes tanto el retardo de propagación como la disipación de
potencia para la selección de la familia lógica a utilizar, el producto velocidad-potencia es una base
adecuada para la comparación de circuitos lógicos. Su unidad es el picoJoule (pJ) y mide la energía que se
pierde en la compuerta por efecto de la conmutación. Típicamente se buscan valores pequeños. En
general, los circuitos CMOS tienen valores para este parámetro mucho menores que los circuitos TTL, ya
que su disipación de potencia es mucho más baja: Ej un HCMOS tiene un producto velocidad-potencia de
1,4 pJ a 100 KHz mientras que un TTL de bajo consumo tiene un valor de 20 pJ.
Carga y fan-out
Cuando la salida de una puerta lógica se conecta a una o más entradas de otras puertas, como
mostramos en la figura, se genera una carga en la puerta excitadora.
Existe un límite para el número de entradas de puertas de carga que una cierta puerta puede excitar.
Este límite se denomina abanico de salida o fan-out de la puerta.
Carga TTL: Una puerta excitadora TTL entrega corriente (fuente) a las entradas de las puertas de carga en
el estado alto (IIH) y absorbe corriente (sumiedro) de las puertas de carga en el estado bajo (IIL) en la
siguiente figura mostramos el funcionamiento simplificado como fuente de corriente y como sumidero
de corriente. Las resistencias representan las resistencias internas de entrada y salida de la puerta.
Una entrada de la misma familia lógica que la puerta excitadora se denomina unidad de carga. Ej la
Familia TTL Schottky de bajo consumo (LS) tienen un fan-out de 20 unidades de carga. La corriente total
de sumidero (absorbida) también aumenta con cada puerta de carga que se añade. Al aumentar esta
corriente, la caída de tensión interna de la puerta excitadora aumenta, haciendo que VOL aumente. Si se
añaden demasiadas unidades de carga VOL será mayor que VOLmax.
En TTL, la capacidad de la corriente de sumidero (estado bajo) es el factor más crítico en la
determinación del fan-out.
Carga CMOS. La carga en CMOS difiere de la de TTL en que la lógica CMOS utiliza transistores de efecto
de campo (FET), que presenta una carga predominantemente capacitiva a la puerta excitadora. En este
caso las limitaciones vienen dadas por los tiempos de carga y de descarga asociados con la resistencia de
salida de la puerta de salida y la capacidad equivalente de la puerta de carga.
Cuando la salida de la puerta excitadora se encuentra en nivel alto, el condensador de entrada de la
puerta de carga se carga, mientras que en caso contrario se descarga. Al aumentar el número de cargas
en paralelo, el valor de la capacidad equivalente aumenta en la misma medida por lo que la frecuencia
máxima de operación disminuye.
Comparación TTL-CMOS
En la tabla siguiente se muestran los datos más importantes de las series analizadas para evidenciar las
diferencias de comportamiento tanto en consumo como en frecuencia de operación.
Por otra parte, los circuitos CMOS tienen una mejor inmunidad al ruido que cualquiera de la serie TTL
como se puede observar en la siguiente tabla de margen de ruido, tanto para valor alto como para valor
bajo
La familia TTL es aún la más utilizada para las prácticas de electrónica digital durante el periodo de
aprendizaje, debido principalmente a que la lógica de transistores bipolares con que están construidas
las compuertas TTL es suficientemente robusta para soportar polaridades erróneas, sobrecargas e
incluso cortocircuitos temporales.
Pero no obstante esta robustez, es importante exponer algunas precauciones en el trabajo con estas
pastillas. Analizaremos con más profundidad los conceptos de fuente y sumidero de corriente para
determinar algunas consideraciones prácticas en el trabajo con circuitos integrados TTL. En la siguiente
figura se muestran dos inversores TTL conectados en cascada.
Cuando la puerta excitadora tiene un estado de salida alto actúa como fuente de corriente para la carga
(flecha sólida). La entrada a la carga es como un diodo en polarización inversa, por lo que la corriente es
mínima (típicamente 40 μA). Por otra parte, cuando la puerta excitadora se encuentra en estado bajo
(línea discontinua) actúa como un sumidero de corriente. Esta corriente es mucho mayor, ya que el
diodo base-emisor de la carga se encuentra en directa (típicamente 1,6 mA.). Además el sentido de la
corriente es hacia afuera de la compuerta, por lo que en las hojas de característica aparece con un signo
negativo.
Las salida totem-pole no se pueden conectar juntas, ya que dicha conexión produce una corriente
excesiva, que daña los dispositivos.
El la conexión entre distintos tipos de compuertas lógicas el principal aspecto a cuidar son los niveles de
tensión para cada uno de los niveles lógicos H y L.
La siguiente tabla nos ayudará a comprender mejor la forma correcta de conectar puertas lógicas de
diferente familias. En la misma se recogen los valores típicos del peor caso de los parámetros de entrada
y salida para varias familias.
Interfaz CMOS-TTL
Observando la tabla vemos que, en este caso, VOH(min)=4,9 de la puerta CMOS es mayor que VIH(min)=2 de
la puerta TTL. Entonces CMOS es compatible con TTL para el estado alto. Por otra parte VOL(max)=0,1 de la
puerta CMOS es menor que VIL(max)=0,8, por lo que también es compatible para el estado bajo.
En términos de corrientes, CMOS puede absorber 4 mA para el estado de salida bajo. Cuando excita a
una puerta TTL, la puerta CMOS debe absorber 1,6 mA de cada entrada TTL. Esto limita el fan-out de la
puerta CMOS a dos entradas TTL. De forma análoga el fan-out para el resto de familias es: 10para LS; 2
para S y 2 para AS.
Interfaz TTL-CMOS
En este caso las tensiones mínimas de salida para el nivel alto en una TTL VOH(min) son de 2,4 a 2,7 voltios,
mientras que la tensión mínima requerida para la entrada en nivel alto de la serie CMOS es de 3,15.
Luego la tensión de salida TTL no es suficiente para excitar un dispositivo CMOS. En el estado bajo, sin
embargo, las tensiones son compatibles.
Para establecer la adecuada interfaz TL-CMOS se debe añadir una resistencia de pull-up (Rp) conectada a
Vcc
El valor de la resistencia Rp se debe calcular en función de la intensidad que debe absorber la puerta
excitadora tanto de las entradas CMOS a las que se encuentra conectada como la corriente de la
resistencia
El mismo criterio de los niveles de tensión es necesario tener presente en el diseño de interfaces de
entrada y salida para interconectar circuitos digitales con sistemas analógicos.
Bibliografía
Objetivos:
- Reconocer las diferencias en las características de funcionamiento de las compuertas lógicas TTL
y CMOS .
- Interpretar información de los catálogos técnicos de compuertas lógicas..
Sustituya la resistencia R de 1KΩ por otra de 100KΩ. Cambie el osciloscopio a modo normal (voltaje v/s
tiempo) para observar lo que ocurre. Comente el efecto producido en relación a la configuración interna
de la compuerta..
Mita el periodo T de la señal de salida con el osciloscopio calibrado a 1 V/DIV, en C.A. y con la base de
tiempo en el menor rango. Probablemente necesitará magnificar la base de tiempo para medir
correctamente el periodo.
Compare las diferencias entre las distintas familias y comente acerca de la posibilidad de interconectar
compuertas de familias TTL y CMOS.
Actividad 2 – Diseño de circuitos combinacionales
Objetivos:
- Ejercitar un procedimiento de diseño de circuitos digitales combinacionales.
- Simular la solución desarrollada en software de simulación Logisim
- Implementar el circuito diseñado con compuertas lógicas y verificar su funcionamiento.
El diseño de circuitos digitales aplicados a la automatización implica encontrar una solución simple y
segura a partir de los requerimientos dados. Puesto que los circuitos digitales trabajan con variables
binarias (entradas y salidas que sólo pueden tomar dos valores opuestos y bien definidos), el diseño
debe comenzar por definir cuáles serán estas variables y cuál será el significado de estos valores.
0 : Bajar (llamada)
L1 =
1 : Subir (envío)
1 : Está abajo
L2 =
0 : No está abajo
0 : Acti var
H1 =
1 : Bloqueo
1 : Está arriba
H2 =
0 : No está arriba
El circuito comandará el motor, al cuál habrá que darle dos instrucciones, según sea el caso:
0 : Detener motor
S1 =
1 : Accionar motor
Con las variables ya definidas, se debe determinar en qué condiciones se debe accionar el motor y en
que sentido debe girar. Esto se hace completando una tabla de verdad.
• El interruptor de bloqueo impide que el montacargas baje si es llamado mientras está en el nivel
superior.
L1 L2 H1 H2 S1 S2 Significado
0 0 0 0 1 0 Bajar
0 0 0 1 1 0 Bajar
0 0 1 0 1 0 Bajar
0 0 1 1 0 X Bloqueo
0 1 0 0 0 X Está abajo
0 1 0 1 0 X Error en sensores
0 1 1 0 0 X Está abajo
0 1 1 1 0 X Error en sensores
1 0 0 0 1 1 Subir
1 0 0 1 0 X Está arriba
1 0 1 0 1 1 Subir
1 0 1 1 0 X Bloqueo
1 1 0 0 1 1 Subir
1 1 0 1 0 X Error de sensores
1 1 1 0 1 1 Subir
1 1 1 1 0 X Error de sensores
S1: S2:
Paso 2: Trazar el diagrama lógico para las funciones obtenidas y simular su
funcionamiento en Logisim
Utilizando únicamente compuertas básicas (AND, OR y NOT), construir el diagrama lógico para las
funciones simplificadas. Simular el funcionamiento del circuito en software Logisim.
Paso 3: Trazar el layout para los circuitos obtenidos
Utilizando las compuertas TTL 7404 (Inverter), 7408 (AND) y 7432 (OR), trazar el diagrama de
conexiones a implementar en el protoboard.
Utilice para las entradas un dipswitch con resistencias pull-up y para las salidas una resistencia y
un led, como indica la figura:
Objetivos:
- Reconocer las distintas etapas que componen un sistema de conversión de datos paralelo
a serie y viceversa.
- Implementar un sistema experimental de transmisión de datos.
Actividad:
1.- Implementar y probar por separado cada una de las etapas del sistema de transmisión de
datos.
2.- Unir los distintos bloques del sistema y verificar su funcionamiento.
3.- Analizar teóricamente el funcionamiento de cada etapa mediante diagramas de tiempo.
Importante: No olvidar los terminales de los flip-flop no indicados en el esquema (alimentación,
preset, clear, enable, strobe, etc.)
Anexo: Configuración de terminales de los circuitos integrados a utilizar.
7493
74175
Evaluación Nro1.
Montaje de una Interfaz para adquisición de datos
Nombre:
1 Funcionamiento del
prototipo
2 Conecta
correctamente
3 Calidad de la
soldadura
4 Aspectos estéticos
y de seguridad
Nombre:
Utilizar el sistema de adquisición de datos para registrar los diagramas de tiempo que permitan
verificar el funcionamiento de las distintas etapas del sistema de comunicaciones serie.
Actividad 1: Diseñe una prueba que permita obtener el diagrama de tiempo que sea útil para
verificar el funcionamiento del multiplexor. Realice la prueba. Dibuje las conexiones que realizó y
el diagrama de tiempo obtenido.
Actividad 2: Diseñe una prueba que permita obtener el diagrama de tiempo que sea útil para
verificar el funcionamiento del registro de desplazamiento. Dibuje las conexiones que realizó y el
diagrama de tiempo obtenido.