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Grupo: 3T1-EO
Turno: Vespertino
Objetivos específicos
1
Introducción
2
Detalles de pines
3
Pin 1 y 2 (𝑽𝒔𝒔 y 𝑽𝒅𝒅 )
Los primeros dos pines de la
pantalla LCD deben estar
conectados a + 5v y 0v.
Pin 3 ( 𝑽𝟎 )
4
Si el estado lógico de RS es '1', se selecciona el registro de datos. Si el
estado lógico de RS es '0', se selecciona el registro de comando.
Pin 6 (mi o E)
Nota: La pantalla LCD solo admite el valor ASCII de los datos que sean.
Pin 15 y 16 (A y K)
5
Colocación del conector LCD en la placa de proyecto FPGA Spartan 6
La pantalla LCD consta de 8 líneas de datos D0-D7, línea de selección de
registro RS, línea de escritura de lectura RW, línea de habilitación.
Primero necesitamos enviar comandos para inicializar la pantalla, la
posición del cursor, borrar la pantalla, incrementar el cursor, etc. Todos
estos comandos se envían a la instrucción Registrarse. El registro de
instrucciones se puede habilitar mediante RS = '0', RW = '1', En = '1'.
Valores ASCI para los comandos utilizados en el código
38 = Conjunto de funciones: 8 bits, 2 líneas, 5x7 puntos
0c = Pantalla activada con el cursor desactivado
06 = Modo de entrada
01 = Borrar pantalla
C0 = Colocar el cursor en la 2ª línea