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UNIVERSIDADE FEDERAL DO ESP IRITO SANTO CENTRO UNIVERSITARIO NORTE DO ESP IRITO SANTO

Disciplina: Arquitetura de Computadores Professor: Renato E. N. de Moraes Aluno:

Turma: EC5 Data: 11/04/12 Semestre: 2012-1 Valor: 2,0 pt Trabalho 01 - Projeto Neander

Nota:

O computador NEANDER foi criado com intenoes didticas. O objetivo deste trabalho c a implementar o NEANDER usando portas lgicas bsicas (NAND, NOR, NOT, LATCHES, e o a o FLIP FLOPS, etc) e simular esse circuito em um simulador lgico de portas para vericar o funcionamento do circuito ao realizar um pequeno programa de 10 instruoes gravado na c memria. o O computador NEANDER tem as seguintes caracter sticas:
Largura de dados e endereos de 8 bits c Dados representados em complemento de dois 1 acumulador de 8 bits (AC) 1 apontador de programa de 8 bits (PC) 1 registrador de estado com 2 cdigos de condiao: negativo (N) e zero (Z) o c Memria de 16 clulas de 8 bits o e

A Figura 1 mostra uma organizaao do NEANDER. c

Figura 1: Organizaao para o NEANDER. c

Centro Universitrio Norte do Esp a rito Santo Rodovia BR 101 Norte, Km 60, Bairro Litorneo, CEP: 29.932-540, So Mateus ES a a Tel.: +55 (27) 3312.1511, Fax.: +55 (27) 3312.1510 S tio eletrnico: http://www.ceunes.ufes.br/ o

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Projeto da Organizao do NEANDER ca


Passo 1: Projeto dos circuitos combinacionais (A) Multiplexador 2:1 de largura de 8 bits. (B) Unidade Aritmtica e Lgica (UAL): conforme a seleo da UAL (selUAL), 5 opee o ca raes diferentes podem ocorrer na UAL. A largura dos dados de 8 bits. A UAL co e trabalha com representao em complemento de dois e capaz de identicar quando ca e o resultado ZERO (Z) ou NEGATIVO (N). e Passo 2: Projeto dos circuitos sequenciais (A) Registradores de 8-bits ACC, REM, RDM e INST(opcode) com carga e sa parada lelas. Notem que todos esses registradores so iguais. a (B) Registrador NZ de 2 bits com carga e sa paralelas. Onde N (negativo): indica da sinal do resultado (1 se resultado negativo e 0 se resultado positivo). Z (zero): e e indica resultado igual a zero (1 se resultado igual a zero e 0 se resultado diferente e e de zero). (C) Contador de 8-bits PC com carga paralela e sinal de incremento (ver Figura 2).

Figura 2: Uma alternativa para implementar o PC do NEANDER.

Passo 3: Projeto da Memria o (A) Memria RAM para programa e dados. A memoria ser um grande banco de reo a gistradores de 16 endereos com largura de dados de 8 bits. Na memoria havero c a registradores, decodicadores de endereos e o seletores. Logo, neste caso teremos c A0, A1, A2 e A3 como entrada de endereo (ver Figura 3). c Passo 4: Projeto da Unidade de Controle A unidade de controle uma maquina de estados nita (FSM) que controla a leitura e e escrita da memria e os elementos da organizao conforme os sinais do decodicador o ca de instruo e a temporizao do processador (ver Figuras 4 e 5). ca ca
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Passo 5: Projeto do programa de 10 instrues A memria projetada ao ser co o inicializada com o sinal de RESET deve conter um programa inicial de 10 instrues dos co endereos 0000 a 1010. Os 6 endereos restantes da memria devem ser usados para c c o dados do programa (variaveis a serem utilizadas). Cada grupo dever criar um programa a diferente.

Trabalhem em grupos de at 3 alunos. O projeto funcionando deve ser apresentado e obrigatoriamente em uma mquina do laboratrio no dia 18/05/2012 (menos 10% por dia a o util de atraso) por um aluno do grupo sorteado pelo professor. Quando solicitado, o aluno responsvel pela apresentao dever explicar o projeto e justicar os resultados obtidos. a ca a

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Figura 3: Uma alternativa para implementar a memria do NEANDER. o

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Figura 4: Sinais de controle do NEANDER.

Figura 5: Uma alternativa para implementar o temporizador do NEANDER.

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