Electrnica Digital

BOLILLA N5 LGICA SECUENCIAL

Generalidad de los sistemas secuenciales. Elementos biestables. Metaestabilidad. Biestables y Flip-Flop. Biestable tipo S-R, tipo D. FlipFlop. Disparo por flanco y maestro esclavo. Tipo D, tipo J-K, tipo T.

SISTEMAS SECUENCIALES

En un circuito combinacional, la salida solo depende del valor de las entradas. En un circuito secuencial el valor de las salidas depende de valor de las entradas y de los estados anteriores.

El estado de un circuito secuencial es un conjunto de variables de estado, cuyos valores contienen toda la informacin pasada necesaria para establecer el comportamiento futuro segn el valor de las entradas

Le descripcin de estos circuitos no se realiza con tablas de verdad sino con diagramas de estado o ASM Chart

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rst
7 7

ch + ch -

Circuito comb.

Variables de Estado

En general un circuito con n variables de estado puede tener hasta 2n estados. Se llaman Mquinas de Estados Finitos (FSM)

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Los sistemas secuenciales se pueden dividir en: Sincrnicos:

Los cambios de estado se realizan en sincronismo con una seal externa.

Asincrnicos
Los cambios de estado se realizan en sin ninguna referencia externa.

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entradas

salidas

n clk rst m

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El circuito secuencial mas simple tiene dos estados -Q es la variable de estado

No se puede controlar su estado

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ANALISIS ANALGICO

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LATCH Y FLIP-FLOP Latches son dispositivos que pueden cambiar sus salidas, cuando la seal de control asume determinado nivel lgico. Flip-flop son dispositivos pueden cambiar el estado de sus salidas, solo en momentos precisos determinado por una seal de reloj.

Los sistemas digitales usan latch o flip-flop que ya vienen empaquetados, sin embargo se pueden construir con compuertas

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Latch S-R (set-reset)

S
0 0 1 1

R
0 1 0 1

Q
Q ltimo 0 1 0

QN
QN ltimo 1 0 0

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S 0 0 1 1

R 0 1 0 1

Q Q ltimo 0 1 0

QN QN ltimo 1 0 0

Se desactivan simultneamente S y R

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S 0 0 1 1 R 0 1 0 1 Q n+1 Q n 0 1 Q n+1 Q n 1 0

Dado que si R y S son 1 no se verifica que QN = Q la tabla se presenta

No utilizar

Tiempos importantes en este latch son el tiempo de propagacin y el ancho mnimo del pulso.

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Representacin del biestable S-R

Latch S R con compuertas NAND (activo bajo)

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/S

/R

0
0 1

0
1 0

Q Q n+1 n+1 No utilizar 1 0 0 1

Q n

Q n

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El biestable S-R con habilitacin

S 0 0 R 0 1 C 1 1 Q Q ltimo 0 QN ltimo 1 QN

1
1 x

0
1 x

1
1 0

1
1 Q ltimo

0
1 ltimo QN

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Latch D
Permite almacenar un bit

D Q C Qn

C 1 1 0

D 0 1 X

Q 0 1

QN 1 0

C
1 0

Q
D Q ltimo

QN
D QN ltimo

Q QN ltimo ltimo

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QN

1
0

D
Q ltimo

D
QN ltimo

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D-latch timing parameters

Retardo de propagacin (de C o D) Tiempo de setup (D antes del flanco de C ) Tiempo de hold (D despue del flanco de C )

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Flip-Flop D

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Tiempos importantes en un Flip-flop Tsetup, T hold y Tcq.

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Flanco activo flanco de bajada

D D

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Qnivel D clk Q D clk Q

c
c o clk

Co

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Entradas asincrnicas

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Flip-Flop J-K

C 0 1

J x x x 0 0 1

K x x x 0 1 0

Q n+1 Q n Q n Q n Q n 0 1

Qn+1 := JQn + KQn Actualmente muy poco usado

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Flip-Flop S-R Master-Slave

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FLIP-FLOP TIPO T ( toggle)
E 0 1 T X Qn+1 Qn Qn

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Tipo de dispositivo

Ecuacin Caracterstica

Biestable S-R Biestable D Flip-Flop D disp p/ flanco

Q*= S + R.Q Q*= D Q*= D

Flip-Flop S-R maestro/esclavo

Flip-Flop J-K Flip-Flop T

Q*= S + R.Q
Q*= J.Q + K.Q Q*= Q Q*= EN.Q + EN.Q

Flip-Flop T con habilitacin