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COMUNICACIN ENTRE
MICROCONTROLADORES
SISTEMAS ABIERTOS
EQUIPO :
BO H O R Q U E Z G A S PA R LU I S U R I E L
G A RC I A E N R I Q U E Z M I R I A M
MELCHOR RODRIGUEZ REYNA ANGELICA
PROTOCOLO I2C
Un estndar que facilita la comunicacin entre microcontroladores, memorias y otros
dispositivos con cierto nivel de "inteligencia", slo requiere de dos lneas de seal .
CARACTERISTICAS:
Se necesitan solamente dos lneas, la de datos (SDA) y la de reloj (SCL).
El bus permite la conexin de varios Masters, ya que incluye un detector de colisiones.
El protocolo de transferencia de datos y direcciones posibilita disear sistemas
completamente definidos por software.
Los datos y direcciones se transmiten con palabras de 8 bits.
Solo los dispositivos pueden comenzar la comunicacion
(condicin de Start): la lnea SDA cae a cero mientras SCL permanece en nivel
alto. A partir de este momento comienza la transferencia de datos.
(condicin de Stop): Master lee el estado de la lnea SDA, si vale 0 (impuesto por
el esclavo), el proceso de transferencia contina. Si vale 1, indica que el circuito
direccionado no valida la comunicacin, entonces, el Maestro genera un bit de
stop para liberar el bus I2C.
PROTOCOLO RS-485/EIA-485
cuando se necesita transmitir a largas distancias o con
ms altas velocidades. Utilizando enlaces con RS-485
no hay limitacin conectar tan solo dos dispositivos.
Dependiendo de la distancia, velocidad de transmisin
y los circuitos integrados que utilicemos, se pueden
conectar hasta 32 nodos con un simple par de cables.
PROTOCOLO WIEGAND
Es una marca de la sociedad Sensor Engineering
Company, muchos sistemas de control de acceso de
seguridad incorporan un protocolo de datos llamado
Wiegand. Wiegand el nombre de su inventor John R.
Wiegand
Fue diseado para conseguir una tecnologa que
permitiera transmitir datos de un identificador (tarjeta)
entre dos dispositivos alejados entre si.
Modos de reloj
Todos los datos son sincronizados por la linea de reloj del
bus.
SPI tienen 2 bits de configuracin
CPOL Polaridad de reloj. Determina si es estado de la
linea es bajo =0
CPHA Reloj de fase determina si el estado de la linea es
alto =1
Debido a que cada bit tiene dos estados existen cuatro
modos de reloj.
Modo A.
Si CPOL esta en un 1 lgico, el maestro desocupa la
lnea SCLK alta.
CPHA=1, la transferencia comienza en el segundo
filo de reloj.
MODO B.
Si CPOL esta en un 0 lgico y ningn dato esta siendo
transferido, el maestro mantiene la lnea SCLK en bajo.
MODO C.
Si CPOL esta en un 1 lgico, el maestro desocupa la lnea
SCLK alta.
Si CPHA=0, la transferencia comienza en el primer filo de
reloj.
Todas las transferencias subsecuentes dentro del byte
ocurren en
MODO D.
Si CPHA=0, la transferencia comienza en el primer
filo de reloj.
Si CPOL esta en un 0 lgico y ningn dato esta
siendo transferido, el maestro mantiene la lnea
SCLK en bajo.
Aspecto elctrico.
Niveles lgicos.
1 D+ 200mV mayor a
D
0 D+ 200mV menor a
D
Host:
Dispositivo
comunicacin.
maestro
que
inicia
la
Tipos de transferencia.
Control: Los datos de control sirven para configurar el perifrico
en el momento de conectarse al USB.
Codificacin
Utiliza codificacin NRZI para enviar los datos para
sincronizar la seal de reloj del host y el receptor.
La codificacin NRZI los valores lgicos 1 y 0 no se
representan por niveles de tensin, sino por transiciones
de los mismos.
bibliografia
http://www.i-micro.com/pdf/articulos/spi.pdf
http://www.ing.unlp.edu.ar/electrotecnia/cdm/Descripcion%20de%20un%20
microcontrolador%20(modulos%20de%20comunicacion).pdf
http://www.todopic.com.ar/foros/index.php?topic=19685.0
http://archive.siliconchip.com.au/cms/A_107882/article.html