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CODIFICADORES Y
DECODIFICADORES
En este tema se explican los conceptos bsicos de los codificadores y
CODIFICADORES
DEFINICIN: Un codificador es un circuito combinatorio que cuenta con un nmero
determinado de entradas, de las cuales slo una tiene el estado lgico 1, y se genera
un cdigo de varios bits que depende de cul sea la entrada excitada.
TIPOS DE CODIFICADORES:
Con Prioridad
Sin Prioridad
PRIORIDAD:
Solo una de las entradas puede estar activa a la vez entonces en cualquier lnea de la
Slo una de las entradas es 1 a la vez, as que slo hay 8 condiciones posible de
DECODIFICADORES
DEFINICIN: Un decodificador es un circuito combinacional que convierte la
informacin binaria de n lneas de entradas a un mximo de 2 n lneas nicas de salida.
Dicho de otra manera, un decodificador realiza la funcin opuesta a la de codificar, es
decir, convierte un cdigo binario de varias entradas en salidas exclusivas.
TIPOS DE CODIFICADORES:
Con salidas activas a nivel alto
Con salidas activas a nivel bajo
SALIDAS:
Para la salida O0, ser 1 cuando los bits de entrada E o y E1 son 0. Luego, la expresin
EJEMPLO PRCTICO:
Se desea construir un indicador luminoso de siete segmentos hecho a base de diodos
EJEMPLO PRCTICO:
La tabla de la verdad se muestra a continuacin:
LGICA SECUENCIAL
La mayora de los circuitos digitales incluyen
elementos de memoria.
Se describen mediante Lgica Secuencial.
Entradas
Salidas
Circuito
Combinacional
Elementos de
Memoria
Flip Flops
Elementos de memoria utilizados en circuitos
Flip Flops
Un flip-flop puede mantener un estado binario
Flip-Flops
Flip Flop= FF
Flip-Flops
-Se les puede considerar memorias de
1 bit, puesto que son celdas capaces
de almacenar un bit" de informacin.
Flip-Flops
Los FF se dividen en:
Circuito Bsico
Flip-flop RS basado en NOR.
1
0
1
0
Circuito Bsico
Se usan los estados en que las
salidas Q y Q son complementarias.
Un Flip flop tiene dos estodos tiles:
Q=1 y Q=0 se dice que est en el
estado puesta a uno (o estado 1).
Q=0 y Q=1 se dice que est en el
estado puesta a cero (o estado 0).
Flip-Flop RS
Dispositivo de almacenamiento temporal de 2
estados (alto y bajo), cuyas entradas
principales, R y S.
R: el borrado (reset ).
S: el grabado (set ).
Latch -RS
TABLA DE LA VERDAD
Latch-RS
Q(NO Q(NA
S
R
R)
ND)
0
0
EA
?
0
1
1
0
1
0
0
1
1
1
?
EA
Donde: (EA) es estado
anterior
y (?) es estado no
dedeterminado.
cada puerta a la entrada
Flip-Flop RS
Flip-Flop JK (Jump
keep)
Es bsicamente igual que el FF-RS.
J: el grabado (set ).
K: el borrado (reset ).
Flip-Flop JK
TABLA DE LA VERDAD
FF-JK
J
K
Q
0
0
EA
0
1
0
1
0
1
1
1
EA
Hay 3 entradas sncronas(J, K y
CLK). Las entradas J y K son
entradas de datos.
Flip-Flop T (Toggle)
NOTA:
Todos
circuito
son
almacenamiento
temporal
estos
de
cambio
de
Flip-Flop T (Toggle)
TABLA DE LA VERDAD
FF-T
Qn+1
T
Q
0
0
0-EA
0
1
1-EA
1
0
1-T
1
1
0-T
Un FF- T se puede construir a
partir de un FF- JK, conectando
ambos pines juntos.
Flip-Flop D (Data)
Un problema con los FF-RS es la condicin S=1,
R=1, una forma de solucionarlo es permitir
una sola nica entrada.
La salida del FF-D, es siempre igual, al valor
mas reciente aplicado a la entrada al
dispararse la seal de reloj.
Por tanto recuerda y produce la ultima entrada.
Flip-Flop D (Data)
Qn+1 : Estado siguiente de Q.
TABLA DE LA VERDAD
FF-D
Usando un inversor, en
una de la entrada se
garantiza de ser una
opuesta de la otra.
Q n+1
Donde: (X) no
importa.
MULTIPLEXORES
MULTIPLEXORES (MUX):
Un Multiplexor es un dispositivo que tiene varias entradas de datos, una nica salida y varias
entradas de seleccin.
El dato o datos que vamos a obtener a la salida depende de la entrada que seleccionemos
desde las entradas de seleccin.
Los MUX son circuitos combinacionales que pueden ser fcilmente implementados con
compuertas lgicas AND, OR y NOT.
Ejemplo de un MUX con dos entradas, una salida y una entrada de seleccin:
MULTIPLEXORES
MULTIPLEXORES (MUX):
Multiplexor de 4 entradas de datos, dos entradas de seleccin y una salida.
MULTIPLEXORES
La ecuacin Booleana de un MUX de 4 a 1 entrada es:
MULTIPLEXORES
Implementacin de un MUX de 4 a 1 con compuertas lgicas:
MULTIPLEXORES
Implementacin de un MUX de 4 a 1 utilizando un decodificador de 2 a 4 lneas:
MULTIPLEXORES
MULTIPLEXORES
Un
El
cdigo de entrada de seleccin
determina cual de las salidas transmitir la
entrada de DATOS , es decir el
demultiplexor recibe una fuente de datos
de entrada y la distribuye en forma
selectiva a 1 de N canales de salida, al igual
que un interruptor de mltiples posiciones.
TABLA DE VERDAD
Cdigo de
SELECCIN
SALIDAS
S2
S1
S0
O O6 O5
7
O4
O3 O2 O1
O0
I es la
entrada
de datos.
al circuito decodificador de 3 a 8 lneas de la figura 92, solo que se agrego una cuarta entrada (I) en cada
compuerta.
Muchos decodificadores de CI poseen una entrada de
HABILITACION, que es una entrada extra que se
agrega a las compuertas del decodificador, por lo que
este circuito integrado decodificador se usa como
demultiplexor en donde las entradas de cdigo binario
(A,B,C) sirven como entradas de SELECCIN y la
entrada de HABILITACION sirve como entrada de datos
I.
Por
lo
que
se
lo
denomina
decodificador/demultiplexor.
como demultiplexor .
La entrada de habilitacin E1 se usa como la
entrada de datos I, mientras que las otras
dos entradas de habilitacin se mantienen en
sus estados activos.
Suponiendo que las entradas de seleccin
son 000, con este cdigo de entrada la nica
salida que se activara seria O0 mientras que
las dems entradas estn en ALTO.
DECODIFICADOR DE
La seal de reloj se encamina al destino bajo
RELOJ
el control de las lneas de Select.
FUNCIONAMIENTO DEMUX
Multiplexador de una lnea
a 8 lneas el cdigo Select
S2 S1 S0 determina la
salida de reloj.
Cdigo
de Select
S S S
2 1 0
0 0 0
0 0 1
0 1 0
0 1 1
1 0 0
1 0 1
1 1 0
1 1 1
O
7
0
0
0
0
0
0
0
I
O
6
0
0
0
0
0
0
I
0
O
5
0
0
0
0
0
I
0
0
SALIDAS
O O O
4 3 2
0 0 0
0 0 0
0 0
I
0
I
0
I
0 0
0 0 0
0 0 0
0 0 0
O
1
0
I
0
0
0
0
0
0
O
o
I
0
0
0
0
0
0
0
SISTEMA DE SEGURIDAD Y
VIGILANCIA
Se vigila el estado abierto o cerrado de las
puertas de acceso.
Cada puerta controla un interruptor
La visualizacin se debe dar mediante LEDS.
SISTEMA DE VIGILANCIA