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wrAC
wrRDM
(Memory data
register) MDR
AC
A B N Bloco de
opULA UL Z controle
wrIR
A IR
wrNZ
Organizao
Microoperaes JN end, N = 0
read write
C1: MAR PC MEM
C2: PC PC + 1 Busc wrPC MAR_sr
C2: MDR MEM(MAR) a c wrMA
PC R
C3: IR MDR (fetc 0
h) 1
C4: PC PC + 1
incPC MAR
(aponta instruo que Decodifica
segue o JN) o e (Memory address
Execuo register)
wrAC
wrRDM
(Memory data
register) MDR
AC
A B N Bloco de
opULA UL Z controle
wrIR
A IR
wrNZ
Organizao
Microoperaes JN end, N = 1
read write
C1: MAR PC MEM
C2: PC PC + 1 Busc wrPC MAR_sr
C2: MDR MEM(MAR) a c wrMA
PC R
C3: IR MDR (fetc 0
C4: MAR PC h) 1
C5: MDR MEM(MAR)
incPC MAR
C6: PC MDR Decodifica
o e (Memory address
Execuo register)
wrAC
wrRDM
(Memory data
register) MDR
AC
A B N Bloco de
opULA UL Z controle
wrIR
A IR
wrNZ
Organizao
Microoperaes JZ end, Z = 0
read write
C1: MAR PC MEM
C2: PC PC + 1 Busc wrPC MAR_sr
C2: MDR MEM(MAR) a c wrMA
PC R
C3: IR MDR (fetc 0
h) 1
C4: PC PC + 1
incPC MAR
(aponta instruo que Decodifica
segue o JN) o e (Memory address
Execuo register)
wrAC
wrRDM
(Memory data
register) MDR
AC
A B N Bloco de
opULA UL Z controle
wrIR
A IR
wrNZ
Organizao
Microoperaes JZ end, Z = 1
read write
C1: MAR PC MEM
C2: PC PC + 1 Busc wrPC MAR_sr
C2: MDR MEM(MAR) a c wrMA
PC R
C3: IR MDR (fetc 0
C4: MAR PC h) 1
C5: MDR MEM(MAR)
incPC MAR
C6: PC MDR Decodifica
o e (Memory address
Execuo register)
wrAC
wrRDM
(Memory data
register) MDR
AC
A B N Bloco de
opULA UL Z controle
wrIR
A IR
wrNZ
Organizao
Microoperaes HLT
read write
C1: MAR PC MEM
C2: PC PC + 1 Busc wrPC MAR_sr
C2: MDR MEM(MAR) a c wrMA
PC R
C3: IR MDR (fetc 0
h) 1
incPC MAR
PRA O Decodifica
PROCESSAMENTO o e (Memory address
Execuo register)
wrAC
wrRDM
(Memory data
register) MDR
AC
A B N Bloco de
opULA UL Z controle
wrIR
A IR
wrNZ
Organizao
Exerccio 1
Listar as microoperaes necessrias para
implementar a instruo LDI (load imediato)
LDI valor
LDI 23 ; AC 23
8 bits
7 4 3 0
wrAC
wrRDM
(Memory data
register) MDR
AC
A B N Bloco de
opULA UL Z controle
wrIR
A IR
wrNZ
Organizao
Exerccio 2
Listar as microoperaes necessrias para
implementar a instruo ADDI (add imediato)
ADDI valor
ADDI 7 ; AC AC + 7
8 bits
7 4 3 0
wrAC
wrRDM
(Memory data
register) MDR
AC
A B N Bloco de
opULA UL Z controle
wrIR
A IR
wrNZ
Organizao
Exerccio 3
Listar as microoperaes necessrias para
implementar a instruo LDIN (load indireto)
LDIN end
LDIN 23 ; AC MEM(MEM(23))
8 bits
7 4 3 0
A B N Bloco de
opULA UL Z controle
wrIR
A IR
wrNZ
Organizao read write
MEM
wrPC MAR_sr
c wrMA
PC R
0
1
A B N Bloco de
opULA UL Z controle
wrIR
A IR
wrNZ
Organizao read write
C1: MAR PC MEM
C2: PC PC + 1 Busc wrPC MAR_sr
C2: IR MEM(MAR) a c wrMA
PC R
(fetc 0
h) 1
A B N Bloco de
opULA UL Z controle
wrIR
A IR
wrNZ
Organizao
Nmero de ciclos necessrios para a execuo de
cada instruo na organizao estudada
CPI Cycles per Instruction
Instruo Ciclos
LDA, STA, ADD, OR, AND 8
JMP, JN (N=1), JZ (Z=1) 6
JN (N=0), JZ (Z=0), NOT 4
NOP, HLT 3
Desempenho
Tempo gasto na execuo de um programa
(ciclos de clock)
Instrues tem diferentes tempos de execuo (CPI)
1. Verificar as instrues executadas e quantas vezes elas so
executadas
2. Verificar o CPI de cada instruo executada e somar tudo
Exemplo
8 ciclos LDA a
4 ciclos NOT
8 ciclos ADD um
8 ciclos STA a
3 ciclos HLT
Total: 31 ciclos
Desempenho
Tempo gasto na execuo de um programa
(ciclos de clock)
loop:
1: 3*8 + 4
2: 3*8 + 4 LDA i ;
3: 3*8 + 6 ADD menos_um ;
3x
86 ciclos STA i ; i--
JZ fim ; Se i = 0 salta para fim
2*6 2x JMP loop ; Seno salta para loop
12 ciclos
fim:
3 ciclos 1x HLT ; Pra o processador
MEM
wrPC MAR_sr
c wrMA
PC R
0
1
wrAC
wrRDM
(Memory data
register) MDR
AC
A B N Bloco de
opULA UL Z controle
wrIR
A IR
wrNZ