UNMSM - FIE

Introducción al curso
Diseño Digital

Ing. Alfredo Granados Ly

 Temario

1. Introducción a los FPGAs (Lógica programable)

2. Lenguaje de descripción de hardware: VHDL
3. Estilo flujo de datos para la implementación de circuitos
combinacionales
4. Estilo algorítmico para la implementación de los
elementos de memoria, registros, contadores, etc.
5. Implementación de máquinas de estado.
6. Estilo estructural.

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 Temario

7. Implementación de un microprocesador de 8
bits: Ruta de datos (banco de registros, ALU,
modos de direccionamiento) y Unidad de
Control.
8. Proyecto de implementación de un sistema
digital en un FPGA.

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 Calificación del curso

Examen Parcial (0 a 20 puntos)

Examen Final = Examen de (0 a 15 puntos) +
Proyecto Final de (5 puntos)
Promedio de Laboratorios (0 a 20 puntos)

PF = [ EP + EF + Prom Laborat] / 3

Nota: La presentación del Proyecto Final se realizará una semana

antes del Examen Final y tendrá una sustentación de máximo 10
minutos por alumno.
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 Objetivos de la Bibliografía

• Material de consulta a la teoría impartida por el

profesor.
• Diferentes puntos de vista sobre la misma teoría.
• Variedad de ejemplos para complementar a la teoría
y laboratorio.
• Ideas de proyectos para la sustentación final.
• Familiarizarnos con material técnico en ingles.

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 Bibliografía

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 Bibliografía

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 Bibliografía

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 Bibliografía

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 Bibliografía

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 Bibliografía

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 Bibliografía

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 Publicaciones del profesor
• “Diseño de un microcontrolador de 8 bits en un FPGA”.
Revista de investigación UNMSM (2007).

• “Diseño de un analizador lógico en VHDL y su

implementación enb un FPGA Spartan 3”. XIII Workshop
Iberchip, Lima (2007).

• “Reproducción de una Imagen en un Monitor VGA

Utilizando un FPGA“. Revista de investigación UNMSM
(2007).

• “Design of a spectrum analyzer for low frequencies”. XV

Workshop Iberchip, Buenos Aires (2009).

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 Publicaciones del profesor
• “Control de mouse vía IR aplicado en la medición de
distancias”. Intercon USMP

• “Implementación del primer microprocesador 4004

de Intel en un FPGA”. Revista de investigación
UNMSM (2006)

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