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TEMA: SEMANA 5
“CIRCUITOS LÓGICOS SECUENCIALES”
Subtitle
Autor:
El flip flop más básico puede ser construido con dos compuertas lógicas tipo NAND.
II.2- LATCH NAND
Diagrama de tiempos.
Representación
alternativa:
Aplicación
II.3- LATCH RS (LATCH NOR)
R S Q(t+1)
0 0 Qt
0 1 1
1 0 0
1 1 ilegal
III. SEÑALES TEMPORIZADAS Y FLIP FLOPS TEMPORIZADOS
Clasificación:
1. Evento Manejado - Circuitos asíncronos que cambian su estado inmediatamente
cuando están habilitados.
2. Reloj Manejado - Circuitos síncronos que son sincronizados a través de una
señal de reloj
3. Pulso Manejado – Es una combinación de los dos anteriores.
III. SEÑALES TEMPORIZADAS Y FLIP FLOPS TEMPORIZADOS
Tsetup: tiempo de establecimiento: mínimo tiempo que la entrada debe estar en nivel
estable antes de que ocurra la transición en la salida.
T hold : tiempo de retención: mínimo tiempo que la entrada debe estar en nivel estable
después de que ocurra la transición en la salida.
III.1.- LATCH D (CERROJO).
Flip-flop T (toggle)
• Conmuta con cada flanco activo del CLK
• Se puede implementar con FF JK y FF D
IV. OTROS PARÁMETROS DE SINCRONIZACIÓN
Revisar: http://www.huarpe.com/electronica2/capitulo/capitulo08/html/555asta.html