DIP 5000 Universal

NDICE
X1 X2 X3 X4 X5 X6 X7 X8 X9 X 10

GENERALIDADES CARACTERSTICAS POSIBILIDADES DE OPERACIN ARQUITECTURA DESCRIPCIN DE OPERACIN ENLACE DIGITAL ENLACE ANALGICO DEL S SYNCHRONIZACIN TIEMPO DE TRANSFERENCIA

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1 FUNCIN

1 - GENERALIDADES

Intercambio de informacin todo o nada entre dos puntos geogrficos, sobre un soporte digital y respetando los siguientes criterios:

 Tiempo de transferencia nominal  Seguridad  Fiabilidad  ETTD Equipo Terminal de Tratamiento de Datos  ETCD Equipo Terminal de Comunicacin de Datos


Tiempo de transferencia :

Tiempo transcurrido entre el cambio de estado de la entrada del equipo emisor y el cambio del estado de la salida correspondiente del equipo receptor , en ausencia de perturbacin y de ruido de lnea. Aptitud del enlace , en ausencia de emisin de orden , para evitar la restitucin de una orden en la salida del receptor , en presencia de perturbacin y/o de ruido (medicin de probabilidad de orden intempestivo). Aptitud del enlace para transmitir una orden de manera satisfactoria en presencia de perturbacin y/o de ruido (medicin de probabilidad de desaparicin de la orden).

Seguridad :

Fiabilidad :

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1 - GENERALIDADES
X

PRINCIPIO
Medio Ana logico

DTE
DIP5000

DCE
MUX/ Demux

Red Digita l DCE

MUX/ Demux

DTE
DIP5000

Fibra Optica
Proteccion Linea Proteccion

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1 - GENERALIDADES
3 APLICACIN

 La DIP 5000 ha sido concebida para responder a la necesidad de las protecciones de

los redes elctricas , teniendo en cuenta el tiempo de transferencia , fiabilidad y seguridad.

 Sin embargo , se puede utilizar tambien la DIP para transmitir cualquier tipo de
informacin todo o nada como una alarma , una indicacin de emparejamiento para una funcion de bloqueo etc...

 El equipo administra 3 tipos de rdenes :



Permisivo tipo que favorece la fiabilidad (para las protecciones de distancia). Bloqueo tipo que favorece la velocidad (para las protecciones de distancia).

disparo directo tipo que favorece la seguridad (para todos los tipos de proteccin).

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SOPORTE DE TRANSMISIN

2 - CARACTERISTICAS

Las normas disponibles para el soporte digital son :

 G703.1  G703.6  V11 / X24

X

64 kbps 2048 kbps 32 hasta 256 kbps

rdenes entradas/salidas

2 a 8 rdenes simultneas, independientes y bidireccionales.

 ENTRADA


Cada entrada puede ser , siguiendo su aplicacin y su conexin ;

un contacto seco una tensin , automticamente escogida por soft, (24V- 250 VDc)

Adquisicin de la entrada de la orden con rel (1 contacto N/O para cada orden) y un diodo.

 SALIDA

1 contacto esttico NO (MosFet) - Vmax 290 V Dc, Imax 2 A, Pmax : 120 W. Salida duplicada con rel (1 N/O or N/C contacto para cada rden) y un diodo. Posibilidad de prolongacin de restitucin de 20 hasta 250 ms.

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2 - CARACTERISTICAS
X

3 TIEMPO DE TRANSFERENCIA / APLICACIONES Y SUMINISTROS para el modo digital

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2 - CARACTERISTICAS
X

4 TIEMPO DE TRANSFERENCIA / APLICACIONES Y SUMINISTROS para el modo analgico

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2 - CARACTERSTICAS
5 Anchuras de bandas para el modo analgico

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 HARDWARE
   

3 - POSIBILIDADES DE OPERACIN

Fuente de alimentacin redundante opcional Botn de reset Indicacin de alarma por medio de diodo y contacto Indicacin de las rdenes de entrada/salida por medio de diodo y contacto

 SOFTWARE (con PC )
  

Prueba hardware Teleconfiguracin y prueba remota en el modo digital solo Posibilidad de bloqueo individual o simultneo de la seal de transmisin y/o las salidas de las rdenes Bucle local y remoto en el modo digital solo Forzado de las entradas /salidas Medicin directa del tiempo de transferencia en la lista de eventos. 2 contadores por orden (rx y tx) Registro de 256 eventos Registro de 256 alarmas (precisin de 1 ms) (precisin de 1 ms)

     

10

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4 - ARQUITECTURA
X1

COMPOSICIN

El equipo es conforme a la norma tipo EUROPE de 19 pulgadas de largo y 3 unidades de altura (1 pulgada = 25,4 mm ; 3 unidades = 132,5 mm).

11

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X2

Posicin de las borneras

4 - ARQUITECTURA

12

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X3

Conexin de los bloques

4 - ARQUITECTURA

13

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X3

Conexin de los bloques

4 - ARQUITECTURA

14

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X4

Conexin del interfaz de lnea (lado del cable)

4 - ARQUITECTURA

15

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5 - DESCRIPCIN DE OPERACIN
X DIAGRAMA

EN BLOQUES GENERAL

16

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5 - DESCRIPCIN DE OPERACIN
X X

1 1.1

AL 137/AL 139/AL 140/AL 141 DESCRIPCIN DE LAS FUNCIONES

tensin baja , sealada por un diodo verde. Proteccin de sobrecorriente e inversin de polaridades por fusible y diodo.

 alimentacin , filtracin y proteccin 48V Dc o 127V hasta 250V Dc

 

 Generacin y vigilancia del 5V Dc



puntos de prueba 0 y +5v. 2 diodos rojos para alarmas menores y mayores : 2 rels con 2 contactos para cada alarma

 Sealizacin de ALARMA:  Restitucin de ALARMA



0 o 2,5 o 5 o 10 segundos de temporizacin a la activacin.

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5 - DESCRIPCIN DE OPERACIN
X 1.2

DIAGRAMA EN BLOQUES AL137/AL139/AL140/AL141

18

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5 - DESCRIPCIN DE OPERACIN
1.3 TARJETAS DE FUENTE

19

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5 - DESCRIPCIN DE OPERACIN
X2 X 2.1

TARJETA SR 114 /SR115 DIAGRAMA EN BLOQUES

20

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5 - DESCRIPCIN DE OPERACIN
X

2.2

ENTRADA DE ORDEN
elctricamente independientes.

 La SR114/SR115 tiene 4 circuitos de entrada de rdenes.Todas las entradas son  Se hace el aislamiento galvnico con fotodiodos.  Las entradas de rden pueden activarse con el estado presencia de tensin o
ausencia de tensin siguiendo la conexin.

 En el caso de la presencia de tensin puede ser de 48-127Vdc u 220-250Vdc para la

SR114 y de 24-60Vdc u 110-127Vdc para la SR115. La seleccin se hace con puentes.

 Un diodo amarillo se encende por cada orden activada.  Seprovee un rel con un contacto abierto en reposo con una sealizacin externa.

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5 - DESCRIPCIN DE OPERACIN
X

2.3

SALIDA DE RDEN

 La SR114/SR115 tiene 4 salidas de restitucin de rden.  Cada salida de restitucin de orden tiene 2 transistores MOSFET en serie
trabajando como contacto esttico , montados en paralelo con un rel electromecnico.

 Los MOSFET tienen un tiempo de transicin de rden de 500s y una corriente

de 2A.

 No hay polaridad en el circuito de salida , debido a la configuracin de montaje ,

de los MOSFET.

 La corriente esttico se manda a travs de una caja de desacoplo optoelectrnico asegurando un aislamiento de 2,5 kVeff.

 Un diodo en el frontal delantero confirma la activacin de una orden.  Seprovee un rel con un contacto abierto en reposo para una sealizacin
externa.

22

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5 - DESCRIPCIN DE OPERACIN
X 2.4

DIAGRAMA EN BLOQUES DEL CIRCUITO DE RESTITUCIN DE ORDEN

23

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5 - DESCRIPCIN DE OPERACIN
X X

3 3.1

TARJETA UT148 DESCRIPCIN

1 Digital Signal Processor tipo ADSP2189M.

 El componente principal de esta tarjeta es un procesador :



 Esta tarjeta est compuesta de seis bloques :

 

El bloque POWER fuente de alimentacin,RESET,supervisin. El bloque DSP SYSTEM administra y comprueba las funciones relativas al DSP. El bloque COM administra la comunicacin sobre el enlace digital. El bloque DATE administra la fecha , los eventos y las alarmas. El bloque V24 interfaz de comunicacin hacia el PC de configuracin. El bloque GEN CLK se encarga de la generacin de los relojes para los otros bloques.

   

24

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5 - DESCRIPCIN DE OPERACIN
X 3.2

DIAGRAMA EN BLOQUES DEL UT148

25

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5 - DESCRIPCIN DE OPERACIN
X

3.3

Bloque POWER
componentes conectados sobre estes E/S.

 generacin de los 3,3v a partir de +5v para los E/S del DSP como para todos los  generacin de 2,5v a partir de +5v para el ncleo del DSP ADSP2189M.  Un sistema con comparadores vigila en permanencia los 5v,3,3v y el 2,5v.  Generacin del seal Reset en 3 casos ;
1. Puesta en servicio del mdulo reset activo durante 200ms. 2. Cada de un de los voltajes antedictos. 3. Pulsado del botn de reset.

26

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5 - DESCRIPCIN DE OPERACIN
X X

3.4

Bloque SYSTEME DSP

3 componentes (ADSP2189M,AM29LV033C,EPLD) aseguran las siguientes funciones;  Vigilancia y control de las seales de orden E/S.  Vigilancia de los archivos de eventos y alarmas.  Vigilancia de las alarmas : deteccin, tratamiento, restitucin.  Comunicacin con el usuario para la configuracin, vigilancia de las pruebas y el
mantenimiento (conexin RS232/V24).

 Interfaz con el DSP SYSTEM y la tarjeta de comunicacin.  Archivo de los eventos y alarmas sobre la RAM de socorro , la configuracin y
los contadores estan almacenados sobre la EEPROM.Un reloj en tiempo real , con una precision de 1 ms , (Power cap) , da la fecha y la hora.

 Vigilancia de todos los diodos de sealizacin.

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5 - DESCRIPCIN DE OPERACIN
X

3.5 Bloque COM

X 2 posicines ; tarjeta hija del UT148 o una tarjeta 3u verticale (IR182) conectada al UT con la FB182.
X X X X X X X

Identificacin del interfaz de comunicacin Solicitud de interfaz co o contra-direccional para la G703 Alarma ausencia de seal y prdida de sincronismo de la interfaz Datos transmitidos hacia y recebidos del interfaz Reloj de emisin y de recepcin Solicitud de blucaje de la lnea de emisin Solicitud de bucle de la emisin sobre recepcin

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5 - DESCRIPCIN DE OPERACIN
X 3.6

Bloque DATE fechadero de fecha watch dog de memorizacin

X caja

X funcin X funcin X funcin X interfaz

IRIG-B para la sincronizacin externa (tarjeta hija del UT148)

29

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5 - DESCRIPCIN DE OPERACIN
X 3.7 X

Bloque V24

Este bloque administra la interfaz hombre mquina remota que comunica con la consola (interfaz V24/V28). El conector de delante detecta la presencia de la conexin de un terminal de un ETCD , y la comunicacin voltea hacia este conector si se detecta la presencia sino , el conector trasero opera automticamente.

30

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5 - DESCRIPCIN DE OPERACIN
X 3.8

Bloque GEN CLK

El ritmo bsico es de 12,288Mhz que viene de un oscilador de cuarzo. Los otros relojes son los siguientes 1,536Mhz para el UART 4Khz para aplicaciones diversas lgicas 10,417Hz , 7,8125Hz , 3,9062Hz , 1,9531Hz para las intermitencias de los diodos y las temporizacines de los rels de alarma.

31

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5 - DESCRIPCIN DE OPERACIN
X 3.9

Diagrama en bloques de la supervisin de alarma:

32

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5 - DESCRIPCIN DE OPERACIN
X 3.10 X 3.10.1

Bloque SISTEMA DSP (UT148) Codificacin y restitucion :

 El emisor envia en permanencia un mensaje de guarda en estado

de reposo.Un mensaje especfico se envia durante una rden , en lugar de la guarda , codificado con la siguiente informacin binaria :

Ordenes 1 y 2 OFF Orden 1 ON, orden 2 OFF Orden 1 OFF, orden 2 ON Ordenes 1 y 2 ON

Cada grupo de 2 ordenes esta codificado con una clave de 32 bits multiplicada por 4 valores distintos = 16 claves max = 128 alfabetos distintos constituyen cdigos auto-sincronizados.

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5 - DESCRIPCIN DE OPERACIN
 Tamao de la informacin binaria :
 

4 claves de 32 bits para 2 ordenes 16 claves maximum para 8 ordenes

 El escogido del cdigo respeta los siguientes criterios :



Distancia de Hamming entre la clave recibida hacia la clave del alfabeto inferior a las L/N informacin binaria consiguientes (L y N fijados por el tipo de aplicacin). Codificacin auto-sincronizando. La totalidad de las claves constitua un alfabeto.Hay 128 alfabetos diferentes asociados a 128 seas.Una sea y un alfabeto estan definidos por un enlace (2 DIP 5000).

 

34

> DIP5000U - 22/09/04 - DCP/Sp

5 - DESCRIPCIN DE OPERACIN
X 3.10.2

Administracin del receptor :

Los alfabetos estan seguros porque durante un resbalamiento de un numero cualquier de bits con relacin a la sincronizacin no se puede haber rdenes intempestivos . Los alfabetos son codigos auto-sincronizados. Se puede hacer la sincronizacin o la resincronizacin del receptor solamente sobre la recepcin de la informacin binaria de la guarda.

 Resbalamiento y sincronizacin :


 

 Restitucin


El receptor pede una restitucin de rden cuando reconece la clave del rden corespondiente en el cdigo recibido. Distancia de Hamming entre las claves recibidas y las claves esperadas inferior a un nivel durante un tiempo definido. Los parametros L y N son automaticamente fijados con el tipo de aplicacin configurada.

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5 - DESCRIPCIN DE OPERACIN
 Clculo de la tasa de error (BER)


El receptor clcula en permanencia la tasa de error con bit instantaneo del enlace. Los niveles de alarmas son programables entre 10-1 y 10-3 para el alarma mayor y de 10-3 hacia 10-6 para el alarma menor. El nivel del alarma menor debe ser inferior al nivel del alarma mayor. Los niveles son configurados con el IHM.

36

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5 - DESCRIPCIN DE OPERACIN
X 3.10.3

Canal de servicio en el modo digital solo:

 Una parte de la informacin binaria transmitida esta reservada

para las informaciones de servicio , en permanencia las informaciones de estado son cambiandos entre las 2 extremidades :


la prueba permanente de la disponibilidad del enlace de comunicacin. La transmisin de las alarmas entre los 2 equipos. Teleconfiguracin , telebuclaje y repatriacin de las informaciones del equipo remoto. Medicin en permanencia del tiempo de transmisin sin los contactos de los rels interna.

 

37

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6 - ENLACE DIGITAL
X1 X Se

GENERALIDADES

puede hacer la transmisin digital con las siguientes interfaces :

 V11 / X24  G703.1  G703.6  Cada interfz tiene una tarjeta hija del UT148:
  

IR 180 para G703.1 IR 179 para V11 / X24 IR 173 para G703.6

 El modulo IR182 hace el interfaz ptico para la fbra monomodo

(tarjeta 3u separada)
38 > DIP5000U - 22/09/04 - DCP/Sp

6 - ENLACE DIGITAL
X Interfaz

39

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6 - ENLACE DIGITAL
X2

INTERFAZ V11 / X24

 Equivalente a la RS422 y la RS485  V11

: Interfaz elctrica estandar (UIT) para la transmisin digital sncrona de los suministros binarios de 32 hacia 256 kbps.

 X24 :
Recomendacin UIT para el uso del circuito de juncion , seal de reloj, etc

 ISO 4903 :
Estandar internacional para el tipo de conector (SUB-D 15 puntos) y la relacin seal/pin.

 Impedancia nominal 120 ohm simtrico.

40 > DIP5000U - 22/09/04 - DCP/Sp

6 - ENLACE DIGITAL
X 2.1

DIAGRAMA EN BLOQUE IR179

41

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6 - ENLACE DIGITAL
X3

INTERFAZ G703.1

 Interfaz de datos sincrnico utilizado sobre los enlaces tipo MIC

con 64 kbps.

 Co-direccional (IR180) donde las seales de informacin y de

ritmo son asociadas y transmitidas hacia la misma direccin

 Impedancia simtrica 120 ohm.

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6 - ENLACE DIGITAL
X 3.2

INTERFAZ IR 180

43

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6 - ENLACE DIGITAL
X4

INTERFAZ G703.6

 Estandar UIT, para la transmisin digital a 2048 Kbps (2 Mbps).  El suministro de transmisin esta impuesto por la red porque la
DIP5000 esta considerada como un ETTD.

 No hay corector de caracterstica de lnea en la interfaz porque el

enlace DIP-MUX es muy corto.

 Impedancia simtrica 120 ohm.

44

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6 - ENLACE DIGITAL
X 4.1

INTERFAZ IR173

45

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6 - ENLACE DIGITAL
X5

INTERFAZ PTICA IR182

Interfaz para fbra monomodo operando con un suministro de 256 kbits/s. Versin distancia lejana utilizando un diodo lser con 1550 nm (100km , atenuacin inferior a 30db). Versin distancia corta utilizado un diodo lser con 1310 nm (40km , atenuacin inferior a 30db).

46

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6 - ENLACE DIGITAL

47

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6 - ENLACE DIGITAL

48

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7 - ENLACE ANALGICO
IR 183 GENERALIDADES No hay la facilidad del canal de servicio porque la banda 4 kHz es utilizada con las 4 ordenes.

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7 - ENLACE ANALGICO
Connexion I 5000C5000

50

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7 - ENLACE ANALGICO
IR 183 Prueba de enlace
X

Est funcin se uede inici r m nu lmente o utomticamente (diario o cada hora). rueba de la codificacin = +6dB solamente.

X X

El comando consi ue siem re rioridad en rueba del enlace.

Maintenance
Loc Rem

Link

CPU

MTN

LCK

LOOP

SYNC

REM AL

STATUS

BAT

V7

V5

V3

V2

V4

V6

V1

V8

V9

S1

S2

MAIN POWER Opt. Link TX MAJOR ALARM

AUX. POWER

RX

MINOR ALARM

O ptical interface indicator lights

Power supplies indicator lights

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8 - DELs

52

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9 - SYNCHRONIZACIN
IR184

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10 - TIEMPO DE TRANSFERENCIA
Medida del tiempo de transferencia

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55

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