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ENGENHARIA ELECTROTCNICA 1 Semestre 2006/2007 SISTEMAS DIGITAIS EXAME TIPO (01-MAR-2007) TIPO B
Notas importantes:
1 Leia atentamente a totalidade do EXAME. Procure arrumar as ideias previamente e comece por responder s perguntas em que est mais vontade. 2 Identifique totalmente as respostas e as folhas de exame. 3 DDNA Digito Dezenas do Nmero de Aluno 3 No se deixe impressionar com aparentes dificuldades. Cabea fria e BOM TRABALHO.
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Sistemas Digitais
2[1.5V] Projecte um circuito usando Descodificadores adequados que realize a seguinte funcionalidade: - O circuito possui 3 entradas ABC binrias que representam o nmero n e duas sadas Z e W. Z ser 1 se o nmeron+DDNA for par, e simultneamente for mltiplo de 3. W 1 se a operao (n+1) for nmero primo. Grupo IV Tecnologia 1 Suponha que vai utilizar num circuito integrados do tipo AS com as seguintes caractersticas: Tipo 74AS04 (NOT) 74AS32 (OR2) TpLH(nS) 4 5 TpHL(nS) 5 8 iOL(mA) 10 20 iOH(mA) 0,6 0,2 iIL(uA) 30 10 iIH(uA) 30 10
a)[0.75V] - Quantas portas 04 poder ligar sada de um 04 ? Justifique. b)[0.75V] - Qual o tempo de atraso mximo de um circuito composto pelo circuito f= (a + b) + c, usando as portas da alnea a) quando se aplica numa das entradas uma onda quadrada perfeita (sinal que varia de 0101... com tempos iguais a 0 e 1)? Qual a frequncia mxima de funcionamento do circuito? Justifique desenhando um diagrama temporal de auxlio. Nota: f = 1/T em que T = tempo de atraso mximo. Indique os valores com as unidades correctas. 2[0.75V] Explique se se podem ligar as sadas de duas portas OC ao mesmo ponto.
Grupo V Circuitos especiais OU aritmtica binria Responda apenas questo 1 ou 2. 1 Para o seguinte circuito (ignore os tempos de atraso):
X 1 W X Y W 1 K K
a) [1V] Complete o Diagrama Temporal. b) [0,5V] Qual a utilidade de tal circuito ? 2 a) [0,5V] Codifique em binrio o seguinte nmero decimal: 123,125 b) [1V] - Multiplique em hexadecimal (passao a passo) 1243h * 3421h
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Sistemas Digitais
Grupo VI Flip-Flops, registos e contadores 1[0.75V] Desenhe o seguinte contador usando FF escolha.
10
01
00
11
2[1.5V] Para o registo de deslocamento direita seguinte, e aps _Reset, indique as respectivas sequncias de contagem at se repetirem. _Reset
Q1 Q2 Q3 Q4
=1
Grupo VII Circuitos Sequnciais sncronos 1[2V] Desenhe um diagrama de estados de uma mquina sequncial sncrona com uma entrada (Z) e uma sada (K) que detecte a sequncia na entrada 010 nos ltimos 3 bits. Ex: Z : 0 1 0 1 0 0 0 1 0 0 1 0 1 0 1 0 1 0 1 0 0 0 1 0 1 0 1 0 1 0 1 0 1 0 0 0 0 0... K: 0 0 1 0 1 0 0 0 1 0 0 1 0 1 0 1 0 1 0 1 0 0 0 1 0 1 0 1 0 1 0 1 0 1 0 0 0 0 2[2V] Desenhe o diagrama de estados do seguinte circuito sequncial sncrono: __ __ __ __ D0 = Q1 . Z D1 = Q0 . Q1 . Z K = Q0 . Q1 3[2V] Desenhe o logigrama correspondente ao diagrama de estados seguinte. Utilize os FF que achar conveniente de modo a simplificar o circuito. _Reset
0/0 A 0/1 1/1 FIM C 1/0 1/1 B 0/1
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