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Eap Final Caetano
Eap Final Caetano
JOINVILLE
2022
CAETANO PERUCHI DE PELLEGRIN
JOINVILLE
2022
SUMÁRIO
1 INTRODUÇÃO . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3
1.1 JUSTIFICATIVA . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3
1.2 OBJETIVOS . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3
1.2.1 Objetivo geral . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3
1.2.2 Objetivos específicos . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3
2 FUNDAMENTAÇÃO TEÓRICA . . . . . . . . . . . . . . . . . . . . . . 4
2.1 CIRCUITO INTEGRADO CD 4046 . . . . . . . . . . . . . . . . . . . . . 4
2.1.1 VCO - Voltage-Controlled Oscillator . . . . . . . . . . . . . . . . . . . . 4
2.1.2 Comparador de Fase . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5
3 DESENVOLVIMENTO EXPERIMENTAL . . . . . . . . . . . . . . . . 7
4 CONCLUSÃO . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 10
REFERÊNCIAS . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 11
3
1 INTRODUÇÃO
1.1 JUSTIFICATIVA
1.2 OBJETIVOS
2 FUNDAMENTAÇÃO TEÓRICA
O circuito integrado CD4046 é um controlador PLL que habilita um sinal de saída com
fase igual a do sinal de entrada. O CI é composto por 16 pinos com as conexões e componentes
internos apresentados na Figura 1.
Este CI pode ser melhor analisado se observado como composto dois subcircuitos: circuito
VCO e circuito de comparação. Um subcircuito externo, tomado como um filtro passa-baixas,
também pode ser estudado com os dois anteriores, uma vez que juntos compõe o sistema básico
do PLL, tal qual apresentado na Figura 2
Além disso, os pinos não associados diretamente a esses subcircuitos exercem funções
gerais de ajuste e proteção do 4046.
O pino 16 (VDD) é o pino de alimentação do circuito, o qual suporta de -0,5 a +18 de
tensão contínua, enquanto que o pino 8 (VSS) é considerado a referência do circuito. Já o pino
15 (Zener) regula a tensão de alimentação do circuito, se for necessário.
responsável por promover uma oscilação cuja frequêcia será tomada como referência para os
circuitos comparadores.
Há oito pinos fundamentais que se associam ao circuito do VCO: pinos 4, 5, 6, 7, 9, 10,
11 e 12.
O pino 5 (Inhibit), quando em nível lógico alto, equivalente à metade da tensão de
alimentação, desabilita o VCO e dreno comum associado a este subcircuito para minimizar o
consumo de energia em standby
O pino 10 (Demodulador)
O pino 4 (VCO Out) é a saída do subcircuito, com sinal oscilante cuja frequência é
determinada a partir da tensão de entrada aplicada pino 9 (VCO In). Entre pinos 6 e 7 (C1A e
C1B) é conectado um capacitor, enquanto que nos pinos 11 e 12 (R1 e R2) são conectados dois
resistores ao pino VSS.
A resistência de R1 é o parâmetro principal a definir a frequência central do oscilador,
enquanto R2 define a frequência de Offset, optativa aos circuitos. A capacitância de C1 se
relaciona às resistências segundo os gráficos apresentados na Figura ?? e Figura ??
Esse comparador de fase opera com o princípio que a média do sinal de saída é proporci-
onal ao deslocameno de fases entre as duas entradas, ou seja, um sinal de pulso será liberado no
intervalo de atraso entre os sinais de subida e de descida das ondas de entrada. Para o CD4046 as
entradas são os pinos 3 (Comparator In) e 14 (Signal In). O sinal de saída, também denominado
como sinal de erro, desse comparador é o pino 2 (Phase Comp I Out).
A tensão média de saída pode ser obtida a partir da Equação 1, a qual associa o período
do pulso de saída com o valor de tensão em nível lógico alto mostrado na Figura 5
Ton
Vmd = ∗Vc.mx (1)
T
7
3 DESENVOLVIMENTO EXPERIMENTAL
Quando o valor dessa resistência é aumentado, tal qual na Figura 7, denota-se uma
diminiução na frequêcia, a qual aproxima-se da faixa de 10−3 Hz conforme o gráfico mostrado
na Figura 3.
8
4 CONCLUSÃO
REFERÊNCIAS