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de Souza-Santos Menezes DRE: 019045927 Victor da Costa Moura Email: filipebarretto@poli.ufrj.br Gustavo Figueiredo Gontijo DRE: 109106634 Email: guga_gon@poli.ufrj.br Preparatrio Objetivo: Projeto de Circuitos Lgicos Sequenciais: flip-flops tipo JK, D, T e SR, contadores sncronos e assncronos. Referncias: Circuitos Digitais e Microprocessadores, Herbert Taub Eletrnica Digital Princpios e Aplicaes, Malvino/Leach Resumo Terico: A sada de um circuito lgico combinacional depende somente dos valores da entrada a cada instante. Nos circuitos sequenciais, a sada depende das entradas, assim como de situaes passadas, a cada instante. Os circuitos sequenciais so estruturas com memria e as unidades bsicas de memria so flip-flops. Os tipos de flip-flops mais usados so JK, D, T e SR, cujas tablas de operao so mostradas a seguir. J 0 0 1 1 K 0 1 0 1 Q+ Q 0 1 Q D 0 1 Q+ 0 1 T 0 1 Q+ Q Q S 0 0 1 1 R 0 1 0 1 Q+ Q 0 1 indefinido
3.2 Contador assncrono crescente de mdulo 16 (0 a 15) que apresente um terminal de RESET para permitir zerar o contador quando necessrio, utilizando o CI 7476 (dual flip-flop JK mestre-escravo). Tabela Verdade Pulso 0 1 2 3 4 5 6 7 8 9 10 11 12 13 14 15 Q3 0 0 0 0 0 0 0 0 1 1 1 1 1 1 1 1 Q2 0 0 0 0 1 1 1 1 0 0 0 0 1 1 1 1 Q1 0 0 1 1 0 0 1 1 0 0 1 1 0 0 1 1 Q0 0 1 0 1 0 1 0 1 0 1 0 1 0 1 0 1 R 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 1
Circuito
DISP1 Q3 Q2 Q1 Q0
4321
CK 0V
U1 74LS76
__ Q1 Q1 __ Q2 Q2
U2 74LS76
__ Q1 Q1 __ Q2 Q2
5V SET
5V RESET
V +V 5V
3.3 A partir do contador assncrono do item 3.2 programe-o, atravs da adio de lgica combinacional simples, para que o mesmo seja transformado em um contador assncrono crescente (contagem de 0 a 3) e adicionar lgica que permita o acionamento do RESET manualmente. Tabela Verdade Pulso 0 1 2 3 4 5 6 7 8 9 10 11 12 13 14 15 Q3 0 0 0 0 0 0 0 0 1 1 1 1 1 1 1 1 Q2 0 0 0 0 1 1 1 1 0 0 0 0 1 1 1 1 Q1 0 0 1 1 0 0 1 1 0 0 1 1 0 0 1 1 Q0 0 1 0 1 0 1 0 1 0 1 0 1 0 1 0 1 R 1 1 1 1 0 x x x x x x x x x x x
Mapa de Karnaugh 1 0 x x 1 x x x 1 x x x 1 x x x
Circuito
DISP1 Q3 Q2 Q1 Q0
4321
CK 0V
U1 74LS76
J1 K1 CP1 SD1 RD1 J2 K2 CP2 SD2 RD2
__ Q1 Q1
U2 74LS76
J1 K1 CP1 SD1 RD1 J2 K2 CP2 SD2 RD2
__ Q1 Q1
__ Q2 Q2
__ Q2 Q2
5V SET
V +V 5V
5V RESET
3.4 Contador sncrono de 8 estados que gera a sequncia 0-2-3-4-6-0. O estado seguinte de todos os estados no constantes da sequncia o zero. Tabela Verdade J2 K2 J1 0 x 1 0 x 0 0 x x
Pulso 0 1 2
Q2 0 0 0
Q1 0 0 1
Q0 0 1 0
K1 x x 0
J0 0 x 1
K0 x 1 x
3 4 5 6 7
0 1 1 1 1
1 0 0 1 1
1 0 1 0 1
1 x x x x
x 0 1 1 1
x 1 0 x x
1 x x 1 1
x 0 x 0 x
1 x 1 x 1
Mapa de Karnaugh
0 x x 1 0 x x 0
x 1 1 x x 1 1 x
1 0 x x 1 0 x x
x x 1 0 x x 1 1
0 0 1 0 x x x x
x x x x 0 1 1 1
( )
Circuito
J2
K2
K1
J0
Q2
Q1
Q0
KB
V1 5V +V
U1 74LS76
__ Q1 Q1 __ Q2 Q2
U2 74LS76
__ Q1 Q1 __ Q2 Q2
CK 0V
5V SET
5V RESET
Concluso Atravs dessa aula prtica, aprendemos a utilizar circuitos sequenciais, alm do set e do reset.