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CIRCUITOS COMBINACIONAIS
CIRCUITO COMBINACIONAL
decodificadores e aritméticos.
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CIRCUITOS ARITMÉTICOS
MEIO SOMADOR
Somas:
Ts
Somas: 6 + 7 decimal em binário com 4 bits.
Ts
Ts
MSB LSB
2
O meio somador binário é um bloco digital referente a soma de 1 bit (LSB).
EXERCÍCIO TUTORIADO
A B S Ts
SOMADOR COMPLETO
3
O somador completo binário é um bloco digital referente a soma de 1 bit utilizado nos
demais bits além do LSB que necessita de um “vem um” (TE) adicional.
A B TE S Ts
4
SOMADOR COMPLETO PARALELO DE 4 BITS
5
SUBTRAÇÃO EM BINÁRIOS
MEIO SUBTRATOR
6
A B S TS
SUBTRATOR COMPLETO
0-0-0=0
0 - 1 - 0 = 1 e empresta um do bit superior (TS)
1-1-0=0
1 - 0 - 1 = 0, considera o vem 1 do bit inferior (TE)
1 - 1 - 1 = 1, considera o vem 1 do bit inferior (TE) e empresa 1 do bit superior (TS)
Exemplo de subtração:
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Bloco Funcional – Subtrator Completo de 1 bit
A B TE S TS
8
SUBTRATOR COMPLETO PARALELO DE 4 BITS
SUBTRATOR EM COMPLETO DE 2
Exemplo: 11 – 4 em decimal
11 = 10112
4 = 01002
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soma em complemento de 2
1 0 1 1 1 0 1 1
-1 0 1 1 + + 1 1 0 0
0 1 0 0 1 0 1 1
C1 C2 1 0 1 1 1
overflow
complemento de 2 (C2)
0 1 0 0 1 0 1 1
+ 1
1 1 0 0
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1. Unidade de Controle (UC) recebe uma instrução da memória especificando que
um número armazenado em uma posição de memória (endereço) deve ser
adicionado ao número armazenado no Acumulador.
2. Número a ser adicionado é transferido da memória para o registrador B.
3. Número no registrador B e no Acumulador são somados através dos circuitos
lógicos (somador) ao comando da UC. O resultado é armazenado no Acumulador.
4. O novo número pode permanecer no Acumulador para ser somado a outro
número, ou então, o processo aritmético é terminado e o resultado pode ser
transferido para a memória.
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0
PROPAGAÇÃO DE CARRY
A adição dos bits LSB produzem um carry até o bit MSB, no qual o bit da última posição
depende da soma do primeiro bit.
O bit MSB não atingirá seu valor correto até que ocorra toda a propagação pelos
somadores intermediários.
Se cada somador possui um tempo de atraso de 40 ns, o MSB atingirá o valor correto
somente após 120 ns e a soma terá o valor correto somente após 160 ns.
Este atraso acaba sendo proporcional ao número de bits, por exemplo, para 32 bits
haveria um atraso de carry de 1280 ns = 1,28 μs.
Este atraso é proibitivo para computadores de alta velocidade, sendo necessárias
técnicas como carry antecipado que observa os bits LSB para verificar se um carry de
mais alta ordem deve ser gerado.
Este esquema de detecção adiciona um maior número de circuitos lógicos.
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SOMADORES PARALELOS COM CI COMERCIAL
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Somador paralelo de 8 bits a partir de dois somadores paralelos de 4 bits 74HC283
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Somador paralelo de 4 bits
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Somador/Subtrator paralelo em complemento de 2 – 74LS283
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CI ARITMETIC LOGIC UNIT (ALU) 74LS382/74HC382 (TTL)
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CI ALU 74HC382 como somador de 8 bits
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CI ALU 54/74LS181
ENCAPSULAMENTO
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EXERCÍCIOS EXTRA-CLASSE
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