Circuitos Digitais - 4452B-04

Experiência 7
Decodificadores / Multiplexadores

Data da Entrega:
Entrega Deadline
17/10 21/10

Objeto do Estudo:
1. VHDL
2. VHDL – Descrição Comportamental;
3. Circuitos Lógicos Combinacionais;
4. Decodificadores;
5. Multiplexadores;
6. Display de 7-Segmentos.

Especificação:
Projete, em VHDL, um circuito lógico decodificador que apresente em um único display
de 7-segmentos (selecionável) um caractere das quatro palavras dadas na Tabela 1:

Letra
00 01 10 11
00    
   
Palavra

01

10    
11    
Display 3 2 1 0
Tabela 1 – Tabela Verdade de Referência.
A entidade deste circuito lógico combinacional deverá ser obrigatoriamente nomeada
como “palavra_letra”. A arquitetura deverá ser nomeada com os nomes dos autores do circuioto,
por exemplo, “fulado_beltrano”.

Os nomes das portas de entrada e saída (pinout) descritas na entidade “palavra_letra”

deverão seguir os nomes, sentidos e tipos de dados apresentados na Tabela 2.

Nome Sentido Tipo Descrição

palavra in std_logic_vector(1 downto 0) Entrada para seleção da palavra.
letra in std_logic_vector(1 downto 0) Entrada para seleção da letra.
display out std_logic_vector(6 downto 0) Barramento de dados dos displays.
display_en out std_logic_vector(3 downto 0) Barramento de controle dos displays.
Tabela 2 – Portas da Entidade.

O projeto dos circuitos lógicos decodificadores, para a seleção do caractere a ser

apresentado no display de 7 segmentos, deverá utilizar duas chaves ou botões para a seleção
da letra (letra) a ser apresentada no display de 7 segmentos.

O projeto do circuito lógico multiplexador, para seleção da palavra a ser apresentado no

display de 7 segmentos, deverá utilizar duas chaves ou botões para a seleção da palavra
(palavra) a ser apresentada display de 7-segmentos;

Prof. Marlon Moraes, Msc 1/2

marlon.moraes@pucrs.br
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O projeto do decodificador, para a seleção e acionamento do display na respectiva

posição da letra deverá também considerar o estado lógico das portas relativas a entrada
nomeada como “letra”.

Critérios de Avaliação:

A Avaliação desta experiência seguirá os critérios indicados abaixo:

1. Desenvolvimento / Funcionamento / Apresentação (50%):

o Decodificador – Caracteres;
o Decodificador – Seleção do Display;
o Multiplexadores;
2. Código / Relatório (50%):
o Codificação;
o Estruturas Lógicas;
o Comentários;

Código / Relatório:
O código VHDL (*.vhd) contendo as informações sobre o desenvolvimento dos itens
anteriores deverá ser postado na Área Moodle da disciplina até a data de entrega.

Prof. Marlon Moraes, Msc 2/2

marlon.moraes@pucrs.br