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ExtraCompilado-O C
ExtraCompilado-O C
A) Registradores de memórias.
A) Quarta geração
B) Quinta geração
C) Primeira geração
D) Terceira geração
E) Segunda geração
QUESTÃO: Um hazard ou bolha de pipeline pode ser definido como um evento onde a
próxima instrução de pipeline não poderá ser executada no ciclo de clock seguinte,
ocasionando um atraso (bolha) na execução geral dos processos. Isso ocorre devido a alguma
parte dele precisar parar de executar sua tarefa original e ter que atender algum desvio, como
uma interrupção, por exemplo. Os hazards de pipeline são subdivididos em categorias, como
hazards de dados, hazards de recursos e hazards de controle. Em se tratando
especificamente dos hazards de controle, assinale a alternativa que está correta em
afirmar que:
A) Ocorrem quando duas ou mais instruções que estão no pipeline necessitam do mesmo
recurso, resultando que as instruções precisarão ser executadas em série em vez de paralelo.
B) Ocorrem quando duas instruções escrevem dados ou instruções na mesma posição
(memória ou registrador).
C) Ocorrem quando o pipeline toma uma decisão errada ao prever algum tipo de
desvio, trazendo instruções para dentro do pipeline, que precisarão ser descartadas na
sequência.
D) Ocorrem quando uma instrução lê o conteúdo de um registrador ou posição da
memória e uma instrução subsequente é escrita nessa posição.
E) Ocorrem quando uma instrução modifica o conteúdo de um registrador ou de uma
posição da memória principal, de modo que uma instrução subsequente lê os dados dessa
posição.
A) 30%
B) 50%
C) 60%
D) 80%
E) 90%
QUESTÃO: A execução de uma instrução geralmente envolve um ou mais operandos lidos
da memória e, se algum outro endereçamento for utilizado, então acessos adicionais à
memória serão necessários. Nessas situações, um tipo diferente de endereço será
considerado como um estágio a mais no ciclo de instrução. Esse endereço adicional do ciclo
de instrução está presente em qual modelo de ciclo?
A) Divisão de tempo de duração de cada lacuna entre estágios inicial e final do pipeline.
B) Duração do ciclo de clock.
C) Latência dos latches (registradores encarregados de armazenar dados temporários).
D) Homogeneidade na divisão de tarefas entre os estágios do pipeline.
E) Número de estágios do pipeline.
1. Registrador de segmento de código (code segment – CS): usado para apontar para uma
área de memória que contém o código do programa que está sendo executado.
2. Registrador de segmento de dados (data segment – DS): usado para apontar para um
segmento de memória que será utilizada no armazenamento de dados do programa em
execução.
3. Registrador de segmento de pilha (stack segment – SS): utilizado na identificação do
segmento que será utilizado como pilha (stack), com o objetivo de armazenar os dados
temporários do programa em execução.
4. Registrador de segmento extra de dados (extra segment – ES): utilizado para determinar
um segmento extra de dados, como no armazenamento e acesso da memória de vídeo.
B) Movimentação de dados.
C) Armazenamento de dados.
D) Controle.
E) Processamento de dados.
B) Resistores.
C) Flip-flops.
D) Relés.
E) Indutores.
QUESTÃO: A máquina de von Neumann, também conhecida como computador IAS que se
refere ao departamento de pesquisa onde foi criada, foi intelectualmente desenvolvida pelo
matemático húngaro John von Neumann em meados de 1952. O objetivo da criação desse
computador foi o de melhorar o desempenho do computador ENIAC, cujo funcionamento
possuía algumas lacunas, como o fato de ser uma máquina que operava em base decimal
(base 10) ao invés de utilizar a base binária (base 2) aceita mundialmente nos dispositivos
eletrônicos digitais atuais. Além dessa melhoria, assinale a alternativa que contém outra
melhoria fundamental, introduzida na máquina de von Neumann.
QUESTÃO: As memórias somente de leitura (ROM - read only memory) são fabricadas a
partir de materiais semicondutores (silício) e são não voláteis, ou seja, não perdem seus
dados/instruções ao serem desligadas. As memorias ROM possuem desempenho semelhante
aos das memorias de leitura/escrita e são seguras permitindo apenas a leitura de seu
conteúdo através de determinados programas. O tipo mais básico de memória ROM e a
programada por mascara, nome dado devido ao processo de fabricação e escrita de bits nesse
modelo. Os bits que fazem parte do programa de usuário são gravados no interior dos
elementos da memória durante o processo de fabricação, conhecido como hardwired, em que
cada um já é gravado no endereço de célula correspondente. Assinale a alternativa que
determina uma das principais características da memória do tipo ROM.
A) Após a fabricação, a ROM estará pronta para ser utilizada e nenhum tipo de
software será capaz de modificar os bits nela gravados.
B) Após a fabricação, a ROM não fica pronta para ser utilizada e nenhum tipo de software
será capaz de modificar os bits nela gravados.
C) Após a fabricação, a ROM estará pronta para ser utilizada e qualquer tipo de software
será capaz de modificar os bits nela gravados.
D) Após a fabricação, a ROM não estará pronta, mas qualquer tipo de software será capaz
de gravar novos dados.
E) Após a fabricação, a ROM estará pronta para ser utilizada e somente algum tipo de
software específico do usuário será capaz de modificar os bits nela gravados.
Comentário: ROM programada por máscara é o tipo mais básico de memória ROM é a
programada por máscara, nome dado devido ao processo de fabricação e escrita de bits nesse
modelo. Os bits que fazem parte do programa de usuário são gravados no interior dos
elementos da memória durante o processo de fabricação, conhecido como hardwired, onde
cada um já é gravado no endereço de célula correspondente (MONTEIRO, 2019). Após sua
fabricação, a pastilha ROM estará pronta para ser utilizada e nenhum tipo de software
será capaz de modificar os bits nela gravados
A) Possui a capacidade de enviar um grupo de bits de cada vez, em que cada bit é enviado por
uma linha separada de transmissão
B) A sincronização de RX é realizada e cada novo caractere transmitido, de modo que antes
de a transmissão ser iniciada, cada caractere será acrescido de dois pulsos, um no início
e outro no final do pulso.
C) Os bits enviados podem não chegar ao destino exatamente no mesmo instante no qual
foram programados para chegar.
D) Possuem diferenças de comprimento de cabos entre os canais de comunicação.
E) Os dados são transmitidos de uma só vez por blocos de caracteres, sem a necessidade de
intervalos entre eles e sem a necessidade de um pulso indicando o início ou o fim da
transmissão.
Comentário: Existem duas maneiras básicas para aumentar a largura de banda para
transmissão de dados no barramento:
1. Redução do tempo para realizar a transmissão de dados, o que implicaria mais
transferências por segundo.
Aumento da largura de dados, possibilitando mais bits em cada transferência
A) Acesso sequencial.
B) Acesso aleatório.
C) Acesso interpretativo.
D) Acesso associativo.
E) Acesso direto.
Comentário: Acesso associativo é uma variação do acesso aleatório, porém nesse tipo de
endereçamento uma palavra será recuperada da memória baseada em um pedaço de seu
conteúdo, em vez do seu endereço.
Acesso aleatório: nesse tipo de acesso à memória, cada local endereçável possuirá um
sistema de endereçamento exclusivo, que está fisicamente interligado.
Acesso sequencial: as memórias são organizadas em unidades chamadas registros. O acesso
em algumas memórias é realizado em uma sequência linear específica. Acesso direto: de
forma semelhante ao acesso sequencial, esse geralmente envolve um esquema compartilhado
para realizar a leitura/escrita. Nesse tipo de acesso, os registros individuais ou blocos de
registros possuem um endereço exclusivo em algum local físico da memória.
Comentário: Embora os barramentos PCI e PCIe sejam muito eficientes e rápidos para anexar
dispositivos de alto desempenho, eles são muito caros para ser empregados em dispositivos
de E/S, que operam a baixa velocidade. Para resolver pendências relacionadas ao
desempenho, em 1993 sete empresas de tecnologia (Compaq, DEC, IBM, Intel, Microsoft, NEC
e Northern Telecom) se juntaram para buscar uma solução de unificação para a anexação de
uma gama variada de dispositivos de E/S. O padrão resultante dessa pesquisa em conjunto foi
lançado em 1998 e ficou conhecido como USB (universal serial bus – barramento serial
universal).
QUESTÃO: Todo computador oferece algum mecanismo para que operações que envolvam
alguma comunicação com a memória, como o processador ou algum dispositivo de E/S,
possam ser interrompidas em algum momento de sua operação. Embora possa parecer ao
usuário comum que uma máquina trabalhe melhor sem ser interrompida, as interrupções na
verdade garantem uma operação otimizada do computador. As interrupções também podem
ser agrupadas em simples e múltiplas, de acordo com a quantidade em que aparecem durante
o ciclo de instruções. Em se tratando especificamente das interrupções múltiplas, qual tipo de
interrupção possui como característica permitir que uma interrupção de maior
prioridade possa ter um tratamento de interrupção distinto do tratamento de interrupção
de menor prioridade?
A) Interrupção aninhada.
B) Interrupção paralela.
C) Interrupção horizontal
D) Interrupção vertical.
E) Interrupção sequencial.
Comentário: Há pelo menos uma década o uso de chips com um único processador atingiu o
seu limite de desempenho e de execução de instruções em paralelo. Através do
desenvolvimento da arquitetura multicore foi possível explorar e melhorar o processamento
multithreading em vários núcleos do processador. Assim, fica claro que o uso de uma
arquitetura que oferece vários núcleos em vez de um único também aumentará o número de
níveis de memória cache, aumentando com isso o desempenho geral de processamento.
A) Preâmbulo.
B) Trilha.
C) Lacuna entre setores.
D) Lacuna entre trilhas.
E) Cilindro.
Comentário: Os setores possuem um campo inicial, que se inicia antes dos bytes destinados
para dados, e que é conhecido como preâmbulo. O preâmbulo contém elementos necessários
para sincronizar a cabeça antes de cada leitura/gravação.
B) RAID 5.
C) RAID 3.
D) RAID 1.
E) RAID 4.