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- (PLDs-Programmable Logic
1-Introduo
Existe uma grande variedade de CIs (por ex. famlia TTL 74XX) com diversas
funes lgicas e arranjos de circuitos lgicos em chips de diversos fabricantes. Porm,
h algumas desvantagens em empregar estes CIs em determinados circuitos:
Para reduzir o nmero de CIs a ser usado em um projeto, preciso alocar mais
funes lgicas dentro do chip. Isto feito com aplicaes das tecnologias LSI e VLSI
para funes padres da microeletrnica. Porm, h situaes de projeto que no
existem CIs LSI e VLSI que atendam os requisitos de projeto. A soluo apresentada
pelas indstrias de dispositivos foram os PLDs.
Um PLD- Programmable Logic Device (Dispositivo Lgico Programvel),
um circuito integrado com um grande nmero de portas lgicas, flip-flops, e
registradores que so interconectados no chip.
Vrias conexes de um PLD so elos fusveis, semelhantes aos encontrados em
PROMs, que podem ser queimados. Mostra-se na figura 1 a estrutura bsica usada
pelos PLDs: um arranjo de portas AND e um arranjo de portas OR, cujas entradas
podem ser interconectadas para produzir funes nas sadas das variveis de entrada.
O arranjo de portas AND de entrada seria o decodificador e o arranjo de portas
OR de sada o codificador. Os arranjos AND de entrada podem ser conectados s
variveis de entrada para formar os termos produtos necessrios. As funes de sada do
circuito so obtidas interligando os termos produtos de sada do arranjo AND s
entradas das portas do arranjo OR.
Fig.2-Simbologia simplificada
A Figura 6 mostra uma PROM de quatro entradas que so decodificadas pelo arranjo
AND, onde cada porta gera um dos dezesseis minternos das variveis de entrada. As
conexes das variveis de entrada ao arranjo AND so fixas, ou seja, no-programveis,
enquanto que as conexes das linhas de sada dos mintermos s portas OR so todas
programveis.
Fig.6 Arquitetura de uma PROM. -Fusveis so queimados para programar as funes de sada.
Tabela 1
ARRANJOS LGICOS
(a)
(b)
Fig 8- (a) Arquitetura tpica de um dispositivo PAL; (b) A mesma PAL programada.
EPM 7128S
EPM7064S
Portas disponveis
2500
1250
Macroclulas
128
64
LABs
68
100
84
...
de I/O disponveis
Total de pinos no chip
alto, permanecendo sempre habilitado (como entrada). A sada y est agora configurada
como a quarta entrada do PLA. Como as sadas w e x continuam a funcionar como
funes de sada, ento os elos fusveis de realimentao so queimados para assegurar
que no tero efeito nas entradas.
Reprogramveis
Volteis
Dispositivo
Tecnologia
Fusvel
No
No
PLAs
Bipolar
EPROM
Sim
No
FPGAs
UVCMOS
EEPROM
Sim
No
FPGAs
EECMOS
SRAM
Sim
Sim
FPGAs
CMOS
Anti-fusvel
No
No
FPGAs (Actel)
CMOS+
transistores EPROM;
transistores EEPROM;
5-Programao de PLDs
Os PLDs so programados e testados utilizando equipamentos que programam
atravs de programas especficos desenvolvidos para esta finalidade. Usando um
microcomputador, o usurio informa ao programador, as equaes lgicas que deseja
programar no PLD. O programa gera o mapa de queima dos fusveis e os dados de
testes e envia ao programador que realiza a programao. Mostra-se na figura 19, o
fluxograma tpico de programao e teste de um PLD.
Bibliografia
[1] TOCCI, R.J., Sistemas Digitiais, Princpios e Aplicaes.10 edio, Editora Pearson Prentice
Hall, 2007, 940p.