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Polarizao em circuitos amplificadores MOS Um passo essencial no projecto de um circuito amplificador MOSFET, passa pelo estabelecimento de um ponto de operao DC apropriado, para o transstor. Este passo conhecido por projecto de polarizao (bias). Um ponto de operao DC apropriado caracterizado por uma corrente de dreno DC (iD) estvel e previsvel e por uma tenso dreno-source DC (VDS) que assegure a operao na regio de saturao, para todos os nveis de sinais de entrada esperados. Polarizao usando um valor de VGS fixo. A forma mais simples de polarizao de um MOSFET, consiste em fixar a tenso gate-source num valor que proporcione a corrente desejada ID. Este valor de tenso pode ser obtido a partir da tenso da fonte de tenso VDD, usando um divisor de tenso apropriado. Em alternativa, VGS pode ser uma adequada tenso de referncia existente no sistema. Independentemente do modo como VGS gerado, este tipo de polarizao no a melhor.
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ID =
W 1 n C ox (VGS Vt ) 2 L 2
Tenso de limiar aspect ratio do transstor
Capacidade do xido
Estes parmetros variam fortemente entre dispositivos do mesmo tamanho e tipo. Alm disso, Vt e n dependem da temperatura. Assim, se fixarmos o valor de VGS, a corrente de dreno ID, torna-se bastante dependente da temperatura. Para reforar o facto de que uma tenso fixa de polarizao VGS no constitui uma boa tcnica, a Fig. 32, mostra duas curvas caractersticas (iD vGS), representando valores extremos para MOSFETs do mesmo tipo.
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Observa-se que para um valor fixo de VGS, a diferena na evoluo da corrente de dreno pode ser substancial.
Fig. 32
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VG = VGS + RS I D
(44)
Se VG muito maior de que VGS, ID ser essencialmente determinada pelos valores de VG e RS. Mesmo que VG no seja muito maior de VGS, a resistncia RS proporciona realimentao negativa, a qual actua como estabilizador da corrente de polarizao ID. Para perceber o funcionamento, considere-se a situao em que ID aumenta por qualquer razo. A equao (44), indica que nestas circunstncias, como VG constante, VGS ter de decrescer. Tal resulta num decrscimo em ID, variao esta oposta ao inicialmente assumido. RS actua de forma a manter ID o mais constante possvel. A esta aco de realimentao negativa de RS d-se o nome de resistncia de degenerao.
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Fig. 33 81
Comparativamente ao caso de VGS de valor fixo, neste caso a variao obtida em ID muito menor. Note-se que a variao decresce medida que VG e RS so incrementados.
Fig. 34
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Fig. 35
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Fig. 36
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RD =
VDD VD 15 10 = = 10k ID 0 .5
RS =
VS 5 = = 10k I D 0.5
O valor de VGS pode ser determinado, calculando previamente a tenso overdrive VOV usando,
1 ' 2 I D = k n (W / L) VOV 2
Assim,
1 2 0.5 = 1 VOV 2
VOV = 1 V
EXEMPLO 8 (cont.) Afim de estabelecer esta tenso na gate, pode-se seleccionar RG1 = 8 M e RG2 = 7 M. O circuito projectado mostrado na Fig. 37. Observe-se que a tenso DC no dreno (+10V) permite a excurso de um sinal positivo de +5V (i.e., at VDD) e de um sinal negativo de -4V (i.e. abaixo de (VG Vt)). Se o transstor NMOS substitudo por um outro tendo Vt = 1,5 V, o novo valor de ID pode ser determinado por,
1 I D = 1 ( VGS 1.5) 2 2
I D = 0.455 mA
Assim, a variao em ID :
VG = VGS + RS I D
7 = VGS + 10 I D
Fig. 37 i.e.
0.045 x100 = 9% 0.5
(variao) 87
A eq. (45) tem a mesma forma que a eq. (44). Se por qualquer razo ID aumentar, VGS tem de decrescer. O decrscimo em VGS, por sua vez, causa um decrscimo em ID, variao que oposta inicialmente assumida. Assim, a resistncia de realimentao, proporcionada por RG, funciona de modo a manter o valor de ID o mais constante possvel.
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Fig. 38
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I D1 =
1 ' W k n (VGS Vt ) 2 2 L 1
(46)
onde foi desprezado a modulao do comprimento do canal (i.e. = 0). A corrente de dreno de Q1 fornecida por VDD, atravs de R. Visto que as correntes de gate so zero,
I D1 = I REF =
(47)
Onde a corrente atravs de R, a corrente de referncia da fonte de corrente, designada por IREF. Dados os parmetros de Q1 e o valor desejado para IREF, as equaes (46) e (47) podem ser usadas para determinar o valor R.
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Fig. 40
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I = I D2 =
1 ' W k n (VGS Vt ) 2 2 L 2
(48)
onde foi desprezada a modulao do comprimento do canal (i.e. = 0). Equaes (47) e (48), permitem a obteno de uma relao entre a corrente I e a corrente IREF.
I = I REF
(W / L) 2 (W / L)1
(49)
Como se verifica, I relacionado com IREF pela relao dos aspect ratios de Q1 e Q2. Este circuito conhecido como espelho de corrente, sendo muito popular no projecto de amplificadores MOS.
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Exerccio 7 Dimensione o circuito da Fig. 41 de forma a que o transistor funcione na saturao com VD a 1 V da regio de trodo, com ID=1 mA e VD=3 V, para os seguintes dispositivos (considerar 10 A no divisor de tenso): a) V t = 1V , k ' p W / L = 0 ,5 mA / V 2
' 2 b) Vt = 2 V , k p W / L = 1, 25 mA / V
Fig. 41
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Como estudado anteriormente, a amplificao linear pode ser obtida polarizando o MOSFET de modo a que este funcione na regio de saturao. Considere-se, agora, a operao para pequenos sinais, com algum detalhe, usando para o efeito o circuito amplificador source comum, mostrado na Fig. 42. O transstor MOS polarizado aplicando uma tenso VGS. Claramente uma situao pouco prtica mas que simples e til. O sinal de entrada a amplificar (vgs), surge sobreposto tenso de polarizao VGS. A corrente de polarizao ID, pode ser determinada fixando o sinal vgs a zero. Assim, assumindo = 0
ID =
1 ' W k n (VGS Vt ) 2 2 L
(50)
VD = VDD RD I D
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(51)
Fig. 42
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VD > VGS Vt
Visto que a tenso total no dreno, ter a componente de sinal sobreposta a VD, esta tenso ter de ser suficientemente superior a (VGS Vt), afim de permitir que o sinal tenha a excurso desejada. A corrente de sinal no terminal de dreno. dreno Considere-se, agora, o sinal de entrada (vgs) aplicado. A tenso instantnea gate-source, ser:
vGS = VGS + v gs
Resulta uma corrente de dreno instantnea:
(52)
1 ' W kn 2 L 1 ' W iD = k n 2 L iD =
1 ' W (VGS Vt )v gs + k n 2 L
2 v gs
(53) 94
iD =
1 ' W kn 2 L
2 ' W (VGS Vt ) + k n L
1 ' W (VGS Vt )v gs + k n 2 L
2 v gs
O primeiro termo identifica a corrente DC de polarizao (ID). O segundo termo, representa a componente de corrente que directamente proporcional ao sinal de entrada (vgs). O terceiro termo, representa a componente de corrente que proporcional ao quadrado do sinal de entrada. Este ltimo termo indesejvel, pelo facto de representar distoro. Afim de reduzir a distoro, introduzida pelo MOSFET, o sinal de entrada deve ser mantido num baixo valor, tal que:
v gs << 2 (VGS Vt )
(54)
ou
v gs << 2 VOV
iD I D + id
(56)
com
' W id = k n (VGS Vt )v gs L
O parmetro que relaciona id com vgs, designado por transcondutncia do MOSFET gm:
gm =
ou
id ' W = kn v gs L
(VGS Vt )
(57)
' W g m = k n VOV L
(58)
A Fig. 43 representa uma interpretao grfica, para a operao de pequenos sinais do amplificador MOSFET. Note-se que gm igual inclinao da caracterstica iD vGS do ponto de polarizao,
gm =
iD vGS
(59)
vGS =VGS
Fig. 43
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vD = VDD RD iD
Assim, a componente de sinal da tenso de dreno : (60) Pelo que o ganho de tenso dado por Av (61) 97
Tal ilustrado na Fig. 44, que mostra vGS e vD. Admite-se que o sinal de entrada tem uma forma de onda triangular com uma amplitude muito menor do que 2(VGS Vt), que a condio de pequenos sinais da Eq. (54), para assegurar funcionamento linear. Para confinar o funcionamento regio de saturao para qualquer instante, o valor mnimo de vD no deve tornar-se inferior ao valor correspondente de vG por um valor superior a Vt. Alm disso, o valor mximo de vD deve ser menor do que VDD, de outro modo o FET entrar em corte e os picos da forma de onda do sinal de sada sero cortados. Fig. 44
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ro =
VA ID
(62)
em que VA = 1/ um parmetro do MOSFET que, ou especificado, ou pode ser medido. VA proporcional ao comprimento do canal do MOSFET. A corrente ID, a corrente de dreno DC (no considerando a modulao do comprimento do canal):
ID =
1 ' W 2 k n VOV 2 L
(63) 101
Av =
uma diminuio do valor do ganho de tenso.
(64)
Verifica-se, assim, que o efeito da resistncia de sada ro d origem a A anlise realizada para o transstor NMOS, os resultados e os modelos de circuito apresentados aplicam-se tambm a dispositivos PMOS, considerando para tal, |VGS|,|Vt|, |Vov|, |VA| e substituindo kn por kp
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Fig. 46
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gm =
(65)
Esta relao indica que gm proporcional ao parmetro de transcondutncia do processo kn =nCox e ao factor W/L do transstor MOS. Assim, para obter uma transcondutncia relativamente grande, o dispositivo deve ser curto e largo. Tambm se verifica que, para um dado transstor, a transcondutncia proporcional tenso overdrive VOV= VGS - Vt, (quantidade para a qual a tenso de repouso VGS excede a tenso limiar Vt). Note-se, contudo, que aumentar gm custa de aumentar VGS tem o inconveniente de reduzir a excurso permitida da tenso de sinal do dreno. Uma outra expresso til para gm pode ser obtida substituindo (VGS - Vt) na Eq. (65) por,
' 2 I D /(k n (W / L))
(eq. (50))
' g m = 2k n W / L I D
(66) 103
' g m = 2k n W / L I D
Para ter uma ideia da ordem de grandeza dos valores de gm dos MOSFETs, considere-se um transstor integrado funcionando com ID = 1 mA e tendo nCox = 120 A/V2. A Eq. (66) mostra que, para W/L = 1, gm=0,35 mA/V, enquanto que para um transstor para o qual W/L = 100 tem um gm = 3.5 mA/V. Uma outra expresso til para gm do MOSFET, pode ser obtida substituindo kn(W/L) na eq. (65) por 2ID/(VGS-Vt)2:
gm =
CONCLUSES:
2I D 2I = D VGS Vt VOV
(67)
Existem trs diferentes expresses para determinar gm. Existem trs parmetros de projecto: (W/L), VOV e ID. O projectista pode escolher que o MOSFET funcione com uma determinada tenso overdrive VOV e a uma corrente ID particular. A relao W/L pretendida, pode ento ser determinada e gm calculada.
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(1)
onde, por simplicidade, ignormos o efeito da modulao do comprimento do canal. Uma vez que a corrente da gate zero, no h queda de tenso em RG ;assim, VGS = VD, que substituda em (1) conduz a
(2)
(3) Resolvendo o sistema formado pelas equaes (2) e (3), vem: ID = 1,06 mA e VD = 4,4 V
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Fig. 48 A Fig. 48 mostra o esquema equivalente para pequenos sinais do amplificador, onde os condensadores de acoplamento foram substitudos por curto-circuitos e a fonte DC foi substituda por um curto-circuito . Uma vez que RG muito grande (10 M), a corrente atravs desta pode ser desprezada comparada com a da fonte gmvgs, o que nos permite escrever para a tenso de sada,
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Assim,
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vDS vGS Vt
VDS Av vi = VGS + vi Vt
4,4 3,3vi = 4,4 + vi 1,5
Resulta
vi = 0,35 V
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O novo n assim criado, designado por X, foi ligado ao terminal da gate G, na Fig. 49(c). Note-se que a corrente da gate no alterada, i.e., continua a ser zero e, portanto, tambm esta alterao no altera as caractersticas terminais. Note-se, agora, que temos uma fonte de corrente controlada gmvgs, ligada aos mesmos terminais da sua tenso de controlo vgs.
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Fig. 49 110
Podemos assim substituir esta fonte controlada por uma resistncia desde que esta resistncia conduza a mesma corrente da source (teorema da absoro da fonte). Teorema da absoro da fonte Admite-se que na anlise de um rede elctrica que temos uma fonte de corrente dependente Ix entre dois ns a e a, cuja diferena de potencial corresponde tenso de controlo da fonte, sendo Ix=gmVx (gm a condutncia). A fonte pode ser substituda por uma impedancia Zx=Vx/Ix=1/gm, como se mostra na figura, pois a corrente absorvida pela impedancia coincide com a corrente da fonte inicial que foi substituda.
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Finalmente, note-se que afim de distinguir o modelo da Fig. 46 do modelo equivalente T, o primeiro designado por modelo hbrido.
Fig. 50
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Exerccio 8 Considere o circuito da Fig. 42 onde temos: Vt=2 V, =0, kn(W/L)=1 mA/V2, VGS=4V, VDD=10V e RD=3,6 k. a) Determine ID e VD. b) Determine o valor de gm para o ponto de funcionamento. c) Calcule o valor do ganho de tenso. d) Se o MOSFET tiver =0,01V-1, determine r0 no ponto de funcionamento e calcule o ganho em tenso.
Exerccio 9 Para o circuito da Fig. 51 substitua o transstor pelo seu equivalente T. Obtenha as expresses para os ganhos de tenso vs/vi e vd/vi.
Fig. 51
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