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Grupo A3
Beatriz Alves Freire – 190056711
Bruno Henrique Silva de Jesus – 211055423
Célio Júnio de Freitas Eduardo
Abstract. The experiment aimed to present the practical concepts of using multiplexers, decoders,
and full adders, thereby enabling the construction of circuits where multiple inputs, along with
selectors, produce a single output - the multiplexer, thus saving logical gates. Alternatively, these
circuits allow for a few inputs to be distributed into multiple outputs - the decoder. Both circuits
either convert multiple inputs into a single output or receive a simpler input and distribute it into
something more complex with multiple outputs. However, the full adder circuit in this experiment
deviated from this concept, as its objective was to demonstrate how a 1-bit binary addition would
work. Nonetheless, it is equally important, as addition is a widely used and crucial operation,
performed billions and billions of times in a processor.
1. Introdução
1.1Objetivos
1.2Materiais
Quartus 2
Portas lógicas AND e OR
Kit FPGA DE2 ou DE2-70
2. Procedimentos e Resultados
Neste experimento foi solicitado a criação de um multiplexador de 8 canais de entrada, para isso
são utilizadas três canais de seleção, pois a relação entre os canais é de logn seleções para os canais
de entrada. A teoria sobre isso se encontra abaixo, como seu funcionamento e tabela verdade.
A B C D E F G H S0 S1 S2 Y
0 0 0 0 0 0 0 0 0 0 0 A
0 0 0 0 0 0 0 0 0 0 1 B
0 0 0 0 0 0 0 0 0 1 0 C
0 0 0 0 0 0 0 0 0 1 1 D
0 0 0 0 0 0 0 0 1 0 0 E
0 0 0 0 0 0 0 0 1 0 1 F
0 0 0 0 0 0 0 0 1 1 0 G
0 0 0 0 0 0 0 0 1 1 1 H
Como podemos verificar acima, as entrada de A a H não influenciam na saída, somente os valores
dos bits de seleção, que acabam por liberar a saída do que estiver naquele canal. O circuito inteiro
poderia ser implementado assim a partir de portas lógicas.
Foi usada uma entrada sempre em enable, que é usada para ativar o multiplexador, não precisa
necessariamente dela mas, caso esse circuito receba entradas que podem ser compartilhadas entre
outro parte do circuito, pode ser importante ter uma entrada que possibilite essa ativação do
multiplexador somente quando necessário. As entradas de seleção se localizam na parte de baixo e
os bits de entrada do lado esquerdo, foram usadas portas ANDS de 5 entradas (considerando o bit
enable) e uma porta OR de 8 entradas, que direciona a saída da porta AND para a saída.
As saída seguem as regras citadas acima, respeitando-se o que está nessa tabela de valores.
Infelizmente não foi possível realizar o teste na placa FPGA por dificuldades técnicas na
implementação do circuito lógico durante o tempo despendido com o projeto, sendo assim só foram
feitas as simulações funcionais e temporais do circuito, que se encontra abaixo.
As imagens acima correspondem a simulação funcional e temporal do circuito.
A última parte desse projeto serviu para demonstrar o funcionamento de um circuito lógico a partir
de uma dada função, qual seja, essa aqui descrita abaixo.
𝑓(𝐴,𝐵,𝐶,𝐷,𝐸,𝐹,𝐺)=𝐹.𝐺+𝐴.𝐵.𝐶.𝐷.~𝐸.~𝐹.𝐺+~𝐴.~𝐵.~𝐶.~𝐷.~𝐸.~𝐹.𝐺+𝐴.~𝐵.𝐶.𝐸.𝐹.~𝐺+
~𝐴.𝐵.𝐶.𝐷.~𝐸.𝐹.~𝐺+𝐴.𝐵.𝐶.𝐷.𝐸.~𝐹.~𝐺+𝐴.~𝐵.~𝐶.𝐷.𝐸.~𝐹.𝐺
O circuito utilizado foi este abaixo, usamos a descrição comportamental para fazer a
implementação.
O circuito foi implementado considerando-se o MUX como definidor dos mintermos e depois
passando para o decodificador, ao final usase-se um conjuntos de ANDs e ORs para se chegar ao
circuito final a partir dos termos que saem do decodificador.
Conclusões
Foi um dos experimentos que deu mais trabalho para fazer, a implementação dessas funções foi
difícil, senti como se tivesse muitos erros em cada parte da implementação, e mesmo a troca para
o comportamental não diminuiu a dificuldades do projeto. A assimilação do conteúdo se deu de
forma não ideal, já que faltou os testes na placa e mesmo agora acredito que a série de erros não
iria diminuir, sendo um fator que precisa ser melhorado para os próximos experimentos. O tempo
dedicado para assimilar a nova linguagem também foi um problema, trabalhar com o bus se
mostrou problemático demais, houve várias coisas que foram realmente problemáticas de se
implementar, o relatório também está incompleto, isso reforça o tanto que isso deu trabalho para o
grupo. Acredito que tenhamos que melhorar bastante em relação a isso.
Referências