ISEL – INSTITUTO SUPERIOR DE ENGENHARIA DE LISBOA

ADEETC - ÁREA DEPARTAMENTAL DE ENGENHARIA DE

ELETRÓNICA E TELECOMUNICAÇÕES E COMPUTADORES

LEETC
Licenciatura em Engenharia Eletrónica,Telecomunicações
Computadores

SEAD – Sistemas Eletrónicos Analógicos e Digitais

Conversores A/D e D/A

Grupo 4

André Moreira (47125)

Francisco Silva (47079)

Marco Pinto (47091)

Orientador

Professor Doutor José Rocha

Professor Doutor Vítor Costa

junho, 2022
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Conversores A/D e D/A
Índice
Índice .................................................................................................................3
Lista de Figura..................................................................................................4
Lista de Tabelas ................................................................................................4
Introdução .........................................................................................................6
1. Conversor Digital/Analógico .......................................................................7
1.1. Contador Binário ...................................................................................7
1.2. Bloco visualizador de LEDS...................................................................9
1.3. Conversor Digital para Analógico .......................................................10
1.3.1. Característica Estática do DAC ..................................................11
1.3.2. 𝑽𝑳𝑺𝑩 ..............................................................................................14
1.3.3. Anulação de uma entrada............................................................14
1.3.4. Tensão de Saída de deslocamento ...............................................14
1.4. Simulação do DAC com o contador ....................................................15
1.4.1. Característica estática do DAC por simulação..........................15
1.4.2. 𝑽𝑳𝑺𝑩 por simulação ....................................................................15
1.4.3. Anulação de uma entrada por simulação ..................................16
1.4.4. Tensão de deslocamento da saída por simulação ......................16
2. Conversor Analógico/Digital (ADC) .........................................................17
2.1. Conversor de Seguimento ....................................................................17
2.2. Verificação de Funcionamento do ADC .............................................17
2.2. Simulação do ADC ................................................................................18
3. Realização experimental do DAC .............................................................19
3.1. Montagem do contador e do bloco visualizador ................................19
3.2. Montagem do DAC ...............................................................................19
3.2.1. Compensação da tensão de desvio de saída do primeiro andar
através de 𝑹𝒑 ...............................................................................19
3.2.2. Análise do Erro de Fim-De-Escala. ............................................19
3.2.3. Traçado da característica estática do DAC ...............................20
3.2.4. Cálculo da DNL /INL ...................................................................21
4. Realização experimental do ADC .............................................................21
4.1. Montagem do ADC ...............................................................................21
4.2. Verificação de Funcionamento do ADC ............................................22
4.2.1. Ajuste do valor de 𝜶 .....................................................................22
4.2.2. Sinal quadrangular ......................................................................23
4.2.3. Sinais sinusoidal e triangular .....................................................23
5. Conclusão ....................................................................................................24
Anexo ...............................................................................................................25

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Conversores A/D e D/A
Lista de Figura
Figura 1 - Contador e conversor Digital/Analógico de 4 bit. ...........................................7
Figura 2 - Pinos do contador..............................................................................................8
Figura 3 - Circuito auxiliar para visualização do estado da saída do contador .................9
Figura 4 - Tensão para cada nível lógico.........................................................................12
Figura 5 - 𝑣𝑐𝑜𝑟 ................................................................................................................12
Figura 6 - 𝑣𝑐𝑜𝑟 em função de α.......................................................................................13
Figura 7 - Tensão em Vo com anulação da entrada Qb...................................................14
Figura 8 - Tensão para cada nível lógico simulado .........................................................15
Figura 9 - Tensão em Vo com anulação da entrada Qb por simulação ...........................16
Figura 10 - Sinal de Saída com offset..............................................................................16
Figura 11 - Diagrama de blocos do conversor A/D de seguimento.................................17
Figura 12 - sinais á saída do ADC ...................................................................................18
Figura 15 - sinal à saída do ADC para onda sinusoidal...................................................18
Figura 15 - sinal à saída do ADC para onda quadrangular ..............................................18
Figura 15- sinal à saída do ADC para onda triangular ....................................................18
Figura 16 - Bloco Visualizador de Leds ..........................................................................19
Figura 17 – Característica estática do DAC obtida experimentalmente após correção dos
erros de offset e de ganho ................................................................................................20
Figura 18 - Característica estática do DAC .....................................................................21
Figura 19 - Malha limitadora do ADC ............................................................................22
Figura 20 - Sinais 𝑣𝑎 e 𝑣𝑜 com 𝑣𝑎 um sinal quadrangular .............................................23
Figura 22 - Sinais 𝑣𝑎 e 𝑣𝑜 com 𝑣𝑎 um sinal triangular ..................................................23
Figura 21 - Sinais 𝑣𝑎 e 𝑣𝑜 com 𝑣𝑎 um sinal sinusoidal..................................................23

Lista de Tabelas
Tabela 1 - Descrição dos Pinos do contador......................................................................8
Tabela 2 - Valores dos componentes do circuito auxiliar para visualização do estado de
saída do contador .............................................................................................................10
Tabela 3 - Valores das resistências dimensionadas para o DAC .....................................11
Tabela 4 - Valor de cada bit para as 16 combinações .....................................................20
Tabela 5- DNL e INL ......................................................................................................21
Tabela 6 - Valores de tensão e corrente da malha limitadora ..........................................22

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Introdução
No presente trabalho iremos estudar iremos estudar um conversor digital -
Analógico (DAC) e um conversor Analógico – Digital (ADC).
Um conversor digital analógico é um conversor que permite converter uma
palavra digital em um sinal analógico, enquanto um conversor analógico – digital,
converte um sinal analógico em uma palavra digital.
O trabalho encontra-se dividido em quatro partes, sendo que na primeira iremos
dimensionar e analisar diversas características do DAC, já na segunda parte iremos
estudar o ADC. Por fim, no terceira e quarto capítulo, comprovaremos os resultados
obtidos teoricamente e por simulação para o DAC e ADC respetivamente.

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1. Conversor Digital/Analógico
No presente capítulo iremos estudar o circuito da figura 1, fazendo o
dimensionamento dos seus componentes e estudando diversas características recorrendo
á ferramenta de simulação LTSpice.
Este circuito é composto por um conjunto de componentes que forma um
conversor Digital-Analógico (DAC) a 4 bits.

1.1. Contador Binário

O modelo do contador a utilizar como gerador da palavra binária de entrada será
o integrado 4029, alimentado a 0 e 𝑉 , com 𝑉 = 5 V sendo o modelo do ampop o
TL082.

Figura 1 - Contador e conversor Digital/Analógico de 4 bit.

A tabela 1 descreve a funcionalidade de todos o pino do contador 4029CP. É de

salientar que tabela não dispensa a consulta da informação providenciada pelo
fabricante referente ao integrado em causa.

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 Figura 2 - Pinos do contador

Tabela 1 - Descrição dos Pinos do contador

Para que a contagem seja feita em binário natural, o pino 9 encontra-se ligado a
𝑉 .
Em relação às tensões de alimentação, o pino 16 estará ligado a 𝑉 , quanto que
o pino 8 estará ligado a Groud. O pino 15 (CLOKC) estará ligado a uma onda quadrada,
que varia entre os 0V e os 5V.

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1.2. Bloco visualizador de LEDS

As resistências 𝑅𝐵 e 𝑅𝐶 presentes na figura 3 serão dimensionadas de forma que

a corrente no LED seja de 12.09 [mA] e que a corrente de saturação na base seja de 0.303
mA.

∑ 𝑛
𝐼 = = 12.09 𝑚𝐴
1000 × 𝑀

𝐼
𝐼 ≥ 10 = 0.302 𝑚𝐴, 𝑜𝑛𝑑𝑒 𝛽 = 400
𝛽

Figura 3 - Circuito auxiliar para visualização do estado da saída do contador

Assim,

𝑉 − 𝑉
𝑅 = = 14 𝑘Ω
𝐼

𝑉 −𝑅 𝐼 −𝑉 −𝑉 = 0 ⇔ 𝑅 = 268 Ω

A tabela 2 apresenta os valores das correntes do circuito visualizador a LEDs,

bem como os valores das resistências e sua conversão para valores da série E12.
Considera-se que o transistor é do modelo BC547C e que o LED tem uma tensão de
condução de 1.5 V.

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 𝑅𝑏 [𝑘Ω] 𝑅𝐶 [Ω] 𝐼𝑏[𝑚𝐴] 𝐼𝐿𝐸𝐷[𝑚𝐴]
Valor Teórico 14.19 272.6 0.303 12.12
Valores da série E12 12 270 - -
Tabela 2 - Valores dos componentes do circuito auxiliar para visualização do estado de saída do
contador

1.3. Conversor Digital para Analógico

Iremos dimensionar o conversor analógico – Digital (DAC) de forma que 𝑣 e o
𝑉 seja o valor resultante das equações abaixo.

𝑣 = 𝐾. 𝑉 . 𝐷
𝑉 =𝑉
𝑉 = 𝑉 − 1 = 4[𝑉]

𝐷= 𝑎 × 2 = 15

Assim,

1.05 ∑ 𝑛
𝐾= = 0.0494
𝑀 × 10

Logo,
𝑣 = 𝐾. 𝑉 . 𝐷 ⇔ 𝑣 = 3.705 [𝑉]

Em relação aos valores das resistências que constituem o amplificador 𝐴 ,

Respeitando uma gama de valores, escolheu-se os seguintes valores

𝑅 = 33 [𝑘Ω]

𝐶 = {𝑅 =𝑅 = 1𝑘Ω, 𝑅 = 220Ω}

Para o amplificador 𝐴 , dimensionou-se a resistência tem em conta o ganho,

sendo necessário determinar a tensão em 𝑣 do amplificador 𝐴 .

1 1 1 1
𝑣 = 𝑉 + 𝑉 + 𝑉 + 𝑉 = 3.125 [𝑉]
3 6 12 24

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 Para 𝑣 = 3.705 𝑉 :

𝑅
𝑣 = 1+ 𝑣 ⇔ 𝑅 = 5.3879𝑅
𝑅

Pela relação anterior, definiu-se,

𝑅 = 53.87 [𝑘Ω] 𝑒 𝑅 = 10 [𝑘Ω]

A tabela 3 apresenta os valore das resistências dimensionadas para o DAC bem

como a sua conversão para valores da série E12. De salientar que considera-se que o
ampop utlizado é do modelo TL082.

𝑅 [𝑘Ω] 𝑅 [𝑘Ω] 𝑅 [Ω] 𝑅 [𝑘Ω] 𝑅 [𝑘Ω] 2𝑅 [𝑘Ω]

Valores Série E12 56 10 220 1 1 33
Tabela 3 - Valores das resistências dimensionadas para o DAC

1.3.1. Característica Estática do DAC

i) Determinar 𝑣 em função da palavra de entrada [𝑎 𝑎 𝑎 𝑎 ] indicando o

peso da tensão de cada bit

Considerando que o amplificador 𝐴 encontra-se numa montagem não

inversora, e tendo em conta a escada R-2R, obtem-se os seguintes valores de
tensão de cada bit (considerando 𝑉 = 5𝑉.

𝑅 1 1 1 1
𝑣 = 1+ 𝑣 ⇔ 𝑣 = 1.17 𝑉 𝑎 + 𝑎 + 𝑎 + 𝑎
𝑅 3 2 4 8

1
𝑉 = 𝑉 = 0.243 [𝑉]
24
1
𝑉 = 𝑉 = 0.4875 [𝑉]
12
1
𝑉 = 𝑉 = 0.975 [𝑉]
6
1
𝑉 = 𝑉 = 1.95 [𝑉]
3

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 Figura 4 - Tensão para cada nível lógico

ii) Determinar 𝑣 em função de 𝑣 com os bits todos a ‘0’

Caso todos os bits se encontrem com o valor lógico ‘0’ admite-se que todos os
bits encontram-se a uma tensão de 0V.

Figura 5 - 𝑣

𝑅
𝑣 = 1+ 𝑣
𝑅

𝑅 1
𝑣 = 𝑣 = 𝑣
𝑅 + 2𝑅 3
1
𝑣 = 1.272 𝑣 [𝑉]
3

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 iii) Determinar 𝑣 em função de 𝑣 considerando a palavra de entrada
1
𝑣 = 𝑣
3
1 1 1 1
𝑣 = 𝑉 𝑎 + 𝑎 + 𝑎 + 𝑎
3 2 4 8

𝑣 =𝑣 +𝑣

𝑅
𝑣 = 1+ 𝑣
𝑅

1 1 1 1
𝑣 = 1.272 𝑎 + 𝑎 + 𝑎 + 𝑎 𝑣
2 4 8 3

iv) Determinar 𝑣 em função de 𝛼

Figura 6 - 𝑣 em função de α

Iremos abordar o problema recorrendo ao teorema da sobreposição onde

anulando cada uma das fontes, por análise direta verifica-se os seguintes divisores de
tensão:

𝛼𝑅 + 𝑅
𝑣 = 𝑉
𝛼𝑅 + 𝑅 (1 − 𝛼) + 𝑅 +𝑅

(1 − 𝛼)𝑅 + 𝑅
𝑣 = (−𝑉 )
𝛼𝑅 + 𝑅 (1 − 𝛼) + 𝑅 +𝑅

(2𝛼 − 1)𝑅
𝑣 = 𝑉 ⇔𝑣 = 0.49(2𝛼 − 1) [𝑉]
𝑅 +𝑅 +𝑅

O que resulta,
𝑅 1 1 1 1
𝑣 = 1+ 𝑎 + 𝑎 + 𝑎 + 𝑎 [0.49(2𝛼 − 1)]
𝑅 2 4 8 3

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 1.3.2. 𝑽𝑳𝑺𝑩

Iremos determinar 𝑉 isto é, a variação mínima em 𝑣 , quando se muda o bit

menos significativo da palavra digital de entrada.

1 𝑅
𝑉 = 𝑉 1+ = 0.247[𝑉]
24 𝑅

1.3.3. Anulação de uma entrada

Para anular uma entrada, iremos desligar o terminal da resistência que antes
estava ligada á saída 𝑄 do contador e ligaremos o mesmo á massa, sendo assim este bit
irá estar sempre a 0 V independentemente do contador. Desta forma, por exemplo a
palavra digital 0001 terá o mesmo valor de tensão que a palavra digital 0011.

Figura 7 - Tensão em Vo com anulação da entrada Qb

1.3.4. Tensão de Saída de deslocamento

Considerando 𝑉 = − = −0.123 [𝑉], e todos os bits a ‘0’, e o tipo de

montagem do amplificador 𝐴 , conclui-se o seguinte valor de 𝛼 (valor de rotação do
potenciómetro).

𝑅 𝑅
𝑉 = 1+ 𝑉
𝑅 𝑅 + 2𝑅

𝑉 = 0.49 (2𝛼 − 1) ⇔ 𝛼 = 0.18

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1.4. Simulação do DAC com o contador
Para simular o circuito do DAC, iremos recorrer á ferramenta de simulação
LTSpice, comprovando os resultados obtidos anteriormente.

1.4.1. Característica estática do DAC por simulação

A tensão para a palavra digital ‘0000’ é de 0V quanto que para a palavra digital
‘1111’ é de 3.705 V. A figura 8 representa a tensão a saída do amplificador, conclui-se
que os resultados obtidos por simulação são semelhantes aos obtidos teoricamente.

Figura 8 - Tensão para cada nível lógico simulado

1.4.2. 𝑽𝑳𝑺𝑩 por simulação

Pela figura 8, no gráfico de 𝑉 (𝑡) observa-se que para a variação mínima de 𝑉 ,

ou seja, para o valor lógico “0001”, tem-se um valor de tensão de 250 𝑚𝑉.

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 1.4.3. Anulação de uma entrada por simulação

Ligou-se a resistência que estava ligada a 𝑄 a ground. Assim obteve-se o

gráfico presente na figura 10. Observa-se que a forma do gráfico é igual á obtida
analiticamente apesar do valor de tensão ter uma discrepância de algumas centésimas
em relação ao obtido analiticamente.

Figura 9 - Tensão em Vo com anulação da entrada Qb por simulação

1.4.4. Tensão de deslocamento da saída por simulação

No subcapítulo 1.3.4 definiu-se que para que na saída surgisse uma tensão de
deslocamento negativa igual a metade do valor de LSB, o potenciómetro deveria
apresentar um ângulo de rotação (α) de 0.18. Colocando este parâmetro no circuito
simulado, conseguimos comprovar este offset. O valor de fim de escala será 3.54 V

Figura 10 - Sinal de Saída com offset

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2. Conversor Analógico/Digital (ADC)

2.1. Conversor de Seguimento

No presente capítulo iremos analisar o conversor Analógico/Digital presente na

figura 12. Este ADC de Seguimento irá converter a tensão de 𝑉 para uma palavra
digital. A tensão 𝑉 que vem do DAC será comparada com a tensão 𝑉 , e dependo desta
comparação, o contador irá contar para cima ou para baixo, alterando o valor de 𝑉 que
irá ser outra vez comparado com 𝑉 . Esta iteração ocorrerá as vezes necessárias até que
seja encontrado um nível lógico cuja tensão seja semelhante á de 𝑉 .
Em relação á gama de valores de 𝑉 , esta deve variar entre os 0 e os 3.54 V,
uma vez que 𝑉 não deve exercer a gama de valores de 𝑉 ( considera-se para 𝑉 os
valores simulados com offset obtidos em 1.4.4)

Figura 11 - Diagrama de blocos do conversor A/D de seguimento

2.2. Verificação de Funcionamento do ADC

Colocando na entrada do ADC ( sinal 𝑣 ) um sinal quadrangular com tensão a
vaiar entre os 5% e os 75% do valor de fim de escala, FS(full-scale) e com uma
frequência 40 vezes menor que a do relógio obtem-se a figura 13.

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 Figura 12 - sinais á saída do ADC

Como se pode observar a onda quadrangular tem uma frequência 4ª vezes menor
que a do relógio e que a tensão Vo encontra-se a seguir a tensão 𝑣 ( pulso
quadrangular).

2.2. Simulação do ADC

Considerando a frequência e os valores máximos de tensão máximo e mínimo do
subcapítulo 1.3, observa-se nas figuras 14, 15, 16 a saída do ADC para uma onda
sinusoidal, uma onda triangular e uma quadrangular respetivamente.
Conclui-se tal como esperado, a tensão Vo encontra-se a seguir a tensão 𝑣 .

Figura 15 - sinal à saída do ADC para Figura 15 - sinal à saída do ADC para Figura 15- sinal à saída do ADC para
onda sinusoidal onda quadrangular onda triangular

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3. Realização experimental do DAC
No presente capítulo iremos realizar a montagem do DAC, comparando os
resultados obtidos experimentalmente com os resultados obtidos teoricamente.

3.1. Montagem do contador e do bloco visualizador

Figura 16 - Bloco Visualizador de Leds

Através do bloco visualizador de Leds, observa-se que o contador, conta de

forma ascendente bem como de forma descendente, consoante a tensão de entrada
fornecida pelo pino UP/DOWN, e com a velocidade do sinal de Clock imposto.

3.2. Montagem do DAC

3.2.1. Compensação da tensão de desvio de saída do primeiro andar

através de 𝑹𝒑

Para a palavra digital “0000”, observa uma tensão de -0.1 V, assim de forma a
minimizar o erro de offset, ajustou-se o potenciómetro 𝑅 , até ter-mos uma tensão de
aproximadamente 0 V.

3.2.2. Análise do Erro de Fim-De-Escala.

Para a palavra digital “1111”, observou-se que a tensão 𝑣 obtida

experimentalmente era de 3.5V enquanto o valor obtido teoricamente era de 3.705V,
depois do ajuste realizado anteriormente.
Observando a montagem não inversora do ampop 1 da figura 1 conclui-se que o
ganho do circuito é dado por,

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 𝑅
𝑣 = 1+ 𝑣
𝑅

Assim, de modo a aumentar a tensão 𝑣 colocou-se um potenciómetro em série

com a resistência 𝑅 .

Figura 17 – Característica estática do DAC obtida experimentalmente após correção dos erros de offset
e de ganho

3.2.3. Traçado da característica estática do DAC

Após os ajustes efetuados anteriormente, e manipulando a frequência de
relógio, obteve-se para as 16 combinações de contagem, o valor de tensão de cada bit e
a tensão 𝑣 correspondente.

Tabela 4 - Valor de cada bit para as 16 combinações

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 Observa que os valores de tensão 𝑄 para o valor lógico 1 são idênticos, bem
como para o valor lógico 0. A tensão de 𝑄 obtida teoricamente era de 5V, contudo
experimentalmente observa-se que é cerca de 0.2V inferior. Este valor surge devido á
resistência de carga formada pelo bloco visualizador de Leds e pela malha R-2R.

Com base nas medidas efetuadas das tensões de 𝑄 e de 𝑣 , traçou-se o gráfico

presente na figura 18, o de se pode observar a linearidade do DAC. Observa-se que o
gráfico obtido experimentalmente é semelhante ao gráfico obtido teoricamente.

Figura 18 - Característica estática do DAC

3.2.4. Cálculo da DNL /INL

𝑣 (𝑘 + 1) − 𝑣 (𝑘)
𝐷𝑁𝐿[𝑘] = −1
∆

𝐼𝑁𝐿[𝑘] = 𝐷𝑁𝐿[𝑖]

Tabela 5- DNL e INL

4. Realização experimental do ADC

No presente capítulo iremos realizar a montagem do ADC, comparando os
resultados obtidos experimentalmente com os resultados obtidos teoricamente.

4.1. Montagem do ADC

Para realizarmos o ADC de seguimento, foi necessário adicionar na saída do
comparador uma malha limitadora de modo a garantir que a tensão de saída do

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comparador não estragaria o contador CD4049 por fornecer uma tensão superior ou
inferior à permitida.
Assim, sabendo que os valores de saída do comparador são +5 V ou -5V, que
𝑅 = 10𝑘Ω 𝑒 𝑅 = 1.2𝑘Ω e que 𝑉 ≅ 0.7 𝑉, 𝑉 ≅ 𝑉 ≅ 0.3 𝑉 calculou-se
𝐼 , 𝐼 , 𝑉 𝑒 𝑉 consoante os valores de saída do comparador.

Figura 19 - Malha limitadora do ADC

Para o caso de 𝑉 = −5𝑉 o díodo 𝐷 encontrar-se em condução forçando que

𝑉 = −0.7𝑉. O díodo 𝐷 entra em condução para 𝑉 < −0.3𝑉, portanto o díodo 𝐷
está a conduzir, forçando 𝑉 = −0.3 𝑉.

Assim retiramos que 𝐼 = = 430 𝜇𝐴 e 𝐼 = = 333 𝜇𝐴.

Para o caso de 𝑉 = 5𝑉 o díodo 𝐷 deixa de conduzir porque a tensão imposta é

superior, o mesmo se aplica ao díodo 𝐷 . O díodo 𝐷 certifica-se que a tensão em 𝑉
não ultrapassa os 4.7V.
Como o díodo 𝐷 𝑒 𝐷 não conduzem e como o díodo 𝐷 limita tensão 𝑉 a
partir dos 4.7V, não haverá corrente na malha limitadora implicando que 𝑉 ≅ 𝑉 ≅
𝑉 ≅ +5𝑉 e que 𝐼 ≅ 𝐼𝑏 ≅ 0 𝐴.

Voa [V] Vx [V] Vin [V] Ia [mA] Ib [mA]

+5 +5 +5 0 0
-5 -0.7 -0.3 0.43 0.333
Tabela 6 - Valores de tensão e corrente da malha limitadora

4.2. Verificação de Funcionamento do ADC

4.2.1. Ajuste do valor de 𝜶

Para a palavra digital “0000”, observa uma tensão de 0.3 V, assim de forma a
minimizar o erro de offset, ajustou-se o potenciómetro 𝑅 , até ter-mos uma tensão de
aproximadamente 0 V, á semelhança do que foi feito no DAC.

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 4.2.2. Sinal quadrangular
Quando colocado um sinal quadrangular á entrada, observa-se que na saída do
DAC,𝑣 , a tensão á saída do DAC segue a tensão de entrada, tal como se verificou
teoricamente.

Figura 20 - Sinais 𝑣 e 𝑣 com 𝑣 um sinal quadrangular

4.2.3. Sinais sinusoidal e triangular

Tal como, quando se coloca á entrada um sinal quadrangular, nas figuras 22 e
23, observa-se que a tensão á saída do DAC segue um sinal triangular e um sinal
sinusoidal tal como o expectável.

Figura 22 - Sinais 𝑣 e 𝑣 com 𝑣 um sinal Figura 22 - Sinais 𝑣 e 𝑣 com 𝑣 um sinal

triangular sinusoidal

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5. Conclusão
A elaboração deste trabalho teve por objetivo compreender a conversão de um sinal
analógico para uma palavra digital bem como a conversão de uma palavra digital para um
sinal analógico.
A principal conclusão a retirar deste trabalho é a possibilidade de quantificar a
diferença de tensão analógica com a tensão de saída do DAC baseado num único
comparador.
Concluindo, este trabalho será importante para o nosso futuro académico na
medida em que permitiu compreender como é que através de um contador e uma escada
R-2R se consegue transformar um sinal digital num sinal analógico (DAC), bem como a
partir do DAC e com um comparador se consegue obter o inverso (ADC), que
consideramos conceitos de suma importância na área da eletrónica.

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