UNIVERSIDADE ESTADUAL DE CAMPINAS

FACULDADE DE TECNOLOGIA - FT

João Paulo Magalhães Fernandes

174387

RELATÓRIO 4 – CIRCUITOS DIGITAIS II

Limeira
2021
 Sumário

1.1 Cronômetro digital de 2 dígitos ....................................................................... 3

1.1.1 Código cronômetro digital de 2 dígitos ..................................................... 3
1.1.2 Simulação cronômetro digital de 2 dígitos ............................................... 4
1.2 Somador de 4 bits .......................................................................................... 5
1.2.1 Código somador de 4 bits ........................................................................ 6
1.2.2 Simulação somador de 4 bits ................................................................... 8
1.3 Filtro digital FIR 1D ....................................................................................... 14
1.3.1 Finite Impulse Response ........................................................................ 14
1.3.2 Código filtro digital FIR 1D ..................................................................... 15
1.3.3 Simulação filtro digital FIR 1D ................................................................ 17
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1.1 Cronômetro digital de 2 dígitos

A proposta do mini-projeto 4 consiste na realização de um código em VHDL, que

implemente um cronômetro digital de 2 dígitos, ou seja, utilizando dois displays de 7
segmentos. Nesses dois displays, considerei apenas a unidade de contagem segundos,
então o máximo que o contador digital consegue chegar é até 99 segundos (1 minuto e
39 segundos). A lógica utilizada na linguagem é simples, a cada pulso alto do relógio,
será somada uma unidade de segundo no contador, onde ele inicia em zero e vai até
99. Chegando em 99 segundos, ele zera para fazer a contagem novamente.

1.1.1 Código cronômetro digital de 2 dígitos

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1.1.2 Simulação cronômetro digital de 2 dígitos

Na simulação do cronômetro devemos colocar um período/frequência no relógio,

já que a lógica do código funciona em relação a subida do clock. No exemplo da ima-
gem, o período foi determinado em 60ns.

Podemos observar que o display2 está se referindo a dezena do contador e o

display se refere a unidade. Então no WVF fica claro que, a cada dez contagem no dis-
play, é somado um no display que está relacionado com a dezena. Esse ciclo vai acon-
tecer até ambos os displays possuir o 9 como seu algarismo. Na figura a seguir pode-
mos conferir os valores dos displays para um melhor entendimento da contagem.
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1.2 Somador de 4 bits

A proposta do mini-projeto 5 consiste na implementação de uma calculadora que

executa as 4 operações básicas da matemática, ou seja, adição, subtração, divisão e
multiplicação, utilizando o kit DE1 Altera. As operações devem ser feitas com apenas
dois números de 4 bits, lembrando que o 4º bit se refere ao sinal do algarismo. As leitu-
ras dos números e operações devem ser feitas com a utilização de chaves e/ou botões.
E no final o resultado da operação deve ser mostrado em um display de 7 segmentos.
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1.2.1 Código somador de 4 bits

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Na entidade do código foi declarado um vetor (10 elementos) de entrada para os

Switches da placa. Onde os elementos de 0 à 3 se refere ao valor “a”, os elementos de
4 à 7 ao valor “b”, e por fim os slots 8 e 9 do vetor SW são para a escolha da operação
a ser feita. O código da calculadora suporta operações de 49 à -49.

Na arquitetura foram declarados alguns signals para ser utilizado durante as exe-
cuções dos comandos do código. Temos o sel1 e sel2, onde ambos estão relacionados
com os elementos do vetor SW. O sel1 sendo o SW de 0 à 3 e o sel2 será o SW de 4 à
7. E nestes serão armazenados os dois algarismos que serão utilizados para realizar os
cálculos. O signal a e b receberão o sel1 e sel2 respectivamente.

O signal asw receberá as quatros operações básica da matemática. O op será

utilizado para printar o sinal do resultado da operação no display HEX2. No primeiro
With Select utilizamos o signal sel0 e colocamos os possíveis valores para o signal b.
No segundo With Select utilizamos o signal sel1 e colocamos os possíveis valores para
o signal a. Já o terceiro With Select utilizamos o signal sel e passamos as combinações
referentes as quatro operações para o signal asw. Logo em seguida vem o código que
faz a armazenagem de dezena e unidade do valor. Seguindo adiante o primeiro WITH
SELECT printa a unidade da conta no HEX0. O segundo WITH SELECT printa a deze-
na da conta no HEX1 e o terceiro WITH SELECT printa os negativos.

1.2.2 Simulação somador de 4 bits

1.2.2.1 Adição
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Nessa simulação temos os dois algarismos A (0010) e B (0100), OP (00) indican-

do a operação de adição dos valores A e B. Então 2 + 4 = 6, considerando o display na
borda de descida temos:

Como o resultado da adição deu 6, a saídas que vão ser acesas, são: a, c, d, e, f
e g. Assim formando o algarismo 6 no display.
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1.2.2.2 Subtração

Nessa simulação temos os dois algarismos A (0101) e B (0001), OP (01) indican-

do a operação de subtração dos valores A e B. Então 5 - 4 = 1, considerando o display
na borda de descida temos:
 Adicione um título ao seu documento 11

Como o resultado da subtração deu 4, a saídas que vão ser acesas, são: b, c, g e
f. Assim formando o algarismo 6 no display.

1.2.2.3 Multiplicação

Nessa simulação temos os dois algarismos A (0100) e B (0011), OP (10) indican-

do a operação de multiplicação dos valores A e B. Então 4 x 3 = 12, considerando o
display na borda de descida temos:
12 Adicione um título ao seu documento

Como o resultado da multiplicação deu 12, vamos ter dois displays, sendo o pri-
meiro indicando o valor 1 com as seguintes saídas acesas: b e c, e o segundo indican-
do o valor 2 com as seguintes saídas acessas: a, b , d, e e g. Assim formando o alga-
rismo 12 nos displays.

1.2.2.4 Divisão
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Nessa simulação temos os dois algarismos A (0100) e B (0010), OP (11) indican-

do a operação de divisão dos valores A e B. Então 4 / 2 = 2, considerando o display na
borda de descida temos:

Como o resultado da divisão deu 2, a saídas que vão ser acesas, são: a, b, d, e e
f. Assim formando o algarismo 2 no display.
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1.3 Filtro digital FIR 1D

No último exercício, no caso o mini-projeto 6, tem como objetivo a explicação e

execução de um código em VHDL que implementa um filtro FIR 1D, apresentando seus
resultados no Matlab.

1.3.1 Finite Impulse Response

Como os filtros digitais possui um tempo de resposta ao impulso finito e possui

uma memória finita, então qualquer que seja o transitório deste filtro, ele terá uma dura-
ção limitada. Esses filtros podem implementar uma resposta em módulo desejada com
resposta em fase linear. Devido aos poderosos algoritmos de design que existem para
eles, os filtros FIR são amplamente usados; sua estabilidade inerente quando imple-
mentados de forma não recursiva; a facilidade com que se pode atingir a fase linear; e
outros.
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1.3.2 Código filtro digital FIR 1D

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1.3.3 Simulação filtro digital FIR 1D