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MAX31865 Conversor RTD para Digital

Descrição geral Benefícios e recursos

O MAX31865 é um conversor de resistência para digital fácil de ● A integração reduz o custo do sistema, simplifica os esforços
usar, otimizado para detectores de temperatura de resistência de projeto e reduz o tempo do ciclo de projeto
de platina (RTDs). Um resistor externo define a sensibilidade do • Conversão simples de resistência RTD de platina em
RTD que está sendo usado e um ADC delta-sigma de precisão valor digital
converte a relação entre a resistência do RTD e a resistência de • Alças 100Ahpara 1kΩ (a 0°C) RTDs de platina
referência em formato digital. As entradas do MAX31865 são (PT100 a PT1000)
protegidas contra falhas de sobretensão tão grandes quantoP • Compatível com conexões de sensores de 2, 3 e 4 fios
45V. Detecção programável de RTD e condições de cabo aberto • Interface compatível com SPI
e curto estão incluídas. • Pacotes TQFN e SSOP de 20 pinos
● Alta precisão facilita o cumprimento de orçamentos com erros
Formulários • Resolução ADC de 15 bits; Resolução de temperatura
● Equipamentos Industriais nominal 0,03125NC (varia devido à não linearidade do
● Equipamento Médico RTD)
● Instrumentação • Precisão total em todas as condições operacionais: 0,5N
C (0,05% da escala completa) máx.
• Entradas VREF totalmente diferenciais
• Tempo de conversão de 21 ms (máx.)

● A detecção integrada de falhas aumenta a confiabilidade

do sistema
Informações sobre pedidos aparece no final da folha de dados.
• Proteção de entrada de ±45V
• Detecção de falhas (elemento RTD aberto, RTD em curto
com tensão fora da faixa ou curto no elemento RTD)

Circuitos de aplicação típicos

VDD VDD
CONEXÃO DO SENSOR DE 4 FIOS

0,1µF 0,1µF
DVDD

VDD

VIÉS

REFIN+ REF

DRDY REFIN-

IDE ISENSOR
MAX31865 CABO RC
SCLK
HOSPEDAR
FORÇA+
INTERFACE

CS FORÇA2

CABO RC
SDO RTDIN+

NC
CI* IDT
CABO RC

RTDIN-
DGND
GND1

GND2

FORÇA- * CI = 10nF PARA 1kAhIDT

CABO RC 100nF PARA 100AhIDT

Circuitos de aplicação típicos continua no final da folha de dados.

19-6478; Apocalipse 3; 15/07

MAX31865 Conversor RTD para Digital

Avaliações Máximas Absolutas

Faixa de tensão em VDD em relação ao GND1..........-0,3V a +4,0V Dissipação Contínua de Energia (TA = +70NC)
Faixa de tensão em BIAS, REFIN+, TQFN (redução de potência de 34,5mW/NC acima de +70N
REFIN-, ISENSOR................................. -0,3V a (VDD + 0,3V) Faixa C)...............2758,6mW SSOP (redução de 11,9mW/°C acima de
de tensão ativada FORÇA+, FORÇA2, +70°C)...............952,4mW Proteção ESD (todos os pinos, modelo de corpo
FORCE-, RTDIN+, RTDIN- Relativo a GND1 .... Faixa de tensão de humano) ...................±2kV Faixa de temperatura operacional ................ ........ -40
-50V a +50V em DVDD Relativo a DGND........-Faixa de tensão de 0,3V NC a +125NTemperatura da junção C ................................................ ......+150NC
a +4,0V em todos os pinos digitais Faixa de temperatura de armazenamento......................... -65NC a +150NC
Em relação ao DGND ............................ -0,3V a (VDVDD + 0,3V) Temperatura de soldagem (refluxo) ......................................+260NC
Temperatura do chumbo (soldagem, 10s) ......................+300NC
Tensões além daquelas listadas em “Classificações Máximas Absolutas” podem causar danos permanentes ao dispositivo. Estas são apenas classificações de estresse e a operação funcional do
dispositivo nestas ou em quaisquer outras condições além daquelas indicadas nas seções operacionais das especificações não está implícita. A exposição às condições de classificação máxima
absoluta por longos períodos pode afetar a confiabilidade do dispositivo.

Características Térmicas da Embalagem (Nota 1)

TQFN SSOP
Resistência térmica junção-ambiente (qJA) ..........29°C/W Resistência térmica junção-ambiente (qJA) ..........84°C/W
Resistência Térmica Junção-Caixa (qJC).................2°C/W Resistência Térmica Junção-Caixa (qJC) ...............32°C/W

Nota 1: As resistências térmicas da embalagem foram obtidas utilizando o método descrito na especificação JEDEC JESD51-7, utilizando uma placa de quatro
camadas. Para obter informações detalhadas sobre considerações térmicas da embalagem, consultewww.maximintegrated.com/thermal-tutorial .

Condições de operação CC recomendadas

(TA = -40NC a +125NC, salvo indicação em contrário.) (Notas 2 e 3)

PARÂMETRO SÍMBOLO CONDIÇÕES MÍNIMO TIPO MÁX. UNIDADES

VDD VDD 3,0 3.3 3.6 V

DVDD VDVDD 3,0 3.3 3.6 V
0,3 x
Lógica de entrada 0 VIL CS,SDI, SCLK - 0,3 V
VDVDD
0,7 x VDVDD
Lógica de Entrada 1 VIH CS,SDI, SCLK V
VDVDD +0,3
Tensões Analógicas
(FORÇA+, FORÇA2, FORÇA-, Resultados normais de conversão 0 VBIAS V
RTDIN+, RTDIN-)
Resistor de referência REF 350 10k EU
Resistência do cabo CABO RC Por lead 0 50 EU

características elétricas
(3,0VPVDDP3,6 V, TA = -40NC a +125NC, salvo indicação em contrário. Os valores típicos são TA= +25NC, VDD = VDVDD = 3,3V.) (Notas 2 e 3)

PARÂMETRO SÍMBOLO CONDIÇÕES MÍNIMO TIPO MÁX. UNIDADES

Resolução ADC Nenhum código faltando 15 Pedaços

Tensão de entrada ADC em escala REFIN+ -

V
total (RTDIN+ - RTDIN-) REFIN-

www.maximintegrated.com Máxima Integrada │ 2

MAX31865 Conversor RTD para Digital

Características Elétricas (continuação)

(3,0VPVDDP3,6 V, TA = -40NC a +125NC, salvo indicação em contrário. Os valores típicos são TA= +25NC, VDD = VDVDD = 3,3V.) (Notas 2 e 3)

PARÂMETRO SÍMBOLO CONDIÇÕES MÍNIMO TIPO MÁX. UNIDADES

Entrada de modo comum ADC

0 VBIAS V
Faixa
RTDIN+, RTDIN-, 0NC a +70NC, no estado 2
Corrente de fuga de entrada RTDIN+, RTDIN-, -40NC a +85NC, no estado 5 n/D

RTDIN+, RTDIN-, -40NC a 100NC, no estado 14

Tensão de polarização VBIAS 1,95 2h00 2.06 V
Corrente de saída de tensão de polarização SAÍDA 0,2 5,75 mA
Regulação de carga de tensão de polarização SAÍDAP5,75mA 30 mV/mA
Tempo de inicialização da tensão de polarização (Nota 4) 10 EM
Erro ADC em escala total ±1 LSB
Entrada diferencial, ajuste de endpoint, 0,3 x VBIAS
Não-linearidade Integral ADC ±1 LSB
PVREFPVBIAS
Erro de deslocamento ADC -3 +3 LSB
Ruído (na largura de banda Nyquist) Entrada referida 150 FVRMS
Rejeição de modo comum 90 dB
Rejeição de ruído 50/60 Hz Fundamentais e harmônicos 82 dB
Conversão contínua (notch de 60 Hz) 16,7 17.6
Tempo de conversão de temperatura Conversão única (entalhe de 60 Hz) 52 55
tCONV EM
(Nota 5) Conversão única (entalhe de 50 Hz) 62,5 66
Conversão contínua (entalhe de 50 Hz) 20 21
Tempo de ciclo de detecção automática de
DeCSalto para completar o ciclo 550 600 Fé
falhas

Rejeição da fonte de alimentação 1 LSB/V

DDI Polarização desligada, ADC desligado 1,5 3 mA

Corrente de alimentação (Nota 6) Desligar

DDI Polarização ativada, conversão ativa 2 3.5 mA

Tensão de reinicialização de inicialização
2 2.27 V
Limite
Tensão de reinicialização de inicialização
120 mV
Histerese
Capacitância de entrada CIN Entradas lógicas 6 pF
Corrente de fuga de entrada IL Entradas lógicas -1 +1 FA
VDVDD
Alta Tensão de Saída VOH IOUT = -1,6 mA V
- 0,4
Baixa tensão de saída volume IOUT = 1,6 mA 0,4 V

www.maximintegrated.com Máxima Integrada │ 3

MAX31865 Conversor RTD para Digital

Características elétricas CA: Interface SPI

(3,0VPVDDP3,6 V, TA = -40NC a +125NC, salvo indicação em contrário. Os valores típicos são TA= +25NC, VDD = VDVDD = 3,3V.) (Notas 3
e 7) (figura 1 eFigura 2 )

PARÂMETRO SÍMBOLO CONDIÇÕES MÍNIMO TIPO MÁX. UNIDADES

Dados para configuração do SCLK tDC (Notas 8, 9) 35 ns

SCLK para retenção de dados tCDH (Notas 8, 9) 35 ns
SCLK para dados válidos tCDD (Notas 8, 9, 10) 80 ns
SCLK Tempo Baixo tCL (Nota 9) 100 ns
Tempo alto do SCLK tCH (Nota 9) 100 ns
Frequência SCLK tCLK (Nota 9) CC 5,0 MHz
SCLK Ascensão e Queda tR, tF (Nota 9) 200 ns
CSpara configuração do SCLK tCC (Nota 9) 400 ns
SCLK paraCSSegurar tCCH (Nota 9) 100 ns
CSTempo inativo tCWH (Nota 9) 400 ns
CSpara saída High-Z CDZ (Notas 8, 9) 40 ns
Endereço 01h ou 02h Decodificado
tDRDYH Após acesso de leitura do registro RTD (Nota 9) 50 ns
para DRDYAlto

Nota 2: Todas as tensões são referenciadas ao terra quando comuns. As correntes que entram no IC são especificadas como positivas.
Nota 3: Os limites são 100% de produção testada em TA= +25°C e/ou TA= +85°C. Os limites acima da faixa de temperatura operacional e da faixa
de tensão de alimentação relevante são garantidos pelo projeto e pela caracterização. Os valores típicos não são garantidos.
Nota 4: Para liquidação de 15 bits, é necessária uma espera de pelo menos 10,5 constantes de tempo da rede RC de entrada. O tempo máximo de inicialização é calculado
com um resistor de referência de 10kω e um capacitor de 0,1µF nas entradas do RTD.
Nota 5: A primeira conversão após ativar o modo de conversão contínua leva um tempo igual ao tempo de conversão única para a
respectiva frequência de notch.
Nota 6: Especificado sem carga no pino de polarização como a soma das correntes analógicas e digitais. Nenhuma comunicação ativa. Se a tensão de
entrada do RTD for maior que a tensão de referência de entrada, então um IDD adicional de 400 µA pode ser esperado.
Nota 7: Todas as especificações de temporização são garantidas pelo projeto.
Nota 8: Medido em VIH = 0,7V x VDVDD ou VIL = 0,3 x VDVDD e tempos máximos de subida e descida de 10ms.
Nota 9: Medido com carga de 50pF.
Nota 10:Medido em VOH = 0,7 x VDVDD ou VOL = 0,3 x VDVDD. Medido desde o ponto de 50% do SCLK até o VOH mínimo do SDO.

www.maximintegrated.com Máxima Integrada │ 4

MAX31865 Conversor RTD para Digital

CS

tCC

SCLK

tCDD
tCDH tCDD
tDC

IDE A7 A6 A0

CDZ

SDO
D7 D6 D1 D0

ESCREVER BYTE DE ENDEREÇO LER BYTE DE DADOS

OBSERVAÇÃO:SCLK PODE SER QUALQUER POLARIDADE, TEMPO MOSTRADO PARA CPOL = 1.

Figura 1. Diagrama de tempo: transferência de dados de leitura SPI

CS

tCWH
tCC
tR
tCL TF tCCH

SCLK
tCDH
tCH
tCDH
tDC

IDE A7 A6 A0 D7 D0

ESCREVER BYTE DE ENDEREÇO ESCREVER BYTE DE DADOS

OBSERVAÇÃO:SCLK PODE SER QUALQUER POLARIDADE, TEMPO MOSTRADO PARA CPOL = 1.

Figura 2. Diagrama de tempo: transferência de dados de gravação SPI

www.maximintegrated.com Máxima Integrada │ 5

MAX31865 Conversor RTD para Digital

Características operacionais típicas

(VDD = VDVDD = 3,3V, TA = +25°C, salvo indicação em contrário.)

CORRENTE DE ALIMENTAÇÃO vs. TEMPERATURA CORRENTE DE ALIMENTAÇÃO vs. TEMPERATURA

(MODO DE CONVERSÃO AUTOMÁTICA ADC) (MODO ADC NORMALMENTE DESLIGADO)

4 4

MAX31865 toc01

MAX31865 toc02
3 3
ID ANALÓGICO D
(BIAS PIN UNLO ADED)
DDI (mA)

DDI (mA)
ANALOG IDD
2 2 (PIN DE BIAS DESCARREGADO)

1 1
D
IDENTIFICAÇÃO DIGITAL D
IDENTIFICAÇÃO DIGITAL

0 0
- 50 0 50 100 150 - 50 0 50 100 150
TEMPERATURA (°C) TEMPERATURA (°C)

CORRENTE DE FUGA POR PIN vs. TEMPERATURA (1 VOLT OPERAÇÃO DO FILTRO SINC
APLICADO AOS PINOS FORCE+, FORCE2, RTDIN+, RTDIN-) FREQUÊNCIA DE ENTRADA vs. RESPOSTA A RUÍDO
20
MAX31865 toc03

MAX31865 toc04
140
0
120
RESPOSTA A RUÍDO (dB)

100 - 20 50Hz 60 Hz
ATUAL (nA)

80
- 40
60
- 60
40
- 80
20

0 - 100
50 75 100 125 150 10 50 90 130 170
TEMPERATURA (°C) FREQUÊNCIA DE RUÍDO DE ENTRADA (Hz)

ERRO DE CONVERSÃO ADC vs. RESISTÊNCIA RTD ERRO DE CONVERSÃO ADC vs. RESISTÊNCIA RTD
(4kAhRREF, CONEXÃO DE 4 FIOS) (400AhRREF, CONEXÃO DE 4 FIOS)
MAX31865 toc05 MAX31865 toc06
0,488 0,488

- 40° C
0,244 0,244
+25°C
+25°C
- 40° C
ERRO (Ah)

ERRO (Ah)

˜ ±0,1°C ˜ ±0,1°C
0 0
ERRO ERRO
+100ºC
+100ºC
- 0,244 - 0,244

- 0,488 - 0,488
0 500 1000 1500 2000 2500 3000 3500 0 50 100 150 200 250 300 350
RRTD (Ah) RRTD (Ah)

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MAX31865 Conversor RTD para Digital

Configurações de pinos

DGND

SCLK
SDO
VISTA DO TOPO

IDE
CS
15 14 13 12 11

GND116 10 GND2

NC 17 9 FORÇA-

MAX31865
DRDY 18 8 RTDIN-

DVDD 19 7 RTDIN+

VDD 20 PE 6 FORÇA2
+

1 2 3 4 5
VIÉS

REFIN+

FORÇA+
ISENSOR
REFIN-

TQFN
(5mm x 5mm)

VISTA DO TOPO

+
DRDY 1 20 NC
DVDD 2 19 GND

VDD 3 18 DGND
VIÉS 4 MAX31865 17 SDO
REFIN+ 5 16 CS
REFIN- 6 15 SCLK
ISENSOR 7 14 IDE

FORÇA+ 8 13 GND2
FORÇA2 9 12 FORÇA-

RTDIN+ 10 11 RTDIN-

SSOP

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MAX31865 Conversor RTD para Digital

Descrição do alfinete

ALFINETE

NOME FUNÇÃO
TQFN SSOP
1 4 VIÉS Saída de tensão de polarização (VBIAS)

Entrada de tensão de referência positiva. Conecte-se ao BIAS. Conecte o resistor de referência

2 5 REFIN+
entre REFIN+ e REFIN-.
3 6 REFIN- Entrada de tensão de referência negativa. Conecte o resistor de referência entre REFIN+ e REFIN-.
4 7 ISENSOR Lado inferior do RREF. Conecte-se ao REFIN-.

Unidade RTD do lado alto. Conecte ao FORCE2 ao usar a configuração de conexão de 3 fios.
5 8 FORÇA+
Protegido para ±45V.

Entrada positiva usada somente em 3 fios. Quando estiver na configuração de conexão de 3 fios, conecte ao
6 9 FORÇA2 FORCE+. Quando estiver na configuração de conexão de 2 ou 4 fios, conecte ao terra. Protegido para ±45V.

7 10 RTDIN+ Entrada RTD positiva. Protegido para ±45V.

8 11 RTDIN- Entrada RTD negativa. Protegido para ±45V.

9 12 FORÇA- Retorno RTD do lado inferior. Protegido para ±45V.

10 13 GND2 Terra Analógica. Conecte-se ao GND1.

11 14 IDE Entrada de dados seriais

12 15 SCLK Entrada de relógio de dados seriais

13 16 CS Seleção de chip ativo-baixo. DefinirCSbaixo para ativar a interface serial.

14 17 SDO Saída de dados seriais

15 18 DGND Terreno Digital

16 19 GND1 Terra Analógica. Conecte-se ao GND2.

17 20 NC Não conecte
Saída ativa-baixa, push-pull e pronta para dados.DRDYdiminui quando um novo resultado de conversão está
18 1 DRDY disponível no registro de dados. Quando ocorre uma operação de leitura de um registro de dados de resistência RTD,
DRDYretorna alto.

Entrada de tensão de alimentação digital. Conecte a uma fonte de alimentação de 3,3 V. Bypass para DGND com um capacitor de
19 2 DVDD
bypass de 0,1µF.

Entrada de tensão de alimentação analógica. Conecte a uma fonte de alimentação de 3,3 V. Bypass para GND1 com um capacitor de
20 3 VDD bypass de 0,1µF.

- - PE Almofada exposta (lado inferior da embalagem). Conecte-se ao GND1. Aplica-se apenas ao pacote TQFN.

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MAX31865 Conversor RTD para Digital

Diagrama de bloco

VDD DVDD

VDD VDVDD
VIÉS VBIAS
GERADOR

REFIN+

REFIN-
SCLK
SDO
SERIAL IDE
ISENSOR REGISTROS DE DADOS
LÓGICA
CS

FORÇA+

FORÇA2 LÓGICA DIGITAL

3 FIOS
APENAS
DIGITAL
50/60 Hz DIGITAIS COMPARADOR
RTDIN+
15 bits FILTRO SINC PARA
Σ∆ADC DETECÇÃO DE FALHA

PROTEÇÃO ±45V
INICIADO POR MESTRE
ESTADO DA ADC DRDY
DETECÇÃO DE FALHA
MÁQUINA
RTDIN- CICLO

FORÇA-
MAX31865

GND2 GND1 DGND

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MAX31865
Descrição detalhada
O MAX31865 é um conversor RTD para digital sofisticado com
um conversor analógico para digital (ADC) de 15 bits integrado,
proteção de entrada, um controlador digital, uma interface
compatível com SPI e lógica de controle associada. O circuito de
condicionamento de sinal é otimizado para funcionar com RTDs
PT100 a PT1000. Termistores também são suportados.
Conversão de temperatura
Detectores de temperatura de resistência (RTDs) são
sensores cuja resistência varia com a temperatura. A platina
é o material de fio mais comum e mais preciso; RTDs de
platina são chamados de PT-RTDs. Níquel, cobre e outros
metais também podem ser usados para fazer RTDs. As
características dos RTDs de platina incluem uma ampla faixa
de temperatura (até mais de +800NC), excelente precisão e
repetibilidade e linearidade razoável.
Para PT-RTDs, os valores mais comuns para resistência
nominal em 0NC são 100EUe 1kEU,embora outros
valores estejam disponíveis. A inclinação média entre 0N
C e +100NC é chamado de alfa (α). Este valor depende
das impurezas e das suas concentrações na platina. Os
dois valores de alfa mais utilizados são 0,00385 e
0,00392, correspondendo às normas IEC 751 (PT100) e
SAMA.
A curva resistência versus temperatura é razoavelmente linear, mas
tem alguma curvatura, conforme descrito pela equação de
Callendar-Van Dusen:
R(T) = R0(1 + aT + bT2 + c(T - 100)T3)
onde:
T = temperatura (NC) R(T) =
resistência em T R0 =
resistência em T = 0NC
IEC 751 especifica α = 0,00385055 e os seguintes valores
de coeficiente Callendar-Van Dusen:
a = 3,90830 x 10-3 b
= -5,77500 x 10-7
c = -4,18301 x 10-12 para -200NCPTP0NC, 0 por 0NCPT P
+850NC
Figura 3 mostra a curva de resistência versus temperatura para
um RTD PT100 junto com uma aproximação em linha reta com
base na inclinação entre 0NC e +100NC.
Para medir a resistência do RTD, conecte um resistor de referência
(RREF) e o RTD em série e aplique a tensão de polarização ao topo do
RREF conforme mostrado na figura.Típica
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Conversor RTD para Digital
RESISTÊNCIA DA IDT PT100
versus TEMPERATURA
450
400
350 LINHA RETA
300 APROXIMAÇÃO
RESISTÊNCIA (Ah)
250
200
RESISTÊNCIA À IDT
150
100
50
0
- 200 -100 0 100 200 300 400 500 600 700
TEMPERATURA (°C)
Figura 3. Resistência do RTD PT100 versus temperatura.
Circuitos de Aplicação. A corrente do resistor de
referência também flui através do RTD. A tensão no
resistor de referência é a tensão de referência para o
ADC. A tensão através do RTD é aplicada às entradas
diferenciais do ADC (RTDIN+ e RTDIN-). O ADC, portanto,
produz uma saída digital que é igual à razão entre a
resistência RTD e a resistência de referência. Um resistor
de referência igual a quatro vezes o 0 do RTDNA
resistência C é ideal para um RTD de platina. Portanto,
um PT100 usa um 400EUresistor de referência, e um
PT1000 usa um 4kEU resistor de referência.
Uma conexão de 2 fios (veja oCircuitos de aplicação típicos) pode
fornecer resultados aceitáveis quando o RTD estiver localizado
próximo ao MAX31865. Observe que, para um PT100, a resistência
em série de 0,4EUcausa um erro de aproximadamente 1NC.
Portanto, à medida que o comprimento do cabo aumenta, o erro
devido à resistência do cabo pode tornar-se excessivo.
A conexão de 4 fios elimina erros devido à resistência do
cabo usando cabos de força e de detecção separados.
Uma conexão de 3 fios é uma abordagem de compromisso
que usa um condutor a menos que a abordagem de 4 fios.
Para compensar a queda de tensão no fio de retorno, a
tensão entre FORCE+ e RTDIN+ é subtraída de (RTDIN+ -
RTDIN-). Isso é feito usando a entrada de amostragem
FORCE2. Se as resistências do cabo estiverem bem
combinadas, o erro devido à resistência do cabo será
cancelado. Selecione a operação de 3 fios definindo o bit de
3 fios no registro de configuração como 1.
Máxima Integrada │ 10
MAX31865
Linearização de dados de temperatura
Para uma faixa de temperatura de -100NC a +100NC, uma boa
aproximação da temperatura pode ser feita simplesmente usando
os dados RTD conforme mostrado abaixo:
Temperatura (NC) ≈ (código ADC/32) – 256
Esta equação dá 0NErro C em 0NC, -1,75NErro C em -100
NC e -1,4NErro C em +100NC (assumindo um RTD IEC751
e RREF igual a quatro vezes o 0Nresistência C RTD). Para
alta precisão, use a equação de Callendar-Van Dusen (no
Conversão de temperatura seção) ou uma tabela de
consulta para corrigir a não linearidade previsível do
RTD.
Usando Termistores
Outros sensores resistivos, como termistores (NTCs ou PTCs)
podem ser utilizados. Selecione um RREF que seja maior ou
igual à resistência máxima do sensor na faixa de
temperatura de interesse. Os dados de saída são a razão
entre a resistência do sensor e a resistência de referência.
Conversor Analógico-Digital (ADC)
O ADC possui entradas analógicas totalmente diferenciais,
RTDIN+ e RTDIN-, e entradas de referência totalmente
diferenciais, REFIN+ e REFIN-. O código de saída representa a
relação entre a tensão de entrada analógica e a tensão de
referência. Uma tensão de entrada negativa produz um código
de saída 0. Uma tensão de entrada maior que a tensão de
referência produz uma saída em escala total.
O ruído de entrada é atenuado por um filtro digital “sinc” de terceira
ordem. O ruído proveniente de fontes de energia de 50 Hz ou 60 Hz
(incluindo harmônicos da frequência fundamental da energia CA) é
atenuado em 82 dB.
Detecção de falhas e proteção de entrada
O MAX31865 detecta uma variedade de falhas que podem
ocorrer com o RTD externo e cabos de 2, 3 ou 4 fios. Algumas
falhas são detectadas em cada conversão, enquanto outras são
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Conversor RTD para Digital
detectado somente quando um ciclo de detecção de falha é solicitado
pelo mestre. Durante um ciclo de detecção de falhas, o MAX31865 tem a
capacidade de desconectar a entrada FORCE de seu caminho de retorno
GND2 por meio de uma chave analógica interna.
As condições que geram uma falha estão listadas abaixo, consulte Figura
4 para um fluxograma de detecção de falhas.
• Detectado a qualquer momento
Condição de sobretensão (> VDD) ou subtensão (<
GND1) nos pinos FORCE+, FORCE2, RTDIN+, RTDIN- ou
FORCE-
• Detectou todas as conversões ADC
Resultado de conversão maior ou igual ao limite alto
Resultado de conversão menor ou igual ao limite baixo
• Detectado sob demanda iniciando um ciclo de detecção de
falhas (bits de registro de configuração (D[3:2])
VREFIN-> 0,85 x VBIAS
VREFIN- < 0,85 x VBIAS quando a chave de entrada FORCE está aberta
VRTDIN- < 0,85 x VBIAS quando a chave de entrada FORCE está
aberta
FORCE+, FORCE2, FORCE-, RTDIN+ e RTDIN- são protegidos
contra tensões de entrada de atéP45V. Os sinais aplicados a
esses pinos são controlados por chaves analógicas que abrem
quando a tensão aplicada é normalmente maior que VDD +
100mV ou menor que GND1 - 400mV. Observe que quando
ocorre uma falha de tensão, os circuitos de proteção podem
permitir aproximadamente 350FA do fluxo de corrente. Esta
corrente de fuga induzida por falha não causa nenhum dano ao
MAX31865.
Quando uma condição de sobretensão ou subtensão é detectada, o
bit D2 do registro de status de falha é definido e o ADC interrompe
as atualizações de conversão até que a falha não seja mais
detectada, ponto em que as conversões são retomadas.
Máxima Integrada │ 11
MAX31865 Conversor RTD para Digital

DETECÇÃO DE FALHA

DETECÇÃO DE FALHAS SEMPRE ATIVA

PINOS DO MONITOR CADA DETECÇÃO DE FALHAS DE CONVERSÃO

É FORÇA +, É É
FORÇA2, FORÇA-, N RESISTÊNCIA À IDT RESISTÊNCIA À IDT
RTDIN+, RTDIN-, CONVERSÃO EXECUTAR
VALOR > ALTO
N VALOR < BAIXO
N
INICIADO CONVERSÃO
PINS > VDD OU < LIMITE LIMITE
GND REGISTRO REGISTRO

S S S
PROTEJA PINOS CONTRA
±45V DEFINIR BIT D7 DE FALHA DEFINIR BIT D6 DE FALHA

REGISTRO DE STATUS REGISTRO DE STATUS

DEFINIR BIT D2 DE FALHA

REGISTRO DE STATUS DEFINIR BIT D0 DE DADOS RTD

REGISTRO LSB

ADC INTERrompe ATUALIZAÇÕES

DEFINIR BIT D0 DE DADOS RTD

REGISTRO LSB

CICLO DE DETECÇÃO DE FALHAS INICIADO PELO MESTRE - MODO AUTOMÁTICO

MESTRE ESCRITA ENTRADA DE FORÇA ABRIR

É VREFIN- É VREFIN-
100X010Xb PARA TROCAR 100µs N 100µs FORÇA- 210µs N
> <
CONFIGURAÇÃO RESTOS ATRASO ATRASO ENTRADA ATRASO
0,85 x VBIAS 0,85 x VBIAS
REGISTRO FECHADO TROCAR

S S

DEFINIR BIT D5 DE FALHA DEFINIR BIT D4 DE FALHA

REGISTRO DE STATUS REGISTRO DE STATUS

DEFINIR BIT D0 DE DADOS RTD DEFINIR BIT D0 DE DADOS RTD

REGISTRO LSB REGISTRO LSB

CONFIGURAÇÃO ENTRADA DE FORÇA É RTDIN-

FALHA FINAL N 100µs
DETECÇÃO REGISTRO DEFINIDO PARA TROCAR <
ATRASO
CICLO 100X000Xb PARA FECHADO 0,85 x VBIAS

DEFINIR BIT D3 DE FALHA

REGISTRO DE STATUS

DEFINIR BIT D0 DE DADOS RTD

REGISTRO LSB

CICLO DE DETECÇÃO DE FALHAS INICIADO PELO MESTRE - MODO MANUAL

FEZ
MESTRE ESCRITA ENTRADA DE FORÇA ABRIR
É VREFIN- ESCRITA MESTRE É VREFIN-
100X100Xb PARA TROCAR 100µs N 100µs FORÇA- S 100µs N
> 100X110Xb PARA <
CONFIGURAÇÃO RESTOS ATRASO ATRASO ENTRADA ATRASO
0,85 x VBIAS CONFIGURAÇÃO 0,85 x VBIAS
REGISTRO FECHADO TROCAR
REGISTRO

S S
N
DEFINIR BIT D5 DE FALHA DEFINIR BIT D4 DE FALHA

REGISTRO DE STATUS REGISTRO DE STATUS

DEFINIR BIT D0 DE DADOS RTD DEFINIR BIT D0 DE DADOS RTD

REGISTRO LSB REGISTRO LSB

CONFIGURAÇÃO ENTRADA DE FORÇA É RTDIN-

FALHA FINAL N 100µs
DETECÇÃO REGISTRO DEFINIDO PARA TROCAR <
ATRASO
CICLO 100X000Xb PARA FECHADO 0,85 x VBIAS

DEFINIR BIT D3 DE FALHA

REGISTRO DE STATUS

DEFINIR BIT D0 DE DADOS RTD

REGISTRO LSB

Figura 4. Fluxogramas de detecção de falhas

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Registros Internos Modo de conversão (D6)

A comunicação é feita por meio de oito registros de 8 bits
que contêm dados de conversão, status e configuração.
Toda a programação é feita selecionando o endereço
apropriado do local de registro desejado.tabela 1 ilustra os
endereços dos registradores.
Escreva 1 neste bit para selecionar o modo de conversão automática, no
qual as conversões ocorrem continuamente a uma taxa de 50/60Hz.
Escreva 0 neste bit para sair do modo de conversão automática e entrar
no modo “Normalmente desligado”. Conversões únicas podem ser
iniciadas neste modo.

Os registradores são acessados usando os endereços 0Xh para 1 tiro (D5)

leitura e os endereços 8Xh para escrita. Os dados são lidos ou
gravados primeiro nos registradores MSB.
Cadastro de Configuração (00h)
O registro de configuração seleciona o modo de conversão
(automático ou acionado pelo comando 1-shot), habilita e
desabilita a tensão de saída do pino BIAS VBIAS, inicia
conversões 1-shot, seleciona a conexão RTD (3 fios ou 2 fios/
4- fio), inicia um ciclo completo de detecção de falha, limpa o
registro de status de falha e seleciona as frequências de
corte do filtro. Os efeitos dos bits de configuração são
descritos abaixo.
VIÉS (D7)
Quando nenhuma conversão estiver sendo realizada, o VBIAS
poderá ser desabilitado para reduzir a dissipação de energia.
Escreva 1 neste bit para ativar o VBIAS antes de iniciar uma
conversão única (1-Shot). Quando o modo de conversão automática
(contínua) é selecionado, o VBIAS permanece ligado continuamente.
Quando o modo de conversão estiver definido como “Normalmente
desligado”, escreva 1 neste bit para iniciar uma conversão. Isso faz
com que ocorra uma única conversão de resistência. A conversão é
acionada quandoCSaumenta depois de escrever 1 neste bit. Observe
que se uma gravação multibyte for executada, a conversão será
acionada quandoCSvai alto no final da transação. Se VBIAS estiver
ativado (conforme selecionado pelo Registro de Configuração), a
tensão do RTD será amostrada quandoCSsobe e a conversão
começa. Observe que se o VBIAS estiver desligado (para reduzir a
corrente de alimentação entre as conversões), quaisquer capacitores
de filtro nas entradas RTDIN precisarão ser carregados antes que
uma conversão precisa possa ser realizada. Portanto, habilite o
VBIAS e aguarde pelo menos 10,5 constantes de tempo da rede RC
de entrada mais 1 ms adicional antes de iniciar a conversão. Observe
que uma única conversão requer aproximadamente 52 ms no modo
de filtro de 60 Hz ou 62,5 ms no modo de filtro de 50 Hz para ser
concluída. 1-Shot é um bit autolimpante.

Tabela 1. Endereços de registro e estado POR

NOME DE REGISTRO LEIA O ENDEREÇO (HEX) ESCREVER ENDEREÇO (HEX) POR ESTADO LER ESCREVER
Configuração 00h 80h 00h R/W
MSBs de IDT 01h - 00h R
LSBs RTD 02h - 00h R
MSB de alto limite de falha 03h 83h FFh R/W
Alto limite de falha LSB 04h 84h FFh R/W
Limite de falha baixo MSB 05h 85h 00h R/W
Limite de falha baixo LSB 06h 86h 00h R/W
Status de falha 07h - 00h R

Tabela 2. Definição do Registro de Configuração

D7 D6 D5 D4 D3 D2 D1 D0
Conversão 3 fios Status de falha Filtro 50/60 Hz
VBIAS 1 tiro Detecção de falha
modo 1 = RTD de 3 fios Claro selecione
1 = LIGADO 1 = 1 tiro Controle de Ciclo
1 = Automático 0 = 2 fios ou 1 = Limpar 1 = 50 Hz
0 = DESLIGADO (limpeza automática) (ver Tabela 3)
0 = Normalmente desligado 4 fios (limpeza automática) 0 = 60Hz

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3 fios (D4)
Escreva 1 neste bit ao usar uma conexão RTD de 3 fios.
Neste modo, a tensão entre FORCE+ e RTDIN+ é
subtraída de (RTDIN+ - RTDIN-) para compensar os erros
IR causados pelo uso de um único fio para as conexões
FORCE e RTDIN-. Ao usar conexões de 2 ou 4 fios, escreva
0 neste bit.
Ciclo de Detecção de Falhas (D3:D2)
O ciclo de detecção de falhas iniciado pelo mestre possui dois
modos de operação, temporização manual e automática. Se o
circuito de interface RTD externo incluir um filtro de entrada
com uma constante de tempo superior a 100Fs, o tempo do ciclo
de detecção de falhas deve ser controlado na operação em
modo manual. O ciclo de detecção de falhas verifica três falhas
fazendo as seguintes comparações de tensão e definindo os bits
associados no Registro de status de falha:
1) A tensão no REFIN- é maior que 85% x VBIAS? (bit D5 do
registro de status de falha)
2) A tensão em REFIN- é menor que 85% x VBIAS quando a chave de
entrada FORCE- está aberta? (bit D4 do registro de status de
falha)
3) A tensão em RTDIN- é menor que 85% x VBIAS quando a chave de
entrada FORCE- está aberta? (bit D3 do registro de status de
falha)
Observação:Todas as tensões são referenciadas ao GND1.
OInformações sobre aplicações fornece tabelas para decodificar possíveis
causas de bits de status de falha definidos.
Para entrar no ciclo de detecção automática de falhas, escreva
100X010Xb no registro Configuração. O ADC está agora no
modo “Normalmente desligado”. O ciclo de detecção automática
de falhas insere 100Fs antes da verificação de falhas, permitindo
assim que o filtro de entrada externo se estabeleça. O
Tabela 3. Bits de controle do ciclo de detecção de falhas
REGISTRO DE CONFIGURAÇÃO
D3 D2
ESCREVER (BINÁRIO)
0 0 XXXX00XXb
0 1 100X010Xb Detecção de falhas com atraso automático
Execute a detecção de falhas com atraso manual
1 0 100X100Xb
Conclua a detecção de falhas com atraso manual
1 1 100X110Xb
X = Não me importo
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Os bits do ciclo de detecção de falhas (D[3:2]) são apagados automaticamente para 00b após
a conclusão.
Para entrar no ciclo de detecção manual de falhas, primeiro certifique-se
de que o VBIAS esteja ativado por pelo menos 5 constantes de tempo. Em
seguida, escreva 100X100Xb no registro Configuração. O ADC está agora
no modo “Normalmente desligado”. O MAX31865 verifica falhas
enquanto a chave de entrada FORCE está fechada e, quando a verificação
é concluída, a chave de entrada FORCE abre. Os bits do ciclo de detecção
de falhas (D[3:2]) permanecem definidos como 10b. Novamente, espere
pelo menos 5 constantes de tempo e então escreva 100X110Xb no
registro Configuração. O MAX31865 agora verifica falhas enquanto a
chave de entrada FORCE está aberta; quando a verificação for concluída,
a chave de entrada FORCE fecha e os bits do Ciclo de Detecção de Falhas
(D[3:2]) se auto-limpam para 00b. Observe que se 1 for gravado em D5 (1-
Shot) e D2 ou D3 em uma única gravação, ambos os comandos serão
ignorados. Se 100X110Xb for definido sem o início prévio da primeira
etapa manual (configuração 100X100Xb), o modo de detecção automática
de falhas será executado.
Status de falha apagado (D1)
Escreva 1 neste bit enquanto escreve 0 nos bits D5, D3 e D2 para retornar
todos os bits de status de falha (D[7:2]) no registro de status de falha para
0. Observe que o bit D2 no registro de falha e, subsequentemente, o bit
D0 no registro RTD LSB pode ser definido novamente imediatamente
após a reinicialização se uma falha de sobre/subtensão persistir. O bit D1
de limpeza do status da falha é auto-limpado para 0.
50/60 Hz (D0)
Este bit seleciona as frequências de corte para o filtro de rejeição de
ruído. Escreva 0 neste bit para rejeitar 60Hz e seus harmônicos;
escreva 1 neste bit para rejeitar 50 Hz e seus harmônicos.
Observação:Não altere a frequência de notch enquanto estiver no
modo de conversão automática.
ESCREVER AÇÃO LEIA O SIGNIFICADO
Nenhuma ação Detecção de falha concluída
Detecção automática de falhas ainda em execução
O ciclo manual 1 ainda está em execução; esperando por
(ciclo 1) usuário para escrever 11
O ciclo manual 2 ainda está em execução
(ciclo 2)
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Registros de Resistência RTD (01h−02h) resistência à resistência de referência. D0 do registro

Dois registradores de 8 bits, RTD MSBs e RTD LSBs, contêm os dados de RTD LSBs é um bit de falha que indica se alguma falha do
resistência do RTD. O formato dos dados é mostrado em Tabela 4 . O RTD foi detectada.
formato de dados é simplesmente a proporção de 15 bits do RTD

Tabela 4. Definição de Registros de Resistência RTD

REGISTRO RTD MSBS (01h) INSCREVA-SE RTD LSBS (02h) INSCREVA-SE

Pedaço D7 D6 D5 D4 D3 D2 D1 D0 D7 D6 D5 D4 D3 D2 D1 D0
IDT
Resistência MSB - - - - - - - - - - - - - LSB Falta
Dados

Pedaço
214 213 212 211 210 29 28 27 26 25 24 23 22 21 20 -
Ponderação

Decimal
16384 8192 4096 2048 1024 512 256 128 64 32 16 8 4 2 1 -
Valor

Tabela 5. Relação Resistência-Dados de RTD

BINÁRIO HEX
RRTD/RREF DECIMAL
MSBs RTD (01h) LSBs RTD (02h) MSBs RTD (01h) LSBs RTD (02h)
0,025 0000 0110 0110 0110b 06h 66h 819
0,125 0010 0000 0000 0000b 20h 00h 4096
0,25 0100 0000 0000 0000b 40h 00h 8192
0,50 1.000.0000 0000 0000b 80h 00h 16.384
0,75 1100 0000 0000 0000b C0h 00h 24.576
0,999 1111 1111 1111 1110b FFh FEh 32.767
Observação:D0 (“Falha”) é assumido como 0.

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Registros de limite de falha (03h–06h) Registro de Status de Falhas (07h)

Os registros High Fault Threshold e Low Fault Threshold
selecionam os limites de desarme para detecção de falta do
RTD. Os resultados das conversões RTD são comparados com os
valores nesses registradores para gerar os bits “Fault” (D[7:6])
no registrador Fault Status. Os registros de dados RTD, registros
de limite de falha alto e registros de limite de falha baixo têm
todos o mesmo formato.
O bit RTD High no registro de status de falha é definido
se o valor do registro de resistência RTD for maior ou
igual ao valor no registro High Fault Threshold. O valor
POR do registro High Fault Threshold é FFFFh.
O bit RTD Low no registro de status de falha é definido se
o valor da resistência do RTD for menor ou igual ao valor
no registro Low Fault Threshold. O valor POR do registro
Low Fault Threshold é 0000h.
O registro de status de falha bloqueia quaisquer bits de falha detectados;
escrever 1 no bit Fault Status Clear no Registro de configuração retorna
todos os bits de status de falha para 0.
Interface serial
O MAX31865 suporta os modos SPI 1 e 3. Quatro pinos são
usados para comunicações compatíveis com SPI: SDO (saída de
dados seriais), SDI (entrada de dados seriais),CS (seleção de
chip) e SCLK (relógio serial). SDI e SDO são os pinos de entrada e
saída de dados seriais para os dispositivos, respectivamente. O
CSinput inicia e termina uma transferência de dados. SCLK
sincroniza a movimentação de dados entre o mestre
(microcontrolador) e o escravo (MAX31865).
O relógio serial (SCLK), gerado pelo microcontrolador, fica
ativo somente quandoCSé baixo e durante a transferência
de endereço e dados para qualquer dispositivo no SPI

Tabela 6. Definição de Registros de Limite de Falha

LIMITE DE FALHA ALTO MSB (03h) REGISTRO LIMITE DE FALHA ALTO LSB (04h) REGISTRO
REGISTRO
LIMITE BAIXO DE FALHA MSB (05h) REGISTRO LIMITE BAIXO DE FALHA LSB (06h) REGISTRO
Pedaço D7 D6 D5 D4 D3 D2 D1 D0 D7 D6 D5 D4 D3 D2 D1 D0
IDT
Resistência MSB - - - - - - - - - - - - - LSB X
Dados

Pedaço
214 213 212 211 210 29 28 27 26 25 24 23 22 21 20 -
Ponderação

Decimal
16384 8192 4096 2048 1024 512 256 128 64 32 16 8 4 2 1 -
Valor
X = Não me importo

Tabela 7. Definição do Registro de Status de Falha

D7 D6 D5 D4 D3 D2 D1 D0
IDT alto IDT baixo REFIN-> REFIN- < 0,85 x VBIAS RTDIN- < 0,85 x Sobretensão/
x x
Limite Limite 0,85 x VBIAS (FORÇA- aberto) VBIAS (FORCE- aberto) falha de subtensão
X = Não me importo

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ônibus. A polaridade do relógio inativo é programável em alguns
microcontroladores. O MAX31865 acomoda automaticamente
qualquer polaridade do clock amostrando SCLK quandoCStorna-se
ativo para determinar a polaridade do relógio inativo. Os dados de
entrada (SDI) são travados na borda estroboscópica interna e os
dados de saída (SDO) são deslocados na borda de deslocamento
(consulteTabela 8 eFigura 5 ). Existe um clock para cada bit
transferido. Os bits de endereço e dados são transferidos em grupos
de oito, primeiro o MSB.
Endereço e bytes de dados
Os bytes de endereço e de dados são deslocados primeiro do MSB para a
entrada de dados seriais (SDI) e para fora da saída de dados seriais (SDO).
Qualquer transferência requer o endereço do byte para especificar uma
gravação ou leitura, seguido por um ou mais bytes de dados. Os dados
são transferidos para fora do SDO para uma operação de leitura.
e no SDI para uma operação de gravação. O byte de endereço é
sempre o primeiro byte transferido apósCSé conduzido para
baixo. O MSB (A7) deste byte determina se o byte seguinte será
escrito ou lido. Se A7 for 0, uma ou mais leituras de bytes
seguem o byte de endereço. Se A7 for 1, uma ou mais gravações
de bytes seguem o byte de endereço.
Para uma transferência de byte único, 1 byte é lido ou escrito e
entãoCSé levado para cima (vejaFigura 6 eFigura 7 ). Para uma
transferência de múltiplos bytes, múltiplos bytes podem ser lidos ou
escritos após o endereço ter sido escrito (vejaFigura 8). O endereço
continua a incrementar em todos os locais de memória enquantoCS
permanece baixo. Se os dados continuarem a ser registrados dentro
ou fora, o endereço fará um loop de 7Fh/FFh a 00h/80h. Endereços
de memória inválidos reportam um valor FFh. A tentativa de
escrever em um registrador somente leitura não resulta em
nenhuma alteração no conteúdo desse registrador.

Tabela 8. Tabela de Funções

MODO CS SCLK IDE SDO

Desativar redefinição Alto Entrada desativada Entrada desativada Alta impedância
CPOL = 1*, SCLK subindo
Escrever Baixo Trava de bits de dados Alta impedância
CPOL = 0, SCLK caindo
CPOL = 1, SCLK caindo
Ler Baixo X Próxima mudança de bits de dados**
CPOL = 0, SCLK subindo
Observação:A polaridade do bit CPHA deve ser definida como 1.

*CPOL é o bit de polaridade do clock definido no registro de controle do microcontrolador.

* O* SDO permanece em alta impedância até que 8 bits de dados estejam prontos para serem transferidos durante uma leitura.

CS
MUDANÇA ESTROBE INTERNO
CPOL = 1

SCLK

CS

MUDANÇA ESTROBE INTERNO

CPOL = 0

SCLK

OBSERVAÇÃO:CPOL É UM BIT QUE ESTÁ CONFIGURADO NO REGISTRO DE CONTROLE DO MICROCONTROLADOR.

Figura 5. Relógio serial como função da polaridade do relógio do microcontrolador (CPOL)

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CS

SCLK

IDE
A7 A6 A5 A4 A3 A2 A1 A0

SDO ALTO-Z
D7 D6 D5 D4 D3 D2 D1 D0

Figura 6. Leitura de byte único SPI

CS

SCLK

IDE
A7 A6 A5 A4 A3 A2 A1 A0 D7 D6 D5 D4 D3 D2 D1 D0

SDO ALTO-Z

Figura 7. Gravação de byte único SPI

CS

SCLK

ENDEREÇO DADOS DADOS DADOS

ESCREVER IDE
BYTE BYTE 0 BYTE 1 BYTEN

ENDEREÇO
IDE
BYTE

LER

DADOS DADOS DADOS

SDO
BYTE 0 BYTE 1 BYTEN

Figura 8. Transferência multibyte SPI

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DRDY Recomenda-se 1 ms adicional (para a estabilização dos dispositivos

ODRDYa saída diminui quando um novo resultado de conversão está de proteção) para atingir a precisão especificada.
disponível nos registros de dados RTD. Quando uma operação de
Convertendo Valores de Registro de
leitura dos registradores de dados RTD for concluída,DRDY retorna Dados RTD em Temperatura
alto.
Os resultados da conversão raciométrica ADC encontrados nos
registros de dados RTD podem ser convertidos em temperatura com
Informações sobre aplicações
alguns cálculos.
Para operação em ambientes ruidosos, um capacitor de filtro pode
ser colocado nas entradas RTDIN+ e RTDIN-. Após uma falha de Primeiro, a resistência do RTD precisa ser determinada
sobretensão ou subtensão, após um ciclo de detecção de falha ou com a seguinte equação:
após habilitar VBIAS, sempre aguarde o tempo de estabilização do RRTD = (Código ADC x RREF)/215
filtro de entrada antes de reiniciar o ADC. Um tempo de atraso de
pelo menos cinco constantes de tempo mais um

DRDY

REGISTRO DE IDT
CONVERSÃO n CONVERSÃO n+1 CONVERSÃO n+2
CONTEÚDO

CS
DADOS DE IDT

SDO
ENDEREÇO
DADOS DE IDT

IDE

Figura 9.DRDYOperação

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Código ADC = resultados ADC de 15 bits dos registros de dados RTD determine a temperatura por meio de cálculos ou tabelas de
(01h–02h) pesquisa.

RREF = Resistência do resistor de referência No caso típico de um RTD PT100 com 400EUresistor de
Uma vez conhecida a resistência do RTD, as propriedades resistivas referência de baixa deriva de alta precisão,Tabela 9mostra
bem definidas do RTD selecionado podem ser usadas para exemplos de valores de temperatura e resistência com os
resultados do código ADC correspondentes.

Tabela 9. Exemplo de temperatura para PT100 com 400Ω RREFERÊNCIA

TEMPERATURA RESISTÊNCIA À IDT REGISTRO DE DADOS RTD CÓDIGO ADC/32-256

CÓDIGO ADC (dez)
(°C) (ω) (01h-02h) (hexadecimal) (°C)
- 200 18.52 0BDAh 1517 - 208,59
- 175 29.22 12B4h 2394 - 181,19
- 150 39,72 196 cap. 3254 - 154,31
- 125 50.06 200Ah 4101 - 127,84
- 100 60,26 2690h 4936 - 101,75
- 75 70,33 2D04h 5762 - 75,94
- 50 80,31 3366h 6579 - 50,41
- 40 84,27 35EEh 6903 - 40,28
- 30 88,22 3876h 7227 - 30h16
- 20 92,16 3AFCh 7550 - 20.06
- 10 96.09 3D7Eh 7871 - 10.03
0 100,00 4000h 8192 0,00
10 103,90 4280h 8512 10h00
20 107,79 44FCh 8830 19.94
30 111,67 4778h 9148 29,88
40 115,54 49F2h 9465 39,78
50 119,40 4C6Ah 9781 49,66
60 123,24 4EE0h 10096 59,50
70 127.08 5154h 10410 69,31
80 130,90 53C6h 10723 79.09
90 134,71 5636h 11035 88,84
100 138,51 58A4h 11346 98,56
110 142,29 5B12h 11657 108,28
120 146.07 5D7Ch 11966 117,94
130 149,83 5FE4h 12274 127,56
140 153,58 624Ch 12582 137,19
150 157,33 64B0h 12888 146,75
160 161.05 6714h 13194 156,31
170 164,77 6974h 13498 165,81
180 168,48 6BD4h 13802 175,31
190 172.17 6E30h 14104 184,75
200 175,86 708Ch 14406 194,19
225 185.01 7668h 15156 217,63
250 194,10 7C3Ah 15901 240,91

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Tabela 9. Exemplo de temperatura para PT100 com 400Ω RREFERÊNCIA(contínuo)

TEMPERATURA RESISTÊNCIA À IDT REGISTRO DE DADOS RTD CÓDIGO ADC/32-256

CÓDIGO ADC (dez)
(°C) (ω) (01h-02h) (hexadecimal) (°C)
275 203.11 81FEh 16639 263,97
300 212.05 87B6h 17371 286,84
325 220,92 8D64h 18098 309,56
350 229,72 9304h 18818 332.06
375 238,44 989Ah 19533 354,41
400 247.09 9E24h 20242 376,56
425 255,67 A3A2h 20945 398,53
450 264,18 A914h 21642 420,31
475 272,61 AE7Ah 22333 441,91
500 280,98 B3D4h 23018 463,31
525 289,27 B922h 23697 484,53
550 297,49 BE64h 24370 505,56

Detecção de falhas no cabo RTDIN+
Na configuração de conexão RTD de 3 e 4 fios, um cabo RTDIN+
quebrado ou desconectado resulta em uma entrada ADC+
imparcial no MAX31865. Isso causa resultados de conversão
ADC imprevisíveis, que podem ser influenciados pelo layout da
PCB, ruído do circuito externo e temperatura ambiente. Esta
condição de falha do cabo pode passar despercebida
dependendo dos valores definidos nos registros de limite de
falha. Se esta condição for de interesse, adicione um resistor de
10Mω do pino RTDIN+ ao pino BIAS. Fazer isso resultará em
uma medição de resistência RTD em escala completa se o cabo
RTDIN+ estiver quebrado ou desconectado.
Decodificação de condições de falha de RTD e cabo
Um elemento RTD aberto ou um curto-circuito no elemento RTD
são detectados em cada conversão com base nos dados de
resistência. Um elemento RTD aberto resulta em uma leitura
completa. Defina o limite para detecção de elemento RTD aberto
usando os registros High Fault Threshold. Se o resultado da
conversão for maior ou igual ao valor limite, o bit RTD High no
registro de status de falha é definido no final do
conversão. Um elemento RTD aberto também pode ser
detectado sob demanda testando VREFIN- > 0,85 x VBIAS. Um
elemento RTD em curto produz um resultado de conversão
próximo de zero. Defina o limite para detecção de RTD em curto
nos registros Low Fault Threshold.
Tabela 10 ,Tabela 11 , eTabela 12 resumir como as falhas de RTD
e de cabo são detectadas para configurações de 2, 3 e 4 fios e
fornecer uma descrição da causa mais comum.
Os bits de status de falha são travados até que o bit Fault Clear no
registro de configuração seja definido. Isso permite que falhas
intermitentes sejam capturadas.
Desacoplamento da fonte de alimentação
Para obter os melhores resultados ao usar o dispositivo, desacoplar o V
DDe fontes de alimentação DVDD com capacitor de 0,1 µF. Use um
capacitor de cerâmica de alta qualidade para montagem em superfície, se
possível. Os componentes de montagem em superfície minimizam a
indutância do condutor, o que melhora o desempenho, e os capacitores
cerâmicos tendem a ter resposta adequada de alta frequência para
aplicações de desacoplamento.

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Tabela 10. Decodificação de falhas de RTD para configurações de 2 fios quando bit de falha no registro LSB de dados
de RTD = 1

FALTA
DESCRIÇÃO DO POSSÍVEL DESCRIÇÃO DE
STATUS CONDIÇÃO DETECTADA
CAUSA DADOS RESULTADOS
CONJUNTO DE BICOS

Resistência medida maior que o valor do Limite

D7 Elemento RTD aberto Escala completa
de Falha Alto
Elemento RTD em curto Resistência medida menor que o valor do
D6 Perto de zero
RTDIN+ em curto-circuito baixo Limite de Falha Baixo
IDT aberto Escala completa

D5 RTDIN+ em curto-circuito alto VREFIN-> 0,85 x VBIAS Indeterminado

RTDIN- em curto-alto Indeterminado
D4 RTDIN - em curto-circuito baixo VREFIN- < 0,85 x VBIAS (FORCE- aberto) Parece ser válido
RTDIN - em curto-circuito baixo Parece ser válido
D3 VRTDIN- < 0,85 x VBIAS (FORCE-aberto)
RTDIN+ em curto-circuito baixo Perto de zero

D2 Falha de sobretensão ou subtensão Qualquer tensão de entrada protegida >VDD ou <GND1 Indeterminado

Tabela 11. Decodificação de falhas de RTD para configurações de 3 fios quando bit de falha no registro LSB de dados
de RTD = 1

FALTA
DESCRIÇÃO DO POSSÍVEL DESCRIÇÃO DE
STATUS CONDIÇÃO DETECTADA
CAUSA DADOS RESULTADOS
CONJUNTO DE BICOS

Elemento RTD aberto

RTDIN+ em curto e não
Resistência medida maior que o valor do Limite
D7 conectado ao RTD Escala completa
de Falha Alto
Force+ em curto e
conectado ao RTD
RTDIN+ em curto com RTDIN-
RTDIN+ em curto e não Resistência medida menor que o valor do
D6 Perto de zero
conectado ao RTD Limite de Falha Baixo
Force+ em curto-circuito baixo

Elemento RTD aberto

Force+ em curto e Escala completa

conectado ao RTD
D5 Força+ desconectado VREFIN-> 0,85 x VBIAS
Force+ em curto e não
Indeterminado
conectado ao RTD
RTDIN- em curto-alto
D4 RTDIN - em curto-circuito baixo VREFIN- < 0,85 x VBIAS (FORCE- aberto) Parece ser válido
Force+ em curto-circuito baixo

RTDIN+ em curto e Perto de zero

D3 VRTDIN- < 0,85 x VBIAS (FORCE-aberto)
conectado ao RTD
RTDIN - em curto-circuito baixo Parece ser válido
D2 Falha de sobretensão ou subtensão Qualquer tensão de entrada protegida >VDD ou <GND1 Indeterminado

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Tabela 12. Decodificação de falhas de RTD para configurações de 4 fios quando bit de falha no registro LSB de dados
de RTD = 1

FALTA
DESCRIÇÃO DO POSSÍVEL DESCRIÇÃO DE
STATUS CONDIÇÃO DETECTADA
CAUSA DADOS RESULTADOS
CONJUNTO DE BICOS

Elemento RTD aberto

RTDIN+ em curto e não
Resistência medida maior que o valor do Limite
D7 conectado ao RTD Escala completa
de Falha Alto
Force+ em curto e
conectado ao RTD
RTDIN+ em curto com RTDIN-
RTDIN+ em curto e não
conectado ao RTD Resistência medida menor que o valor do Limite de Falha
D6 Perto de zero
RTDIN - em curto e não Baixo
conectado ao RTD
Force+ em curto-circuito baixo

Elemento RTD aberto

Force+ em curto e Escala completa

conectado ao RTD
Força- desconectado
Força+ desconectado
Force+ em curto e não
D5 conectado ao RTD VREFIN-> 0,85 x VBIAS
Forçado em curto-circuito alto e
Indeterminado
não conectado ao RTD

Forçado em curto-circuito alto e conectado

ao RTD

Forçado em curto-circuito baixo e

não conectado ao RTD

Forçado em curto-circuito baixo e conectado

Indeterminado
ao RTD
D4 VREFIN- < 0,85 x VBIAS (FORCE- aberto)
RTDIN - em curto e conectado ao
Parece ser válido
RTD
Force+ em curto-circuito baixo

RTDIN+ em curto e Perto de zero

conectado ao RTD
RTDIN - em curto e conectado ao
D3 VRTDIN- < 0,85 x VBIAS (FORCE-aberto)
RTD
RTDIN - em curto e não Parece ser válido
conectado ao RTD
Força em curto-circuito baixo

D2 Falha de sobretensão ou subtensão Qualquer tensão de entrada protegida >VDD ou <GND1 Indeterminado

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Circuitos de aplicação típicos (continuação)

VDD VDD
CONEXÃO DO SENSOR DE 2 FIOS

0,1µF 0,1µF

DVDD

VDD
VIÉS

REFIN+ REF

DRDY REFIN-

IDE ISENSOR
MAX31865
SCLK
HOSPEDAR

FORÇA+
INTERFACE

CS FORÇA2

SDO RTDIN+

NC
CI* IDT

RTDIN-
DGND
GND1

GND2

FORÇA- * CI = 10nF PARA 1kAhIDT

100nF PARA 100AhIDT

CONEXÃO DO SENSOR DE 3 FIOS

VDD VDD

0,1µF 0,1µF
DVDD

VDD

VIÉS

REFIN+ REF

DRDY REFIN-

IDE ISENSOR
MAX31865 CABO RC
SCLK
HOSPEDAR

FORÇA+
INTERFACE

CS FORÇA2
CABO RC
SDO RTDIN+

NC
CI* IDT
CABO RC

RTDIN-
DGND
GND1

GND2

FORÇA-

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Informações sobre pedidos Informações do pacote

Para obter as informações mais recentes sobre o contorno do pacote e padrões de
PAPEL FAIXA DE TEMPERATURA PACOTE PIN
terreno (pegadas), vá parawww.maximintegrated.com/packages . Observe que um
MAX31865AAP+ - 40°C a +125°C 20 SSOP “+”, “#” ou “-” no código do pacote indica apenas o status RoHS. Os desenhos do
MAX31865AAP+T - 40°C a +125°C 20 SSOP pacote podem mostrar um caractere de sufixo diferente, mas o desenho pertence ao

MAX31865ATP+ - 40°C a +125°C 20 TQFN-EP* pacote, independentemente do status RoHS.

MAX31865ATP+T - 40°C a +125°C 20 TQFN-EP*

PACOTE PACOTE CONTORNO TERRA
+ Indica um pacote sem chumbo (Pb)/compatível com RoHS. TIPO CÓDIGO NÃO. PADRÃO NÃO.
T = Fita e carretel.
20 TQFN-EP T2055+5 21-0140 90-0010
* EP = Almofada exposta.
20 SSOP A20+1 21-0056 90-0094

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Histórico de Revisão

REVISÃO REVISÃO PÁGINAS

DESCRIÇÃO
NÚMERO DATA MUDADO
0 12/10 lançamento inicial -
1 15/01 RevisadoBenefícios e recursosseção 1
Adicionado o pacote SSOP à folha de dados e proteção de tensão de entrada atualizada para ±45V. 1, 2, 7, 10, 11,
2 15/05
24

3 15/07 Tabela 6 atualizada 16

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A Maxim Integrated não pode assumir responsabilidade pelo uso de quaisquer circuitos que não sejam circuitos totalmente incorporados em um produto Maxim Integrated. Nenhuma licença de
patente de circuito está implícita. A Maxim Integrated reserva-se o direito de alterar os circuitos e especificações sem aviso prévio a qualquer momento. Os valores paramétricos (limites mínimo e
máximo) mostrados na tabela de Características Elétricas são garantidos. Outros valores paramétricos citados nesta ficha técnica são fornecidos para orientação.

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