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Como _podcmos pelo ac ima, o Z80 trabaa
lhu com um b.:t!:ramento de dudos de n c .1m bnrrnmcnto do \ t.:1!
endereo t'le l G bits o qun lhe permite cndcrer1r ate 64 by.;s f' ,')
tcs de Intcrnamcntca CP,U 208 :.,
bits Rl\!'-1 ao pr_ogramD(:cr. EstD _membri.a , _:.j
esta d1v1d1dn cm 10 reg1stradores de O b1ts e 4
res de l 6 bits. Os r cg is tr de O bits podem ser usados . :;. I
indivic1u.Jlmc nte ou aos pares, de- 16_.-_J r-
bits.
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temos .1 conf i CJurn5o reg i[;trnclorcs;
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PROLOG!CA
Qf] C). mk:rocomputodoro3
EiJl.1Hl
[Q(f Ml\NUJ\L CP50G
fl lf 11 d !I i1 O iJ 11 11 tl li fJ 11 !I l3 l1 U ri \\ I I U
v c to r I n ": 0. r ,, I H c f r c s c
r I 1n c n to
I m6ria H
!I 'i u il l ti o 11 li ti (l u !J ti \l Q tl!l Q ij o ,j
I HcC)istr\\dor inl1icc Ir. 1
11 11 n u '' u n 'i u u 11 '' u 1:1 ti o u d 11 u e n d <l
1 inclicn IY 1
ll tl (j IJ u u ij ll t5 u i li\ u u 11 (I !lll " !l q u u il H
I 1\pontador de pilha ' sp 1
:1 () !I H Q Q fl fl IJ H f! li il 11 G U U fl fi !;l :1 H !J rJ !I
I Contador-Programa PC 1
il n o R 11 n {J s.1 11 IIIi u o u n 11 1111 H o 11
Regi s tradores uso especial
--------
DcscriZ o dos Registradores uso esp0cial
(PC)_ O PC 6 o registro rasponTt
svel pela do programa. A cada
5o que b executada o PC & incrementado. Quando h uma insij
truo de jump (salto) o novo valor colocado automatican
mente no PC. e este prossegue a partir dal.
2._Apontador de Pilha .llli r; um rec;istrador de 16 bits
que armazena o valor do PC em caso de intetrup5o ou de
chamada de subrotina. Assim apOs uma instru5o RETURN esse
valor incrementado c seu valor b colocado n0 PC para que
este prossiga a pa rtir do endereo no qual foi doda a
rupo ou a subrotina.
_9e ffi So dois reglstrai.}
dores de 16 bits que so utilizados no modo de endereamento
indexndo. Esses rc<Jistrndorcs s:Jo frequentemente usados cm
programas que utili zam tabelas de dados.
endere:amento de (I) No modo
2 de interrupo do ZG necessrio fornecer dois pares de
8 bits para que este acesso a subrotina de interrupo. Os
oito bits menos significativos suo entregues -CPU pelo bnr.
ramento de durante o ciclo de interrupo. Os oito
bits mais so que est5o armazenado s
no registrador I.
S. Registrado r refrescamento mem6ria (R) Este um rea
gistrador utilizado para fornecer os bits de enderec;amcnt o
de "refresh" das mem6rias din5micas. Esse reg1strndor mH
tomaticamcnte incrementado aps cada de busca. O
dado contido no registrador R para a poro mais
baixa das linhas de endereo j untamente com o sinal de conn
trle RFS II a CPU cst decodificano c execut<:l nd o
um ciclo de busca do c6digo de opera5o.
S:!_l2i_d<1d0. L<'l<JiCu 1\ritmbtic.:.l
A unidade l6gica e aritmbtica do ZOO trabalha coro 8
bits e efet ua as operaes:
7
- --- .


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I
I
I
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I
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G!mm PROLOGICA
E] [L!) r;l
t-1ANU1\L CP500

l\d i5o
Subtr<J ::io
ou
OU Excl.u:;ivo
Comp;:u a-;71o
Gir;H [) \\ta t1 ou direita
I n c r em c 11 t r
Decrementar
l}tivar bit
Desativar bit
Testar bit
Registrador d<: instrues e contr lc CPU :
Durnnte n cxccuc;o de um progrmna, cadn---r:stru:o
procurada na mem6ria, colocnda no reg istrador de
e decodificada. 1\ parte de contrle ge ra e checn os
sinais para ler ou dados nos
dores, contr ola a ULA e gera s inais requeridos externamente
paracontrle.
A 11
1
40
A1 o
A 1?.
2 39 A9
1\13
3 30 AO
A14
4
37 1\7
5
3G
A fi
CLK
G 35
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J2.1__
7
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o z 80
33 A3
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10
31 A1
+5V
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12
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GNO
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13
28

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15
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lN r
1G
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OUSREQ
NMI
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Mf10 19
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iiTl'l
20
21
rf

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__ _ __:._- _- .....: =-=- - .. .. \..- -
/

PBOLOGICA
f:]f) 0 microcomput0<1Qfos
[]EJCJ
OCI Hl\NUl\L 'l' tOIICO CP500
l\OHi\15 (barrumcnto de cnclcrcos)!is5o as 16 linhas
pelo endereamento elo sistema. Suas
:' 1 <.1 ' ' s o e1n t r c c il t .:1 t c c .:1 t i v .:1 s cm n 1 v e l 16 11
alto. Podem enderear irctamcnte 64K de
mcmb ria no modo leitura/escritura. Dura'nte
rcamento ele dispositivos de entrada/sald.J s5o
usudos os O bits menos significativos, podendo
enderear at 256 dispositivos para entrada/sal1
da. Durante o ciclo de refrescamento de membria
o registrador R calocado nas linhas de
o de l\0 .:1 ficando estas vlidas como lia
nhas de O endereo menos signiti6
vo e o l\O.
DOaD7 (Ba rrament o de b o por onde
os o bits de dados. t bidirecional, com
linhas ati vas em nlvel lbgico alto.
m (\lffi ciclo de sinal de snida, ativo em
n1vel baixo, indica que o ciclo de
nn corrente O um ciclo de busca de cbdigo de
opc r uiio. Esr>c si na 1 tambt!m b u ti v ado j un t'mcn te
com para indicar um reconhecimento do ciclo
de interrupc;Zlo (INTJ\CK).
MIT ( r. e qui s i 5o de m em b r i a) t si na 1 d c s a 1 da , t r e e ti
stnte ativo cm nlvol bnixo, serve para
indicar que o conte6do do barramento de
endereos b um endereo vblido para escrita
ou .l e itura de membria.
n:m'Q (r equisio de entrada/ sald.J)ii salda, treerJstate
utivo nlvel 1bgico baixo. Indica que as li,l
nhas dd endereo de J\0 a l\7 s5o vlidas para o
endereamento de um dispositivo de: entrada/salda
Um sinal de i""L{Q tambbm c gerado r-m conjunto com
o s i na 1 pu r a i n d i cu r o r c c o n h e c i me n to e um
ciclo de intcrrupno, permitindo quc o
tiv6 que a intcrrup5o colcgue seu vetar
de intcrrup5o no barramento de dados. Reconheo
cimentos de interrupo ocorrem durante o tempo
enquanto operaes entrada I sa1da nunca
ocor r em durante tal ciclo.
RD (loiturn de membriu) sa5.da, ativo em
bu i xo . Indica que a CPU neces sita de dados da
memOria Oll de um dispositiVO de (entrada/sa ida)
9
ESBREL
Av. Mal. Flcriano, 143
21060 - Rio do .Janeire, . AJ
l=r.n1> tn?1 \ ? J;1 Qnnr.
.'
... z
- -
(:;llllM PROLOGICA
(3 microccmpulodoros
Tf:CNI CO CP500

RFSH
-
1-ll\ LT
INT
ck SCI1c1i:l, trec.1stute, ativo cm
b Cl i x o r. s cl !; i n i' 1 i n d i c q u c o s d a c.1 o s d o b a r r a ii
1ncnt o d e devem ser na membria
OLl 110 d;positivo de cntradu/suld endcre.ado
n1qucl0 momento.
(refrescamento) salda, ativo em baixo. R'FSH ina
dica que os sete bits endereamento 1\0 a A6 so
vlidos para o refrescamento das membrias
rn1cas.
(estado de parada) salda, ativo em Esse
sinnl indica que a CPU cst executnndo uma
ou uma interrup5o n5o mascarada.
to nesse estado n CPU executa NOP's (no
opcratinn), puru manter o rcfrc:;camento . dns
mcmbr ius.
(requisiilo interrupo) Entrada, ativo em
xo. O sinal de interrupo b gerado por disposii
tivos de entrada/snlda. A requisio ser
didi:l ao fim da instruo corrente se o
de . contr6le de interrupo interno (IfF) estiver
c o sinal estiver desativado.
Quando a CPU aceita a intcrrupo, um sinal de
reconhec imcnto ( IORQ durante um c i c lo Mi)
gcri:ldo. J\ CPU pode responder a umn interrupo
de diferentes maneiras do comando
dado pelos IMF. o propbsito de um si4
nal de interrupo forar a CPU a cair numa
subr otina de !::ervio cnvolvidn com troca de
dados, cont rle de estado ou informao. Aps
essa subrotina ser executada i:l CPU retorna ao
ponto de onde havia sido interr ompidn e prosserl
gue de novo a pi:lrtir dai.
Os modos de intcrrup5o s5o: modo 0
modo 1
modo 2
Os f li pHfl ops da
JUinto c;,1da um
interrup5o aprescntamdsc
modos:
Os flipijflops lfFl e
de interrup5o.
IFFl
0
1
modo 0
modo 1
modo 2
IFF2 s 5o
IMFu
(j
l
1
rcsponsvcis
IMFb
0
o
1
pelo estudo
IFF2
0
1
" interrup5o
H interrupo habilitada
No modo O de intsrrup5o o dispositivo que D rca
lO
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!r.l !] PrtOLOGICA
!J
1l\tlUl\ L CPS00
QL ______________ --- --- -. ---------- ---- ---- ------- ----------- ------
-.... ..._
Nl"ll
_ .. __ _
DIJSl{Q
qui:;i t<'t. J>Odl: colocar quulgue r ins truc; iio no ban;
ri:llliCDto dit CPO esta o executnrtl. DP-ssc modo o
f<Hnece a il ser
invs do memria .
No modo 1 a CPU respondcr6 h soltunQ
do para o <:!nd erco 0038 d u modo
a pllt:tir elo e nucre;: o 0038 CJ
a pbs bave:r sido executada a subrotina de interii
a CPU volta ao ponto de parada.
NG modo 2 a Ct?U rnont.a um cndE?rco com o c:ont etlclo
c1r; re<J i :;tr<ldor. r e do vu.lor cedido polo c1i!:posiii
t ivo yue_gcrou a do seguint e modo :
tl SB
LSB
O \1 ii li li rt ti IJ;i foi ' ' U 11 U !l l:l U IIII U .:J U i1 a H !.1 lil n fi U H H ll U ti H O t1 i1 i111 tf "J
I Con l:ctH3o HcrJ is tr udor I 17 b i tn d o per i fbr i co 101
i! C !4 tl til! 3 ll i. H H lS tl !J H !l 1a rt !l \1 U \li! I) U !I /11 H IJ '1 ti fl if 11 ti f:lll H a !:l ij
onde a Cl?U ,V.:l i buscar o
roo de inicio d a subrotinn de interrupo.
( int c r :cup:iio nilo mas caraa) Entr ada , utivo na
borda de Jesc ida. A intcrrupc;5o masca radu
t em priorid ade maior que ITiT' e sempre
r econhccid J ao fim da ins truo corr e nte,
do estado dos de
h<tbili ta.: .J de interrupo. Nl"ii for<;a
camentl: n ::PU a ir. no enderecio 0H66.
0ntr adu , em nlvel bui xo . RESET fora o
contador de programa e o apontador de pilha a
z ero e ini:;iuliza a CPU incluindo:
l. Dcsab ili :a o flipUfl op habi litadot: de intcr\l
1. 11 J_)tt o.
2.Coloc a o r0gistrudor I=00
3. Col oca o registrador R=00
4. Coloca a interrupo no modo 0
Durant t? o dG reset, o barramento ende!l
reamento c dad tis colocado n um estado de alta
impe<1nc iil e -todos os contr l es ue s a 1da v5o pa;1
r a n v c 1 i na t i v o o
(r c quisi5cr barramento). Entr1:1da, ativo ern nlvel
J. 6y i co bai>.o. E:>sc Dinnl utilizado p.:11:a !;oliil
citar a liberao dos barramento s por parte da
CPU, que CS coloca em nivel para que
o disposit.ivo que os solicitou possa usmlos.
Quana o esEc sinal ativDdo a CPU coloca essas
linlws em t:lta impedncia, assim o corrente
ciclo de terminado.
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CJOfl!l
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1
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r...o r ,n
LD r , (li L)
LD r , ( I X + cl )
LD r, { l Y +d)
LD (tiL) ,n
. LD (:[ t: H:l ) , n
r..n ( 11 L) , r
L[l (l. X id) r r
LD ( 1 Y +d) , r
LD h, ( BC)
LD A I (DE)
LDl\,(nn)
LD BC) I l\
LD {DE) ,li.
LD ( nn) ,1\
:,_, _______________ _
1'1ncmun
Z80
registrador
r'.
1:e9 i strador r com valor n.
do
Car18ga registrador r com contc6do
liz,do no enucre.o (IJJ_,).
loca1
Car:r a 1:eg istrador 1: com contc6do loca..,
lizcclo no endereo (IX+ cl).
' rden acima no endereo (I'i d).
Co t.:reJa J.ocalizai:io cnuc rc-:ada por
com o valor n.
Idcrr parD endereada por
+ d)
(I I L)
(I X
1 d e111
+ d)
paru localiza5o por (IY
Carrega loc:ilizao cndcrc1;ada por
c: om o c o n t c tt c1 o d o reg i s t r .:1 do r r
Idem para localizao cndcleada por
+ d)
(H L)
(I X
1 cl cm
+ 9)
para l ocaliza5o endereada por (IY
Ca1:r ::!ga o acumulador corn o contedo ende-i
realo ( DC)
Idem para o endereado por (DE)
o acumulador c om o cont:edo
r.cado por ( nn).
Curr.:ga l ocalizao
acumul<Jdor.
(UC) C:Ot!l o con-1
lde1n
(DE:)
para a localiza5o cndctec;ada por
ldem para
( nn) ..
12
n
Av. Mal:
20080 - flro gg PJ
por
I
one 25-:r:mmr;--- --),--1._
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.......
lc,:r'
[J Kl'il PROLOG ICA
r:JUa [ll mkrtXo.npulmloJO:J
CHi.HJ
UL:>J
HJ\NUJ\L 'rECNICO
----------------- -------- ------------
LI) LIJ
1
11n
LO I X, nn
LO IY,nn
Lo II L, ( nn)
LO dd, ( nn)
LO I X, ( nn)
LD 1 'i, ( nn)
LD { nn) , li L
LO (nn) ,dd
LO (nn) ,I X
LO (nn),IY
LO SP,HL
LO SP,IX
LO SP,IY
PUSII qq
PUSH IX
PUSH IY
POP qq
POP IX
POP IY
EX OE,HL
r:: X AI:"' , li. I E' I
----------
Idem pilra o registro IY
Ca:crcga o reg i L com o
por nn e o registrndor
endereado por nn+,.
contetldo.
H com o
Idem para o s registradores dd
Idem para o registrador IX
Idem para o registrador IY
Carrega locnlizao
registrador L e nn+l
r egist rador H.
nn com COL1 te6do
com o contetluo
Idem par.:. os registradores dd.
Idem par<:\ os registradores IX
Idem pa ra os registradores IY
Car r c,J a "stuck po i n ter" com o con teclo
11 L.
Idem .?ara o de IX
I dem ;_)a r a o de IY
do
do
de
par de registrado res qq no stack
Idem pa ra IX
I d ern par a I Y
par de registradores qq
contebdo do topo do stack.
Idem para IX
Ilcm pura IY
'l'roca contet!dos de DE e 1-!L
Idem par a l\F e li. 'F'
) ]
c.:om o
. c ""'
----- .. . : .. ----- -- _______ .:.....:.___ __ ,._ --- - . ---.
. -- - 1
.-- --'-
EJOtn PROLOGICA
neJ [!!. micro<;GtniJU!r.<luffJS
r:JUr::J t-11\l'lUM.
[][)
- ------------.. , _,. _______ . ---------------
--------------
EXX
u.; P) I 111 .
EX.(SP), IX
EX (SP) I IY
LDI
LDI H
LDO
LODR
CPI
Cl?IH
Cl? S
CPD
CPDI1
ADO 1\,r
1\DD /l.,n
1\DD A,(llL)
J\DD A, (IX+d)
1\DD 1\,(IY+d)
'l'tJda t odo::; os reJ!;tradorcs de: gPral
alternativos.
do stack point:cr com coni
tcudo de HL.
ldCPI
CarreJ<.I contebdo d.:. rncm6.:i.;1 endereado
por !IL cm (DE) incremento DE e III. e
decJ:cmenta l.IC.
O
igual a
mant6m cm loop. at6 que nc
zero.
o mesmo que LDI, s que d ecr ta DE e
!!L.
O m<!::>mo que LDI H,
I! L.
sO que DE e
Complra contebdo
endereado
os \alares forem
decrementa BC.
do acumulador com n
por HL. Seta o flag z se
iguais e inc1:ementa HL e
ll C Slll () t mas efetua LUTI loop at que BC
sej<: igual l zero.
Comfarn contedo do acumulador com regis-
\:.r o s.
O ntESmo que: CPI, mas <]ecremcnt:.l3 HL e BC.
O mesmo que CPIR, mus clecr <::menta HL e BC.
Soma registrador r no acwnulador.
Soma valor n no acumulados
Soma cndcrequdo por (HL)
mulaJor.
l10 DCU..,
contebc1o por
dC un1 Lll ado r
(IX+d) no
o mosmo para o rcgistr.Jdor. IY
--------
.... .-.... --... ....... ___ . - .. - ........ ____ - - - - --
o PHOLOGIC/\
[] ,QJ Cl. micrv<

0 '::.!1
MAHUAL TtCNlCO CP5G0
------------ ---...----...- ------
B
JI.ND s
on s
)<:OR s
lNC r
INC (l!L)
I NC ( 1
INC (lY+ d)
DEC r
1\DD HL,rr
ADC HL, rr
SBC liL,r r
1\DD IX,r.r
ADO IY,rr
INC r r
INC lX
lY
DEC r r.
DEC IX
DEC
Suutrai contetldo s do .acumulador, onde s
pode ser wn registrador, um nbmero ou a
enderead.:l por (IIL), (IX+d) ou
(IYtd).
Idem, s gue subtrai o "carr.y
f 1 ag"
"E" lbg ico do operando s e acumulador. O
resultado armazenado DO acumulador.
Idem para operao "OU"
Idem paru operao "OU
In:;rementa registrador r.
In:rrnnenta localiz.:1o
(H L)
I d par a (I X+ )
ld2m paru (IY+d)
De:rementa registrador r.
s ou a par de r eg i s t r a d o r () s r r
O Llcsmo, muB inclui "c.:11. ry flag"
por
Subtrni pnr de registradores rr. do pa1:
IIL, util izando o "corry flag"
para IX
I d 1 )111 pa r <:1 l Y
In,;r.ementa par de r eg istradJtrcs r r.
Incrementa IX
para IY
Dec rementa par de registradores :. r.
I d < p H a 1 X
---------------------------
15
lo
..
---- _...1; - ' - --.. -- -------
------- .......
Clr!llll PROLOGICA
El mE! microcompuradoro:.
E:JI]CJ t-1I\NU1\L 'I'tCNlC) Cl?SfHJ
DO
DJI.l\
dt!cimal do acumulallor.
CPL
ColllplcniClll:.:l o .lcumulador.
Nt:;G
Coml'lcnwnta o acumulador c soma 1.
.CCF Cornpl ta "c ar r y f LHJ"
SCP
Sctc:1 "carry flag"
NOP
opc rao

t:
e
e:

e
e
e'
e
e

e
e
e
e
e
HALT
Pare u CPU ut que ocorru uar r.nterrupt ou
r.esEt.
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e
e
DI
Des:b.i.J.ita interrupo
EI
' !!abjlita interrupo
Ir10
Seta interrupc;:5o par.l modo "
IMl
Idetr. par a modo l
H1?.
Iderr. para modo 2
Instrues de rot.lfio e deslocamento
--- ----- -- ----- ---
RLC/\
RLA
HHCJ\
RRA
LLC r
RLC (HL)
RLC (I X+d)
RLC (I Y+d)
Gira acumulador csquerda
Idem, incluindo "carru flag"
Gir.u acumulador lJ. direita
. Idem, incluindo "carry fl.lg"
Gira registrador r A esquerda
Gira contedo endereado por (HL)
gu(n: ja.
I d cm par a ( I X+ d)
Idem parn ( IY+d)

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e
e
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e

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e
c
e
e
e
e
c
e
e
RL m O que RLC, mas inclui "carry flag"
e
e
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RRC m que RLC, mDs gira direita.
-...
O
RR m Idem, incluindo "curry f lag"
s I.J\ 5 De s .Loc a oper ando s
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O que SL/\, rnlls IJ ra b d ireita .
:.; .i.n1ul tGnell du <1 tJi ts do ncurnt1la-1
p<H <1 L, L par a 11 e 11 par a o acumulador
mas do acumulador para H, de H para
L de L parn o acumula<.10r.
teste de bits:
Bit b,r Te::;ta bit b do registro r.
Bit b,{llL) 'I' C!:; ta bit b do valor por li L.
Dit b, {I X+d) o mesmo para {IX+d)
Bit b, (I Y+d )
o mesmo para (IY+d)
Set b,r Se1:a bit b do registr ador r
Set b, ( IH. .. ) Seta bit b contetldo endereado por. HL
Set b, (I X+d) Idc;:m
para (IX+d)
Set b, Id(:m parc:1 (IY+d)
HES b,s bit b do operando s.
de c:esv io e c hamada s de subrotinas
JP nn i o incondicional pa ru pos i:o nn.
JP cc,nn Se a condio cc for desvi a
pa ra nn.
JR e
JR
c.,e
JH e
JR Z,e
JR e
.. 1P (HL)
Ca rrega PC com contetldo endereado por
(HL). ,
JP (IX) Idem .para (IX)
JP (IY) I d cm par a (I Y)
17
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De c r l: lll cn til
!je 11 :::0
reg i str o
Chama s ulnotinu
nn.
Cba111a nn S()
verCiadeir(l.
netorna d\1 subrotina
Het<,rna di3 !;ubrotin.J

Hctorna da interrupo
a cond i-7.)o c:c
Ret<rna da interrupo no wascarada.
for
Can:ega PC no stack, e c.:.lr.I1;!ga p cm PC,
pro!;seguindo a partir dnl.
Cancga acurnuludor com con du porta
n.
Cartega registrador r
porta endereada por c.
com o valor da
Carrega contcbdo da porta endereada por
C no endereo especificado por HL,
decrement a B e incrementa HL.
Iclt>.n.,
ig UD 1

efetua um loop at que B
a zero.
seja
o rr esmo que INI, mas tambm decrementa
HL.
o
HL.
n esmo
que INIR, mas decrementa
Carrega contedo do acumulador na porta n
Carrega conte6do do registrador r na por1
ta endereada por c.
Carregn porta endere<; ada c com o
do endereado por HL e decrementa B.
"
O mesmo, mas entra . cm loop at que B seja
igual . a zero.
O mesmo que OVTI, mas d0crementa HL


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sinal shift, sendo gue o pr.imciro bit a
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fique em nlvel lgico
11
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11
o bltimo
b it ter scr utilizada a entrado
serial in.

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desabilita
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fill (ill microcomputndoros
f]]E][:;, TtCNICO CP500

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l\ pL"Icd PVIII ,, p:1rtc' do crsuo, onde estilo
:1 Cl'll, ,. , i.1!; IU1r1 l:l'IWr!, r:ircuito vi clcw
de c os lJUI.! controL.11n o aC<.!!; so uos

Todos os disposi tivos cst5o mupc ndos de ucordu com a
tnbcl.J u r.eg uir:
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C.' NITH Cll l\VEI\DO
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PROLOGICA
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frH]fl
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MANU AL T!CNICO CP500
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fixo de Logo qunndo esti vermos enderenndo um dcd
tcrminudo dis posit ivo os cJcm.::ds estaro
'l'ul de mcm6rin com o oux1lio de
upenus 2 compone nt es : CISO (71LS139) c CI G0 ("/4 LS145). Acono:i
selhumos que a de n leitur a do mnnunl sejn
ncompanhada visualizao dos esquemns eltrico c
9ico dn pl<.lC) PVIII.
Obscrvnndo o esquema baixo, vemos que no CISO
conectadas as l'lHQ, que tcm'por finolidudc habilitur o
dispositivo c Al5, Al3 que por suu vez ntivam as
saldas cJo JccodificoJor.
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MRJ E ;s9
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O o .. 1 1 O 1 l l l l l O l U O O 37C9 !IMPRESSORA

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TECNICO CP500
como v1mos de endereo c
c o c 150' que ,]!; 1 i l\15 c nlll hab i 1 i tam )
segunda metade do CI58 quando est5o cm nivcl lbgico zero ou
comandam banco de RAM ir .s er ncessado
dos sinais CS2, Cl\SJ.
J as linhas l\12, nll c l\10 efctuam o contrOle do CI60,
pela das EPROM's C e D, da leitura do
teclado e do acesso ao circuito de video.
constatar pela 3 a EPROM D possui
dois endereos (37EU e 37E9) cm que eln n5o cst sendo
snda. Tais endereos parn a leitura do
tus da impressorn c sua sele5o se d atrves da lbgica
mada pelos CI' s 72,73,711,75 e BG (74LS3G, 74LS27, 74LS04,
74LS08 c 74LS32 respectivamente), como indica o a
scg ui r:
M.
1\0
1\7
1\G
1\5
A4
A3
Cl72
l.PRI1
Cl75
HABILITA
LEITURA

A2
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DO STATUS
DA IMPRESSORA
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27
VAI PARA
CS DA
EPROM O
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1
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MANUAL TECNICO CP500
\f! e'
111 :uw r r'' c>: is tem c1 comb i nacs que imped cm a
d u l : : : l' , ll.' ; l ,1 1-:1 ' 1\tl f-1 D l.' c om <jllf' O !.;ll< LPI<D Vf.t
.J ::0ro. '1\li s combin<l<r' L' t: :::;
i\lS Alti t\ 13 fll 2 All fll.O fl9 AU T\7 T\G A5 Atl T\3 T\2 T\1 T\0 IIEXT\
O O l l U 1 l l l l l 0 1 0 0 0 37EO
O O 1 l O l l l l l l 0 1 O O 1 37E9
sinal LPRD (que pode 5er gerado atrves do
dccodificador de I / 0, pelo sin"l LPIN, como scrll visto posn
t e r i o r 111 e n t c ) ir b i l i l: a r o C El S ( 7 tl U.i 2 tl tl ) , q u c c um b u f f c r
bidirecional e que traz o status da impressora como mostrado
a SCCJUir:

I J 11 I d 11 1\PG
__ _

[)11
__ _

0 1
--4----------- f)_()__
LPIN
ou
lT'tTo
r-6
+ 5 v -r-----1,.....,
s; __ -4--t- t--- . PARA O
OUT CONECTOR
_r liNIT SELECT J 1
__________
CI
95
T\ssim, se for c f c tuada uma leitura endereos 37E8
ou 37E9, no bnrramento de dados da CPU chcar o otatun da
impressoro scgui.nte maneira:
07 H BUS Y
D6,ii OUT
os ri UNIT

O impressora pronta
1 ri impressora ocupada
:j
impressora com papel
1 :i impressora o cm parel
SELECT o
"'
impressora no -selecionada
1 !i imprcssorQ ocl ccionnda
-1 O I indica de erro n imprcs-.
1 '{
c l
I
c
c
c
c

-
c
c
c-

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e-1
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p-1
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MANUAL TtCNICO CP5U0
Os (YS
1
Y6
1
Y7 c YO) podclll r.c r utilizados
pora o utr o s csti.ldos do impressora (por tJY.cmplo: ca..,
cm im[' I:Css3o gtt'lficu)
1
mus tois sinais sb podem ser
c h c c "d o s " t r v d c s o f t H <I r e
Dur <.wtc <l sclc<;i1o das J:;PHOM' s podemos observar
qu c o b ;u r "1:1 c n to d c d <1 C pU cl c s c o n c c t .1 do do r c s t ll n te
d.:l pl.:lC,"l <l.:l HHJ i cei formada pelos CI ' r; c 100 (7t1 LS
21.5 e 74L.!llU
1
como mo.Gtroclo no esquema u
segui r:
PARA A CPU
m DG D4 o)o2 01 oo
,:?_, _lE;JP13R O S A E B
Cl 90
C
PAHA O OARRAMENTO
A dirl.'o do CI90 b determinada pelos sinais Ml, ORQ e
RD
1
combinado.!:> nos Cl's 75 c 89 (74LS08 e 74LS32
mente). Assim se RD =O ou se (Ml + IOHQ) =0, o CI90 ser posi'i
cionado de forma que os <lados fluem do barramento para a
CPU. Convm obscrv H que ( ffi + IOHQ) =0 indica um reconhec imen-1
to de ( IN'l'/\Cl{).
Por outro ludo rodemo s ver que quando ErROM (ou outro
dispositivo) 6 os dos bnncoo' de R/\M1
C I ' s G 3 0 G 4 { .:1 n; b os NO T 2 G ) s ;:i o p o s i c i o n .:1 cl os cl c f o r m u l os d tl..,
dos cntrnrem n;l como nito sinol de rJ\S, nud b
lhl' HMl '
Vcj.J.) fi9.?
29
___ , __ ,_. - . -- - -----

MANUAL TtCNICO
VAI PAilA OS OANCOS DE liAM
Cl 63
Cl64
VEM DA SAiDA YO __
DO CI 50 DI DODI DODI DODI DO
__
___!.)_7 Jlr=lC,_ ""-- .
VEM DOS MULTI PLEX ADOnES Cl:?1 E Cl42
sinais
Os sinais IT7\S ,C"J'\S e t1UX sUo os responsbvcis pelo ende-i
reamcnto de linhas (ROW ADRESS STRODE), de colunas (COLUMN
ADRESS STROBE) e pe la multiplexaio das linhas de endereo
do AO a AG com A7 a Al3.
O s in<tl l\1\S 6 gerado ditetamente pelo Bin: MRQ, ap6s
passar pelo buffer, C8'1 (74LS367) e dai b distribuldo para
os tr8s bancos de RAM.
Abaixo temos representado um ciclo de leitura/escritura
de mem6riu para o Z00:
. 30
T1
T2 T 3 Ttl
' LK
~
~
....._
-AlS
[!\
ENDERE MENTO DE MEMOill
.
-
R
0-07
Dt
LI
R
0-07
DJ DOS A SE EM GRAV1 DOS
T5 TG
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A
X
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DOS
DOS
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31
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'"Jtc Qfq
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L
CICLO
DE
EITURA
CICLO
DE 1\.1
G RAVAAO
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I
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1
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cgrnrn PROLOGICA
cf!J
c
c,
miaocomputodoto3


MRa
A15
A14
Agora
dos
02
01
MANUA L TtCNICO CPSOO
fiquc.J p cxll:mo:;
G\S c nux.
AO
A1
CLK
A2
A3
CI
f\7
G1
01
AO
A9
A10
M X
o circuito de
1Y
2Y
y
4Y
A/8
c,
..
C(
c,
c4

I
cl
c;

c
c
c
c
e
e
PARAC
A4
1A
AS
A/B
AS C
MEMORit
.........,...__ e
y
AG
4
E
A1 Cl
50
AO
Logo a seguir podemos ver como um ciclo de gcra5o de
HAS, e cKS pura LlS memrias IU\M.
Ant es , necessr i o obser var que quando hb o
inicio de qualque r operao de leitura ou escritura de mcmd
ria ger ndo o sinnl de Hl\S e b efetuado o e ndereamento das
linhas m.:1i s (AO a AG) dus Rl\M' s, poi s com o
s urgi mento do sinal fill (ou m'<) , o latcl:l CICl (74LS175) 0
apagado, fazendo com gue sejam selecionadas as entradas A
nos mult iplcxcrs CI24 c -12 (7-1LS157).
32
HAM e;

c

e;
c
e
e

c:
c
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;;

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l!D t!a B PROLOG!CA
f9 9 f3 microcompuladoros
fD!riD
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CLK
CI
G1
CLK
CPU
MnNUnL TtCNICO CP500
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UJVS!J
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i
'
.,
- JR;;:.Jire,
RJ
Fene (021j
253-8005
Como v l'mos i ma o C I 61 faz com que haja um atraso de
0,19 :. ;1 c cndcrc<lmcnto das linhas (HM)) e o
sutgimenl\) Ju t;in1l lJ UI.! .:.1 dc:ts linlwo
de endereo no a com as l inhas n7 a nl3 nos CI's e 42,
No temos que um atraso d,e 9 C ns entre il gerao
do sinal MUX c o sinal CnS.
Dessa forma o CI6l gera a temporiza:5o adequada para o
endereamento das RnM's.
n sclc5o feita pelas sa1das Y0,Yl e Y2 do CI58
traladas pelas linhas de endereo Al5 e Al4, correspondendo
respectivamente aos sinais CASl,CS2 c CXS3.
Vejo a fig .9 c o esquema eltrico do PVIII.
. J3
TtCNICO CP500
Leitur,, de teclodo
O tccluc1o c formodo por matriz, cujas linhas so
'Jc de 1\C:J a l\7 c as
colunas sao formadns pelas linhas de dados de DO a D7. Dessa
forma, cada tecln possui uma hnica identificada por
uma- li nh-1 de cndcr cos c umu 1 i nha de dados.
Para cxcmplificor, vejamos o csgucmn abaixo, que
corresponde linha do tecludo:
AO
(Q) A
'< '(
o
'<
D
'<
E F
'< '(
DO 01 02 03 . 04 05 06 07
+5V
Pelo esquema da PVIII vemos que os dois barramentos
(dados e endereos) so bufcrizados pelos CI'n 34,35,51 e 65
(74LS05 c MC14050). que o barramento de dados
invertido pelo CI66 (74LS240)
Como exemplo, vejamos as duas instrues que efetuam o
teste dn tecla DREAK. Essa rotina se inicia no endereo
028DH da mcm6ria, logo csU1 contido na EPROM c, ele acordo
com a tabela de endereamento.
020D
0290
31\4038
EG04
LD l\ , ( 3 O 4 011 )
l\ND 0411
l\ _primeir_a foz com <]Ue o Z00 Jeia o contebdo
do endereo 38HHI c o coloque no registro 'fi.. Como sabemos,
tal endereo ao intcrvnlo par o
teclado, sendo que cm binbrio sua configurao b:
l\15 l\14 l\13 l\12 l\ll l\10 l\9 AO l\7 l\6 l\5 l\4 l\3 l\2 Al l\0
'o l, ,l J 0, '"-v-JL 0 1 o 0 J. 0 0 0
seleciona
salda
Yl CI5!3
sclcciona
r; a ldu ..
T6 CIGO
(tecludo)
no USilOS

- .. ......... .... ,fololll., ........ '
MANUAL TtCNICO
Como t 1s linlws de cnl1crco sJo invertidas ante'3 de ati-1
V\lrem .::l!; linh\\r. de tccludo, o cnclcrc:amLnto dilo linhus de
tccl.Jdo
Linh.:1s
1 2 3 4 5 G 7 8
1 l l l l 0 l 1
l\CJ o r .::1 vcjumos como b montada a 6 . linha de tecl<:ldo, que
aquclc1 CJllC iltlV<l em zero:
.
flP5 nrs HP5 RP5
:NT CLR 13RK t
.. _
__.
SP
'< '< '<
'<
'<. '<. '< '<
DO 01 02
03
D4 05 06 07
r.oc_1o , se cn<]u.:-,nto o ZOO cctiver cfct11ando a leitura do
endereo JU40ll tec lc1 13HEAK for no barramento
de dudos do teclado teremos:
DO 01 D2 03 D4 D5 D6 D7
l l 0 1 1 l 1 1
que aps invertido pelo CI66, cai r no burramente de dados
da CPU como
DO 01 D2 03 DS D6 D7
o 1 o
"-'
0 0 0
e ento scrb <:1 rmazenado no reg istro l\.
A seg unda instruo ento compara este valor com o
lor 04H c armazena o resultado no Logo se a
tecla 13REl\K foi acionadu, teremos 01111 no ucumulador.
j
. !
'
I
j
:
.;
..
, J
i
'
; '
, :
l
i\ ..
tORO
WR
'
BD
A7
1\6
AS

.
TtCNICO CP500
E lll1 (::._( o !:; i ti v c1 C? I / O:
1\ dr1 I / O f:eit por dois de-1
CI' 11 .(71LS130), :;;cnuo que o CI-10 b
r e !i p o n:.; l! 1 pc L1 :..; cl t o , d u :; d l :; l' r':; i t i v u r. u u 1 c i tu r a c o 1
b responsvel pelos de cscritu.
Oc dispositivor; de I/0 do tarn b6m ::;5o mapeados,
o espao da EO J FF, Veja n _figura
xo:
+5V
]
,...,.CASS OUT
G1
Y7
OUT
.
'"'G2A
.... LP OUT
69 YG
..., DRV SEL
C: G2B Y5
Y4
OUT
'
Y3
OIJT
/\4
41
hflS232 OUT
Y2
....,

Y1

A2
YO
hWiliNTMASKflEG
"\.
G1
Y7
CASS lN
I
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...
89
lN ,..,
G2A
YG
..... LP lN.
C: G2B YS
'"'AX04
Y4

Y3
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2CCSD
,.OJB
-
!. RJ
f Feme (fF1) i. ' r r
- , ..
------ -'
Vemos ent5o, que os decodificadotes s6 cstat5o
tados quundo as linhas ue endereo /\7 ,1\G c '/\5 forem l isto b
quando houver um sinal IN (caso sejam acionados dispositivos
c leitura pelo CI40) ou um sinal OUT (para dspositivos de
escrita, CI-11). .
podemos notar que ativao de uma determinada
, sa 1du ' no depe nde dus 1 inh.:1s de endereo /\l e 1\0. /\ss im
sendo a cada salda corrcspcindem quatro' endereos de I / 0.
, Como veremos adiante, na maioria dus vczcG esses quatro .
endereos agem como se fossem um bnico, mas no Gaso da
CONTROL III e da placa RS 232C, cada um endere os t em
uma funo espe cifica.
Vamos ent5o detalhar a tabela de end6reamento de I/O
que esth dada a seguir:
36
'H''*'b$'
1
48\lilfQi&WaSZIDWWM
.. . .,, .. -- ,. . .
, ____ ... .


c



t:Q
,_...
_,
,....
-c
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_,
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-I
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e
e
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g






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. . . . . ..... ... ,.," ''1''1{;)'.
" 1 ": ... iii 'l ' li .t..'-.t .. ,. 'ltrJr,' ,
1
r . . .t , ;. y
PHOLOGICA
ln f!l nl OliCT\X."QQll!XJIOOOrtlS
ll.it.iJI.a

fJCI
MANUAL TtCNICO CP500

I ENDEREO I SAlDA ATIVADA I

1 Binrio 1 llcxa 1 Leitura I Escrita 1

1 A7 1\6 1\5 All 1\3 A2 A1 AO 1 1 IORQ + rw 1 IORQ + WR 1

11 1 1 O O O X X I E0 a E3IRD INT STJ\TUS IWRINT MASKREG I

11 1 1 O O 1 X X I E4 a E71RD NMI STATUS IWRNMI MASKREG I

11 1 1 o l o x X 1 ED a EBIRS 232 IN IRS 232 OUT 1

]1 1 1 O l l X X I EC a EFIRTC IN IMOD OUT J

jl 1 1 1 O O X X 1 FO a F3l DI SI< IN I DISK OUT I

11 1 1 1 o l X X I f4 l L"7IMONITOR IDRV SEL .. I

11 1 1 1 1 O X X I F8 a FBILPIN ILP OUT I

11 1 l l l 1 x x 1 rc a FFICnss IN ICASS ouT 1

\v R I NT STnTUS
Este sinal tem por programar qual dispositivo
poder gerar intcrrup5o. feito das linhas de
dados de DO D3 , 1uc s5o no lutch, CI100
(74LS174). Nu circuito temos 4 dispositivos con.j
tralados atravbs dos sinais ENIO BUSINT, ENRTC, ENCAS INF e
ENCAS INTH.
Vejamos o esquema abaixo :
... , ,
37
J/
. ' ' ' : .
. .. w ** Lrl . . tlt.l,: ... ,.,,. ,r"
' I
\ ,
CI
100
wn INT
MAS!'< AEG
lru!QmJ" INT
EN RTC
_jD
85
C ASS .J.t-1.!...----1----o C LI\
------+-+--ICL __ K ___
d1
LEI"-fl-JR_A __
1500 OAUDS
. 3U
-t5V


232
..... ,.,
.
fl \l!Uli PROLOGICA
rn D micn.x:ompulad<JIO:l
mfi!rr::J

.r-1/\ NU/\L CPSOO
Pelo notnmos que se D3 for zero, nfio scrb pos1
s1vel a gcrai:u de intcrrup3o pelo barramento de I /O exter-1
no.
Se D2 for .:cr o nZo scrtl ']eraclo o ::;;innl lN'l' por part e do
sincronismo de v1deo.
E finalmente se DO b Dl forem ambos iguais a zero, no
ser 5o g c r ad os pulsos de N'T pc 1 o c i r c ui to lei tua de casr1
se-te cm l513U Dauds neste manual a parte referente
cussete) .
Dessa mnncira o cru pode dar nlveis de prioridade aos
diversos dispositivos, impedindo que este ou aquele gere
intcrrup5o.
1m Hl'l' S'l'/\TUS
1\s operaes de interrupfio no CP500 sfio feitas no modo
1 (H). quando um dispositivo gera interrup5o, a CPU
vai buscar a subroti na de interrup5o no e nde reo B038H de
memOria. ento b usado para efctuar a leitura do
status de intcrrup3o, descobrir qual despositivo a gerou e
dar-4lhc o tratamento adequado.
Isso b fei.to habilitando1se diversos buffers que do
acesso linhas de dados DO,Dl,D2 e D3, acordo com o
esquema abn i l<O :
IOB
SAlDA CIOS
RO INTSTATU.S ----__.j
A leitura do status de in tcrrupfio se db de uma
rotina que se inicin no endereo 003011.
n partir desse e nJerco o Z80 efctua uma varredura para
descobrir qunl dispositivo gerou a ii1tcrrup5o.
... '

j
I
i \
'
i
i .
' I
Oimlml . PROLOGlCA
rn!;l m . mlcrocomputadunla
ft'lltltB
liDei


Este tem por fun5o programar a interiupc;no no
mascarada na placa CONTROL III. Veja a seo destinada
placa CONTROL III.
RD STi\'rllS
Sua func;5o verificar qunl dispositivo na placa
CON'l'IWL III o sin . .:1l Nt1I.
RS 232 OUT
O sinal RS 232 OUT envia dados ou c omandos para a
' ctlfj

. I

t:"'
c:"'

e:"
C"
e:
C'
C'
e'
e-
e-
"
e-
e-
e-
interface RS232, proporcionando o envio do dad os, a prograi
mao de vcloc idade, ntlmero de stop bits etc, de acordo com
o endereo acess.Jdo, como cst dcscr.ito.ubaixo :
Endere-o
EO
E9
EA
El3
RS 232 IN
-----
func;:5o
Hesct d RS232
Cnrga da velocidade de oaud Rate,
Carga do registro de contrlc
Envio de ddos
n,bits
n.st. >p bit.s
par idade
Este efctuu u leitura, tanto dos como do
status da interface RS232, de acordo com a tabela abaixo:
Endereo
E8
E9
EA
El3
l'lOD OU1'
--
funo
Leitura status modem
N;;1o usado
Lcituril status da
Leitura do dado recebido
Este sinal controla o CI98 (74LS17'1) como est
sentado nu fig .l7 c tem por fun5o controlur diversos
sitivos no CP500.
MOO OlJT
J
01
C LI<
.
02
MQD SEI,.__
03
913
E N/\LT Sf;I.
.Qil
fNEXTIO_
05
DISWAII._
e-
e-
e-
e
'


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I
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""
-
.
PROLOGICA
Elr-3Em microcompulad0f03

EJrn
MnNUAL TtCNICO CP500
poJemos mont.:u a tnbcln
Dl CAS MOTOR ON
02 o SEL
03 ENALTSET
04 -1 ENEXTIO
D 5 "' D I S \'11\ I T
C ij motor do cnssete
1 liga motor do cas sete
0 n caracteres por linha
1 n 32 aracteres por linha
O d desabilita caracteres alterrl
nutivos
1 habita caracteres
vos
0 desabilita I/O externo
1 habilita I/O externo
0 d desabiljta espera de video
1 ,. habilita espera de video
Desses sinnis iremos comentar agora somqnte o sinal
ENEXT IO. l\ fun:'5o deste sinul t! babilitar. ou desabilitar:: os
trs buffers tristate (CI's 101,102 c 102, 74LS245, 74LS244
e 74LS367 respectivamente ) , que controlam a cntradn/sa1dn
de dndos no barramento du I/0, como podumoG ver no esquema .a
segui r
41
""'X'""l"'!Pt .. -
____ , ___ ..... ____ ........ - -
i:
i:
I
.t
I'
'(:

t
.):
. .i ..
l:
I
m!mlm PROLOGICA



-----
AO
WW2-
A1
XA1
A2
XA2
A3
XA3
/\4
102
X/\4
AS
A6 __
X/\ 6
A7
X/\7
f:N
y
..

DO
rn XDO
01 XD1
02
XD2
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04
101
j(D4
-t5V Q5 XD5
06 XD6
I) 07
LQI_
I RGO mn
y EXTIOSEL
lN X lN
QUT XOUT
RESET XRESET
ML__
103
XM1
IORQ XIORQ
EN
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10f3USINT

lENEXTIO
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-41'1

E']Om PRLOGICA
13 f:J.t'll mk:rocompuloooro3
[]E:Htl
t1]l1
MnNUnL TtCNICO CP500
Esse ba rramento pode ser habilitado
a OUT 236,211 do oanic. No to que quem de
termina dirc5o do barramento b. o dispositivo externo,
atravbs do sinal EXT 10 SEL. Se osso sinal for zero o bar1
ramcnto de dados ficar posicionado de forma que os dados
entrem na PVIII.
Veja que o dispositivo externo pode gerar WAIT
ouINT para a CPU.
R'l'C C I N
Se este sinal for ativndo (nlvel lgico zero) ser can1
colada o gcra5o de intcrrup5o por parte do sinal VDRV. Uma
das funes sinal (RTC, Real Time Clock) b manter
ajustado o relgio
DISK OUT
- --
A fun5 o deste sinal controlar a salda de dados ou
comandos para a placa CONTROL III, de acordo com a tabela
abaixo:
Endereo
F0
Fl
F2
f3
DISI< IN
Funo
Efetua programao do FDC
Enderea trilha
Enderea setor
Envia dados para a CONTROL III
Este sinal tem funo inversa do Disk Out, ou soja,
elo ofetua a leitura da CONTROL III, do acordo com a tabela
abaixo :
Endereo fun5o
FO L status do FDC
Fl L nt1mero da trilha
F2 L do se to r
F3 L dados
Ambos sinais (Disk in e Disk out) e suas funes
scrUo descritos com maiores detalhes na scllo referente b
CONTROL III.
DRV SEL
Quando ati vad o, este sinnl a sclc5o do drive , .
da face, . do modo de gravao (FM ou MFM), selco de estado ,
de espera ou e scle5o da prccompcnsao da gravac.
Para tanto, c uda bit do barramento de dados possuJ uma \
de acordo com a tabela abaixo :
1
D7 rl Solc5o do modo leitura/gravao em
(simples ou dupla dcnsidude, rcspec.tivamc nte) .
zero scr aclcci onudo o modo oimplco
Av. Ftfl.
%0060 - .
Feru;: (W' ' l
FM ou
Se D7
MFM
for
I
'
i.
e!Elt!l PROLOGfCA
m!J


TtCNICO CP500
DG ., Sclc:':io do cst:LHlo c)c espera ou nZto . Se 06 for zero
ni:lo sertl sclecion.:1du a (_ler<w5o do sinul
D5 ., de qruva5o. Se 05 for 1
habilita .a gura5o precompansuZlo de
04 1 Sclc:':io fuc e do disco. Se for zero, ser
sclecionada a face O do disco. Caso contr6rio scr
nndn a face 1.
D3 !'I Sclecionn drive 4 , quando ativo cm 1
02 ri Scleciona drive 3, quando . ati vo cm l
Dl Seleciona drive 2, qunndo ativo em 1
DO !4 Selcciona drive l, quando otivo em 1
AX04
De acordo c om u fig.2 (pag.l4), obscrvnmos que a
tem seu endereo conectado a um fliprlflop tipo D e no
diretamente ao burramente de endereos. Dessa forma, somente
metade da (2KD) b endercadn dirctnmcnte pela CPU. A
segunda metade (que o residente) &
quundo & ntivado o sinal
LP OUT
Sua fun5o & enyiar um caracter para a impressora. Para
isso, esse sinnl hubilitn o buffer CI94 (74LS244) e forn a
gera5o do pul s o de strobe, do CI93
(74LS123), pulso que dura nproximudumcntc 4fks ,
O caructer a ser impresso fico disponlvel nas linhas D7
a DO, apbs o buffer.
LPIN
Este sinul efetua a leitura do status da impressora,
do CI75, como j foi descrito nus pginas 29 e 30.
Veja a fig . 4 .
Cl\SS OUT
sua fun5o b criur os a serem gravudos no
cassete e npQ9ar o CI3 qua ndo da leitura.
A gravu5o 6 ntravbs de Judos Dl o D0,
que s5o aplicados a um conversor digital/anal6gico e.cnviado
diretamente ao gruvador, como ser observado aba1xo :
44
- 'd
'7$]&mjD!i$f@'WX11'rtt' ''

(.'
..
: ..

rT

v

ff1"
,.........,
'l:tr
,.........,

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"''"'$fi
f!!!tl PROLOGICA
E] !:lJ 0 mlcrocompulodoros
BDtJ
f]e:J
5V
MnNUnL TECNICO CP500
ASO
DO
Q :::::J.--,.-------....!P:li!.!rtA O
CAS
R21
.=;.0..:..1---t---IDCLR 1----------'----...J
._--;CU<
78
Av. :.
GRAVADOR
f
.
.
2
n090
u g '
f one (021) 253-80(15 I. vr. RJ
Abaixo temos u combinn5o dos dados D0 c Dl e a respec1
tiva tens5o de sulda.
Dl DO HEXn Nlvel salda
o o 0(3
0,4V
o 1 01 0,8V
l o 0 2 o,ov
cnss lN
--
Este sinul, como o prprio nome diz, tem func;o
efetuar a leitura de cassete. Mas albm disso ele tembm
pela leitura do status do sistema, informando
CPU as condies atuais do CPSOO. Para isso, este sinal ha1
bilita o CI99 {74LS244), cuja configurao est descrita a
segui r:
D7 " leitura de cassete cm velocidade baixa
D6 No definido
OS n Verifica espera de vldeo (vej a MOO OUT)
04 tt Verific<l se o I/O externo cst hubilitauo
D3 d Verifica se os caracteres alternat ivos esto
litados
02 i Verifi ca modo 64/32 caracteres por linhD
Dl ft Verifica se o motor do cassete est ligado
Di Leitura de cassete em velocidade alta
45

I
\
.,
'
! '
<'
.. !
1:
')


t!
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l l
I
; I
"', ...

Tf:CN1CO CPS0U
VlDEO
. 1\ntc!.i de descrevemos o circuito tle vitlco, verifiquemos
como os caracteres s5o formatQdos c como sUo apresentados na
tela.
caso do CPSOO existem tr&s tipos de caracteres: os
alfanumricos, os semigrficos c os especiais.
caracteres dcupam os cOdigos de 20H a
7FH, os semigrficos de 0011 n I3FII e os cspcciuis divi
1
didos entre os intervul.os de OCHI a lFH e de C0H u E'FH
. A dos caructeres c especiais
fe1tn sobre uma matriz de 8 linhas por 8 colunas, enquanto
que pnru os cuructcrcs grtlficos b umu mntriz de 12
linhns por oito co;unns, conforme cxemplificudo
07 DGQS 04 0 3 02 01 DO
CARACTER 03H
...
:;. ;.'
..
...
DO 1.7'' .
....
02
... : .::
. ..
01

. ,: .. ' ... : ..
: ' lo 03
. i . . , , ... - " ,
.. : . . . .,..
05
CARACTER ggH
Os caracteres c cspccinis gruvados
numa cnquan to os c.Jr a c teres sem ig r ti fi c os so gcr ades
no momento de sua impress3o no v1deo. No caso dos cuructcrcs
c especiais, a cada coluna corresponde uma
nha de dados c linhn do posnui um endereo
determinado na EPROM de vldco.
Ou r.;io cliviclidos cm "pixefs", Clda
pi:<cl corrc:..;ponclcnclo o um tlc gu.:1tro linhas por
quatro colunas . Este 6 o menor ponto endcrebvcl nu
CP500 (veja no manual de Dasic as instrues Set c Resct)
Cada pixel cstb associado a uma linha de d.:1dos da CPU de D0
a OS. Dessa forma, com esse conhecimento e que os
caracteres em 128 podemos calcular o
digo de um caracter g r + i co se sua upr csentao
na tela. Por exemplo, o caructer a seguir:
. .
----- - --------v--

flllPat! PROlOGICA
r!l rnicroromputadoros
DDrl
f!OI
TtCNlCO CP500
..
04
Apresenta o cdigo 2+4+32+120::166 (/\Gil), pois seus "pi-.
x c 1 5" a<.: e s o s :3 o c o r r c s p o n d e n te s a os b i t s D 1 ( peso 2 ) ; D 2
(peso 4) c D5 (peso 32). O 128 devido ao primeiro cdigo
de caracter
Aprcsenta5o no vidco
Como sabemos a varredura de v1deo feita da esquerda
para a direita e de cima para baixo, sendo que a varredura
horizontal no CP500 possui a frequancia de 15840Hz e a
tica1 a frequncia de GOHz.
3
-
/
Na figura acima est a rcprcsenta5o de
diversos caracteres. 1\ seta 1 indica a scpara5o entre
racteres, que b gerada por software (gravada na EPROM de
deo). A seta nbmero dois indica o espaamento entre duas
nhas de caracteres e que corresponde a 4 1lnhas de varredura
scparao esta que no existe no modo grfico.
A seta nbmero .indica a dire5o da varredura'horiG
zontal.
Como \.Hll;l linha tem 64 caracteres e c.uua caracter 8
colunas, temos que durante uma linha de varredura horizontal
so v ar r idos 512 pontos na tclil, sendo que a cada O pontos
41
Lf/
' - - -
I
,
I
,,
f:
PROLOGICA
[J microcompulodoros

o
TtCNICO CPSOO
r=
\'"r:riJos a do por u.11 f:;
novo.
Qu.:1ndo p3sS.1"'S0 linh.1 de o cicLo se reinicia, C
com o
Todos os C3tac:crc5
em \.:.-:'la c.:: ;..:::ss:.:i
arma:enat 1e24 ca:ac:ercs o
de "64 colu:1as x 16 -

de

No 32 s!o
512 caracteres no Isso b feito e:1dcreando1se a?enas
as posi9cs pares da mcmbria de
Dcscriilo do circuito de vidco
O circuito de v1dco no CPSOO visto como um
vo a mais de membria pela CPU. Desse modo a CPU escreve c
o v1deo as linhas de de Al5 a A0,
sendo que as linhas Al5,Al4,Al3,Al1,All e Al0 efetuam i
selco do circuito de vldeo como foi visto na seo refed
rente a endereamento de mcmria.
Como o vldco & muito mais lento que a
CPU, toda vez que esta quiser efetuar uma leitura ou
tura no vldeo, ter que esperar at que . o vldeo termine a
atual linha de varredura. Isso & feito ntravcs da gerao de
um estado de WAIT para n CPU. Tnl es tado de WAIT tem. a
de que o tempo de uma varredura hoi
rizontal.
Logo, durante . a cxccu5o de programas que se utilizem
muito do video a maior parte do tempo de processamento
consumido pela prbpria espera do v1deo.
Para oc caracteres de vldco s5o utilizadas
dua!J mcmri10 (11\xtl ), perfazendo um total de 1024 ca1
ractcrcz, o que cm tiLtimn o total de caracteres
do vldeo (Gil x lG).
O circuito de vleo pode ser dividido u11 quatro partes:
1. MultipleX\1950 da de vldeo
2. Contr l c do modo de apresenta5o no video
3 ; c gera950 de sincronismo
4. Contr6lc do sinal WAIT da CPU
Iniciaremos com o circuito de multiplexa9o da de
vldeo que pode ser visto a seguir
..,. .
J
........ ---'---""'=...;;:.-:..---=.__------------;;.-
f1 r! Ell PROLOGICA
ln rn 11\ WkJ'OC1)('l'lpuladoro3
tui::Br::l
[H3
MnNUnL T!CNICO CP500
69
Y4
Y2
VA
Y3 V -1
V 1 V/\5
70
v4 vwn
Y1 V/\7
71
Y4 V/\8
Y2 I 1\9
RSVID
49
AO
A1
A2
A3
A4 81
AS
A6
G7
rAilf\ A cru
---- ....
I
I
'
.
ffi!H!J PROLOGICA
(!j m E,1
rrumrrl
t:Jml
CHAIN
N
(.)
MANUAL TtCNICO CP500
ver pcl .:1 fi(jur.:l uCinil que as memrias de vidco
(CI02 c Ul) s5o endereadas tnnto pelas linhas de
cl.:l CPU COIIIU :;inai::;
IU, I\2,H<1 e IW proveniente:; dos contuclorcs de colu1
na;, c (qUL! :;er::io vistos
te)
O sinal RS VID 0 o por esse sctccionamcnto
Tal sinal gerado a partir do sinal VID, que nada mais
e que a sa1du T7 do CIGO (7tlLS145). O CI67 (74LS245) tem por
funo isolar o circuito de vtdco do rcstuntc, e b
do pelos sinais VRD c vvm, combinados no Cll9 (74LS08).
Dessa forma se VRD ou -VWR forem zero haver a habilitarl
o do CI67, cuju comandada pelo sinal VRD.
Esses sinais (VRD c VWR) so provenientes da . CPU, ap6s
passarem pelo multiplexador , CI70 (74LS157).
Notc-1sc que quundo os contudorcs esto endereando as
RAM's de video, os sinais . VRD e VWR vo a nlval l, pois as
entradas c 4B do CI70 esto a um rcsistor de
"pullsup".
Vamos ver agora como funciona o circuito contador.
Abaixo podemos ver seu esquema eletrico:
J.





f
'
>
a:

N ..: co a
co
ID
8
o
..,.N '<t co
a: c:l te >

....
.-1 ..J
{0>--
(.)
(.)
:X:

<5
' J

A 8 C O A B C D A B C D
""'

CLK 56A
CLK 560 CLK 20A
1
. 208
'-
-
..__
CLK a
CLK
CIR CLR
CLR
tPY
(
' (
-
----
O . sinal . CHAIN b equivalente h frequncia de clock de
10,1376MHZ di vi dido por 16, o que nos d uma frequincia
principal c1c G33,6t<IIZ. Este clock scr dividido por dois e
por quatro no CISG A (7tlLS393), resultando as frcqu&ncias
C2=316,0KHZ e C4=158,4KHZ. Esta bltima frequncia ser inje'i
tada no CI56 B (74LS393) guc um contador m6dulo
Nesse contador teremos portanto as frequncias:
C8=79,2 KHz
C1'6a39,G l<llz
C32=15U-10 Hz
HDRV=l5010 llz
r. I f1 >. ,.,
r , , , I
;'I ' . , ,, '
. .. .. ' ' ;; (
esse sinal HDRV que
nismo horizontal. Alm di sso
trada do CI20 l\ (74LS393), um
sinais
11
me' .. "
i r g c r a r os pu 1 s os . - - .:ac.t.o - -=
esse sinal serb aplicado en
1
contador m6dulo 12, gerando os

j
4


--
"'"':'


?
,,_
te;}

,.--.


-






_...,
q:i.
a
Ll=7920 llz
L2 = 3 9 6 O
L4<>1320 llz
LO .. 1 3 2 O 11 z
TtCNICO
0 sin.1l LO ser.'\ cnt5o invertido,
Cll (74LS74) e aplicado entrada
gerundo os sinais:
Rl=660 Hz
R2=330 Hz
R4=165 Hz
R8= 60 Hz
VDRV=60 Hz
dividido por do\s no
de do CI208
O que ocorrcr se o jumpcr entro RO c estiver cm. R4,
pois assim o contador atuar como mbdulo 11.
Caso o jumper esteja ligado cm R8, o circuito atuar
como um contador mdulo 13, resultando cm VDRV uma
frcquncia de 50,74 Esse sianl VDRV ir o sinal de
sincronismo vertical.
Vejamos cnt5o como esses contadores atuam no
menta das RAM's c contrOle do vidco.
Os CI's 56 A e 56 B t&m por finalidade gerar os
.os de Al a AS para a RAM de vldeo e gerar o sinal HDRV, que
ap6s passar pelo CI23 (74LS221) ir formar os pulsos de sin"
cronismo. O cI23 serve para tornar o sinal HDRV compatlvel
com o tempo exigido pela placa de v1doo (VTe01).
O CI20 D gera as linhas restantes de endereo da RAM,
de vldeo c o sinal VDRV que, de maneira anlosa ao sinal
HDRV, b injetado na segunda metade do CI23 para gerar o
sincronismo vertical.
Quando da apresentao de caracteres no vldeo, esses
contadores continuamente endereando as RAM's de
deo. Neste ponto cabe ressaltar que o endereo A0 das RAM's
no k gerado pe los contadores, mas sim por outro circuito
que vist o depois.
Os dados lido da RAM (pois nesse momento VWR=l, por
causa do rcsitor de "pullo;iup" no CI70) 1rao para o latch
CI60 (74L.S273), cujo sinal de clock te? gerado cm um divisor
(CIS, 74LS93), que scrll visto em detalhes. A nartir desse
lntch os dados se dividem em dois caminhos. O primeiro o
cominho que leva EPROM de v1deo, CI36, responsvel pela,
apresentao dos carac teres no modo alfanumcrico. O segundo
leva ao circuito grfico, composto pelos CI's 54 c 53
(74LS155 e 74LS244, respectivamente). Tanto a sa1da da EPROM
como a salda do circuito grfico se encontram no CI52 (74LS
166), que b pela serializao dos dados, para
sua aprcsenta5o no v1deo.
A seguir temos representados os circuitos alfanumcrico
e grbfico, com seus principais componentes:
-----__..;..--,
ESBREL
51
f
t-1/\NU/\L 'l'II:CNICO CPSOO
I
!
l
l

HDRV
l
r--
X1
..._
X2
..._
X3
X4
53
X5
1--
XG
1--
X7
....._
X8
G G

BL..A.WS. 10 i DLYBLANK
20 ZQVCLR -


LATCH CLK 4 DLYCHAfl
52
- '
AI-
B
c
D
E
FI-
G
H
.
--c=--e S" ""'r=v'JI.

I
'nO f"l'\
LJ ....:wo
IDl':lfll
IJCl
----------- ---- - --------------- --------------
rtCNICO
priuwirun1<.:11te u parte alfanurnbric<l do circuito .
J\ps tl!I: l
1
d!;saclo a do latch os cl.Jdos provcninntes
d.J HMI de vZ10 servi r de endereo para a de ca>J
. ractcrcs. No temos que os endereos mais baiJws da
EPROM (J\O,J\1 e J\3) s5o J"ornecidos pelo contador, CI20 A. Ou
seja, a cada pulso de JIT.DV (o que corresponde t'l varredura de
uma linh.1 tio vhleo) b increment'ado um endereo dil EPROM.
Dessa form.1 temos :
Ll3 L4 L2 Ll
o o o 0 l. linhil do caracter
0 o o 1 2. linha do caructer
o o l o 3 linhu do c ar H.: ter
0 o 1 l 4 linha do caracteJ:
o 1 0 o 5. linha do caracter
o l 0 1 6 linha do curacte1:
o l 1 G 7 linha do caracter
o 1 1 1 8. linha do c a r a c ter
1 o o o 9. linha do curacter
l u o l lO.linha do carac ter
1 o l o ll.linha do carac ter
l o 1 1 l2.1inha do caracter
Porbm u pu r ti r du 8 linha, atravbs de um circuito
auxiliar, so enviados so nQn te bruncos para a tela. Isso faz
com que entre um cara.: ter e outro hajam 4 linhas de
varredura, fazenclo a separac;o vertical entre caracb?res.
J\ :3epa rao horizontal, depende daquilo que gra-1
v ado na roembria I.:;P ROM.
Vejamos, por exemplo como se encontra grnvado o
caracter 03H . (Veja fig.2o:
ENDEREOS Dl\DOS
AlO J\9 J\0 A7 J\G J\5 J\4 1\3 [12
J\1 J\0 D7 06 DS DI\ D3 D2 Dl DO
o o o o o o 1 l o o o 13 0 o 0 0 1 0 0
o o o o o o l 1 0 0 1
}
o o 0 1 o o 0
o o o o o o 1 l o 1 o e 0 1 1 1 1 o
J
o o o o o o l 1 o 1 l
(i)
l
(i)
o 0
"0 l o
o o o o o o l 1 l 0
(i)
0 l 1 1 1 1 l 0
o o o o o o l l 1
(i)
l 0 l o 0 o l3 o 0
o o
\)
o o o l 1 1 1 0 0 0 1 1 1 1 o
J
o o o o o o 1 l 1 l 1 0 0 0 0 o
"
0 u
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-.:...,1-;.;;;.p --

t!l0
tmnam
l]!.:!l
------------- - -- .... -------
CP500
__ ..___
o clH..?9a .!1 9. linha
1
entro em t:t5o
0
C t'C: U i tO ;:llJ .) i X O :
.
06_ ---
['1_ _________ ,_ ., [ 1G
l:Q___ -------
-------------------- ---
teste c ircuito que irtl fox:ar o apagamento o f:cixe du-.
rnnte ar.; 4 de ''uttcdura que separam os caructere::; ou
du1:onte o:; rctr nc.;on horizonnl e vertical.
Gua ida :
Observe que n conbinDc;o dos ddos VD6 e VD7 o
naJ. CIJAH. 1\:;sim :
ULJ\NK::: ( tH'Kff:-Dl) <VDHV+Hi5RV)
Dessa mune i r a o s i n n )_ B LA N K s c r ze ro s c um a das s e ri
guint:cs f\)t satinfeita
1. VDIW ou II DHV for zero
2. 07 ::0 , 06::X e !.8=1
3. D7cX, c J.8::1
Durante n a presc! nta5o dos caracteres ol fanumbr icos,
vemos que c l i C) v ar it:trn de (.3011 n 7 FII c c COI I n FFII.
Logo ou D'/= 0 ou D7 c: l c D6nl. Logo na cond icn 2
e 3 podem ser c a tisfc j tas de sde que LB=l.
husim, dur ante a de caracteres
ricos, o sin.:1l C!l l\R fjca sendo igual a 1. Logo no momento em
que LO chcgt:t a l (9. linha de varredura) o sinal DLnNK vai a
zero. Eut: c 6 irrvertido e transferido pa..:a o chift r.c1t
9ister atravbs de {sinal DLY DLnNK), fazendo com que
selccionadn a c r. tradn s e rial do shift r o9;tc r.
cntr .;ldt:l o:; t .!\ at(!rl::adn, fazendo com, C]UC !;[l lalll SOffiClltC
zctos na Si.l 1da ser ial.
Entfio, durante linhas de varredura (da 9. 12.)
o v\dco fica npagudo , separando os caracteres. Tambm
r <.ln te os rctr a<;os ll o I i zon tal e ver i cal, o v hlco se man
apagado.
54

PHOlUtJI C/\
[](2J 1::::1 rflkt'OC<. U:J
l1EHJ
[]C)
-------------------
MhNUAL rtCNICO CP500
1'!;1:; < caractcrC?!> <Jrtlficos o s iti
nul BLMII\ L:lliV<htO por VDHV Oll l!OHV . lS!:iO !iC dC)V a o
do o do!; grtlficos <)::itur c ontido entre
0011 c tii:'ll, D7=). e DG:.-:0, dC?sabilitando cnt5o o
L8.
1\ssim, o d;,1s quatro linhas in:t.bido r.c o
caracter que estiver ser:do presentado for
7\baixo temos o circuito de gcrno dos
racteres grbficos .
Q_Q_r1-;;--
2CO
1C1
53
2C1
D.1. __ 1C2
2C2

l.4 LO
,.,
..
Q
3
J;.
4 Q
54
5 F
"
G. ______ J:
7
u t-t
lOLY GRAPHIC
Como pod emos observar na figura acima os b its OG c 07
no entram no rnultiplcxucor CIS4 (74LS153), pois estes so
usados para gQrar os si nais DLY GRAPIIIC c OLY CHJ\R.
Quando da apresentao de caracteres grbficos, DLY
c DLY CHl\H=l, o que forr,a a dcsabilitullo ela EP1.10M
de v1dco c a habilitar,5o do CI53. O multiplcxaclor CI53 6
controlado pel o contudor 20 /1. das linhas LU e L'l .
Como exemplo vejamos como feitu a aprcscnta5o do
c a r ac t e r 991-l-1001 1001 (fig .20).
L8 L4 L2 L1 os 04 D3 D2 Dl 00 Y1 Y2 li G F E o c B A
13 .o o o o
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1 o 0 l 1 o 1 1 J. l
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1 0 0 o o 1 l G 0 l l o l 1 1 1 o 0 0 0
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-1 1 1 1
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1 o 1 1 o 1 l o o 1 1 o 1 l 1 1 o 0 o 0
Av.
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'l'f'n
5
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q
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flB PROL0GICA
UDJ

t;Jm
------------------------------------ - - --'""'t-'1-----------
MnNUAL
Note que" d;1s LIJ c IA faz . .;om qu0
jnm do multiplex.:ldor <1 cuda 4 linhas ue
vari:elurc.1. bits controlam as O colun;:.s, 4
colunas paro cuda bit. Observe que a fun5o do CI54 blod
quear o sir1al nc' de estarem sendo .:q_nesentados
caracteres e dar o fan;out ncccssrio aon 4
de saidn.
agora ao modo de apr esen taf1o no v i duo.
Como s ub0rnos, a t.elu do pude Gr formotadn cm 64
ou 32 cnrnctcrus por linhn do software.
Por exempl o , entre no Dnsic residente (ou disco) do
CP500, apague n tela c digitt? a seguinte instruo:
?CHH$(23)
I\ tela deve tc:r mudado para o formato expundido. n9orn
diq i te vllr ius h!tr.as e tecla <EtlTER>. enl:ZLO <l im;.J
trullo:
?CHH$(20)
Sobturam espaos em branco. Isso se deve ao fato
de quando da aprescntiH;o cm 32 caracteres por 1 inha, serem
usados somGnt.e or, endcrecrou pares da RAM clt? S01ncntc
surUo apresentadon 512 :axacteres . ( 32xl6) nesse modo.
Vejamos ent5o como isr;o b feito.
Lembremos que as RAM's de v1deo s5o endcreadac pelos
con tadorcs, c om e"ce<;) do endereo l\0 que forncc: ido
sinal Cl, proveniente dJ circuito nbaixo:
5.0600MHZ
,-'"'--
L __ 1B 3Y .c.uAlN... __
---lA
5
_r 20
-...
2YI..::C::..:.1 __ _
[
- 1\IN
_ .. ___________ :_


--
1\
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...

. .... ....,
!!')
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r:JlJE:!l PHOLOGICA
({: mtn:>COilliNIJ<IUIC:I

"'Wl IW.l .
--------&-------- --- ------ --- --
111\ llU/\L 'l't:CtHCO CP5013
I
1\ partir do c ircuit.o mostrado no pagina anterior
que se MOO SEL for igmu a zero, teremos a seguinte collf<Jll1
tac;5o nu salclt1:

Cl =SHIFT/l= 633l<llz
SHIFT=l0.1376Nl!z
O sinal CHJ\IN u frequncia principal de v1dco, que
ir <jetar os sinu is de !;iucronismo horizontal, e
endereos das Hl\1-1
1
s, conforme visto anteriormente.
O sinal Cl 0 o endereo 1\0 Hl\M' s o o siral t;hift c
o rcsponsvcl pela serializac;:o dQs dados no shift registcr
c pela ger<H;-Zo do sinul latch, aps ter sido dividido pelo
CI5 (74LS93). lJUe o r.inal latch c gerado il cuda O
shifts, ou seja, a cada oito colunas impresso s no
Veja ento o que acontece quando o sinal MOO SEL muda
para 1:
C til\ I N = S lU FT /O= 6 3 31\11 z
Cl=>O
StHFT=5 .IJGOL!I'!llz
1\ frequnci u bllsica no mudou, mas muclnram sinain
Cl, shift e latch.
Sendo o sinul Cl oo endereo .A0 das
RAM's e como os contadores acessam as Rl\M's de vldeo somente
p.ua leit ura, vemos que s6 sero lidos os cnderec,os pnres
d . .l membr ia. VeHios tlmb6m que sendo shi ft c latch corH: spon:;
dt;?nte tnet ade do tempo a1terior um ponto ficar exposto nu
o dobro do C!Xpandindo o caracter.
Passemos cnt 5o no de CJCrao de Wait para a
CPU.
como dito .:mteriorrnente, toda vez qun u CPU
t<?tltar o vldco c sendo nprcscnt;)do um C<:IJ:uc>J
t<?r, o circuito de v1c1co um sinLil de wait para a CPU .
Logo a CPU !.; pode l!r ou escrever no vldco, dut:ant e os
n ve:: ticais ou ns quatro linhas
de ap.:t)amerito gue scp.:uam u!.> linhas de
l\ sel)uir vemo:> o cir<:uito de C.Jero de Wait.
57
)/


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ii .
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PFtOL'OGICA
3rl\. mkmcc>nliJIIIJd<lltl!l

l3ll!B_ --
----------- --------.. --------------
NANUhL TtCNICO CP500
CLOCI<
--- D
VID
.------l=>--D-CLK ---o--1
flll.lit) D Q -
RSVID
CLK Q --
------1-...i
- .-
LATCt-1
Observe que o sinnl PULANK gerado pela combinao do
sinal BLANK e DISWAIT nu porta ANO, CI39 (74LS00). Lcmbrcflse
que o sinal DISWAIT t gerado a partir do sinal MODOUT e do
bit OS, no Cil00 e serve para desabilitar a gerao de WAIT
para a CPU.
Ento se o sinal PBLANK for zero (BLANK ou DISWAITcO)
teremos, apbs um pulso de latch, 0 no pino 10 do CI16 c 1 no
pino 5 do CllS. Isso forar 1 na salda O do CI16.
Logo teremos o sinal PWAIT igual a 1, pois a cnd.
trada 4 do CI19 cstar em 1 em consequGncia do Cll
no estar apagado.
Assim, caso o sinal VID seja igual a zero, este passar
para a do CI17 (74LS74) invertido o forar o sinal
RSVID para zoro, o que fad1 a multiplexui3o dos cJe
v1deo, permitindo cntBJ que a CPU leia ou qscreva nas RhM's.
Porm, se o sinul PDLANK for igual a 1, teremos 1 no
pino lO do CI16 e o n) pino 5 do CilG. Isso fora o sinal
RSVID cm 1 , fazendo co1n gue os contadores enderecem un HM1' s
ngora, se o sinal VID for a zero, que a CPU
ir fazer uma leitura ou esctitura RhM's de v1deo,
mos O na sa1da O do CI 16, o que forara o sinal PWAIT em 0 ,
gerando assim um estudo de \'11\I'l' passa a CPU, ate que o !:; inal
P B LI\ N 1\ v ll il O "
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58

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PROLOGICA
liEI m rnlcrocompulttduru!l
r. ..
la[]
MnNUhL TtCNICO
No CPSOO u em 1<7 d(? um cont
versar cfctuodl de duls velocidldcs
diferentes, sclccionveis por software: 500 c bauds.
Vomos discutir como os dados s5o grovldos
no fit;J, para depois c>\ aminurmos o circuito de gravao.
Como sabemos, existem dois tipos de programas
tcs que podem ser g r .JVad)S em fi ta: os que es t'5o cm Das i c e
aqueles que esto em l"inguagem de (SYSTEM). Pura
cada um desses tipo:.; ex Lste um formato diferente de grnvan
co. para que 01:orra a leitura tanto de uma fita em
modo SYSTEM, como para uma fita em DhSIC necessrio que
huja um sincronismo inic.L ul dos da.dos gruvudos nu fita.
Para isso, no inlcjo de qualquer programu s5o gravados
255 bytes de zeros e um byte correspondente a.o valor
A parti r dn 1 comenn1 n s mudunas.
Pilra progrumas cm llasic, oo byte h5 scgucm-1se 3 bytes
Co3 e cbdigo ASCII do notn<! do progrnma. Logo em seguido estilo
gravndos os cbdigos bcxc:,c.lecimais dos instrues Dl\SIC (de
<::.corda com a pag.l62 dc1 manual de operu5o) e os cbdigos
ASCII dos textos. O do programa indicado por dois
bytes consecutivos a zero.
J para us fitas no ' modo SYSTEM, ao byte de sincronismo
segueoise um byte S5H, pnra indicar que a fita est.l no
to SYSTEM. Em seguida v&rr seis bytes reservados paru o
go J\SCII do nome do programa e um byte 3C, indicando inicio
de bloco.
Cada bloco contm 256 bytes e <:tpbs o byte 3C de inicio
de bloco, vem um byte correspondente a-o endereo menos
s ig ni fica ti v o de c.:-Hg a do bloco c um byte contendo o cnder
o mais signifi c ativo de carga. Ao fim do bloco, existe um
byte correspondente ao chccksum desse bloco, culculado cm
mbdulo 2 56.
J\ partir dai sucedcmtsc os blocos, sempre iniciando com
3CH, at que seja encontrado o caracter 78H, que indica o
fim e programo.
Em a esse :aracter 78H esto dois bytes que
indicom a partc menos c mais significativa do endeteo c
inicio do programa.
os dado!.i p<Hl :>erem gravados em velocidade baixa so
codificados de acordo c1)m l figura abnixo, que mostro a
fprma de onda do dado 511 (0101).
SINC. O SINC. 1 SlNC.
o SINC.
1
_I
5)
--------------------------------------------------
l!UEB P.ROLOGICA
ll3CJ mUocompuludoro:l
l[]fJ[3
Ir!(})
MANUAL TtCNICO
QE_era<,.:JlO leitura o comprimento de um
!;etor do di sco pode ser L20, 252, 512 ou tanto
no formuto 1:'11 com 1'1::'11 (simples ou dupla d<msidad e ,
rcspec ti vamcn te) Isso determinado por um byte especial no
campo de identificao. Se o byte de comprimcnt0 de setor
for OOH, o setor pousuirtl 1213 bytes; se for CHH de 2!)G
bytes; se for 02!1 de 512 bytes e se for igual D 03H o
compr imcnto do setor s9rtl igual a 1024 bytes. o de
por tril ha deve entre 1 e 255 setorcs.O ntlme:.:o
de trilhas deve e star enl:rc 0 e 255 trilhas.
Para opera es ele l<:itura, o fDC 1793 regucr HEl\D
[lATA, ou seja, os d.ados vindos diretament<? do disquete, com
'pulsos de 250ns por' transio de fluxo <? um sinal de clock
(READ CLOCK) indicar os entre ele
fluxo. Esse sinul de clock pode ser obtido por PLL
(caso do CP500), tcnicus de contador es e circ:uitos "onc
!:;hot". Em adiuo for r. ccido um sinal "Read Gate" na salda
pino 25, que pode ser usado para obter o inici a l
d o PLL. Quando da leitura em dupla densidade, "Hr::Dd Gate" 6
rnantido ativo 4 bytes de 0011 ou fFH, se esGc::. sflo
detectados.
Durante operaes de leitura, (WG=0), o ninal \'VI:'
fornecido sincronizao do circuito PLL . Nns operaes
de leitura cm qisco o sinnl "data request" (DRQ) ativac1o
toda vez que o de dados carreg ado. Esse sinal
apagado quando os dados so lidos pela CPU. Se o rcgistraa
dor de dados 6 lid? aps um ou mais caracteres terem sido
perdidos, o bit dl] : "Lost Duta" b sctado no de
status. I
5lc disco .: a o
sinal "write (\'IG) iltivado. Caso o sinal
11
\-lrite
pt:otectcd" cstc:ia cm nivel lgico bnixo, todas n:c;
de gravuo silo inibida :; , o bit de
11
writc pro t ectcd
11
do
de status 6 :;etado gerada uma requisio de
interrupo.
Para opcru qs de escri tu o FDC 1793 utiliza as saidas

11
\-Jtite gat
11
e "Hrit<! data
11
(WD). Os dados de gravao
consistem de pulsos de ns no modo MFM (DDEN=0)
durante a gravao, ! doi!> sinais adicionais so usados para
prccompensano da yravaZio. so eles: "early" e "lnte
11

"Early" 6 ativado gltando o pulso de gravao deve ser
adiantado e "late" i b <:ttivado quando o pulso deve ser
atrasado. Desde . a p1ecompensao de gravao varia de
ncordo com o modelo de drive usado e outros fatores
intr1nsecos do disco, ; o seu real valor , determinado por
circuitos
11
one shot" ou. per de ntrasO localizados
tonamente ao FDC.
l\ cada dado ativado o sinal "Data request",
informando que o registrador de est vazio. Esse sii
nal resetado quando o registrador de dados carregado com
um novo byte. se :um novo dado no e carregado durante o temrl
po cm que o prximo byte serial i zado , gravado um byte
---------
;
;;
,,
'
"
.
.I
I
!
TtCNICO CP500
_Reg de dados : essE: registrador
tem por funo montar os dados lidos serialmente da entrada
de leitura de dados READ) durante operaes de leitura
e de serializar os dados para a salda wo, durante no
cs de 9ravnfio.
Registrador c.le 9<dos : esse reg istrauor llsado durc:mte
operaes de leitura ou gravao de dados. Durante operaes
de g rav allo de dados, 3Stes sUo transferidos do "Heg i t;tr ado r
de dados" para o
11
teJ istrador de deslocamento de dados".
Durante a de leitura o fluxo b
l3!:.9.._!.;>trador de : durante operaes do gravao
esse reg1strador Cnt.Sm o setor no qual o dado sur C)ravado
e durante operaes leitura, esse reg istraclo1: o
do setor do qua .L o dado foi lido.
. . istrador .!:,:=ilha : a funo desse reg if;trauox: b
1nd1car em qual tr1lha o dado ser gravado e de trilha
foi lido. O do registrador de trilha 6 cornpar.ndo
com o nt1mero 91:avudo no campo de idcntifica5o do setor
rante operaes de grilVaUo, leitura c verific.l5o (Obs:
essa comparao valida para o registrador de
!te9 de :
comando a t ualmen te em
barramento de dados da CPU.
esse registrador contm O
Esse comando carregado do
Registrador de status : A funo desse registrador h
indicar o estado 1793 CPU.
Alm desses regjstradores, o FDC 1793 possui ainda
diversos dispositivos internos de verificao e contrle de
dados. Tais dispositivlS esto descritos abaixo :
de CRC : ut i 1 i zado par a gerar O!J .16 bits cl'o
"Cycllc Redundance Check" (CRC). funo utilizada para seu
c1culo b G (X) :x'
6
+ x
11
+ x':i + 1.
Unidade 16gica aritmtica a ULA do FDC 1793 um
comparador serial, incrementador e usados
para modificaes e comparaes com os dados gravados no
campo de do setor.
c Contrle: Todos entre o
drive e a CPU so feits por esse dispositivo.
Deletor de marca de endereqamento : esse dispositivo
9eleta o cwmpo de e marcas de
bndereamento durante operaes de leitura e gravao.
{
(


(




e


<


4--
I
..
,,
I
!'
I
'l' ECNJ.CO CP509
nlta c ur>adn somente uma t:en !:>O de
gruvao, setdo que indica5o de bit um ou zero c dadn
pelo telllpo cnt1:c doi!. pulr:;o:.:; connccuti voz , com frequGncin:.:;
que variam entr e 13201-l z ("l") e 2G80llz ("C1
11
).
Passemo s ento, ro circtiito de cm K7.
O b r.>' e l: v e :.1 o p c 1 a f i g u r a 31 :
5V
R21
+sv
R20
O
GHAVADOH
Como vemos o circuito de gravao em cassete
tu1do por dois flipufll)ps, cujos dados de entrada correspon-J
dem uos bitn DO e Dl. Os rcsistores R23, R21, R20 e R27
formam a malha do con"ersor DlJ\, sendo que podemos ter as
seguintes saldas
Dl
(
(
1
1
Df<J
o
1
o
1
Snid
0, 1V
0,!3V
O,I3V
n5o usado
o contrl e do clcck dos efetuado pelo
nal CASSOUT (porta FCH)
observe que tanto para velocidade alta baixa, o
circuito de g;:avat;o o mesmo.
J para leitura, existem dois circuitos separados, um
para vel ocidade.
Vejamos pr imeiramente o circuito de leitura em 1500
bauds, representado a seguir
.-.. - --- --- ------
GO
b







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.. ...
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U

; __.i,i.:'..
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'rLCNlCO CP500
+5V
CASS

cRut_Jc95
_l_
.!i
+5V
RSB
o CI96 ntua como um dclctor de pnssagem por
A funo dos rcsisl:ores R59 e R57 fornecer cm nivcl
quiescente de 50mV na cnt1:uda positiva do CI96.
O sinul do do CI96 vai pnru u linha de dodos uo,
onde b lido, c p<Hu os CI8S, onde scrvirtl puril
gerar interrup5o. Obser\c que a interrupo s6 6. gerada em
nl tl, no scndo portanto gerada em velocid<1de
baixa.
!\baixo temos o circuito para leitura em velocidade
xa :
,61
1\J:, i\ ____________________ . .::.:. ..
'' .!..
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I
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IGICA
lhlllllfO:I
. TtCNICO CPSOO

-..-,

fl52
O CI79 n 1Cl741) componentes a5sociados formam um
filtro eli1ninando o ruldo de G0Hz. Ap6s passar
por cnne filtro o b rctificado pelos urnplifican
dorc!i formndo:.; pe lo CISO e ento uplicado uo c ompa rJ
rador, CI 96 (LM339). O sinal de ent o 'invertido
pelo Cl2 (74LS 04) c apl :l cndo ao fliptlflop CI3 (74LS74). Para
cada pulso recebido, t! apugac.1o pelo
CASSOUT. O sinal de saida lido pela linha de dado5
07.
J
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I
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I,
I
PROLOGIC/\
rn miqocompuladorus

Q]OJ
--------
--------------------------------- ------------
.MhNUAL TtCNICO CP500
DESCRInO DOS fRINCIPniS COMPONENTES DA CONTROL III
1. E'DC 1793
O FDC 1793 l! um c:ontrolndor de drivcs de 5"1/-1 ou de U"
que as hmes de mov imen taZio da cabe do dr i v e,
gravao e lei tu r a de dados corri verificao ( CRC) , podr.mdo
operar nos modos de simples ou dupla densidade.
Abaixo vemos a de sua pinagcm
I
-
NC
1 40
+12Y.

2 J.O 39
INTRQ
] Jl.O 30
_!)AO
HE
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4 l.O 37
5DEN
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Vir!
_D:?L 9 FDC1793
32
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WG
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12 29
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RG
fAnJ:L. 17
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C LI<
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10
t/J23
HLT
.MI1
1U
22
TES!
Qtill_ 20
;
21
+5V
De ser io da pi nagcrn
q no conectado, Internamente este pino est ligado
ao s ub s trilto lo chip e deve ser deixado. desconeca
tado.
2csWE o (\'JRl TE ENn BLE) um nivel 16g ico ba ixo nesta entral
da f az com o FDC efe tue a leitura dos dados
c ontidos no barramento, des de que cs=e.
\
............ - - .
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tm!Vl1E!l' PROLOGICA
!J!I[J) 0\!C/'OCQill pUfaOIOS
UJII!]9

MhNUAL 1tCNICO
3riCS (CII IP SELEC'l') -i um nlvcl lgico buixo ncstu en1
tx.ud .:1 habilita o FDC 1793.
4i:!RE 1 (HEI\D ENMHE) um nlvcl lbgico b.:d..co ncstu cn-t
tradu faz com que o dado contido no registrador
s e l e cionado por AG e Al seju colocado no
mcn t o el e dados.
5,6NA0aAl (REGISTER SELEC'l' LINES) Essas entradas seled
ci onam os diversos registrudorcs internos do FDC
para e ntrada/salda de dados, conttoladas pelos
sinu i s RE e WE de acordo com .a tabela
Al
o
o.
1
1
no
u
l
o
1
RE
r c') is tro de
reg is tro de
reg i str o de
reg is tro de
\lE
status rctJistro de comando
trilha r eg i stro de trilha
s e to r reg i stro de s e to r
dados registro
dados
7ul4 H DO .:1 07 :i (linhaz de ncesso de d ados) 1 s flo oito
linhus bidir 2cionais, usadas parn receber e
tr.1n s mitir dudos, contrle c stutus do FDC.
15 STEP ':! Pulso de passo para o step motor do drive.
Pnra cadu pulso o do drive se
uma trilh.
lGuDIHC (Dil\ ECTIOin -1 Indica a direo de de:.;locamen!l
tu d o stcpimo : or do drive. Se 0, este se
rb da trilha O para trilha 40.
J.7nE/\HLY Qua ndo a:ivo em alto, este sinal inclica que
o dado a gravado deve s e r adiantado para
ele gravaZio.
':1 Qua ndo at:.vo em alto, este .sinal indica que o
dado a s er gravado deve ser atrasado parn precoml
pe n s a o de <J r a v ao.
HESI:'l') um nivel baixo nesta entrada re-J
set a o FDC 17
1
3, gravando 0311 no registro de con
mando. Qulndo MH volta a 1 c executado um comando
de r e stare (cabeote do drive vai para il trilha
zero) e b cnrregado 01H no reg, de setor.
ii (GROUND) ;j t e rra
...
2lfiVCC U +5V
. 65
UI
--
'"
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. . ; '
I I
(o
. . . ..
--- - - .. . - ---
PROLOGICA
s n [j microcontpul:ldoros
r;JUBW
ti][]
------ - ----- ---
22 d TEST cs e s so .>. ntraa usada paro testca 9ernis e
dev e ser lig.ld nos +SV.
23 t1 IIL'l' 11 (IIEJ\D ::..01\D 'l'JMING) .. esse ninal utilizado
para reconhecer quando a cilbea de lcitura/ grnva"
o estfl em contnto com o disquete. ativn cm
ni vcl lbg ico alto.
24 w CLK u DE CLOCK DO FDC. do
essa entradn tnmb6m indico qual tipo de
dr i v e es t uso do pcl a frequnc L.1 de o per atl
o (2Mil z U E"; H1Hz ll 5"1/4).
25 d RG d (READ GPTE) um sinol alto ne sta sa1da indica
ao circuito separador de dados que um campo de
"zeros" ou "lns" foi encontrado c utilizado patl
ra sincronizao.
26 " RCLI< n (READ CLOCK} um clock de onda JUadrnda de'l
rivado do sinal de leitura deve ser aplicado a
esta entrada. A fase entre este sinal e o sinal
RAW importante para a leitura.
27 RAW READ u Os dados lidos do disquete direta1
mente para essa entrada. o sinal deve possuir uma
ne9ntiva (de l para 0) pard cada trnn1
si5o de fluxo gravada.
28 tt HLD (HEAD LO.l\D) esse sinal controla o atracamen11
to do solcnbide do drive, para pos1c1onar a cabe1
a de leituru/ grava5o sobre o f:; ativo
em nlvel lbgi<:o ul to.
29 " TG43 li GREATER THAN 43) esse sinal serve
30
para indi car que a cabea de leitur/gravao
ultrapas s ou a trilha 43 c que deve ser inciado o
processo de p1:ecompensao de gravao.
" \'lG t1 (WRI 'l'B Gl.'fE) sinal de sa1da,
lbgico alto, se rve para indicar
scr5o dados.
ati v o em n 1 v e 1
ao drive que
31 ij WD ri (WRITE DATA) pino por onde os dados saem
scrializodos c com pulsos dc sincroni smo.
32 H READY o entr ada, quando em ni vel lbgico alto indica
que o drive est pronto para operaes de leitura
escrituro. Caso esteja em nlvel baix-o e seja teni
tada uma l e itura ou gravao de dados, o ge ra
um pedido de interrupo
'66
-
...
A
--


..... . ..,.,

I! l!J H PROLOGIC/\
m microcompuladuros
l!ll!1D
DHLI
MANUA L TtCNICO
33 t1 1-il:' -:j (\'IHI'fE 1:'.1\UL'l') esse um sinal bidirecional
que tem como func;o indicar erro do rJravac;5o no
disrJuete c hu::>ilitar o circuito separador llc da:l
dos. Quando 1"/G=l, WF funciona como Se
n2ssc moment) WE' for forado a zero, todas as
operl.lcs de sero imediatamente terrninlol
dun. Quando IJG=0, WJ:'.funcionu como .5aldu. E;.;tc
c1 nlvcl lgico buixo umn
il o d 0 1 e i t u .r o1 , a p b n H L'l' te r i d o a l
34 "' TR00 d {TR/\CK tl0) essa entrada inform<l ao FDC que
.:1 cabc.:1 de :.eitura/gravac;:o do drive cstll posii
cionada no trilha 0.
35 n IP ;, (INDEX PULSE) essa entrada informa ao ITDC que
foi encontrado o furo de index do disquete.
36 d WPRT {WRITE PROTECTED) essri cntradn b testada
sempre que um comndo de grava5o recebido. Se
seu for zero, 6 interrompido o comc1ndo c {?
sct<td o o bit ie "proteo contru grava5o
11
do bytJ
to} de stntus .
37 n DDEN (DOUULE DENSITY) essa entrada faz a Sleo
entre ou modos de simples e dupla densidade. Se
DDEN= O, !{; sclccionado o modo dupla densidade.
30 K DRQ " (0/\T/\ REQUEST) essa salda indica que o
gistrador de dados c6ntm dados prontos para
tura ou que o registrador est vazio, durante
opcra5Gs de gravao de dados. Deve ser usado um
resistor de "pull-tup" de l0K nessa salda.
Obs: cst<:l 6 do tipo " coletor abcrto
11

39 .. . IN'l'l\Q t1 {IN'l'ERRUP'r HEQUEST) salda C setada
apOs o completamente ou finalizao de qualquer
c 6 resetado durante a introduo de um
novo ou quando o registrador de b
lido. Deve ser liga1o um resistor de " pull':lup" de
valor de lOK nessa salda. Obs: essa c uma salda
do tipo coletot aberto.
40 :i VDD +l2V
De se r i5o de _func ion.1men to do 17 9 3
o FDC 1793 possu i internamente 6 r egistrudorcs de D
bits cuja a seguir :
7

i
I
I
:!

,,
'
I
I
.
'1:.

,:
I
..
... ' .,r(...
1\ t l U 1\ L T f. C N l C O CP 5 O O
OUH e ativado o bit de "lost data" do registrador de
status.
1\o completar qualquer comando um INTRQ 6 INTERQ
resetodo efetuada urna leitura do registrador de
status ou pela carga de um novo comando no registrador de
comandos.
Comandos do FOC 1793
Sero discutidos neste manual somente os comandos de
maior interesse. Para maiores informaes consulte a
C)rafia. _
: O FDC 1793 oceitu 11 tipos diferentes de comandon.
Palavras de comando podem ser no registrodor
de comandos, desde que o bit
11
l3usy
11
do registradnr de status
seja igual a zero. Uma o comando para forar
terrupilo. Enquanto um comando est sendo execut ado o bit de
status "Busy" b setada e quando o comando b terminado, o bit
"Busy" c rcsetado c umo interrupo 6 gerado. C' registrador
de status se encar r ega de indicar se a opero5o foi bem suq
cedida ou no.
Abaixo esto descritos on tipos de comandos com uma
tabela indicando o seu formoto:

I COMANDO I I

I I 07 06 D5 03 D2 00 I
ii u e l1 '' a u tt " o u t:1 o u u o n u ll n nu u u 11 t1 u :1 a ,, u 11 n o n o g u ,. u s o 14 n ij u ti w a e u e n a oJl
I R c s r o H E 1 o o o o h v r 1 r 0 1

I SCE!\ I O o O l h V rl r0 I

I STCP 1 0 o 1 u h V r1 x0 1
ti '1 d Q 11 ll 11 11 U d ti li tl ll ti ti !I H Q ti li IIII U 14 ii U cl li il ij U ll U rl !l ti H fi U IH1 U ll ti I! ll O I( li t \I d Cl!l ii
I STEP lN 1 a l O u h V r1 r0 1

I s TE P ou '1' . 1 o 1 1 u h v r 1 r 0 1

I RCAO SECTOR I 1 O O m F2 C Fl 0 I

I \\ RlTE SEC'l' OH I 1 1 o IJ (J E G G I

I REAO 1\DRESS I l l l o o E o 0 I

I REAO I l 1 l . l o E o o I

1 \v R I TE T R A c K 1 1 1 1 1 o E' o o 1
-
I FORCE INTERRUPTI 1 . 1 o 1 ! 3 12 Il IO I

.J . .J

_,

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".,"" ..


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rirt

1,!;7
-..



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---
.........

... --...
'A<Il __...._
.......
r.: ;r
...... -... ,
fl [;] m. PROLOGICA
DOr.A microcomovladofos
[1HJJCl
lr:J()
MnNUnL TtCNlCO CP500 .
os C<)m;mdos Seek, Stcp in c Stcp , out,
pertencem tod os .10 tipo de cum,\tHJu, comlndos do tipo 1
u:n campo de velocidade (rl,rO) qtH? determina a vei
locidade do de ucordo com a tabela abaixo :
li !I A H li t-1 ri ri li ti l! ,.tj ii :l !l d H 1 1 !111 tl
I CLK : I HHlz I lMilz I
H !I j H li tl \J d f\ ti H U U H '.1 H !I !I !I -l '4
I DDEN I 0 I 1 I

I TEST I l I 1 I

1 rl rO I
., 'i d 1\ lj !i ri 'i 1.,
I ll O 1 G1ns
:! li :i 11 :l :l :l !l :J iJ ii ti !1 il 'i H H !j il !J H !i rl 1
I O 1 l l2ms I I
ti :1 ti 'i li \l H ti ti tl li ii :l H !i 11 ':i r1 ii \"l H ti :1
I l O I 2lJms 1 20ms 1
:l :i :l :1 d ':i !J !i d il 1 'l H ii ti ii li :1 H H O !! U ':I 'i -J
I l 1 I 30ms I I

Tamb6m neste tipo de comando existe um "flag" (h) para
indicar a c.Jrg.J da cabc.J. Esse flag indica que o sinll HLD
deve ser ativ.-1do no inicio do com.:1ndu, seja igual a 1.
Se h=O, IILD np6s t1 CHCJu da c<Jbca O FDC
a .:lS!.>im llt6 que um comundo ordcnlndo o seu des-;1
selccionamento ::.;cja dudo. Por0m se o FDC estiver des<Jtivo
durante . muis de lS revolucs do drive, a
c.:1bcu Nesse ti po de corn.:1ndo um
"flug" (V) rl e vcrificaZio da exccuilo d.:'s operucs. Se V=l
.:1
Durant e li a cube.:t c aps um
interno de 15ms o s in.1l IIL'l' checado. !.:<) IIL'l' csttl
o primeir o ele liclo do disco
n trilll,, cdmpt.l dQ c nU:o comparuc.la
com ll tr'ilh.:l d o' d e trillws. forem ic:Juais c se
o CI\C do f o r v:1lido, uma requisiZio
interruvy-:1\) 'Jc r<..hl\1 o bit do rcrJ istrador c.lc
status 6 Se trilhas n3o conferirem, mas o CRC
do cumpo de idl)lltifici.lti'.:O for v:1liclo , ge rada umu int cJ:;,j
rupii:O, o hiL do !;t;,t:ur.; :.;ut<.1do
c o de "Bus y" rc-sctado . Se os trilhas conferis::;cm, mos o
CRC n5o, o bit crror " do rcgi s tr iJc1o r de stltus l? setado
c o prximo cumpo de b lido pa ra vc rifica5o .
Se ncnbum cumpo ele idcnti f i ca5o com um C-1.\C ido pode Gcr
encontrado aps quatro revolues do drive, o FDC finuliza a
e <JCrl1 um.:1 intc.rrupflo.
os comandos STEP IN c STEP OU'l' possuem urn "f lug"
(u) de atualiz.:.,z, o . Se u=l, o rc<Jistrado r de triJ.ha c utua1
lizado a novo stcp .
np6 s rc.ceber este coma ndo , o sinal TR0 0 b
checado. Se se u v.:or fnr CJUal n O indi c.:1 que u cobc a de
71
- - --------- -
I
I
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t4

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1
r


lt

MANUAL TtCNICO CP500
esta sobre a trilhn zero. Ento
o registr3d or de trilha carregado com zero e uma
interrupo b gerada. Se o valor de TROO for igual a l,
pulsos de STEP (cem a velocidade programadn por rl r0) r;5 o
gerados que TR00 seja u. aps 255 pulsos de step o
FDC no for sinalizado a respeito da trilha G, ser gerada
uma ihterrupo e o bit de crror" scr ntivttdo
Observe que um comando de restore ocorre sempre que um reset
dndo no FDC.
Seek n Este comando assume que o registrador de trilhas
possul"""il posic;5o corr e nte du cabci1 e que o registrador de
.dados n pr6ximil da cabea. Quando executado,
ele registrudor de trilhas o valor do
de e ti:lnt'or; !_jt:ep!:: quilnto!.i forem
neccssrios o posicionamento du c abea na final
Uma b gerada ao fim do comando.
Step d np6::; receber ente comando, o FDC cnv iarb um
so de ntep para o drive. Uma & gerada aps a
execuo do comando.
Step in u Ap6s receber este comando, o FDC 1793 envia
um pulso de !itcp, indicando a dirc5o da trilha 413 (atravbs
de DII\C). Se o "flag" u estb sctado, o registrador de
trilhas incrementado de 1. Umil intcrrupo b CJerada ao fim
da execuo da operaUo .

os de step para drives possuem
de 2 s no formato MFM. Para cada pu l so enviado, o
drive move um tri lha na dirc5o indicado pelo sinal Dll\C.
s inal b 12 s de guulgucr pulso de stcp.
/\baixo temos uma t.[lbcla com .:1 configur &J5 o do
registrador de status c sua respectiva explicao:
---gq
ii\


-

""'
-

,....


-
p
p


c
c
')
c
., _______________________ 7_2 ____ __
----- __ __.,.,....,_,_ __ , __
..
,1)
....

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l \ .
PHLOGICA
rn rnicrocompvlador03


TtCNICO CP50U
-1 , 1 :i ., 1 "i 'l I '1 '3 ., , ;j :J , ri ':l !I :1 i rl ii :l J 1 'i I t1 :1 :1 :1 I 1 ':! fi rl !I -i 'i d :i H :1 ri :i ll :i :1 :i rl ti :1 ti d :i d :l ri 11 :1 ri
UIT STATUS I
COMANDO
U7 IDG ID5 j D3 ID2 jDl ID0 I

I
TODOS 'fI PO I I t-lOT I WP I" L EEK I CHC I TR/\CK I INDEX I BUS y I
. HEADY EimOR ERROR 0 .

I
HEAD s ECTOH I tJOT I o I HT I CHC I LOST I DRQ I BUSY I
Hf: 1\0Y EHROH DAT/\

'1\:R ITt: Sl:CTOH 1\;F \HNI:' \ LOST IDRQ IBUSY 1
. f..l.:\DY !:. RHOh D/\ T/\ f
, -l I , :1 1 -1 ri l 4 o! :1 :I .; '1 -1 4 i :\ :1 :i 1 :1 ; 1 '1 'i :1 :, 'i :i 'i :i li ; !1 'i ; 1 '1 !i !i !i 9 tf I'! :1 1 !i !i :i 'i 'a :i ti il :1

I r:1n I u I u I JWL' I CI<C I LOS'!' / I DUSY /


EI<J<OH DT\'1'1\
-I !1 ., '1 H ri .; 'J ri 'i :1 " :1 'i r! 'I I :l :1 'i H 'i :i 'i :1 d 'i ii :1 li li ii d !I :1 h b ti :1 :i -1 1 d ri i i 'i ., !I !i ti !11 H ti :i :l !I :1 ri il 'i !l i1 :I H 1

TIU\CI\ I o I Ll I o I o ILO.ST IDHQ IBUSY I


. DAT/\

l
lvl\lTt: \\\' l' I\'1' 11\'F I " I o /DHQ IDUSY /
I\ !::\DY i )) /\'1'/\
:1 'i 'l :l ii :1 ii :i '1 1 :i 'i -i !l 'i 1 :1 1 tl :-t :I rl :1 :i 1! :1 !! 'i Li
1
J ti 'l , 11 I 1 ii i H 'i 'i 'I :l :i 'i 'l H :1 !l '1 !l !1 -l !i 1 '1 !1 'i "i
HEADY bit indicu qm: o d rive ni10 cst tl pronto
h'Pln' "l (\;In 'I'E l' IWTEC'l'ED) E:.tc bit indica q1w o disco
cst"S f?J:Otcyi do contru <Jr ilVa3o .
llL rl (IIEAD LC' i\DE\)) E!_;tc bit indi ca que u Cc:lr<Ju da Cbc 1
a f o i f c t u <1 d c o r r c t.1 m r. n t c
SEEK ElUWH :i Qu;1ndo scL1Jo inc1 i cu que <1 trilho
d o i ll c o n t r a d d
" Indic<l o n;lo f oi vcrif i cudo um
ou maTs<.:-J"m po J o :.;c to r,
ll'Z'lO !>:-11..1 i iS .
ou s j ' que o s <.] .,d os lidos
THi\ CK o :; Qu<Hldo cm O indic<:l qu0 o cabcc;n de lcituro/
l ' l h:on t r'' por; i c i on;\\Ll !>Obre <:1 trilha zc r o .
INDEX 'i !:vt;1do , indic.1 (j \ H' ;1 m;trc<l ele 1nc1 icc foi
de Lhl".
BUS Y !I !:\:l'<tdo i m1 i c<t qu
Quundo intii ca
sendo executado .
o COII1i111 d o t t1 crn
nenhum c r,rnlndo
CXC-:1
cstt1
RT H (RECORD TYPE) Durante o l ci tur o indi ca lei t ura do
cod i go do tipo de const u n tc do campo de dados .
Durante a gravac;5o , indica erro de gruva5o.
RNT d (RECORD NOT FOUND) Quondo setada que o
tr, trilhi1 ou L1cc ni o foram encont r ados .
-------------------
b
I
I
I
I
I
I
I
I
I
!
I
..
_ .; .
A'IJ. f.'J .. 1. f '.
2gcao ;;.J
_ ....... --
'

- , .... ....... , '
.
PROLOGICA
[]{]fl\

F.JCJ
-----------------------------
MANUAL T!CUICO CPSOO
LOST DATA a Quando sctado indica que a CPU n5o
cie;- DRQ e que dados foram perdidos em
quncia disso.
DATA RE('liEST t1 Qu"ndo indica que hl! dados para
serem retirados do registrador de dados, no caso de
lbitura, ou q ue o de dados est vazio, no
c n s o d c tJ r i' v ;1 c; 5o
2. riD 16 91
O WD 1691 um de dndos, que g r. ra o sinal
RCLI< par a o FDC, f:cndo uso d frequncia gerada por um VCO
externo.
Durante a grava5o, o WD 1691 proporcionar a
do sinnl de
AbDl<O temos sua pinoCJcm e a dcscri5o do funcionamcnt.o
de cadu pino :

Q..14_ __ ,3

'l!J)..Q.UL G
ws.: 7
1."-'----10
9
WDIN H (WRITE DATA IN) Entrada de dados para gravar,uo.
Ol ,02 ,03 , 04 fj Entradu de 4 para gcrur um pedido
de atraso, para de grava5o.
STB " (STRODE) Salda, pcrmaneccr em nivel nlto na
s u b i c1 a do sina 1 \10 I N c em n 1 v c 1 b a i x o na borda de
sub ida ' do sinnl fas e <1 (0-1).
PD Salda tristate que ir a n1vel baixo, quando for
oocessr ia uma dt:?crcmcntao da frcqllncia de PLt,,
HD OUT a (\m I TE DATl\ our ) Sa 1da de dados pu.: il gravao.
05 L1dos j s..1cm prccompcnL;ados.
.;.i. .k'l
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OrJn PROLOGICJ\
(3 C Ll mictocompvt;x_!Qr os
ff"JCJCJ
DO
1 Gi1TI-:) Indi'..:d .:JO \,':J <l'JC
u:na grilvo3o .
1..;r tt II.Jbilit. v.Jri.Jc:; nu do vco.
TG43 ot (TR/\CK GH/\TTEH 1'11/\N 4-3) Indicu que a cabea de
.. , elo <lriV<! a trilild 43 c que,
portanto, deve iniciada a precompensaZo de
5o.
VSS fi Tcrru.
RDD :1 Sin.1l de lcituru proveni e nte diretamcnte do
drives.
RCLK rt Sinnl de clock, scparudo dos Este sinul b
pelo I'.'D p.1rtir dos :>inuis rmo v VCO.
PU i1 Sin.:-d
o 1-.'D 16
vco.
su1d,
11l'Cessi tu r
tristte, a n1vcl ulto quando
ele um incremento du frequncia de
()()EN >i lldh i l i t : l r(:O p;tt:;) dupL1 Qu ; tlt<lo <'m 1
1
i:l
{i:""'(juJncL, d l ! vco intcrnumcnte diviuida po!" dois.
VCO de clock, fornecidu pelo VCO externo que
deve ser d l! (drive 5"1/tl) quando o circuito
c s t i v c r i n ,, t i v o ( s cm c f c t u u r 1 c i t u r a ou g r a v c:. o)
El\RLY c TJ\TJ: :I Sin;1is uliliz<t<Jos puru \)Ctur a prccom1
l)u11S:.13,-l-;rov cnicnLcs elo FDC 1793.
VCC 'J +SV
3. \VD 2143
1\'D 2143 c um circuit o purn g erar as fuses
o 1691. 1\ Llr rJur ,, de pulso forn c r::i cl o po r cada fusc
por externos. 1\ trmos rcpre1
sent<1d.:1 su.:1 pin.J<J c:n :
t',
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(\'>;: ' ' . (
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I

I




-
[i o !! 9 do cn1da pato conttlc dn .prc1
a ativao cm nivcl 16gico alto
Dl e anterior, por6m ativaz nlvel l6gico

%7JH;l, 'M'1H ... 2 o para cristal externo.
1 $alda da frequncia do cristal, dividida por
.
A 5 hjuste da largura de cada pulso das fase.
fi'r !e i to por rcsistorc's ex ternos, Se for usatt
da a entrada OPH, estes pinos podem ser : deixados
abortos.
01't4 o palCa contrle da lilrgura de pulsos de tol1
dn as fases.
vcc a vcc.
--
76
\7:\
::,;.;_p


fB

l
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PROLOGICA
no Oh microcompulaO<OS
rHSJCJ
fJ{]
11:\NUl\ L Tf;C:NICO CPSOO
DA CONTROL III
1\ entr<HL1 c c n.J pl<l::.J
III 6 control.Jd.J por dois buffers: CIU2 (71\LS245,
n.Jl). c. CIUl (71r.:0211 , de ncor.do com o esquema
.:tb.JlXO :
D7
DG
.Q..S
D4
!.?L
!)_2 ___
p1
110 Nl\11

l'l...l..L>.I..I->ooj
U2
UI\
D?
D6
DS
01
D:l
')
!.!.o
01
Observe que os sin.Jis controlnm o dircc i onamcnto do
CIU2 DISKIN c RDNMI MASK HEG. Ou seja , o barramento scr
direcion<1do cL1 pL1c.:1 III puru u PVIII CJuando for
necessbri.:1. u:no lc i t ur\.1 do d e interrupr;'5o ou quundo
for u:n ,1 lei tura nos rc<JistrDdores elo FDC.
Como ,endo at uqui, tod os os dispositivos de
I/O e memria do Cr50 0 s3o m.Jpeados, Conforme foi descrito
n.J sc:io
11
Endc t: c ,;amcnlo dos di!..ipositi vo s de I /0
11
vimos que
os DISI\Hl t: que controL11n <1 p laco CONTROL III
nos i:'O e 1:' 3 . Al bm desses. sinais,
temos o;, HD r-EG, \lH NCH 11ASK REG e
DISK SEL que i.l l. U-:1:11 n1 CONTI<OL I I I. l\b.:lixo temos urn dcsc r ii:i o
desses sin.::Jis
DISK OUT
Endereo FO (l\ l =O;AO=l) rl Escreve com.:1nd o no FDC. Esses
s5o oquele;. cle:.c ritos na refer en t e a "Comnn-J
d os do FDC 1793".
Endereo Fl (Al=O;AO=: l) tl Re<Jistru o nbmcro do trilho
. r.
77

MANUAL
para onde o cabeote se
Endereo
ser
F2 (Al=l;AU=O) rl Registra o setor onde o dado
EI)dereo
gravado.
DISK lN
F3 (l\l=l;n0=l) t1 str a o
. Endereo FO ( Al=O; nO=O) n efetua n
dado
a ser
leituru do
registrador de veja a tabela de stutus,
do FDC 1793.
na descrio
registrador de trilha.
Endereo F2 (Alc l;A0=0) o L o de setor.
Endereo F3 (Al=l;AO=l) L o registrador de
DRV SEL
Este sinal tem por funes sclecionar o drive, n densiQ
dade de grava5o e o de faces; o motor do
drive, controlar a lOgica de WAIT e ucionar a precompensa5o
de gravai10.
Para sclc5o do drive, nmcro de faces c modo de
o, o sinal DHVSEL atuar como clocl< de um latch, CIU6
(74LS171) conforme figura abaixo:
D7 os as
04 04 04
03 03
UG
02
02
01
01
DO ao
CLK
CLR
A
U15
-----10
C
1-------'
.....
-y:J
-
:0
-
:n
-
::Ti)
,, ..
.
t!lr:39 PROLOGICA
rn D fl microcompu!;)QOros

0[]
MANUAL TtCNICO CP500
temos que o bit 00 c o rresponde b selco do drive
1 ; D 1 se 1 c <i do d r i v c 2 ; O 2 s c l c f1 o do d r i v e 3 D 4
controla qual do drive nccssadn permitindo assim,
a cxpansno drive dupla face. E D7 controla a
que o sistema opere com
disquetes gravados em densidade simples.
Observe no esquema cltricQ da placa CONTROL III que
os sinais de salda s5o buferizados c invertidos pelos
CI'sUl, U9 e U21 (7416, todos). Note tambbm que os sinais
que os drivcs externos se dirigem s saldas do
conector externo (Jl).
A funo do CIU15 (74LS123) temporizar u acionamento
do mot9r do drive. Se aps o tempo de curao da salda motor
'on, ainda estiver sendo cfetuada algurnu operao com o
drive, um novo pulso DRVSEL se farb presente, forando
assim, a continuidad(? da rotaUo do drive.
h formn Jc ondn tlpica do sinal DRVSEL com o drive
acessado e ..1 mcn cm "Disque te?" na tela, pode ser v i sta na
fig.39.
I
'--
J
Tambm selecionado um drive, h a simulao
dos sinais HLT c ROY para o FDC, pela lgica formada peloa
CI' r. UlO c U3 LS260 e 74 LSOO, respccti vamente) , . conforme
pode vi!;tu ;\l)dixo
HLT
' I
'
i '
;
r.Jf1H9 PROLbGICA
[;2 ['i][!l mi<:rocomputadoros


Assim se sclcionado, temos O na salda do
CIUlO que invertido por U3 paro gerar os r.;inais IILT e
ROY.
O sinal DRVSE L tomb6m serve para comandar o inicio da
de a partir da trilha 22.
Isso l! f(!ito utilizandorisc metade do f:.. ipotflof, CIU18
(74LS7l) e do linho de dados 05. Quando htl nccessidude do
inicio du prccomp1.2nsoilo o dado 05 colocado em 1 e ao
mo enviado um r.;inal DUVSEL. Isso foz com que a salda
do n l. Observe que esta salda est6 ligada b
elltradil TG-13 do C!Ull (\'-101691). Dessa forma este sinal est
simulando p3ro o ClUll, a pela trilha 43, quando nu
r a li d a d c o d r i v c e !> tl1 na t r i 1 h o 2 2 I s fJ o se d c v e u o f u to do
FDC s6 fornecer sinal para ini cio da prccompcnsa5o a partir
da trilha 43, fazcndodse cnt5o ncccssrio, para o
uso com drive 5"1/ ll.

6.
os
D
PR
a
c; E
um
C LI(
LB_
L -=
J----+SV
o contrlc d\1 de \iAl'l' 6 fci to do sinal DRVSEL
c do bit 06.
Toda vez que b feita uma opcra56 de leitura ou
5o com os drivcs, o sinal DRVSEL se encurrefQ de gerur um
pur<J a CPLl uU! que " cstcju tcrminadu.-
Vcju o circuito ubuixo :
0111----...
R4
uo
-:

c
fi"'
....
fi'
-

....
p
-
-
-
-
-
-
.....
.,.
.....
r
-
)'
-
-
PROLOGICA
r:!\ mk::rocompulodorcs
[]EJt'l
[!3\.j
------------------------------------------------
MANUAL TtCNICO CP500
ObDervc que quando b gerado um wait para a CPU, ecse
RESET,
que a

wait pode ser interrompido por somente 4 fatores
DRQ, INTRQ e a sa1da Qll do contador. Ou seja, at
operao em andomente tenhil acabado ou at que se o
Qll seja gerado, a CPU se mantm cm WAIT.
A fun5o d.Jsf>c r.innl Qll 6 impedir que o estado de Hait
muito prolotH.Jndo, pnra que ni:io ocorra o npngllmcnto das
RJ\M' s din5micus por fnltn de rcfr'ech.
Esse b gcrudo a cada s. Observe que o sinal
wait foi desabilitado por algum dos sinais DRQ, INTRQ ou
RESET, o sinal Qll n5o gerado, pois o CIU20 resetado.
WR NM 1 t-11\S K REG
------
A funo deste sinal programar o flip4flop CIUS
(74LS74) parn habilitar a pelo fDC, pelo aciona
mente do motor, por ambos ou por nenhum.
____
_____
1
o
RD N l"\1\S !\ [\ EG
-----
U16
rN na
( f-DC)
MOTOR ON
A funo deste sinal c descobrir qual dispositivo (FDC
ou acionamcnto do motor) gerou uma interrup5o NMI. Isso b
feito o CIU19 CJUC nos seus pinos
13 c 11 aprescntar o stiltus dos sinais MOTOR 0N e INTRQ
respectivamente. t bom salient<H novamente, que Loda vez que
u.'tla opera3o e pelo FDC, um INTHQ gerado por cc'J
te.
l
l
I
l
I
l
I
1
]
l
I
l
I
!

i
I
t
..
i:
1:
r:
i

j:
H
li
I
i
I
I
I
l
'
I
ll?U!!fl PROLOGICA
m rmca microcompuladoros
CH'.':3G1
!.:] !]
'l'tCtH CO CP 50 0
elco dri ves externos/internos
Como o pouc suporliH at6 quatro drives
1
2 externos c 2 internos. Para os sinais de
sa1da (\'lO, HG 1 DI R 1 STEP 1 MOTOR ou
1
e SD s EL) SDO d upl ica11
dos pc 1 os b u f f c r s U l
1
U 9 c U 21 ( to d os 7 4 1 6 )
Ent5o esses sinais para seus
respectivos conec tores (externo ou interno) .
J os sin<lis de cntruda vem para a CONTROL cm duplicata .
(por exemplo, sinal RD dos drivcs externos e sinal no dos
drives internos). Para h um multiplexador,
CIU22 (71LS157) gue b controlado pelos sinais 054 c DS3,
conforme esquema abaixo :
TA O 1Y AIO

.:.:IP'--___
1
2Y
.;...;R=0 ___


Ajustes e R7
A seguir damo s a rotina de ajustes para ns trimpots RS,
R6 e R7.
l. frcyuGn c iu uu PLL
1. 1 . Com os drives desativado s, ajuste R7 para obter
u:na l ei tura de l,tlV no p ino 2 do CI Ul-1.
1. 2.
2.000.000llz .i
Hcgule
100Hz
H7 puru obter
no pino 7 do CIUl-1.
uma f requnc ia
2. l\justc da frequncia de de
de
2.1 Inici e a de um disquete em qualquer um
dos drives.
2.2. Sspc rc que o cubeote cheque a trilha 22. A partir
da1 e com o auxilio de um osciloscbpio, ajust0. RS de forma a
obter pulsos de na purtc baixa do sinal que sui do
p ino 4 d CIUll , conforme ind i cuclo ahuixo .
200NS
.-ll--
-
I'
,.
I
..
,..
-
,-
-
c
e

-

-

- I
r..: : cl
- ,.....
't 8 2 '}._ ;>;,IJ
\1 l J
' 11 1 =-=:::::;;o;.._.,_.....,. _____________________________ _..._. __ 4

' -
t'li\tWl\L TtCtliCO CPSGO
DOS PRINCIPl\IS COMPONENTES Dl\ VII
1. TR1G02
o. TR1602 um circuito integrado de 40 pinos que tem
por funes serializar O!> dados para envio, t)arulelizar os
dados recebidos, checar e controlar e!>ses dados e a linha,
verificando os de "hund shake". Este circuito somente
opera de forma ass1ncrona, possuindo 6 registradores
nos que silo :
1. de trilnsmiss5o: Nesse rcg:strador ficam
armazenados os dados ( l byte de cada vez) , er.:perando que o
registrador de e transmi.ssflo csteju livre.
2. Registrador de deslocamento e tr ansmisso: Para esse
regi.straJor vo os que c!>tavnm no registrador de
tran.smiss5o, para serem scrializados.
3. Registrador de contr6lc: esse registrador carrega a!>
dos duelos a serem enviados, c recebidos (pa1
ridade, tam\lnho du p.:llllvra, nt'lmero de stop bits).
4. de status: b nesse registrador que fica
armazenado s e 0 dado foi recebido ou
te ou se o uve erro (paridade, erro de protocolo, perda de
d<1dos)
5. 1\CJi;,trador de rcccpc;::io c deslocamento: este registJ
trudor tc111 fllli findliJildc receber e paralcliznr os dadoc,
posteriormente pnra o registrador de
G. Rcgistrnuor de reccp5o recebe os
registrador de rccepc;5o c dcslocnmento e os
linhu de dados.
dados
para
do
a
A seguir temos a pinogem do TR1602 e suns respectivas
func;es
!34

(
'
t


t
.::





e








t


,s
.s
tr


:;.
'!"!

rr

p.

,..-
p
e:
-
.
PROLOGICA
ruo m rnicrocQmpvradofos
l]f]lr)
fEl!]
MANUAL TtCNICO CP500
v
40
R
VD_Q__ 2
39
li
3 30
4 37
5 36
G 35
PI
7
34
CAL
8
TR 1602
33
TAO
9
32
TR7
10 31
TRG
11 30
rns
12 29 TR.tl
E..
13 20
F
14 27
E
15 26
25
24
23
22
BECI 20 21
Al imen
1. vcc a +5V
2. VOO ll Ul2V
3. GND t1 C3V
Contrle
31 " CIU. ll <lo de controle.
nesta cfc tuo a do de
le. Os sinais de contrle segue abaixo:
Um ni vcl
contro
35 n PI w Um nlvcl alto nesta ent rada, quando ativado
CRL, que a gerao de paridade serb inibida. Ao
mesmo tempo a PE para n1vcl baixo.
36 SDS Scleciona o ntmero de um nlvel
alto selcc iona stop bits c um nlvcl selcc iona um
stop,bit. Um stop bit c meio automat i camente gerado se o
tamanho da 6 de 5 bits c sns cst.'l cm nlvcl lbCJico
to. ,
I
I
I
I
I
. r
I
i
MANUAL TtCNICO CP500
37,30 u \I/LSl,IJLS2 Controlam o t.=:11nunho da palavra de
acordo com a tabela abaixo
1-JLS 2 1-1 r. s 1
'1'/\M/\NIIO J)/\
l' /\ T.l\ V lU\ (bits)
o o
5
o 1 6
l o
7
l 1 o
39
gerada
baixo)
EPE u EGta cntruun determina a paridade
ser par (n1vel 1bgico alto) ou 1mpar (n1vel
a ser
lbg ico
STATUS
13 d PE d Um nivcl alto nest.:1 salda que foi
recebido um dado com par idade inv til ida.
14 lt FE tf Um nlve1 .:11to salda indica que foi recebido
um dado com nrnero de stop bits inv.!.l1ido.
15 o OE a Um n1vc1 alto nesta salda indica que foi per
dido um dado.
16 o SFD M F.GGn entrada tem por funilo desconectar as
saldas do registrador de status do b.:1rramcnto de dados,
quando cm n1vcl alto.
19 t1 DR ti Um l nlvC1l alto nesta salda indica que um
caracter foi recebido e no registrador de recepo.
22 u Tlli\E a Quunclo c:n nlvel alto, esta G.:llda indica que
o registro de transmiss5o est vazio.
24 H TRE Ind ica que o rcgiGtrador de deslocamento e
transmiss5o cst vazio quando cm nlvel lbgico alto.
Enkrada e salda de dados :
5 tl 12 t1 HRO a IUU ti salda de dados. Se for dado um
n1vcl buixo n;:l en trada Rl\D , os prcsentcs no
dor de rcccpilo colocados nessas saldas.
4 rl rmo tl um nl vcl baixo nesta entrada c.n1oca os dados
presentes no reg istr ador de recepo n.:1s S.:1ld.:1s RRO a RR1.
17 d !WC a Entrada c.le clock de reccpc;5o.
10 u DRR u Tem por funo dcr.;.:1bilitar a linha de status
DR, quando for ap.lic.:1do um nlvcl lb<Jico buixo nesta entrada.
20 tt lU w Entr.Jda de dados scriais.
-


-4
'.,4...,
.



PROLOGICA
O (J (.'!( mi<:rocompulaoros
f'lEHJ
fJ(!l
MhNUAL TtCNICO CPSOO
23 ti fi!HL <1 Um n1vcl baixo ncstLI cntruda introduz um
byte no de transmiss5o.
26 u 33 u rnl a THO c Entruda de dados paru o
r cg ! s t r ado r de t r a n sm i ::; s 5o
40 N THC Entrudo de clock paru transmisso.
2. BR1941
o um chip que tem. por gerar diversas
frequ6ncins de clock para programar a vclocidade de transt
miss5o e rcccp5o do TH1602.
Abaixo temos sua pinagem e descrifio:
15_T!IL1
10
+r: I
2
17
r-R
3 16
n 4
15 3
!lli 5
14 TC
R
6
13
flQ
7
12
STA
u
11
-i 12V g
10
lalO " XTALl,XATL2 " cristal externo
o Frequncia de recepo
17aFT ri Prcquncia de transmiss5o
BeSTR B Strobe do registro de recepo
12uSTT o do registro de transmiss5o
4 a 7 u RA , HU,RC ,RD " entrada do registro de recepo
Veju abaixo .
16 n
t r <1 n sm i s s i10
13 u TA,TU,TC,TD ri Entrada
tDbcla a seguir
U I
do reg i stro de
:,J:
.


6JfjCJ
E!U:I
I
,:
r:
!
___ ,..., .
PROLOGICA
rnicro<;OmpUtodoros
W\NUJ\L TtCNICO
HD HC HB RJ\
'l'D TC TU '1'1\ Velocidade
(Bauds)
o o o
(J
o
(3
o
50
0 o o 1 (J
o
(J
1 75
o o l o o o 1 0 110
o o 1 1 v
o
1 1 134,5
o 1 o 0
"
1 0 0 150
o 1 o 1
"
1 0 l 300
0 l l o o 1 1 0 6(30
o 1 l 1 (3
1 1 1 1200
1 o o 0 1. 0
(3
0
1 o o 1 1
(3
0 1 2000
1 o 1 o
1 0 1
(3
2400
1 o 1 1
1 1 1' 3600
1 1 o o
1 1
"
o 4800
1 1
{j
1 l 1 o 1 7200
1 1 1 o
1 1 1
(J

1 1 1 1 1 1 1 1
DESCHIno DJ\ PLACA INTERfACE VII
Como havlamos estudado na parte de endereamento de I/O
a placa INTERFACE VII um dispositivo mapeado.
O contrlc do mapeamento du INTERFACE VII feito
do que controlado pelos sinais RS
232 IN e RS 232 OUT c pelas linhas de endereo A0 e Al.
Vejamos cntfio como atuam estes sinais na INTERFACE VII.
RS 232 IN d conforme foi visto na seo de endercamen
to de I/0 da placa PVIII, o sinal RS 232 IN ativo entre os
endereos EB c EB, incl usive, sendo subdividido da seguinte
forma :
Endcr co
E8
E9
E/\
E8
Funo
Leitura do status do
No usado
Leitura do statbs da UJ\RT
Leitura do registrador de
recepo.
OD bnicos endereos que varima de EG a EB s5o 1\l e J\0,
que esto ligadon nas entradas de sele5o do CIB.
Assim se RS 232 IN estiver ativo, teremos :
Endereo E8HA1=0;J\O=O o Ativa a salda INE8 do CI8,
habi1illtando o CI5 (74LS367), efetuano assim a leitura do
status do modem, de acordo 6om a tabela abaixo
Bit Leitura de:
D7 C'l'S
06 OSR
05 CD
0-1 RI
I

P:

"
P"'
e-'
:-'
i>"""
;._I


(
,. . ('
; I . - f
DO RD
"-9oq- .... ,, 7
\-
. -mrr11 ., ,A
fJ u
--

,_

.
amm PROLOGICA
rnicroromputoooro3
(jl]CJ
cm
MANUhL CP500
Endereo
est nno
AOnl 11 Ativn INE9 do CIO,
ten<.lo f lHl<;Zlo portanto.
que
Endereo Enunlcl; d ntivn salda INEA do CIB, habiG
litando portnnto o CI4 (74LS367), efetua'1do assim a leitura
do status da UhRT, de acordo com a tabela abaixo :
nit
07
D6
05
04
03
Leitura de :
(dado recebido)
TIIHE (rc<Jistrador de transmisso vazio)
OE (perda de dados)
fE (erro de protocolo)
PE (erro de paridade)
Endereo nO=l Ativa salda INES, que tem por
funo colocar os dados contidos no registrador de recepo
da UART, no barramento ao mesmo tempo habilita o buffer
tristate CI3 (74LS244).
RS 232 OUT Similarmente ao sinal RS 232 IN, este
sinal ativo entre os endereos EB e ED, inclusive,
do, entretanto, para escritura.
h deste sinal 6 a seguinte :
Endereo
E8
1::9
E/\
EB
Pun5o
Hcsctnr a UJ\R'l'
Carga ela velocidade de rec
ccpilo c transmisso
Carga do registrador de
miss3o
Carga do registrador de
trle dos sinais de hand shake
(RTS c DTR)
..
Endereo EBU/\0=0; /\0=0 " J\tiva a salda OUT EB do CIB,
que age sobre a entrada MR da U/\RT,
Endereo E9u/\l=O; /\0=1 /\tua sobre as entradas e
STR do gerador de baud rate. As linhas de dados de 00 a 03
devero conter o c6digo da frequncia de (R/\ a RO)
e as linhas de 04 a D7 dcvero conter o c6digo de transmisd
s'Zlo (TA a 'I'O)
Endereo EA /\1=1; A0=0 u .Ao mesmo tempo que carrega o
de contr8le da UART, atravbs do bcu pino CRL,
atua como clock do CIG (74LS174), gerundo os sinais RTS,
DTR, SRTS, STD, SUN de acordo com a tabel" abi::1x
Dit Salda
RTS
Dl DTR
03 SRTS
D4 STD
DS SUN
89 .
!
I
.
I.
f
.
'
\
\
\
. t-1ANUAL TtCtHCO
A 2Q do Cl6, correspondente b ent radz 2D (bit D2)
habilita ou no a transmissfio de dados, atravcs do CI16
(1488), pino 13.
AO=l w controla a carga de dados no
registiador de armazenamento de transmisso, atuando
mente sobre o pino TBRL da UART.
AlOm dos RS 232 IN e RS 232 OUT, dois outros si8
nais controlam a INTERFACE VII. so eles
WR INT MJ\SI< REG
HD INT l'1ASK REG
O sinlll WH IN'r HEG programa o CilO (74LS174) para
determinar yuill dos sinais gcrar uma
OE
FE
PE
THRE
DR
pcrdi'l ele dados
erro de protocol o
erro de paridade
re9 istro de transmisso vazio
eludo recebido
Isso f e ito com o auxilio da linha s de D6i 05 e
D 4 { 7 4 LS 3 8 )
C a s o o c o r r a a lg um c r r o
1
o u um Da d o se j a r e c e b i d o , t; g e !J
rada uma interrup5o. Quando isto ocorre, 6 ativado o sinal
RD INT STJ\TUS, que habilitando o CI9 (74LS368) efetua a
leitura do b it que gerou a interr upuo
-
9{3
1 - ==-

kfsit=w '* "'' - ------------- -
'
j
_.
, ..
___ r ... .,,......,. . ,......, ...
. . '

MANUAL CP500
A VT Ol tem por fun5o c controlar
os sinais de vidco pela PVIII, para o tubo de raios
catdicos. Podemos divid1dln cm 3 partes :
sincronismo vertical
2. si nc ron i smo hor i :.:on t .:1 l
3. Contrlc do sinal v1deo
1. Sincronismo Horizontal
O sincronismo b de um cricuito
.monocst!vel, pelo c compoentus associados.
Os pulsos de sincronismo gerados pela PVIII
so injetados no CI2 ntravs do transistor TS e C29. n saida
pino 3 do CI2 est liqada ao transistor T4, . que serve
chave para o TPl. Este transfor:o,ador tem por
isolar as duas partes do circuito c fornecer pulsos
com tens5o suficiente para excitar a base de Tl. O diodo que
estA representado em paralelo com Tl c interno ao
tor e . serve para proteger este dos transientcs provocados
pelo. FLY BACK. O trimpot TPl tem por ajustar a
qu5ncio horizontal e os indutores Ll c L2 fazem o ajuste da
linearidade horizontal. Observe que o sinal O dividido cm C3
indo parte p.ua bobinas de varredura horizontal Ll-11 c Ll-12
no YOKE e a outra parte indo para o FLY nncK. n1 este sinal
tem !; ua tcns:::io !.icndo que cm seguida ele b rctificai;l
do em meia onda, por um diodo de alta tcns5o, localizado no
interior do prprio FLY DACK. Sua filtragem & feita pelo Cad
pacitor formado pelo Qquadag e o exterior do cinescbpio, que
c recoberto grafite c atcrrauo.
2. Sincronismo
O sincronismo vertical b gerado por um circuito TDA1170
que controla a linearidodc, n freguGncia e o
vertical ptopriamentc ditos.
Trs . tr impo t:s s5o responsveis pelas diversas rcgulaQ
gens
TPS n cm coni unto com IU2 c Cl7 te tr irnpot lj usta a
vcrti c o.
'l'P:l t l"'oliJ\lllLlnHnt, com nll trimpot a
amplitude d;1 ri1mpi1 de do 'l'Di\11-Jt.J, Vlriando lssim a
turu, no viclco .
TP2 w f unno aj ustar n l inearidade do sinal de
sa1d.J.
. 92

C'"";
e;




c-

C'
e:'



e-:

e"'
e---
e-,

e---,

e--;
(!"
- I
P';'
- (
(JY'
- I
til')

(rJ
-- Ci7
--
r:"ll

..
lEI!1Cl POLOGICA
microcompvi<Jdorcs
tr:1[!]C

MANUAL T!CNICO CP500
3. Contrlc do sinal de vidco
-----
. --.. --... .... ---- ... ..... ...._ - .... .... ....
o sin01 de v1dco vindo da PVIIl 6 amplificado pelo
transltor 'r2, mas antes disso h um trimpot, TP7, que regula
seu nlvel de entrada,atuando assim como um primeiro
lo t1o bs: i llw. .
Em sequl!nc i.:1 existem do i z tr impots : um ex ter no, que e
o contrle de brilho e um TP6, gue age sobre a
primeira grade do c ntua como contrle de contraste.
O foco b regulado atravs de um trimpot b bltima
grade (TP4).
ESB REL
RUA VlTO::. , .. 1 5"' .. ,

r .. (Cf-' ..
9.3


-

0



.;:e
:::@).

:::()


!e





MANUAL TtCNICO CP500
A fonte do CPSOO tipo convencional, sendq suas
tenses de salda estabilizadas por circuitos LO tipo LM723,
7912 e 7012.
Abaixo sequem as tenses de entrada e salda da fonte,
lembrando que as tcnsucs de salda silo fornecidas em rela5o
ao terra.
U llVCA
CNl/luCNl/2 a 20VCA
CN2/3uCN2/l U 16VCA
U lGVCA
Obs:As tenses alternQdas podem variar
te cm rcla5o a este valor, devido a fatores tais
como rde el6trica, caracterlsticaz particulares do trafo
etc.
CN4/3

u +SVDC
CN7/2
CN8/l
CN9/l
CN4/l
CNS/1 U +12VDC
CNG/1
CN7/6
CN0/3 11 +l2VDC
CN9/3
CN7/S
iS ol2VDC
CN9/4
A tens5o de pura a alimentao das RAM's
na prpria placa PVIII pelo regulador VRl (79L05 ou 7905)
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MANUnL TtCNICO CP500
FERRAMENTA L NECESSARIO PARA REPARO DO CP500
CHAVE TUDO 7mm
CHAVE TUBO Br.un
ALICATE BICO
ALICATE CORTE
FERRO SOLDA DE NO MAX IMO 35W
SUGnDOR SOLDn
CHAVE FENDA MtDih
CHAVE FENDA GRANDE
CHAVE PHILIPS
CHAVE PLi\STICA PnHn h.;JtlSTI:: DE DODINA
MULT 1 t-\ETIW DIGITAL
OSCILOSCOPIO COM l\S CnRACTER!STICAS
11 Duplo f e ixe
w de cannis
o Inversil o de pe l o menos um canal
Freguncia minima de 30mhz
a Trig9cr externo
( .
Obs: tn l osc iloscpio tamb6m pode ser usado para
nhament o de drives.
1. FREQUENC lMETRO DIGITAL (OPCIONAL)
o Soldo
ij Alcool isopropllico (para limpeza dos drives)
l,l,l Tricloroetano (para limpeza das placas)
tt l\lgodil o
1t Flanela
u Pince l
ri Cola Super Uonder
ii GrVlldOr K117
d F i t a s 1\ 11 7
a Disguctcs (no mlnimo 3 : 1 com programas de tcst&
c 2 virgens)
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900i134a2
900o3iltl3


900a34u2
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900u34aP4
100Hl08
l00al07
lOOnlOG
1001il09
mbquinas an tigas (at junho/8 2)
usam teclas s P juntas efetuar o
HARDCOPY
aps junho/82
aceitam shiftf * para efetuar o HARDCOPY
' possuem monitor Vcr.l.l (aceita DHEAK)
apenas oltera5o do cdigo da verso
anterior
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