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8 anos atrás
Thiago Lima
25 Comentários
Portas Lógicas
portas-logicas
ÍNDICE DE CONTEÚDO
Sistema Digital
Tabela Verdade
Portas Lógicas
Porta Lógica NOT
Porta Lógica AND
Porta Lógica OR
Porta Lógica NAND
Porta Lógica NOR
Porta Lógica XOR
Porta Lógica XNOR
Portas Lógicas: Teorema de De Morgan
Associações de portas lógicas: Exemplo
Baixe um arquivo com todas essas operações em uma mesma folha no
arquivo abaixo
Sistema Digital
Um sistema digital é um sistema matemático que deSne informações
como valores numéricos. Dessa forma, é possível deSnir operações
digitais como cálculos matemáticos. Comumente trabalhamos com
valores numéricos na base decimal, mas um sistema digital trabalha
de maneira diferente. Em analogia ao sistema decimal, onde cada
dígito possui 10 valores possíveis, um sistema digital é um sistema
binário, onde cada dígito possui apenas 2 valores possíveis. Esses
dois valores são deSnidos como “níveis lógicos” e adota-se o valor de
0 (zero) ou 1 (um) apenas.
O EMBARCADOS
Ligado ou desligado;
Nível alto ou nível baixo;
CONTEÚDOS
Alimentado ou em zero;
EM DESTAQUE
VCC ou Terra.
OPORTUNIDADES
As
operações observáveis para esses níveis lógicos são deSnidas
como operações lógicas. Todas as possíveis operações lógicas são
PERFIL em apenas 3 operações primárias, que são:
baseadas
LOG Inversão;
IN
Soma lógica;
Produto lógico.
Tabela Verdade
A Tabela Verdade trata-se de uma técnica para determinar como a
saída lógica de um determinado circuito depende dos níveis lógicos
presentes nas entradas de cada circuito. Ela está representada neste
das portas lógicas.
texto do lado direito das imagens, ao lado
Portas Lógicas
Porta Lógica AND
PORTAE(AND) C=A.B
AB C
A 0 0 0
1
1 0
1 1
1 module exemplo_AND ( A, B, C );
2 input wire A, B;
3 output wire C;
4
5 assign C = A & B;
6
7 endmodule
Porta Lógica OR
Porta Lógica OR
Porta OR em Verilog:
1 module exemplo_OR ( a, b, c );
2 input wire a, b;
3 output wire c;
4
5 assign c = a | b;
6
7 endmodule
1 module exemplo_NAND ( a, b, d );
2 input wire a, b;
3 output wire d;
4
5 assign d = a ~& b;
6
7 endmodule
1 module exemplo_NOR ( a, b, d );
2 input wire a, b;
3 output wire d;
4
5 assign d = a ~| b;
6
7 endmodule
Porta Lógica XOR
1 module exemplo_XOR ( a, b, c );
2 input wire a, b;
3 output wire c;
4
5 assign c = a ^ b;
6
7 endmodule
1 module exemplo_XNOR ( a, b, c );
2 input wire a, b;
3 output wire c;
4
5 assign c = a ~^ b;
6
7 endmodule
Formato PowerPoint
FAZER PARTE
Thiago Lima
270 posts
https://www.linkedin.com/in/tplima
Sou formado em Engenharia Elétrica na USP
Sao Carlos, com mestrado em Engenharia
Elétrica no Rochester Institute of Technology
pelo CsF. Tenho 17 anos de experiência em
projetos de circuitos eletrônicos. Escrevo
regularmente para o Embarcados, adoro
eventos sobre tecnologia, onde posso rever
amigos e conhecer pessoas do ramo.
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25 COMENTÁRIOS recentes
Thiago
13/12/2022 23:12
exercicio_eletronica3.png
0 Responder
Thiago
13/12/2022 23:10
exercicio_eletronica2.png
0 Responder
Ramildo Vicola
15/11/2022 11:10
0 Responder
Syri
02/09/2022 14:17
Estudante de TI.
Venho aqui agradecer por esse conteúdo.
0 Responder
jabunço
09/05/2022 14:51
legal.
0 Responder
Daniel SOUZA
07/03/2022 15:26
2 Responder
lmao
06/12/2021 17:54
é verde
0 Responder
Elisandro
23/03/2021 14:02
3 Responder
flavio
11/03/2021 22:16
1 Responder
josimar
30/06/2020 01:08
4 Responder
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