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Centro de Tecnologia
Departamento de Computação e Automação
Lista 1 - Unidade 1
Natal/RN
2023.1
1 A figura ilustrada na questão nos mostra um transis-
tor do tipo pMOS esse transistor funciona da seguinte
00 00 01 10 11 10 10 forma :
x = 0 → 1º transistor conduz
2 x = 1 → 1º transistor não conduz
y = 0 → 2º transistor conduz
00 01 11 10000000000} 10
| {z y = 1 → 2º transistor não conduz
indica que virá uma sequencia sem compressão
3
a) 1282 → 10000000 6
b) 1286 → 80
c) 1283 → 11202 a) F = ab + b̄c
d) 1285 → 1003
e) 12815 → 88
4
M CD
A 50ms 1ms
B 20ms 2ms
C 20ms 1ms
b) F = b(a + c) + d(c + e)
40 transações/s
1 /40 = 0.0025s = 25ms/transações
Para particionar as tarefas para serem realizadas pelo
micrprocessadorr ou e pelo circuito digital de forma
a minimizar o uso de circuito digitais personalizados,
deve-se realizar uma transação a um tempo menor ou
igual a 25ms, para isso podemos faze-lo da seguinte
forma:
5
O transistores do tipo CMOS são nMOS e pMOS:
7
M = 1 → movimento detectado
→ liga sirene
L = 0 → não é dia
liga sirene → B = 1
B = M · L‘
2
d) F (a, b, c) = c′
10
8 F = (ab′ + b) + (a′ c)
F = abd′ + acd
b) F( a, b, c) = ab + ac̄ + bc
a b c F
0 0 0 1
0 0 1 1
b) F (a, b, c) = a′ b 0 1 0 1
0 1 1 1
1 0 0 1
1 0 1 1
1 1 0 0
1 1 1 1
c) F( a, b, c) = ab + ac + abc + c̄
c) F (a, b, c) = abc + ab + a + b + c a b c F
0 0 0 1
0 0 1 0
0 1 0 1
0 1 1 0
1 0 0 1
1 0 1 1
1 1 0 1
1 1 1 1
d) F( a, b, c, d) = ābc + d¯
3
a b c d F A partir da tabela verdade conseguimos extrair as
0 0 0 0 1 seguintes equações:
0 0 0 1 0
0 0 1 0 1
0 0 1 1 0 L = S0′ S1′ S2′ + S0′ S1′ S2 + S0′ S1 S2′
0 1 0 0 1
Em seguida partindo das equações conseguimos obter
0 1 0 1 0
o seguinte circuito combinacional:
0 1 1 0 1
0 1 1 1 1
1 0 0 0 1
1 0 0 1 0
1 0 1 0 1
1 0 1 1 0
1 1 0 0 1
1 1 0 1 0
1 1 1 0 1
1 1 1 1 0
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F = a′ b′ c + abc′ + abc → a′ b′ c + ab
(c′
+c)
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′ ′
F = a b c + ab L
XN OR → A B
A B Y
0 0 1
0 1 0
1 0 1
1 1 1
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Descrevendo o comportamento é desejavel que o De-
tector de nível de gasolina que vai de 0 (000) ote
7(111) indique L=1 quando o nível de gasolina estiver
abaixo de 3(010). Portanto tomando esta informação
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como premissa temos que: Um decodificador tem como função é decodificar um
Tabela Verdade número binário de n bits de entrada resultando ape-
S0 S1 S2 L nas uma das 2n saídas em 1
0 0 0 1
0 0 1 1
0 1 0 1 • z0 = a′ b′ c′ • z4 = ab′ c′
0 1 1 0
• z1 = a′ b′ c • z5 = ab′ c
1 0 0 0
1 0 1 0 • z2 = a′ bc′ • z6 = abc′
1 1 0 0
1 1 1 0 • z3 = a′ bc • z7 = abc
4
17
18
C
D
S1
R1
Q
MUX 4x1 19
Um latch D sensivel ao nível e um flip-flop D sensível
à borda são ambos circuitos capazes de armazenar um
Para qualquer valor de S0 e S1 , apenas uma porta bit. Enquanto a entrada do clock for 1, a latch D irá
AND terá dois bits iguais a 1 de seleção, deixando guardar o valor da entrada após um certo período.
passar para a porta OR o valor da sua entrada de Usando 4 Mux’s encadeados irémos obter o seguinte
dados. circuito:
5
C
D
Q1
Qf f
20
clk
D1
Q1
D2
Q2
D3
Q3
Comparando com o flip flop D:
Q2
D3
D3
6
21
22
a3 ... a0 11 | 14 | 8 | 1 | 5 | 9 | 15 | 15 | 3 | 3 | 9 | 14 | 0 | 0 | 0 | 7 | 2 | 7
b3 ... b0 ? 14 5 15 9 0 2
c3 ... c0 ? ? 14 5 15 9 0
d3 ... d0 ? ? 14 5 15 9 0
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Entrada → B
Saída → s1 , s0
• s1 s0 = 00 → hora
• s1 s0 = 01 → alarme
• s1 s0 = 10 → cronometro 26
• s1 s0 = 11 → data 1. Maquina de estados
2. Arquitetura
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Entrada gent → g
Saída → xyz
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3. Lógica Combinacional 1. obtemos 000000000 invertendo os bits
n1 = s′1 s′0 a′ b′ + s′1 s0 ab′ + s′1 s0 ab + s1 s′0 a′ b′ + 2. somando-se 1 ao numero invertido temos
s1 s′0 a′ b + s1 s′0 ab 000000000 + 1 = 000000001
n0 = s′1 s′0 a′ b + s′1 s0 a′ b′ + s′1 s0 a′ b + s1 s′0 a′ b +
3. 000000001 = −1
s1 s′0 ab + s1 s′0 ab
y = s′1 s0 (a′ b′ + a′ b + ab′ + ab) + s1 s′0 (a′ b′ + c) 100000000 = −256
a′ b + ab′ + ab)
4. d) 110000000 = −128
27 e) 111111110 = −2
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Se aplicarmos operações AND para cada par de tran-
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sição de E0 vamos obter as seguintes equações:
a) 6 = 110 ⇒ 110 = 00000110
a·a′ b = (a·a′ )b = 0·b = 0 a′ b·b′ = a′ ·0 = 0 , Portanto 6|2 = 3, resto 0
a · b′ ̸= 0 logo demonstra-se que tanto o estado de a e 3|2 = 1, resto 1
b’ podem ser verdadeiras simultaneamente. 1|2 = 0, resto 1