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Introdução À Prática Laboratorial Com o Z80
Introdução À Prática Laboratorial Com o Z80
1. Ser suficientemente simples para que se torne possível efectuar neste capítulo
uma apresentação exaustiva, garantindo que mesmo utilizadores com
conhecimentos básicos consigam compreender em pormenor todos os aspectos
da respectiva implementação.
3. Devem existir quatro entradas digitais, cujo estado possa ser lido pelo
microprocessador através de uma operação de leitura de um porto de entrada.
4. Devem existir quatro saídas digitais, cujo estado possa ser controlado pelo
microprocessador através de uma operação de escrita num porto de saída.
Refira-se que a especificação deste modelo funcional permite desde logo que se
desenvolvam programas de aplicação, uma vez que estão já disponíveis todos os
elementos necessários para este fim. A título de exemplo, e se se pretender gerar
uma forma de onda em dente de serra na saída analógica, aproveitando a
† A memória tanto pode ser seleccionada com WR=0 e RD=1 (ciclo de escrita) como com
WR=1 e RD=0 (ciclo de leitura).
.end
5.2 IMPLEMENTAÇÃO
barramento de dados
Z80
saída
Memória Conversor
barramentos analógica
D/A
de endereços e
de controlo
selecção de selecção de
acesso acesso
entradas digitais
Descodificação
saídas digitais
e entrada / saída paralela
/MEM_CS = /MREQ*IORQ*/A15
DA_CS = MREQ*/IORQ*/A7*A6*/WR*RD
D0.TRST = MREQ*/IORQ*A7*A6*WR*/RD
D1.TRST = MREQ*/IORQ*A7*A6*WR*/RD
D2.TRST = MREQ*/IORQ*A7*A6*WR*/RD
D3.TRST = MREQ*/IORQ*A7*A6*WR*/RD
D0 = KEY0
D1 = KEY1
D2 = KEY2
D3 = KEY3
(os sinais estarão negados nas entradas ou nas saídas, quando forem activos
em zero)
mux
0 OUTi
Di D
1
elemento de memória
condição de selecção de Di: (flip-flop) do tipo D
MREQ*/IORQ*A7*/A6*/WR*RD relógio do
sistema
condição de selecção:
MREQ*/IORQ*A7*A6*WR*/RD
KEYi Di
U1
27 30 A0 U2 U3
M1 A0
31 A1 A0 10 11 D0 CLK 1 23 D3
A1 A0 Q0 I1/CLK O1
/MREQ 19 32 A2 A1 9 12 D1 /MREQ 2 22 D2 VCC
MREQ A2 A1 Q1 I2 O2
/IOREQ 20 33 A3 A2 8 13 D2 /IOREQ 3 21 D1
IORQ A3 A2 Q2 I3 O3
/WR 22 34 A4 A3 7 15 D3 A15 4 20 D0
WR A4 A3 Q3 I4 O4
/RD 21 35 A5 A4 6 16 D4 A7 5 19 OUT3 1
RD A5 A4 Q4 I5 O5
VCC 36 A6 A5 5 17 D5 A6 6 18 OUT2 C3
A6 A5 Q5 I6 O6
28 37 A7 A6 4 18 D6 KEY0 7 17 OUT1 2 100n
REFSH A7 A6 Q6 I7 O7
R1 2K2 38 A8 A7 3 19 D7 KEY1 8 16 OUT0
A8 A7 Q7 I8 O8
1 2 18 39 A9 A8 25 KEY2 9 15 DA_CS
HALT A9 A8 I9 O9
R2 2K2 40 A10 A9 24 KEY3 10 14 /M_CS
A10 A9 I10 O10
1 2 24 1 A11 A10 21 /WR 11
WAIT A11 A10 I11
R3 2K2 2 A12 A11 23 VCC /RD 13
A12 A11 I12
1 2 /INT 16 3 A13 A12 2
INT A13 A12
1 2 /NMI 17 4 A14 A13 26 22V10 JP1
NMI A14 A13
R4 2K2 5 A15 A14 1 1 GND OUT0
A15 A14 1 2
/RESET 26 C2 VCC OUT1
RESET 3 4
R5 2K2 14 D0 /M_CS 20 2 100n Q0 OUT2
D0 CE 5 6
1 2 25 15 D1 /WR 27 Q1 OUT3
BUSRQ D1 WE 7 8
23 12 D2 /RD 22 Q2 KEY0
BUSAK D2 OE 9 10
8 D3 Q3 KEY1
D3 11 12
VCC CLK 6 7 D4 DS1230Y Q4 KEY2
CLK D4 13 14
9 D5 VCC Q5 KEY3
D5 15 16
10 D6 R10 Q6 /NMI
D6 17 18
1 13 D7 1 2 Q7 /INT
D7 19 20
C1 1
2K49
2 100n Z80 C5 CONECTOR
2 100n VEE
Y1
1 2
1 U6
3 4
4MHz U5
U7A U7B
U4A U4F D0 3 2 Q0 12 4 2 J1
D0 Q0 B8 V IOUT SAIDA
D1 4 5 Q1 11 + 1 5
D1 Q1 B7
1 2 13 12 CLK D2 7 6 Q2 10 3 7 1
D2 Q2 B6
D3 8 9 Q3 9 2 6
D3 Q3 B5 IOUT TL082
1 D4 13 12 Q4 8
D4 Q4 B4
C8 74HCT14 74HCT14 D5 14 15 Q5 7 8 TL082 2
D5 Q5 B3
2 100p R13 R14 D6 17 16 Q6 6
D6 Q6 B2
1 2 1 2 D7 18 19 Q7 5 16 R8
D7 Q7 B1 COMP
VDD 1 2
1K 1K 1 14 1
OC VR+
DA_CS 11 C7 1 10K
G V
VCC VCC 15 1 2 100n R9
VR- - VLC
74LS373 10K
1 1 DAC0800 VCC
1 2 R11 R12 3 VEE 2
R16 D1 2K49 4K99
10K 1N4148 1 1
U4C U4E 2 2 C6 VCC D4
S1 2 1 VEE 2 100n LED_2
1 2 5 6 11 10 /RESET
VCC
RESET
1 2
R15 1 74HCT14 74HCT14 1 VCC
1K C9 R28
2 4u7 390R
2 VCC VCC 1
2 D5
VCC VCC VCC VCC R25 1 LED_3
1 1 OUT2 1 2 Q1
D2 D3 BC547
VCC U4B VCC U4D 1 1 1 1 LED_0 LED_1 10K 3 2
R17 R18 R19 R20 R21 R22 1
1 2 3 4 1 2 9 8 2K2 2K2 2K2 2K2 R27
2 2 390R
2K2 2K2 2 2 2 2
74HCT14 74HCT14 KEY0 KEY1 KEY2 KEY3 1 1 2
VCC R23 R24 R26 1
390R 390R OUT3 1 2 Q2
2 2 2 2
JP2 BC547
+5V VCC 1 S2 S3 S4 S5 2 2 10K 3
1 VCC
+12V C4 KEY0 KEY1 KEY2 KEY3 OUT0 OUT1
2 VDD
-12V 2 100n
3 VEE
GND
4
1 1 1 1 SITEMA Z80 - SD2
ALIMENTACAO
Size Document Number REV
A JMF / HCM 1.0
Date: December 12, 1995 Sheet 1 of 1
0001 0000
0002 0000 inicio .org 0h
0003 0000
0004 0000 saida .equ 40h
0005 0000
0006 0000 3E 00 inicio ld a,$00
0007 0002 D3 40 ciclo out (saida),a
0008 0004 3C inc a
0009 0005 C3 02 00 jp ciclo
0010 0008
0011 0008 .end
0012 0008
ADDR 00 01 02 03 04 05 06 07 08 09 0A 0B 0C 0D 0E 0F
-----------------------------------------------------
0000 3E 00 D3 40 3C C3 02 00 00 00 00 00 00 00 00 00
Figura 5.8: Forma de onda em dente de serra gerada pelo código apresentado acima.
Sendo a frequência da forma de onda gerada de 625 Hz, verifique que o conjunto
de instruções que lhe dá origem, executado à frequência de relógio de 4 MHz,
conduz efectivamente aquele valor de frequência para a onda em dente de serra.
1. http://www.yahoo.com/text/Computers_and_Internet/Hardware/Microprocessors,
que contem uma grande quantidade de apontadores para outros locais do
WWW relacionados com os microprocessadores e microcontroladores. A este
respeito consulte-se também http://www.cera2.com/micro.htm.