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Circuitos Sequenciais
Índice Geral
OBJECTIVOS............................................................................................................................1
INTRODUÇÃO...........................................................................................................................2
LISTA DE MATERIAL...............................................................................................................2
Circuito Integrado Portas Lógicas NAND - 7400...................................................................3
Esquema de Ligações 7400.................................................................................................3
Logigrama 7400.....................................................................................................................3
Tabela de Verdade do Circuito Integrado 7400................................................................3
Implementação de um Flip-Flop S-R Latch Reset Prioritário..............................................4
Logigrama do FF S-R Latch Reset Prioritário....................................................................4
Logigrama do FF S-R Latch Reset Prioritário com NANDS............................................4
Tabela de Verdade................................................................................................................5
Esquema do Circuito com as ligações realizadas na breadboard..................................5
Implementação de um Flip-Flop D Latch usando NANDS..................................................6
Logigrama FF D Latch..........................................................................................................6
Logigrama do FF D Latch com NANDS.............................................................................7
Tabela de Verdade................................................................................................................7
Esquema do Circuito com as ligações realizadas na breadboard..................................8
CONCLUSÃO............................................................................................................................9
OBJECTIVOS
INTRODUÇÃO
Os circuitos que temos analisado em trabalhos práticos anteriores eram circuitos cujas
saídas dependiam das entradas de uma forma linear e momentânea. Todas as variações
nas entradas provocavam instantaneamente variações nas saídas, não podendo as saídas
ficarem invariáveis às alterações das entradas. Uma saída para se tornar independente
das entradas, tem de ser definida de forma a manter o seu valor, mesmo quando as
variáveis de entrada se alterem. Deste tipo de circuitos, podemos concluir que poderão
memorizar o seu valor até ordens em contrário.
LISTA DE MATERIAL
1 Alicate de Corte.
1 Breadboard.
Fios de cobre.
1 Caixa de Testes.
Logigrama 7400
A B X =A . B
0 0 1
0 1 1
1 0 1
1 1 0
Tabela de Verdade
S R Q Q Observações
0 1 0 1 Reset (Q=0)
1 0 1 0 Set (Q=1)
1 1 0 1 Reset Prioritário
¿
0 0 Q Q Memoriza o estado
Após uma análise ao logigrama que nos foi entregue, verificámos que se tratava de um
Flip-Flop S-R Latch Reset Prioritário.
Ao colocar o Set a “0” e o Reset a “1” vamos ter na saída Q o valor “0” e na saída Q o
valor “1” que corresponde que o Reset guardou “1”. Ao colocar-se o Set a “1” e o Reset
a “0” vamos ter na saída Q o valor “1” e na saída Q o valor “0” que corresponde que o
Set guardou “1”. Ao colocarmos o S a “1” e o R a “1” podemos verificar que se trata de
um Flip-Flop S-R Latch com Reset Prioritário ao vermos a saída Q a “0” e a saída Q a
“1”. Quando temos o S e o R a “0” ele memoriza o estado anterior, se a saída Q estiver
igual a “0” e a saída Q igual a “1” e se colocarmos o S e o R a “0” ele memoriza o
estado que estava anteriormente mantendo o Q a “0” e o Q a “1”. Se por acaso o S
estivesse a “1” e o R a “0” na saída iriamos ter Q igual a “1” e Q igual a “0” e se colocar
o S igual a “0” e o R igual a “0” iremos ter na saída o Q igual a “1” e o Q igual a “0”,
verificamos que ele memorizou o estado anterior que era “1”.
Logigrama FF D Latch
Tabela de Verdade
E D S R Q Q Observações
¿
0 - 0 0 Q* Q Memoriza o estado
1 0 0 1 0 1 R=E. D
1 1 1 0 1 0 S=E.D
- - 1 1 - -
Após uma análise ao logigrama que nos foi entregue, começámos por desenhar um Flip-
Flop D Latch recorrendo somente a NANDS.
Ao colocar o E (Enable) a “1” e o D (Data) a “0” iremos ter na saída Q o valor “0” e na
saída Q o valor “1”
Ao colocar o E (Enable) a “1” e o D (Data) a “1” iremos ter na saída Q o valor “1” e na
saída Q o valor “0”
Ao colocar o E a “1” e o D a “0” iremos ter na saída Q igual a “0” e Q igual a “1” em
que ao colocar o E a “1” fez colocar o em Q o estado que está em D.
Ao colocar o E a “1” e o D a “1” vamos ter na saída Q o valor “1” e em Q o valor “0”.
Ao colocar o E a “0” e o D a “1” ele irá ignorar o actual estado do D, pois memorizou o
estado anterior em que vai colocar na saída Q o valor “1” e na saída Q o valor “0”. Só
quando colocar novamente o E a “1” é que ele irá colocar na saída Q o valor que estiver
na entrada D.
CONCLUSÃO
Após montagem do circuito verificámos que um dos circuitos integrados não estava a
funcionar, após a uma verificação de todas as ligações do circuito verificámos que a
alimentação não estava a chegar a um dos circuitos integrados, tal se deveu ao pino 14
estar torto e não fazer contacto com os pinos da breadboard.