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1) Quais os estados que não podem ocorrer nas entradas dos latches e flip-flops “RS”?
Esses estados são diferentes quando usamos lógica positiva ou lógica negativa?
R: Quando a entrada SET é rapidamente pulsada em nível BAIXO, ao passo
que a entrada RESET permanece em nível ALTO, a entrada proibida é 0 0.
Quando o SET e CLEAR (RESET) são ativadas em nível ALTO, a entrada
proibida é 1 1.
2) Qual a diferença entre os latches e flip-flops tipo “RS” em relação ao tipo “D”?
R: Quando o atraso de programação for igual, bem como a ocorrência de
transição for de R = S = 1 para R = S = 0, não é possível que o latch RS
síncrono impeça o ponto de oscilação.
Iniciando um inversor relacionando as entradas R e S, uma complementará a
outra, fazendo com que o circuito funcione na região normal de operação. Tal
circuito é conhecido como latch D.