Eletrônica Digital I - TE050 24/07/2003

Universidade Federal do Paraná

Setor de Tecnologia
Departamento de Engenharia Elétrica

Eletrônica Digital I – TE050

Circuitos Combinacionais

Prof. Lúcio Mauro M. Tonon

Circuitos Combinacionais

• Circuitos Combinacionais são circuitos digitais que, em um

dado instante de tempo, o estado de todas as saídas depende
apenas dos valores das entradas no mesmo instante de tempo.
Isto é, não depende de seus valores passados. Este tipo de
circuito lógico pode ser visto como uma caixa preta com N
entradas e P saídas, conforme a figura abaixo:

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Decodificadores
• Um decodificador de duas entradas e quatro saídas e sua
tabela verdade são mostrados na figura abaixo. A característica
importante do decodificador é que, para cada entrada A1A0,
somente uma saída tem nível lógico 1. Isto significa que em
qualquer instante uma das saídas é diferenciada das outras.
Um decodificador de n entradas necessitaria 2n portas e teria 2n
saídas.

A1 A0 O0 O1 O2 O3

0 0 1
0 1 1
1 0 1
1 1 1

Decodificador 3x8

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74XXX138 – 1 of 8 Decoder

Codificadores
• Um codificador é um circuito que efetua a operação inversa de
um decodificador, ou seja, representa nas suas saídas o código
binário do número da entrada que está ativa.
• Um codificador com 2N entradas tem N variáveis de saída.

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Codificadores de prioridade
• Um codificador de prioridade é um circuito que representa nas
saídas o código binário do número da entrada ativa com maior
prioridade.
• Um codificador de prioridade com 2N entradas tem N variáveis
de saída.
• Os codificadores de prioridade podem ter uma entrada adicional
de “enable” (EN) que permite controlar (ativar/desativar) a
função de codificação.
• Os codificadores de prioridade têm, normalmente, uma saída
adicional que permite detectar a situação em que nenhuma das
entradas está ativa.

Codificadores de prioridade 4 para 2

• O codificador de prioridade de 4 para 2 da figura, designado por
COD 4:2, tem 4 entradas (Y3, Y2, Y1, Y0), sendo a mais
prioritária a entrada Y3 e a menos prioritária a entrada Y0. Para
além das saídas B e A, existe uma saída adicional EO que
indica se pelo menos uma das entradas está ativa.

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Mapas de Karnaugh para as saídas B, A e EO

Conversores de Códigos
• Freqüentemente, a informação disponível em forma codificada
deve ser traduzida para um código diferente. Um circuito lógico
que realiza esta tradução é chamado Conversor de Código. Um
conversor de código pode ser construído ligando um
decodificador e um codificador em cascata, conforme a figura
abaixo:

Z0
A0 B0
Z1
A1 Decodificador Codificador B1
.
. .
.
An Bk
Zm

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Decodificador de 7 segmentos
• Um exemplo interessante de conversor de código aparece em
conexão com o dispositivo digital de display, chamado de
Display de sete segmentos.
• Cada algarismo (ou dígito) é composto de sete barras de
material semicondutor emissor de luz – LED (ou de cristal
líquido de absorção de luz), como pode ser visto na figura
abaixo:

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Decodificador de 7 segmentos
• Essas barras são energizadas de forma seletiva no sentido de
fornecer visualmente o dígito desejado. Para mostrar o número
2, por exemplo, os segmentos a, b, g, e e d são energizados.
Como exercício, crie a tabela-verdade para a lógica que recebe
um dígito BCD (dígitos BCD de entrada: w, x, y e z) como
entrada e forneça as saídas de sete segmentos (cada dígito é
formado pelas saídas 1 ou 0 de cada segmento: a, b, c, d, e, f e
g) correspondentes aos dígitos do display, obedecendo a caixa
preta abaixo:

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Tabela Verdade para o número 2

Decimal BCD a b c d e f g
wxyz
0 0000 1
1 0001 0
2 0010 1 1 0 1 1 0 1
3 0011 1
4 0100 0
5 0101 1
6 0110 1
7 0111 1
8 1000 1
9 1001 1

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Exercício
• Projete um circuito lógico combinacional, fazendo uso do Mapa
de Karnaugh para minimizar as funções lógicas encontradas e
desenhe o seu diagrama eletrônico com todas as portas
necessárias para o segmento “a”

A
1 1
1 1
D
1 1
C
1 1
B

Segmento “a”: /AC+/B/C/D+/A/B/D+/ABD+A/B/C

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Multiplexador / Demultiplexador
• Um multiplexador ou seletor de dados é um circuito que permite
selecionar uma dentre várias entradas como fonte de
informação para uma única saída.
• A seleção de uma das entradas de dados é controlada por um
conjunto de entradas adicionais (entradas de seleção). Uma
das 2N entradas de dados é selecionada à custa de N entradas
de seleção (MUX 2N:1).
• Os multiplexadores podem ter uma entrada adicional de
“enable” (EN) que permite controlar (ativar/desativar) a função
de multiplexagem.

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Multiplexador 4x1 com entrada adicional de

enable

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74XXX151 – Dual 8-Line to 1-Line Data

Selector/Multiplexer

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Demultiplexador
• Um demultiplexador é um circuito que permite encaminhar
seletivamente a informação aplicada numa única entrada para
uma de várias saídas.
• Um demultiplexador de 1 para 2N tem uma entrada, 2N saídas
e N entradas de seleção.
• Realiza a função inversa de um multiplexador.

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74XXX155 – Dual 1 of 4 Decoder/Demultiplexer

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Circuitos comparadores
• Um circuito comparador permite determinar se dois números
binários são iguais, e não o sendo, qual deles é o maior.

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74XXX85 – 4 Bit Magnitude Comparator

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Circuitos Aritméticos
• Um circuito somador é um circuito que produz a soma de dois
números que lhe são fornecidos num determinado código
binário. São vários os tipos de circuitos somadores em função
do número de bits e do tipo de código binário utilizado nas
parcelas e na respectiva soma. Considera-se, a título
exemplificativo, apenas os circuitos somadores de números
expressos em código binário natural.

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Meio Somador (“half-adder”)

• Um circuito meio adicionador realiza a soma de dois números
de um bit (Ai, Bi), produzindo, tal como acontece na soma com
números decimais, um eventual transporte a ser considerado na
posição seguinte (Ci+1).

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Somador completo (“full-adder”)

• Um circuito adicionador completo realiza a soma de dois
números de um bit (Ai, Bi), considerando um transporte (Ci) de
posições anteriores e produzindo um transporte a ser
considerado na posição seguinte (Ci+1).

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Somador de números de n bits

• Com base nos adicionadores completos, é possível construir
um circuito adicionador de N bits, colocando-os em cascata
(“ripple adder”), tal como se representa na figura.

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Somadores com transporte antecipado

(Fast Carry)
• Conforme foi referido anteriormente, nos adicionadores em cascata, o
tempo de propagação é proporcional ao número de bits do
adicionador. Para eliminar esta desvantagem, são construídos circuitos
adicionadores com transporte antecipado.
• Estrutura interna de um somador de 2 bits com transporte antecipado.

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74XXX283 – 4 Bit Full Adder With Fast Carry

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Exercício
• Projetar um circuito somador / subtrator de 2 bits, comandado
por um sinal de controle que determina a função:

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